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JPH06281959A - アクティブマトリックス液晶表示装置 - Google Patents

アクティブマトリックス液晶表示装置

Info

Publication number
JPH06281959A
JPH06281959A JP9540493A JP9540493A JPH06281959A JP H06281959 A JPH06281959 A JP H06281959A JP 9540493 A JP9540493 A JP 9540493A JP 9540493 A JP9540493 A JP 9540493A JP H06281959 A JPH06281959 A JP H06281959A
Authority
JP
Japan
Prior art keywords
liquid crystal
pixel electrode
drain line
slit
common electrode
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP9540493A
Other languages
English (en)
Inventor
Minoru Kanbara
実 神原
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Casio Computer Co Ltd
Original Assignee
Casio Computer Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Casio Computer Co Ltd filed Critical Casio Computer Co Ltd
Priority to JP9540493A priority Critical patent/JPH06281959A/ja
Publication of JPH06281959A publication Critical patent/JPH06281959A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】 【目的】 アクティブマトリックス液晶表示装置の画質
の向上を図る。 【構成】 特に図1(A)においてハッチング(斜線)
で示すように、画素電極6の近傍におけるドレインライ
ン4及びその幅方向両側の所定の範囲と対向する部分の
共通電極12にスリット13が設けられている。従っ
て、ドレインライン4に信号パルスが加えられてもスリ
ット13の部分におけるドレインライン4近傍の液晶2
1の不要な応答を防止することができる。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】この発明はアクティブマトリック
ス液晶表示装置に関する。
【0002】
【従来の技術】図2(A)、(B)は従来のアクティブ
マトリックス液晶表示装置の一例の概略構成を示したも
のである。このアクティブマトリックス液晶表示装置
は、特に図2(B)に示すように、表示駆動パネル1上
に共通電極パネル10が対向配置され、その間に液晶2
1が充填された構造となっている。表示駆動パネル1
は、特に図2(A)に示すように、ガラス等からなる透
明基板2上に多数のゲートライン(走査電極)3と多数
のドレインライン(信号電極)4とがマトリックス状に
配線され、両ライン3、4からなる交差部分の近傍に薄
膜トランジスタ(スイッチング素子)5が設けられ、両
ライン3、4によって囲まれた部分にITO等からなる
方形状の画素電極6が設けられ、各画素電極6がそれぞ
れ対応する薄膜トランジスタ5を介して両ライン3、4
に接続された構造となっている。共通電極パネル10
は、特に図2(B)に示すように、ガラス等からなる透
明基板11の下面ほぼ全体にITO等からなる共通電極
12が設けられた構造となっている。そして、各画素電
極6、各画素電極6と対向する共通電極12及びその間
の液晶21によって、各画素の静電容量部が構成されて
いる。
【0003】このアクティブマトリックス液晶表示装置
では、ゲートライン3を順次走査して1つのゲートライ
ン3上の全ての薄膜トランジスタ5を一斉にオン状態と
し、この走査に同期させてドレインライン4から信号パ
ルスを印加すると、オン状態の薄膜トランジスタ5に接
続されている画素電極6に対応する部分の液晶21に表
示データが電荷の形で書き込まれる。そして、薄膜トラ
ンジスタ5がオフとなると書き込まれた電荷が放電さ
れ、この放電が終るまで対応する部分の液晶21が応答
し続け、液晶21による表示が行われることになる。
【0004】
【発明が解決しようとする課題】しかしながら、従来の
このようなアクティブマトリックス液晶表示装置では、
画素電極6と共通電極12とが対向している他に、特に
ドレインライン4と共通電極12も対向しているので、
ドレインライン4と共通電極12とその間の液晶21と
によっても静電容量部が形成されることになる。この結
果、ドレインライン4に加わる信号パルスによって、ド
レインライン4近傍の液晶21が応答し、画質の低下を
引き起こし易いという問題があった。この発明の目的
は、画質の向上を図ったアクティブマトリックス液晶表
示装置を提供することにある。
【0005】
【課題を解決するための手段】この発明は、マトリック
ス状に配線されたドレインライン及びゲートラインと、
スイッチング素子と、このスイッチング素子を介して前
記ドレインライン及び前記ゲートラインと接続された画
素電極とを備えた表示駆動パネルに対向して、共通電極
を備えた共通電極パネルが配置され、前記表示駆動パネ
ルと前記共通電極パネルとの間に液晶が充填されてなる
アクティブマトリックス液晶表示装置において、少なく
とも前記画素電極の近傍における前記ドレインラインと
対向する前記共通電極にスリットが設けられてなること
を特徴とするものである。
【0006】
【作用】この発明によれば、少なくとも画素電極の近傍
におけるドレインラインと対向する共通電極にスリット
を設けることによって、ドレインラインに信号パルスが
加えられてもスリットの部分におけるドレインライン近
傍の液晶の不要な応答を防止し、表示すべき画素電極上
の液晶以外の液晶の応答を低減することにより画質の向
上を図ることができる。
【0007】
【実施例】以下、この発明の一実施例におけるアクティ
ブマトリックス液晶表示装置について、図面を参照しつ
つ説明する。図1(A)、(B)は本実施例におけるア
クティブマトリックス液晶表示装置の概略構成を示すも
のである。なお、これらの図において上述した図1
(A)、(B)と同一名称部分は同一の符号を付し、そ
の説明を適宜省略する。このアクティブマトリックス液
晶表示装置では、例えば図1(A)においてハッチング
(斜線)で示すように、画素電極6の近傍におけるドレ
インライン4及びその幅方向両側の所定の範囲と対向す
る部分の共通電極12にスリット13が設けられてい
る。即ち、一の画素電極6とその右側に位置する画素電
極6との間であって、その下側のゲートライン3の上縁
から一の画素電極6と接続された薄膜トランジスタ5
(のドレイン電極)と接続された部位のドレインライン
4のやや下側までの領域と対向する共通電極12にスリ
ット13が設けられている。
【0008】従って、このアクティブマトリックス液晶
表示装置では、スリット13が設けられている部分にお
いてドレインライン4と共通電極12とが対向せず、こ
のためスリット13の部分において不要な静電容量部が
形成されないことになる。この結果、ドレインライン4
に信号パルスが加えられてもスリット13の部分におけ
るドレインライン4近傍の液晶21の不要な応答を防止
することができる。即ち、表示すべき画素電極6上の液
晶21以外の液晶の反応を低減することにより画質の向
上を図ることができる。
【0009】なお、上記実施例においては、スリット1
3を画素電極6の近傍におけるドレインライン4及びそ
の幅方向両側の所定の範囲と対向する部分に設けている
が、ドレインライン4の長さ方向ほぼ全体及びその幅方
向の所定の範囲と対向する部分に設けてもよく、またド
レインライン4のみと対向する部分に設けてもよい。
【0010】
【発明の効果】以上説明したように、この発明によれば
少なくとも、画素電極の近傍におけるドレインラインと
対向する共通電極にスリットを設けることによって、ド
レインラインに信号パルスが加えられてもスリットの部
分におけるドレインライン近傍の液晶の不要な応答を防
止し、表示すべき画素電極上の液晶以外の液晶の応答を
低減することにより画質の向上を図ることができる。
【図面の簡単な説明】
【図1】(A)はこの発明の一実施例におけるのアクテ
ィブマトリックス液晶表示装置の一部の平面図、(B)
はそのB−B線に沿う断面図。
【図2】(A)は従来のアクティブマトリックス液晶表
示装置の一例の一部の平面図、(B)はそのB−B線に
沿う断面図。
【符号の説明】
1 表示駆動パネル 3 ゲートライン 4 ドレインライン 5 薄膜トランジスタ(スイッチング素子) 6 画素電極 10 共通電極パネル 12 共通電極 13 スリット 21 液晶

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 マトリックス状に配線されたドレインラ
    イン及びゲートラインと、スイッチング素子と、このス
    イッチング素子を介して前記ドレインライン及び前記ゲ
    ートラインと接続された画素電極とを備えた表示駆動パ
    ネルに対向して、共通電極を備えた共通電極パネルが配
    置され、前記表示駆動パネルと前記共通電極パネルとの
    間に液晶が充填されてなるアクティブマトリックス液晶
    表示装置において、 少なくとも前記画素電極の近傍における前記ドレインラ
    インと対向する前記共通電極にスリットが設けられてな
    ることを特徴とするアクティブマトリックス液晶表示装
    置。
JP9540493A 1993-03-29 1993-03-29 アクティブマトリックス液晶表示装置 Pending JPH06281959A (ja)

Priority Applications (1)

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JP9540493A JPH06281959A (ja) 1993-03-29 1993-03-29 アクティブマトリックス液晶表示装置

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