JPH05313598A - 交流駆動型プラズマディスプレイパネル駆動方法 - Google Patents
交流駆動型プラズマディスプレイパネル駆動方法Info
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- JPH05313598A JPH05313598A JP11738792A JP11738792A JPH05313598A JP H05313598 A JPH05313598 A JP H05313598A JP 11738792 A JP11738792 A JP 11738792A JP 11738792 A JP11738792 A JP 11738792A JP H05313598 A JPH05313598 A JP H05313598A
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- period
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- Control Of Gas Discharge Display Tubes (AREA)
Abstract
(57)【要約】
【目的】表示品質を向上させる。
【構成】１フレームを第１〜第８サブフィールドで構成
し、第１サブフィールドを、全面書込み期間と、全面消
去期間と、アドレス期間と、維持放電期間とで構成し、
第２〜第７サブフィールドの各々を、全面消去期間と、
アドレス期間と、維持放電期間とで構成する。
し、第１サブフィールドを、全面書込み期間と、全面消
去期間と、アドレス期間と、維持放電期間とで構成し、
第２〜第７サブフィールドの各々を、全面消去期間と、
アドレス期間と、維持放電期間とで構成する。
Description
【０００１】
【産業上の利用分野】本発明は、交流駆動型プラズマデ
ィスプレイパネル駆動方法に関する。
ィスプレイパネル駆動方法に関する。
【０００２】
【従来の技術】図３は、交流駆動型プラズマディスプレ
イ装置の全体構成を示す。
イ装置の全体構成を示す。
【０００３】交流駆動型プラズマディスプレイパネル１
０は、その一方の面に、互いに平行な走査電極Ｙ１〜Ｙ
ｎ及び共通電極Ｘが設けられ、対向面にこれら電極と直
角な方向にアドレス電極Ａ１〜Ａｎが設けられている。
共通電極Ｘは、各走査電極Ｙ１〜Ｙｎに対応してこれに
接近して設けられ、一端が互いに共通に接続されてい
る。
０は、その一方の面に、互いに平行な走査電極Ｙ１〜Ｙ
ｎ及び共通電極Ｘが設けられ、対向面にこれら電極と直
角な方向にアドレス電極Ａ１〜Ａｎが設けられている。
共通電極Ｘは、各走査電極Ｙ１〜Ｙｎに対応してこれに
接近して設けられ、一端が互いに共通に接続されてい
る。
【０００４】図４は、１画素である、第ｉ行第ｊ列のセ
ルＣｉｊの断面構成を示す。共通電極Ｘ及び走査電極Ｙ
ｉはガラス基板１１上に形成され、その上に、放電空間
１７に対し絶縁するための誘電体層１２が被着され、さ
らにその上にＭｇＯ保護膜１３が被着されている。一
方、アドレス電極Ａｉは、ガラス基板１１と対向配置さ
れたガラス基板１４上に形成され、その上に蛍光体１５
が被着されている。また、ガラス基板１４及びアドレス
電極Ａｉ上には、画素境界に、セル間混色防止用及び放
電ギャップ維持用のセパレータ１６が形成されている。
ＭｇＯ保護膜１３と蛍光体１５との間の放電空間１７に
は、Ｎｅ＋Ｘｅペニングガスが封入されている。
ルＣｉｊの断面構成を示す。共通電極Ｘ及び走査電極Ｙ
ｉはガラス基板１１上に形成され、その上に、放電空間
１７に対し絶縁するための誘電体層１２が被着され、さ
らにその上にＭｇＯ保護膜１３が被着されている。一
方、アドレス電極Ａｉは、ガラス基板１１と対向配置さ
れたガラス基板１４上に形成され、その上に蛍光体１５
が被着されている。また、ガラス基板１４及びアドレス
電極Ａｉ上には、画素境界に、セル間混色防止用及び放
電ギャップ維持用のセパレータ１６が形成されている。
ＭｇＯ保護膜１３と蛍光体１５との間の放電空間１７に
は、Ｎｅ＋Ｘｅペニングガスが封入されている。
【０００５】図３において、共通電極ＸはＸドライバ２
０の出力端に接続され、走査電極Ｙ１〜ＹｎはＹドライ
バ３０の出力端に接続され、アドレス電極Ａ１〜Ａｍは
アドレスドライバ４０の出力端に接続されている。これ
らＸドライバ２０、Ｙドライバ３０及びアドレスドライ
バ４０は制御回路５０からの制御信号により制御され、
制御回路５０は、外部からの表示データＤ、表示データ
Ｄの読込みタイミングを示すクロックＣＬＫ、水平同期
信号ＨＳ及び垂直同期信号ＶＳに基づいてこの制御信号
を生成する。
０の出力端に接続され、走査電極Ｙ１〜ＹｎはＹドライ
バ３０の出力端に接続され、アドレス電極Ａ１〜Ａｍは
アドレスドライバ４０の出力端に接続されている。これ
らＸドライバ２０、Ｙドライバ３０及びアドレスドライ
バ４０は制御回路５０からの制御信号により制御され、
制御回路５０は、外部からの表示データＤ、表示データ
Ｄの読込みタイミングを示すクロックＣＬＫ、水平同期
信号ＨＳ及び垂直同期信号ＶＳに基づいてこの制御信号
を生成する。
【０００６】図５は、交流駆動型プラズマディスプレイ
パネルの駆動方法の一例を示す電圧波形図であり、１サ
ブフィールド分を示している。この１サブフィールド
は、全面書込み期間と、全面消去期間と、アドレス期間
と、維持放電期間とに区分される。
パネルの駆動方法の一例を示す電圧波形図であり、１サ
ブフィールド分を示している。この１サブフィールド
は、全面書込み期間と、全面消去期間と、アドレス期間
と、維持放電期間とに区分される。
【０００７】２N 階調表示を行う場合、１フレームをＮ
個のサブフィールドで構成し、各サブフィールドを前記
４つの期間で構成し、第１〜Ｎサブフィールドでの維持
放電期間の比を２0 ：２1 ：・・・：２N-2：２N-1とす
る（特願平２−３３１５８９号）。図６は、Ｎ＝８の場
合の１フレームの各サブフィールドの構成を示す。
個のサブフィールドで構成し、各サブフィールドを前記
４つの期間で構成し、第１〜Ｎサブフィールドでの維持
放電期間の比を２0 ：２1 ：・・・：２N-2：２N-1とす
る（特願平２−３３１５８９号）。図６は、Ｎ＝８の場
合の１フレームの各サブフィールドの構成を示す。
【０００８】
【発明が解決しようとする課題】しかし、１フレーム内
の各サブフィールドで全面書込み及び全面消去を行うの
で、全面消去状態の表示を行う場合でも各サブフィール
ドにおいて本駆動波形では４回放電発光し、例えばＮ＝
８の場合には１フレームで３２回も放電発光する為、全
面消去、すなわち全面黒の表示のときでも、灰色にな
り、高品位表示を阻害する原因となっていた。
の各サブフィールドで全面書込み及び全面消去を行うの
で、全面消去状態の表示を行う場合でも各サブフィール
ドにおいて本駆動波形では４回放電発光し、例えばＮ＝
８の場合には１フレームで３２回も放電発光する為、全
面消去、すなわち全面黒の表示のときでも、灰色にな
り、高品位表示を阻害する原因となっていた。
【０００９】本発明の目的は、このような問題点に鑑
み、表示品質を向上させることができる交流駆動型プラ
ズマディスプレイパネル駆動方法を提供することにあ
る。
み、表示品質を向上させることができる交流駆動型プラ
ズマディスプレイパネル駆動方法を提供することにあ
る。
【００１０】
【課題を解決するための手段及びその作用】本発明に係
る交流駆動型プラズマディスプレイパネル駆動方法を、
図面を参照して説明する。
る交流駆動型プラズマディスプレイパネル駆動方法を、
図面を参照して説明する。
【００１１】本発明は、例えば図３に示すようなプラズ
マディスプレイパネル１０を駆動する方法であり、この
プラズマディスプレイパネル１０は、互いに平行に敷設
された複数の走査電極Ｙ１〜Ｙｎと、走査電極Ｙ１〜Ｙ
ｎの各々に対し平行に敷設されかつ一端が互いに共通に
接続された共通電極Ｘと、走査電極Ｙ１〜Ｙｎ及び共通
電極Ｘと離間しかつクロスして互いに平行に敷設された
アドレス電極Ａ１〜Ａｍと、走査電極Ｙ１〜Ｙｎ及び共
通電極Ｘのアドレス電極Ａ１〜Ａｍ側を被った図４に示
すような壁電荷生成用誘電体層１２とを備えている。
マディスプレイパネル１０を駆動する方法であり、この
プラズマディスプレイパネル１０は、互いに平行に敷設
された複数の走査電極Ｙ１〜Ｙｎと、走査電極Ｙ１〜Ｙ
ｎの各々に対し平行に敷設されかつ一端が互いに共通に
接続された共通電極Ｘと、走査電極Ｙ１〜Ｙｎ及び共通
電極Ｘと離間しかつクロスして互いに平行に敷設された
アドレス電極Ａ１〜Ａｍと、走査電極Ｙ１〜Ｙｎ及び共
通電極Ｘのアドレス電極Ａ１〜Ａｍ側を被った図４に示
すような壁電荷生成用誘電体層１２とを備えている。
【００１２】本発明では、例えば図１及び図２に示す如
く、１フレームをＮ個（図１ではＮ＝８）のサブフィー
ルドで構成し、Ｎ個の該サブフィールドのうち少なくと
も１個のサブフィールドを、（１）共通電極Ｘと全ての
走査電極Ｙ１〜Ｙｎとの間に放電開始電圧よりも高い書
込み電圧のパルスを印加して全画素を放電発光させ壁電
荷を生成させる全面書込み期間と、（２）共通電極Ｘと
全ての走査電極Ｙ１〜Ｙｎとの間に該放電開始電圧より
も低い消去電圧かつ直前の放電で生じた壁電荷と同一極
性のパルスを印加して全画素を放電発光させることによ
り該壁電荷を消去させる全面消去期間と、（３）点灯さ
せようとする画素でクロスする該アドレス電極Ａｊと走
査電極Ｙｉとの間に該放電開始電圧よりも低い選択書込
み電圧のパルスを印加して該画素を放電発光させ壁電荷
を生成させるアドレス期間と、（４）共通電極Ｘと全て
の走査電極Ｙ１〜Ｙｎとの間に放電開始電圧よりも低い
維持電圧かつ直前の放電で生じた壁電荷と同一極性のパ
ルスを印加して該アドレス期間で選択的に書込みした画
素を放電発光させ壁電荷を生成させる維持放電期間とで
構成し、Ｎ個の該サブフィールドのうち残りのＮ−１個
のサブフィールドの各々を、（１’）共通電極Ｘと全て
の走査電極Ｙ１〜Ｙｎとの間に該放電開始電圧よりも低
い消去電圧かつ直前の放電で生じた該壁電荷と同一極性
のパルスを印加して該壁電荷が在る画素を放電発光させ
ることにより該壁電荷を消去させる消去期間と、
（２’）該アドレス期間と、（３’）該維持放電期間と
で構成し、該第１〜第Ｎサブフィールドの各維持放電期
間の長さを互いに異ならせることにより２N 階調表示さ
せる。
く、１フレームをＮ個（図１ではＮ＝８）のサブフィー
ルドで構成し、Ｎ個の該サブフィールドのうち少なくと
も１個のサブフィールドを、（１）共通電極Ｘと全ての
走査電極Ｙ１〜Ｙｎとの間に放電開始電圧よりも高い書
込み電圧のパルスを印加して全画素を放電発光させ壁電
荷を生成させる全面書込み期間と、（２）共通電極Ｘと
全ての走査電極Ｙ１〜Ｙｎとの間に該放電開始電圧より
も低い消去電圧かつ直前の放電で生じた壁電荷と同一極
性のパルスを印加して全画素を放電発光させることによ
り該壁電荷を消去させる全面消去期間と、（３）点灯さ
せようとする画素でクロスする該アドレス電極Ａｊと走
査電極Ｙｉとの間に該放電開始電圧よりも低い選択書込
み電圧のパルスを印加して該画素を放電発光させ壁電荷
を生成させるアドレス期間と、（４）共通電極Ｘと全て
の走査電極Ｙ１〜Ｙｎとの間に放電開始電圧よりも低い
維持電圧かつ直前の放電で生じた壁電荷と同一極性のパ
ルスを印加して該アドレス期間で選択的に書込みした画
素を放電発光させ壁電荷を生成させる維持放電期間とで
構成し、Ｎ個の該サブフィールドのうち残りのＮ−１個
のサブフィールドの各々を、（１’）共通電極Ｘと全て
の走査電極Ｙ１〜Ｙｎとの間に該放電開始電圧よりも低
い消去電圧かつ直前の放電で生じた該壁電荷と同一極性
のパルスを印加して該壁電荷が在る画素を放電発光させ
ることにより該壁電荷を消去させる消去期間と、
（２’）該アドレス期間と、（３’）該維持放電期間と
で構成し、該第１〜第Ｎサブフィールドの各維持放電期
間の長さを互いに異ならせることにより２N 階調表示さ
せる。
【００１３】本発明では、１フレーム内の１個のサブフ
ィールドにおいてのみ全面書込みを行っているので、全
面消去の表示を行う場合、例えばＮ＝８では１フレーム
で４＋３×７＝２５回放電発光し、全面消去時の放電発
光回数が従来の３２回よりも少なくなって、表示品質が
向上する。
ィールドにおいてのみ全面書込みを行っているので、全
面消去の表示を行う場合、例えばＮ＝８では１フレーム
で４＋３×７＝２５回放電発光し、全面消去時の放電発
光回数が従来の３２回よりも少なくなって、表示品質が
向上する。
【００１４】本発明の第１態様では、全面消去期間を有
する上記１個のサブフィールドは、１フレームの最初の
サブフィールドである。
する上記１個のサブフィールドは、１フレームの最初の
サブフィールドである。
【００１５】なお、共通電極は、複数組に分割されてい
てもよい。
てもよい。
【００１６】
【実施例】以下、図面に基づいて本発明の一実施例を説
明する。
明する。
【００１７】例えば２５６階調表示を行う場合、図６に
対応して図１に示す如く、１フレームを第１〜８サブフ
ィールドで構成する。第１サブフィールドは、全面書込
み期間と、全面消去期間と、アドレス期間と、維持放電
期間とからなる。第２〜８サブフィールドはいずれも、
第１サブフィールドの全面書込み期間を除いたもの、す
なわち、全面消去期間と、アドレス期間と、維持放電期
間とからなる。
対応して図１に示す如く、１フレームを第１〜８サブフ
ィールドで構成する。第１サブフィールドは、全面書込
み期間と、全面消去期間と、アドレス期間と、維持放電
期間とからなる。第２〜８サブフィールドはいずれも、
第１サブフィールドの全面書込み期間を除いたもの、す
なわち、全面消去期間と、アドレス期間と、維持放電期
間とからなる。
【００１８】第１〜８サブフィールドの各維持放電期間
ｔ１〜ｔ８の比は図６と同様に、 ｔ１：ｔ２：ｔ３：・・・：ｔ７：ｔ８ ＝１：２：４：８：１６：３２：６４：１２８ となっている。
ｔ１〜ｔ８の比は図６と同様に、 ｔ１：ｔ２：ｔ３：・・・：ｔ７：ｔ８ ＝１：２：４：８：１６：３２：６４：１２８ となっている。
【００１９】１フレーム時間は図６の場合と等しく、１
／６０秒である。したがって、本実施例では図６の場合
よりも（全面書込み期間）×７の時間だけ他の期間で使
用でき、パルス幅を図６の場合よりも広くすることがで
きる。
／６０秒である。したがって、本実施例では図６の場合
よりも（全面書込み期間）×７の時間だけ他の期間で使
用でき、パルス幅を図６の場合よりも広くすることがで
きる。
【００２０】図２は、第１及び第２のサブフィールドに
おいて、アドレス電極Ａ１〜Ａ４８０、共通電極Ｘ及び
走査電極Ｙ１〜Ｙ４８０に印加される電圧の波形を示
す。第１サブフィールドの電圧波形は図５と同一であ
り、以下にこれを説明する。なお、図中のサブフィール
ド区分信号は、図３の制御回路５０で生成される。
おいて、アドレス電極Ａ１〜Ａ４８０、共通電極Ｘ及び
走査電極Ｙ１〜Ｙ４８０に印加される電圧の波形を示
す。第１サブフィールドの電圧波形は図５と同一であ
り、以下にこれを説明する。なお、図中のサブフィール
ド区分信号は、図３の制御回路５０で生成される。
【００２１】（１）全面書込み期間 最初の全面書込み期間では、走査電極Ｙ１〜Ｙｎがグラ
ンドレベルＧＮＤにされ、この状態で共通電極Ｘが、放
電開始電圧Ｖf よりも高い書込み電圧ＶWにされて（全
面書き込みパルス）、共通電極Ｘと走査電極Ｙ１〜Ｙｎ
との間で、すなわち全セルで、書込み放電が行われる。
放電が進むにつれ、共通電極Ｘ電極上の誘電体層１２に
は負の壁電荷が蓄積され、走査電極Ｙ１〜Ｙｎ上の誘電
体層１２には正の壁電荷が蓄積される。この壁電荷は放
電空間の電圧を低減させるため、１μｓ程度で放電が終
結する。
ンドレベルＧＮＤにされ、この状態で共通電極Ｘが、放
電開始電圧Ｖf よりも高い書込み電圧ＶWにされて（全
面書き込みパルス）、共通電極Ｘと走査電極Ｙ１〜Ｙｎ
との間で、すなわち全セルで、書込み放電が行われる。
放電が進むにつれ、共通電極Ｘ電極上の誘電体層１２に
は負の壁電荷が蓄積され、走査電極Ｙ１〜Ｙｎ上の誘電
体層１２には正の壁電荷が蓄積される。この壁電荷は放
電空間の電圧を低減させるため、１μｓ程度で放電が終
結する。
【００２２】次に、走査電極Ｙ１〜Ｙｎが、放電開始電
圧Ｖf よりも低い維持電圧ＶSにされ、共通電極Ｘがグ
ランドレベルＧＮＤにされ（維持パルス）、これに前記
壁電荷による電圧が加算されて、共通電極Ｘと走査電極
Ｙ１〜Ｙｎとの間で維持放電が行われる。これにより、
共通電極Ｘ電極上の誘電体層１２には正の壁電荷が蓄積
され、走査電極Ｙ１〜Ｙｎ上の誘電体層１２には負の壁
電荷が蓄積されて、放電が終了する。この維持パルスに
より、壁電荷が安定化される。
圧Ｖf よりも低い維持電圧ＶSにされ、共通電極Ｘがグ
ランドレベルＧＮＤにされ（維持パルス）、これに前記
壁電荷による電圧が加算されて、共通電極Ｘと走査電極
Ｙ１〜Ｙｎとの間で維持放電が行われる。これにより、
共通電極Ｘ電極上の誘電体層１２には正の壁電荷が蓄積
され、走査電極Ｙ１〜Ｙｎ上の誘電体層１２には負の壁
電荷が蓄積されて、放電が終了する。この維持パルスに
より、壁電荷が安定化される。
【００２３】（２）全面消去期間 次に、共通電極Ｘが維持電圧ＶSにされ、走査電極Ｙ１
〜ＹｎがグランドレベルＧＮＤにされて（全面消去パル
ス）、消去放電が生じ、壁電荷が中和されて消去され
る。この消去方法には、放電の進行段階でパルスを中断
させる細幅消去方法と、維持電圧ＶSより低い電圧で微
小な放電を生じさせる太幅消去方法とがある。
〜ＹｎがグランドレベルＧＮＤにされて（全面消去パル
ス）、消去放電が生じ、壁電荷が中和されて消去され
る。この消去方法には、放電の進行段階でパルスを中断
させる細幅消去方法と、維持電圧ＶSより低い電圧で微
小な放電を生じさせる太幅消去方法とがある。
【００２４】（３）アドレス期間 次に、表示データの書込みが線順次に行われる。すなわ
ち、まず走査電極Ｙ１がグランドレベルＧＮＤにされて
選択され、第１表示行の点灯しようとするセルに対応し
たアドレス電極に電圧Ｖａが印加されて（書込みパル
ス）、両電極間で書込み放電が行われ、壁電荷が生成さ
れる。以下、第２〜ｎ表示行についてこの順に、上記同
様の動作が行われる。
ち、まず走査電極Ｙ１がグランドレベルＧＮＤにされて
選択され、第１表示行の点灯しようとするセルに対応し
たアドレス電極に電圧Ｖａが印加されて（書込みパル
ス）、両電極間で書込み放電が行われ、壁電荷が生成さ
れる。以下、第２〜ｎ表示行についてこの順に、上記同
様の動作が行われる。
【００２５】（４）維持放電期間 次に、走査電極Ｙ１〜Ｙｎが共に維持電圧ＶSの状態で
共通電極ＸがグランドレベルＧＮＤにされ（維持パル
ス）、アドレス期間で書込み放電を行なったセルにおい
て壁電荷が加算され、維持放電が行われる。次に、共通
電極Ｘを維持電圧ＶSに戻した状態で走査電極Ｙ１〜Ｙ
ｎが共にグランドレベルＧＮＤにされ（維持パルス）、
アドレス期間で書込み放電を行なったセルにおいて壁電
荷が加算され、維持放電が行われる。以下、このような
動作が交互に繰り返される。すなわち、共通電極Ｘと走
査電極Ｙ１〜Ｙｎとの間に交流維持パルスが供給され
て、画像が表示される。
共通電極ＸがグランドレベルＧＮＤにされ（維持パル
ス）、アドレス期間で書込み放電を行なったセルにおい
て壁電荷が加算され、維持放電が行われる。次に、共通
電極Ｘを維持電圧ＶSに戻した状態で走査電極Ｙ１〜Ｙ
ｎが共にグランドレベルＧＮＤにされ（維持パルス）、
アドレス期間で書込み放電を行なったセルにおいて壁電
荷が加算され、維持放電が行われる。以下、このような
動作が交互に繰り返される。すなわち、共通電極Ｘと走
査電極Ｙ１〜Ｙｎとの間に交流維持パルスが供給され
て、画像が表示される。
【００２６】第２サブフィールドは、第１サブフィール
ドでの全面書込み期間を省略し、維持放電期間を第１サ
ブフィールドのそれの２倍にしている。他は第１サブフ
ィールドと同一である。
ドでの全面書込み期間を省略し、維持放電期間を第１サ
ブフィールドのそれの２倍にしている。他は第１サブフ
ィールドと同一である。
【００２７】第２サブフィールドの全面消去期間におい
ては、直前の維持放電で生成された壁電荷が、全面消去
放電により消失する。第３サブフィールド以下の全面消
去期間についても第２サブフィールドと同様である。
ては、直前の維持放電で生成された壁電荷が、全面消去
放電により消失する。第３サブフィールド以下の全面消
去期間についても第２サブフィールドと同様である。
【００２８】本実施例では、１フレーム内の最初のサブ
フィールドにおいてのみ全面書込みを行っているので、
全面消去の表示を行う場合、１フレームで４＋３×７＝
２５回放電発光し、放電発光回数が従来の３２回よりも
少なくなって、表示品質が向上する。
フィールドにおいてのみ全面書込みを行っているので、
全面消去の表示を行う場合、１フレームで４＋３×７＝
２５回放電発光し、放電発光回数が従来の３２回よりも
少なくなって、表示品質が向上する。
【００２９】
【発明の効果】以上説明した如く、本発明に係る交流駆
動型プラズマディスプレイパネル駆動方法では、１フレ
ーム内の１個のサブフィールドにおいてのみ全面書込み
を行っているので、全面消去の表示を行う場合に放電発
光回数が従来よりも少なくなって、表示品質が向上する
という効果を奏する。
動型プラズマディスプレイパネル駆動方法では、１フレ
ーム内の１個のサブフィールドにおいてのみ全面書込み
を行っているので、全面消去の表示を行う場合に放電発
光回数が従来よりも少なくなって、表示品質が向上する
という効果を奏する。
【図１】本発明の１実施例に係り、２５６諧調表示する
場合の１フレームの各サブフィールド構成図である。
場合の１フレームの各サブフィールド構成図である。
【図２】第１及び第２のサブフィールドでの各電極に印
加される電圧波形図である。
加される電圧波形図である。
【図３】交流駆動型プラズマディスプレイ装置の概略構
成図である。
成図である。
【図４】図３のセルの断面構成図である。
【図５】従来例に係り、１サブフィールドでの各電極に
印加される電圧波形図である。
印加される電圧波形図である。
【図６】従来例に係り、２５６諧調表示する場合の１フ
レームの各サブフィールド構成図である。
レームの各サブフィールド構成図である。
Ａ１〜Ａｍ アドレス電極 Ｘ 共通電極 Ｙ１〜Ｙｎ 走査電極
Claims (2)
- 【請求項１】 互いに平行に敷設された複数の走査電極
（Ｙ１〜Ｙｎ）と、該走査電極の各々に対し平行に敷設
されかつ一端が互いに共通に接続された共通電極（Ｘ）
と、該走査電極及び該共通電極と離間しかつクロスして
互いに平行に敷設されたアドレス電極（Ａ１〜Ａｍ）
と、該走査電極及び該共通電極の該アドレス電極側を被
った壁電荷生成用誘電体層（１２）と、を備えたプラズ
マディスプレイパネル（１０）を駆動する交流駆動型プ
ラズマディスプレイパネル駆動方法において、 １フレームをＮ個のサブフィールドで構成し、 Ｎ個の該サブフィールドのうち少なくとも１個のサブフ
ィールドを、該共通電極と全ての該走査電極との間に放
電開始電圧よりも高い書込み電圧のパルスを印加して全
画素を放電発光させ壁電荷を生成させる全面書込み期間
と、該共通電極と全ての該走査電極との間に該放電開始
電圧よりも低い消去電圧かつ直前の放電で生じた壁電荷
と同一極性のパルスを印加して全画素を放電発光させる
ことにより該壁電荷を消去させる全面消去期間と、点灯
させようとする画素でクロスする該アドレス電極と該走
査電極との間に該放電開始電圧よりも低い選択書込み電
圧のパルスを印加して該画素を放電発光させ壁電荷を生
成させるアドレス期間と、該共通電極と全ての該走査電
極との間に放電開始電圧よりも低い維持電圧かつ直前の
放電で生じた壁電荷と同一極性のパルスを印加して該ア
ドレス期間で選択的に書込みした画素を放電発光させ壁
電荷を生成させる維持放電期間とで構成し、 Ｎ個の該サブフィールドのうち残りのＮ−１個のサブフ
ィールドの各々を、該共通電極と全ての該走査電極との
間に該放電開始電圧よりも低い消去電圧かつ直前の放電
で生じた壁電荷と同一極性のパルスを印加して該壁電荷
が在る画素を放電発光させることにより該壁電荷を消去
させる消去期間と、該アドレス期間と、該維持放電期間
とで構成し、 該第１〜第Ｎサブフィールドの各維持放電期間の長さを
互いに異ならせることにより２N 階調表示させることを
特徴とする交流駆動型プラズマディスプレイパネル駆動
方法。 - 【請求項２】 全面書込み期間を有する前記１個のサブ
フィールドは、前記１フレームの最初のサブフィールド
であることを特徴とする請求項１記載の交流駆動型プラ
ズマディスプレイパネル駆動方法。
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