JPH0529520Y2 - - Google Patents
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- JPH0529520Y2 JPH0529520Y2 JP1984146609U JP14660984U JPH0529520Y2 JP H0529520 Y2 JPH0529520 Y2 JP H0529520Y2 JP 1984146609 U JP1984146609 U JP 1984146609U JP 14660984 U JP14660984 U JP 14660984U JP H0529520 Y2 JPH0529520 Y2 JP H0529520Y2
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- JP
- Japan
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- output
- clock pulse
- charge transfer
- transfer device
- bbd
- Prior art date
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- 238000006243 chemical reaction Methods 0.000 claims description 4
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 239000000284 extract Substances 0.000 description 1
- 238000000034 method Methods 0.000 description 1
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- Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
Description
【考案の詳細な説明】
(産業上の利用分野)
本考案は楽音のピツチコントローラ等に利用さ
れる時間軸変換装置に関し、さらに詳言すれば電
荷転送素子を用いた時間軸変換装置に関する。[Detailed Description of the Invention] (Industrial Field of Application) The present invention relates to a time axis conversion device used as a pitch controller for musical tones, and more specifically, to a time axis conversion device using a charge transfer element.
(従来技術)
従来、磁気再生装置で伴奏音を再生する所謂カ
ラオケにおけるピツチコントロールは磁気テープ
の走行速度を可変して行なつており、それぞれ独
立してコントロールすることは簡単にはできなか
つた。特にビデオデイスク再生装置を使用した所
謂カラオケは高価なピツチコントローラを用いな
ければならず、信号をPCM化して処理を行なう
ため、非常に高価となる。(Prior Art) Conventionally, pitch control in so-called karaoke where accompaniment sounds are played back using a magnetic playback device has been carried out by varying the running speed of the magnetic tape, and it has not been easy to control each pitch independently. In particular, so-called karaoke using a video disc playback device requires the use of an expensive pitch controller, and the signal is converted into PCM for processing, making it very expensive.
(考案の目的)
本考案は上記にかんがみなされたもので、電荷
転送デバイスを用いて簡単に構成できる時間軸変
換装置を提供することを目的とする。(Purpose of the invention) The present invention has been made in view of the above, and an object thereof is to provide a time axis conversion device that can be easily constructed using a charge transfer device.
(考案の実施例) 以下本考案を実施例によつて説明する。(Example of idea) The present invention will be explained below using examples.
第1図は本考案の一実施例の構成を示すブロツ
ク図である。 FIG. 1 is a block diagram showing the configuration of an embodiment of the present invention.
1および2は同一段数のバケツトブリゲードデ
バイス(以下BBD素子と記す)である。 1 and 2 are bucket brigade devices (hereinafter referred to as BBD elements) having the same number of stages.
入力信号は不要周波数成分を除去するバンドパ
スフイルタ3を介して交互に閉成状態に制御され
るアナログスイツチ4,5を経てBBD素子1,
2に各別の供給され、BBD素子1,2からの出
力信号は交互に閉成状態に制御されるアナログス
イツチ6,7を経て、BBD素子1,2のノイズ、
クロツク成分を除去し所要周波数帯域分のみを取
り出すバンドパスフイルタ8を介して出力端子
OUTに出力する。 The input signal passes through a bandpass filter 3 that removes unnecessary frequency components, passes through analog switches 4 and 5 that are alternately controlled to be closed, and then is sent to the BBD elements 1 and 5.
The output signals from the BBD elements 1 and 2 pass through analog switches 6 and 7, which are alternately controlled to be closed, to eliminate the noise of the BBD elements 1 and 2.
The output terminal is passed through a bandpass filter 8 that removes clock components and extracts only the required frequency band.
Output to OUT.
バンドパスフイルタ8の出力は交互に閉成状態
に制御されるアナログスイツチ9,10を経て
BBD素子1,2にそれぞれ供給する。 The output of the bandpass filter 8 is passed through analog switches 9 and 10 which are alternately controlled to be closed.
It is supplied to BBD elements 1 and 2 respectively.
一方、クロツクパルス発振器20および21は
BBD素子1,2の電荷転送クロツクパルスを出
力するクロツクパルス発振器であり、クロツクパ
ルス発振器20のクロツクパルス周波数は固定で
あり、クロツクパルス発振器21のクロツクパル
ス周波数は可変抵抗21aにより可変される。な
おクロツクパルス発振器20,21から転送パル
スとして出力されるクロツクパルスは2相パルス
であるが図では簡略化して示してある。 On the other hand, the clock pulse oscillators 20 and 21
This is a clock pulse oscillator that outputs charge transfer clock pulses for the BBD elements 1 and 2. The clock pulse frequency of the clock pulse oscillator 20 is fixed, and the clock pulse frequency of the clock pulse oscillator 21 is varied by a variable resistor 21a. Note that the clock pulses output as transfer pulses from the clock pulse oscillators 20 and 21 are two-phase pulses, but are shown in a simplified manner in the figure.
クロツクパルス発振器20のクロツクパルス出
力はアナログスイツチ24を介して、クロツクパ
ルス発振器21のクロツクパルはアナログスイツ
チ24と交互に閉成されるアナログスイツチ26
を介してBBD素子1に電荷転送クロツクパルス
として供給してあり、クロツクパルス発振器20
のクロツクパルス出力はアナログスイツチ24と
交互に閉成されるアナログスイツチ25を介し
て、クロツクパルス発振器21のクロツクパルス
出力はアナログスイツチ25と交互に閉成される
アナログスイツチ27を介してBBD素子2に電
荷転送クロツクパルスとして供給してある。一
方、クロツクパルス発振器のクロツクパルス中の
第1相は出力はたとえばリプルカウンタ22に供
給して分周し、分周出力の半周期が、段数および
クロツクパルス発振器20の出力クロツクパルス
周波数により定まるBBD素子1,2の遅延時間
に等しい値となるように設定してある。この分周
出力でアナログスイツチ4,7,10,24,2
7を閉成し、分周出力Aをインバータ23にて反
転した出力でアナログスイツチ5,6,9,2
5,26を閉成するように構成してある。 The clock pulse output of the clock pulse oscillator 20 is transmitted through an analog switch 24, and the clock pulse of the clock pulse oscillator 21 is transmitted through an analog switch 26 which is alternately closed with the analog switch 24.
The charge transfer clock pulse is supplied to the BBD element 1 via the clock pulse oscillator 20.
The clock pulse output of the clock pulse oscillator 21 is transferred to the BBD element 2 via the analog switch 25 which is alternately closed with the analog switch 24, and the clock pulse output of the clock pulse oscillator 21 is transferred to the BBD element 2 via the analog switch 27 which is alternately closed with the analog switch 24. It is supplied as a clock pulse. On the other hand, the output of the first phase of the clock pulse of the clock pulse oscillator is supplied to, for example, a ripple counter 22 and frequency-divided, and the half period of the divided output is determined by the number of stages and the output clock pulse frequency of the clock pulse oscillator 20. The value is set to be equal to the delay time of . With this frequency divided output, analog switches 4, 7, 10, 24, 2
7 is closed, and the frequency-divided output A is inverted by the inverter 23 and the analog switches 5, 6, 9, 2 are inverted.
5 and 26 are closed.
上記の如く構成された本考案の一実施例におい
て、カウンタ22の分周出力すなわち出力Aが高
電位の期間、アナログスイツチ4,7,10,2
4および27は閉成され、アナログスイツチ5,
6,9,25および26は遮断状態に制御され
る。この結果、BBD素子1にはクロツクパルス
発振器20の出力クロツクパルスが電荷転送パル
スとして供給され、BBD素子2にはクロツクパ
ルス発振器21の出力クロツクパルスが電荷転送
パルスとして供給されることになる。 In one embodiment of the present invention configured as described above, during a period when the divided output of the counter 22, that is, the output A is at a high potential, the analog switches 4, 7, 10, 2
4 and 27 are closed, analog switches 5,
6, 9, 25 and 26 are controlled to be in a cut-off state. As a result, the output clock pulse of the clock pulse oscillator 20 is supplied to the BBD element 1 as a charge transfer pulse, and the output clock pulse of the clock pulse oscillator 21 is supplied to the BBD element 2 as a charge transfer pulse.
まず、BBD素子1について説明すれば、入力
信号はバンドパスフイルタ3を介してBBD素子
1に入力され、クロツクパルス発振器20の出力
クロツクパルスにしたがつてサンプルされ、サン
プル値に対応する電荷は順次転送される。このと
きアナログスイツチ6は遮断状態のためBBD素
子1の出力は出力端子OUTには現われない。つ
ぎにBBD素子2について説明すれば、アナログ
スイツチ5は遮断状態であり、アナログスイツチ
7は閉成状態であるため、BBD素子2には入力
端子INからの入力信号は入力されず、BBD素子
2内に蓄積記憶されている入力信号に対応する電
荷がクロツクパルス発振器21の出力クロツクパ
ルスにしたがつて順次転送され、バンドパスフイ
ルタ8を介して出力端子OUTに出力される。ま
たアナログスイツチ10は閉成状態であるため出
力端子OUTに出力された出力信号はBBD素子2
に入力される。 First, to explain the BBD element 1, an input signal is input to the BBD element 1 via the bandpass filter 3, sampled according to the output clock pulse of the clock pulse oscillator 20, and charges corresponding to the sampled values are sequentially transferred. Ru. At this time, since the analog switch 6 is in a cut-off state, the output of the BBD element 1 does not appear at the output terminal OUT. Next, explaining the BBD element 2, since the analog switch 5 is in the cutoff state and the analog switch 7 is in the closed state, the input signal from the input terminal IN is not input to the BBD element 2, and the BBD element 2 Charges corresponding to the input signals accumulated and stored in the circuit are sequentially transferred in accordance with the output clock pulses of the clock pulse oscillator 21, and are outputted to the output terminal OUT via the bandpass filter 8. In addition, since the analog switch 10 is in the closed state, the output signal output to the output terminal OUT is transmitted to the BBD element 2.
is input.
出力Aが高電位になつた直後にBBD素子1の
初段に充電された電荷がクロツクパルス発振器2
0の出力クロツクパルスにより転送されてBBD
素子1の終端にまで到達したとき、出力Aは低電
位に、出力は高電位となる。そこで上記した
BBD素子1とBBD素子2とが入れ替つた如く作
用する。すなわちBBD素子1には入力端子INか
らの入力信号は入力されず、BBD素子1内に蓄
積記憶されている入力信号に対応する電荷がクロ
ツクパルス発振器21の出力クロツクパルスにし
たがつて順次転送され、バンドパスフイルタ8を
介して出力端子OUTに出力される。また出力端
子OUTに出力された出力信号はBBD素子1に入
力される。BBD素子2にはバンドパスフイルタ
3を介して入力端子INに供給されている入力信
号が入力され、クロツクパルス発振器20にした
がつてサンプルされ、サンプル値に対応する電荷
は順次転送される。このときアナログスイツチ7
は遮断状態のためBBD素子2の出力は出力端子
OUTには現われない。 Immediately after the output A becomes a high potential, the charge charged in the first stage of the BBD element 1 is transferred to the clock pulse oscillator 2.
BBD is transferred by an output clock pulse of 0.
When the terminal end of element 1 is reached, the output A becomes a low potential and the output becomes a high potential. So I mentioned above
It acts as if BBD element 1 and BBD element 2 were exchanged. In other words, the input signal from the input terminal IN is not input to the BBD element 1, and the charge corresponding to the input signal accumulated and stored in the BBD element 1 is sequentially transferred in accordance with the output clock pulse of the clock pulse oscillator 21, and the band It is output to the output terminal OUT via the pass filter 8. Further, the output signal output to the output terminal OUT is input to the BBD element 1. The input signal supplied to the input terminal IN is inputted to the BBD element 2 via the bandpass filter 3, and sampled according to the clock pulse oscillator 20, and charges corresponding to the sampled values are sequentially transferred. At this time, analog switch 7
is in the cut-off state, so the output of BBD element 2 is the output terminal
It does not appear in OUT.
また出力が高電位になつた直後にBBD素子
2の初段に充電された電荷がクロツクパルス発振
器20の出力クロツクパルスにより転送されて
BBD素子2の終端にまで到達したとき、出力
は低電位となり、再びBBD素子1と2とが入れ
替つた如く作用する。 Immediately after the output becomes high potential, the charge charged in the first stage of the BBD element 2 is transferred by the output clock pulse of the clock pulse oscillator 20.
When reaching the terminal end of BBD element 2, the output becomes a low potential and acts as if BBD elements 1 and 2 have been exchanged again.
そこで、入力信号はクロツクパルス発振器20
の出力クロツクパルス周波数とクロツクパルス発
振器21のクロツクパルス周波数との差に対応し
て時間軸が圧縮、伸長された出力信号となる。 Therefore, the input signal is sent to the clock pulse oscillator 20.
The time axis is compressed or expanded in accordance with the difference between the output clock pulse frequency of the clock pulse oscillator 21 and the clock pulse frequency of the clock pulse oscillator 21.
また時間軸が圧縮された場合においても出力端
子OUTの出力信号がアナログスイツチ9,10
を介してBBD素子1,2に戻されるためにBBD
素子1,2が空になるようなことはない。 Also, even when the time axis is compressed, the output signal of the output terminal OUT is
BBD to be returned to BBD elements 1 and 2 via
Elements 1 and 2 are never empty.
したがつて、可変抵抗21aの設定により時間
軸の圧伸が行なえ、楽音のピツチコントローラと
したとき可変抵抗21aにより楽音のピツチが制
御できることになる。 Therefore, the time axis can be expanded by setting the variable resistor 21a, and when used as a pitch controller for musical tones, the pitch of musical tones can be controlled by the variable resistor 21a.
またBBD素子1,2に代つてCCD素子の如く
他の電荷転送素子を用いても同様である。 Further, the same effect can be obtained even if other charge transfer elements such as CCD elements are used in place of the BBD elements 1 and 2.
(考案の効果)
以上説明した如く本考案によれば、電荷転送素
子を用い、入力信号読み込みのときの電荷転送素
子への転送クロツクと、電荷転送素子から電荷の
読み出しのときの転送クロツクとを異にし、後者
の転送クロツクを可変としたため、時間軸の圧伸
が可能となり、かつ信号をPCM化して処理する
等のことは不必要であり簡単な構成で、安価に構
成することができる。(Effects of the invention) As explained above, according to the invention, a charge transfer element is used, and a transfer clock to the charge transfer element when reading an input signal and a transfer clock when reading charge from the charge transfer element are transferred. On the other hand, since the latter transfer clock is made variable, it is possible to compand the time axis, and there is no need to process the signal by converting it into PCM, so the configuration can be simple and inexpensive.
第1図は本考案の一実施例の構成を示すブロツ
ク図。
1および2……BBD素子、3および8……バ
ンドパスフイルタ、4〜7,9,10,24〜2
7……アナログスイツチ、20および21……ク
ロツクパルス発振器、22……カウンタ、23…
…インバータ。
FIG. 1 is a block diagram showing the configuration of an embodiment of the present invention. 1 and 2...BBD element, 3 and 8...band pass filter, 4-7, 9, 10, 24-2
7...Analog switch, 20 and 21...Clock pulse oscillator, 22...Counter, 23...
...Inverter.
Claims (1)
バイスと、周波数固定の第1のクロツクパルス発
振器と、周波数可変の第2のクロツクパルス発振
器と、第1のクロツクパルス発振器の出力クロツ
クパルスを分周しかつ分周出力の半周期が入力読
み込みのときの第1および第2の電荷転送デバイ
スの遅延時間に等しく設定された分周手段と、分
周手段の出力が一方の極性の期間第1のクロツク
パルス発振器の出力クロツクパルスと入力信号と
を第1の電荷転送デバイスに供給するとともに第
2のクロツクパルス発振器の出力クロツクパルス
を第2の電荷転送デバイスに供給しかつ第2の電
荷転送デバイスの出力を出力端子側に導くととも
に第2の電荷転送デバイスに供給し、かつ分周手
段の出力が他方の極性の期間第1のクロツクパル
ス発振器の出力クロツクパルスと入力信号とを第
2の電荷転送デバイスに供給するとともに第2の
クロツクパルス発振器の出力クロツクパルスを第
1の電荷転送デバイスに供給しかつ第1の電荷転
送デバイスの出力を出力端子側に導くとともに第
1の電荷転送デバイスに供給する切替手段とを備
えてなることを特徴とする時間軸変換装置。 first and second charge transfer devices having the same number of stages, a first clock pulse oscillator with a fixed frequency, a second clock pulse oscillator with a variable frequency, and dividing and frequency-dividing the output clock pulse of the first clock pulse oscillator. a frequency divider whose half period of the output is set equal to the delay time of the first and second charge transfer devices when reading the input; and an output of the first clock pulse oscillator during which the output of the frequency divider is of one polarity. supplying the clock pulse and the input signal to the first charge transfer device, supplying the output clock pulse of the second clock pulse oscillator to the second charge transfer device, and guiding the output of the second charge transfer device to the output terminal side; supplying the output clock pulse of the first clock pulse oscillator and the input signal to the second charge transfer device while the output of the frequency dividing means is of the other polarity; switching means for supplying the output clock pulse of the first charge transfer device to the first charge transfer device, guiding the output of the first charge transfer device to the output terminal side, and supplying the output to the first charge transfer device. Time axis conversion device.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1984146609U JPH0529520Y2 (en) | 1984-09-29 | 1984-09-29 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1984146609U JPH0529520Y2 (en) | 1984-09-29 | 1984-09-29 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6164666U JPS6164666U (en) | 1986-05-02 |
JPH0529520Y2 true JPH0529520Y2 (en) | 1993-07-28 |
Family
ID=30704844
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1984146609U Expired - Lifetime JPH0529520Y2 (en) | 1984-09-29 | 1984-09-29 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0529520Y2 (en) |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS54139514A (en) * | 1978-04-20 | 1979-10-30 | Sanyo Electric Co Ltd | Time axis conversion circuit of signals |
JPS57114198A (en) * | 1980-12-30 | 1982-07-15 | Masanori Kaneyasu | Device for varying musical interval |
JPS58159210A (en) * | 1982-03-18 | 1983-09-21 | Sanyo Electric Co Ltd | Signal processing circuit of variable speed sound reproducer |
JPS5930600A (en) * | 1982-06-28 | 1984-02-18 | 日本コロムビア株式会社 | Frequency spectrum compression/expansion unit |
-
1984
- 1984-09-29 JP JP1984146609U patent/JPH0529520Y2/ja not_active Expired - Lifetime
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Publication number | Priority date | Publication date | Assignee | Title |
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Also Published As
Publication number | Publication date |
---|---|
JPS6164666U (en) | 1986-05-02 |
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