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JPH04192370A - Semiconductor acceleration sensor - Google Patents

Semiconductor acceleration sensor

Info

Publication number
JPH04192370A
JPH04192370A JP31804690A JP31804690A JPH04192370A JP H04192370 A JPH04192370 A JP H04192370A JP 31804690 A JP31804690 A JP 31804690A JP 31804690 A JP31804690 A JP 31804690A JP H04192370 A JPH04192370 A JP H04192370A
Authority
JP
Japan
Prior art keywords
cantilever
silicon
acceleration sensor
polycrystalline silicon
film
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP31804690A
Other languages
Japanese (ja)
Inventor
Patoritsuku Jieemusu Furenchi
フレンチ・パトリック・ジェームス
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Nissan Motor Co Ltd
Original Assignee
Nissan Motor Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nissan Motor Co Ltd filed Critical Nissan Motor Co Ltd
Priority to JP31804690A priority Critical patent/JPH04192370A/en
Publication of JPH04192370A publication Critical patent/JPH04192370A/en
Pending legal-status Critical Current

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Abstract

PURPOSE:To eliminate the mounting step for manufacturing a highly reliable sensor with high precision by a method wherein a cantilever and the spaces encircling the catilever are formed using the thin film technology on the surface of a silicon substrate so that the cantilever and the spaces may be integrated to form the title acceleration sensor. CONSTITUTION:The title semiconductor acceleration sensor is a capacitance type sensor composed of two capacitors comprising a p<+> silicon region 11 and a polycrystalline silicon layer 12 formed above and beneath a cantilever 10 used as a common electrode respectively through the intermediary of the first silicon film 13 and the second silicon nitride film 14. This p<+> silicon region 11 is formed on the surface of an n-type silicon substrate 16. When this sensor is accelerated, the cantilever 10 approaches to the p<+> silicon region 11 so that the capacitance between the cantilever 10 and the P<+> silicon layer 11 may be increased while the capacitance between the cantilever 10 and the polycrystalline silicon layer 12 may be decreased. In such a constitution, the acceleration can be measured by measuring the fluctuation in the capacitance.

Description

【発明の詳細な説明】 〔発明の目的〕 (産業上の利用分野) 本発明は、半導体加速度センサに関する。[Detailed description of the invention] [Purpose of the invention] (Industrial application field) The present invention relates to a semiconductor acceleration sensor.

(従来の技術) 近年、半導体基板上に形成された半導体領域のピエゾ抵
抗効果による抵抗変化や変位による微小な容量変化を検
出することにより、−加速度等を検出するようにした超
小形の半導体歪検呂装置が注目されている。
(Prior art) In recent years, ultra-small semiconductor distortion devices have been developed to detect -acceleration, etc. by detecting resistance changes due to piezoresistance effects and minute capacitance changes due to displacement of semiconductor regions formed on semiconductor substrates. The Chero device is attracting attention.

このような半導体加速度センサは、集積回路技術を用い
て形成されるため、例えば、振動部分の長さか100μ
m程度、厚さか1μ圓程度、チップ全体の大きさか1m
m角程変色極めて小形の素子を形成する二とかできる。
Since such semiconductor acceleration sensors are formed using integrated circuit technology, the length of the vibrating portion is, for example, 100 μm.
m, thickness is about 1 μm, whole chip size is about 1 m
It is possible to form an extremely small element with discoloration of about m square.

また、集積回路によって他の素子と同一基板上に形成す
ることができるという優れた特徴を有している。
Furthermore, it has the excellent feature that it can be formed on the same substrate as other elements by using an integrated circuit.

例えば、このようなヰ導体加速度センサの一例として、
通常第10図および第11図に示すように、シリコン基
板1を2枚のガラス基板2.3で挾み、先端にこのシリ
コン基板1の厚さの振動部7を有し、表面にピエゾ抵抗
5を配設してなる肉薄領域4からなる片持ち梁が、表面
および裏面からエツチングされるとともに、支持リング
9を残して形成されており、これかガラス基板2,3て
シールされ振動部7および片持梁4とが、閉空間8内で
自由に変位可能なように構成されている(IEEE  
電子通信デバイス第26巻、(1979)、“バッチ形
成シリコン加速度センサ“)。
For example, as an example of such a conductor acceleration sensor,
Usually, as shown in FIGS. 10 and 11, a silicon substrate 1 is sandwiched between two glass substrates 2.3, and a vibrating section 7 having the thickness of the silicon substrate 1 is provided at the tip, and a piezoresistor is provided on the surface. A cantilever beam consisting of a thin region 4 formed by disposing a cantilever beam 5 is etched from the front and back surfaces, leaving a support ring 9, which is sealed with glass substrates 2 and 3 to form a vibrating section 7. and the cantilever beam 4 are configured to be freely displaceable within the closed space 8 (IEEE
Electronic Communication Devices Vol. 26, (1979), “Batch Formed Silicon Accelerometers”).

そして、この支持リング部9の上にも該ピエゾ抵抗5と
同一のピエゾ抵抗6か形成されており、ブリッジ回路を
形成している。
A piezoresistor 6 identical to the piezoresistor 5 is also formed on this support ring portion 9, forming a bridge circuit.

そして、この振動部7はデバイスの感度を増大するため
の重りとしてはたらくようになっている。
The vibrating section 7 functions as a weight to increase the sensitivity of the device.

この加速度センサては、加速度による片持ち粱4の変位
をピエゾ抵抗5の抵抗値変化として検出するようにして
いる。
This acceleration sensor detects the displacement of the cantilever 4 due to acceleration as a change in the resistance value of the piezoresistor 5.

このようなセンサは、シリコン基板1をICの製造プロ
セスによってエツチングし、バッチ処理で作ることがで
きるようになっている。
Such a sensor can be manufactured by etching the silicon substrate 1 using an IC manufacturing process and by batch processing.

(発明か解決しようとする課題) しかしながら、このような加速度センサてはウェハ表面
および裏面から半導体基板をエツチング加工し、重り部
、片持ち梁なとの構造物を形成するようになっており、
裏面エツチングに合わせずれが生じやすい上、工程中に
片持ち梁が破損して歩留まりが低下するという問題もあ
った。
(Problem to be solved by the invention) However, in such an acceleration sensor, the semiconductor substrate is etched from the front and back surfaces of the wafer to form structures such as a weight portion and a cantilever beam.
In addition to being prone to misalignment during backside etching, there was also the problem that the cantilever beams were damaged during the process, reducing yield.

また、実装に際して2枚のガラス系板にンールしなけれ
ばならないため実装コストが過大となる上、ギャップを
制御するのか極めて困難であるという問題があった。
In addition, since mounting must be performed on two glass plates, the mounting cost becomes excessive, and it is extremely difficult to control the gap.

本発明は前記実情に鑑みてなされたもので、エツチング
の合わせずれをなくし実装の容易な加速度センサを提供
することを目的とする。
The present invention has been made in view of the above-mentioned circumstances, and it is an object of the present invention to provide an acceleration sensor that eliminates misalignment of etching and is easy to mount.

〔発明の構成〕[Structure of the invention]

(課題を解決するための手段) そこで本発明では、いわゆるマイクロマシーン加工を用
いて小型の加速度センサを形成したちので、シリコン基
板表面に形成した空間内に伸長するように多結晶シリコ
ン膜からなる梁を形成するとともに、この空間を多結晶
シリコン膜で閉じるようにし、一体構造の加速度センサ
を構成している。
(Means for Solving the Problems) Therefore, in the present invention, a small acceleration sensor is formed using so-called micromachining, and is made of a polycrystalline silicon film that extends into a space formed on the surface of a silicon substrate. A beam is formed and this space is closed with a polycrystalline silicon film to constitute an integrated acceleration sensor.

すなわち、この加速度センサは、半導体基板から構成さ
れる固定部と、この固定部上にスペーサ層を介して積層
され先端に質量部を有する多結晶シリコンからなる片持
ち梁と、さらにこの上層にスペーサ層を介して形成され
た多結晶シリコン膜からなるキャンプ部とを具備し、キ
ャップ部によって、片持ち梁のまわりに形成された空間
を多結晶シリコン膜て閉しるようにしている。
That is, this acceleration sensor includes a fixed part made of a semiconductor substrate, a cantilever made of polycrystalline silicon laminated on the fixed part via a spacer layer and having a mass part at the tip, and a spacer on the upper layer. A camp portion made of a polycrystalline silicon film formed through layers is provided, and a space formed around the cantilever is closed with the polycrystalline silicon film by a cap portion.

(作用) 上記構造によれば、シリコン基板表面に薄膜技術を用い
て片持ち梁およびこれを囲む空間を形成するようにし、
加速度センサか一体的に形成されるため、実装工程が不
要で、極めて容易に高精度で信頼性の高いセンサを得る
ことか可能となる。
(Function) According to the above structure, the cantilever and the space surrounding it are formed using thin film technology on the surface of the silicon substrate,
Since the acceleration sensor is integrally formed, there is no need for a mounting process, making it possible to obtain a highly accurate and reliable sensor extremely easily.

例えば、予め空間を形成すべき領域を規定しここにエツ
チング特性の異なる膜(PSG膜など)を埋め込んでお
き、積層後選択エツチング技術を用いてこの膜をエツチ
ングし、空間を形成するようにすれば容易に高精度の空
間を形成することかできる。
For example, a region in which a space is to be formed is defined in advance, a film with different etching characteristics (such as a PSG film) is embedded in this region, and after lamination, a selective etching technique is used to etch this film to form a space. It is possible to easily create a highly accurate space.

(実施例) 以下、本発明の実施例について図面を参照しつつ詳細に
説明する。
(Example) Hereinafter, an example of the present invention will be described in detail with reference to the drawings.

この半導体加速度センサは、第1図に断面図、第2図に
平面図を示すように、片持ち粱10と、これを共通電極
とし、上方および下方にそれぞれ第1の窒化シリコン膜
13および第2の窒化シリコン膜14を介して形成され
たp+シリコン領域11および多結晶シリコン層12に
よって2つのキャパシタを構成してなるもので、容量型
のセンサである。このp+シリコン領域11はn形シリ
コン基板16の表面に形成されている。
As shown in a cross-sectional view in FIG. 1 and a plan view in FIG. The p+ silicon region 11 and the polycrystalline silicon layer 12 formed through the second silicon nitride film 14 constitute two capacitors, and are a capacitive type sensor. This p+ silicon region 11 is formed on the surface of an n-type silicon substrate 16.

二の片持ち梁は、狭い幅の支持部23と幅広部15とで
構成され、感度を最大にすべく支持部23は最小にする
一方、この幅広部15は固定端のまわりのモーメントを
増大し、測定すべきキャパシタンスを拡大するのに用い
られる。
The second cantilever consists of a narrow support section 23 and a wide section 15; the support section 23 is minimized to maximize sensitivity, while the wide section 15 increases the moment around the fixed end. and is used to magnify the capacitance to be measured.

そして加速度がかかると第3図に示すようにV]持ち梁
10がp+シリコン領域11に近づき、片持ち梁10と
p+シリコン領域11との間のキャパシタンスが増大し
、片持ち梁10と多結晶シリコン層12との間のキャパ
シタンスが減少する。
When acceleration is applied, the support beam 10 approaches the p+ silicon region 11 as shown in FIG. The capacitance between silicon layer 12 is reduced.

これらのキャパシタンスの変化を測定する二とにより加
速度の測定が可能となる。
By measuring changes in these capacitances, acceleration can be measured.

次に、この半導体加速度センサの形状加工工程について
第4図(a)乃至第4図(C)を参照しつつ説明する。
Next, the shape processing process of this semiconductor acceleration sensor will be explained with reference to FIGS. 4(a) to 4(C).

まず、n型シリコン基板16表面に窒化シリコン膜パタ
ーン13を形成しこれをマスクとして不純物拡散を行い
p+シリコン層11を形成する。
First, a silicon nitride film pattern 13 is formed on the surface of an n-type silicon substrate 16, and impurities are diffused using this pattern as a mask to form a p+ silicon layer 11.

この上層に、CVD法によりPSGS上膜を堆積し表面
を平坦化した後、p型にドープされた多結晶シリコン層
10を堆積し、表面を酸化して酸化シリコン膜32を形
成する。
A PSGS upper film is deposited on this upper layer by the CVD method to planarize the surface, and then a p-type doped polycrystalline silicon layer 10 is deposited and the surface is oxidized to form a silicon oxide film 32.

この後通常のフォトリソ工程により片持ち梁10をバタ
ーニングする(第4図(a))。
Thereafter, the cantilever beam 10 is patterned by a normal photolithography process (FIG. 4(a)).

そしてさらに、第4図(b)に示すように、この上層に
窒化シリコン膜パターン14を形成し、さらにCVD法
によりPSG膜21を堆積し表面を平坦化し、さらにこ
の上層に多結晶シリコン層12を堆積しこれに不純物を
注入する。
Further, as shown in FIG. 4(b), a silicon nitride film pattern 14 is formed on this upper layer, a PSG film 21 is deposited by CVD method to flatten the surface, and a polycrystalline silicon layer 12 is further formed on this upper layer. is deposited and impurities are injected into it.

そして通常の方法でコンタクト(図示せず)などを形成
した後、第4図(C)に示すように、酸化シリコン膜3
2をマスクとしてPSGS上膜およびPSG膜21を選
択的にエツチング除去して、自由空間を形成し、さらに
片持ち粱10上に露呈する酸化シリコン膜32をエツチ
ング除去し、第1図および第2図に示したような加速度
センサか完成する。
After forming contacts (not shown) in the usual manner, a silicon oxide film 3 is formed as shown in FIG. 4(C).
2 as a mask, the PSGS upper film and the PSG film 21 are selectively etched away to form a free space, and the silicon oxide film 32 exposed on the cantilever tile 10 is etched away. The acceleration sensor shown in the figure is completed.

この方法では、あらかじめ空間を形成すべき領域にPS
G膜ユ9およびPSG膜21を埋め込んでおき後に選択
エツチングによりこれをエツチング除去して、自由空間
を形成しているため、高精度の空間を形成することがで
きる。
In this method, PS is applied to the area where the space is to be formed in advance.
Since the G film 9 and the PSG film 21 are buried and then etched away by selective etching to form a free space, a highly accurate space can be formed.

また、このようにして形成された加速度センサは、実装
工程が不要であり、−枚のシリコン基板を薄膜テクノロ
ジーのみを用いて加工することによって形成され、極め
て微細で高精度の形状加工か可能である。
In addition, the acceleration sensor formed in this way does not require a mounting process, and is formed by processing a single silicon substrate using only thin film technology, making it possible to process extremely fine and highly accurate shapes. be.

前記実施例では容量型の加速度サンサについて説明した
が、本発明の第2の実施例として、ピエゾ抵抗型の加速
度センサについて説明する。
In the embodiment described above, a capacitive acceleration sensor has been described, but as a second embodiment of the present invention, a piezoresistive acceleration sensor will be described.

この加速度センサは、第5図および第6図に示すように
、質量部31を支持する2つの梁17゜18の表面に設
けられた多結晶ンリコン層25か梁の偏りを検知するピ
エゾ抵抗を構成してなるものである。そしてこの質量部
31および2つの梁1.7.18は第1および第2の多
結晶シリコン層22.25の間に酸化シリコン膜または
窒化シリコン膜24を挾んだ二重構造を有している。
As shown in FIGS. 5 and 6, this acceleration sensor includes a polycrystalline silicon layer 25 provided on the surfaces of two beams 17 and 18 that support the mass part 31, and a piezoresistor that detects the deviation of the beams. It is composed of The mass portion 31 and the two beams 1.7.18 have a double structure in which a silicon oxide film or a silicon nitride film 24 is sandwiched between the first and second polycrystalline silicon layers 22.25. There is.

次に、この半導体加速度センサの形状加工工程について
第7図(a)乃至第7図(d)を参照しつつ説明する。
Next, the shape processing process of this semiconductor acceleration sensor will be explained with reference to FIGS. 7(a) to 7(d).

まず、第7図(a)に示すように、n型シリコン基板1
6表面に窒化シリコン膜パターン13を形成し、この上
層に、CVD法によりPSGS上膜を堆積し表面を平坦
化した後、p型にドープされた第1の多結晶シリコン層
22を堆積し、表面を軽く酸化して酸化シリコン膜を形
成し、さらに窒化シリコン膜24を形成した後、第2の
多結晶シリコン層25を堆積しこれに不純物を注入する
First, as shown in FIG. 7(a), an n-type silicon substrate 1
A silicon nitride film pattern 13 is formed on the surface of the silicon nitride film pattern 13, and a PSGS upper film is deposited on this upper layer by the CVD method to flatten the surface, and then a p-type doped first polycrystalline silicon layer 22 is deposited. After lightly oxidizing the surface to form a silicon oxide film and further forming a silicon nitride film 24, a second polycrystalline silicon layer 25 is deposited and impurities are implanted into this.

ここで第1及び第2の多結晶シリコン層の間に挾む層と
して窒化シリコン膜24を用いる場合には、歪を低減す
るために薄くするのが望ましい。また、酸化シリコン膜
を用いる場合にも、P−8G膜19およびPSG膜21
のエツチング工程でのエツチングを最小限に抑えるため
に薄くするのが望ましい。さらに多結晶シリコンの不純
物濃度は膜特性か良好となるように選ぶ。また、このよ
うに梁を酸化シリコン膜または窒化シリコン膜24を挾
んだ二重構造とするのは、片持ち粱17,18の表面を
膜24により絶縁して、歪みレベルが最大となるような
表面上に検知層としての多結晶シリコン層25が位置す
るのを確実にするためである。
When using the silicon nitride film 24 as a layer sandwiched between the first and second polycrystalline silicon layers, it is desirable to make it thin in order to reduce strain. Also, when using a silicon oxide film, the P-8G film 19 and the PSG film 21
It is desirable to have a thin layer to minimize etching during the etching process. Furthermore, the impurity concentration of polycrystalline silicon is selected so as to provide good film characteristics. Furthermore, the reason why the beam has a double structure with a silicon oxide film or a silicon nitride film 24 sandwiched between the beams is to insulate the surfaces of the cantilever beams 17 and 18 with the film 24 so that the strain level is maximized. This is to ensure that the polycrystalline silicon layer 25 as a detection layer is located on the same surface.

これによって、片持ち梁の表面に別工程でピエゾ抵抗を
形成する必要がなくなる。
This eliminates the need to form a piezoresistor on the surface of the cantilever in a separate process.

この後通常のフォトリソ工程により、質量部31を有す
る片持ち梁17,18をバターニングする(第7図(b
))。
Thereafter, the cantilever beams 17 and 18 having the mass portion 31 are patterned by a normal photolithography process (Fig. 7(b)
)).

そしてさらに、第7図(C)に示すように、この上層に
窒化シリコン膜パターン14を形成し、さらにCVD法
によりPSG膜21を堆積し表面を平坦化し、さらにこ
の上層に多結晶シリコン層26を堆積しこれに不純物を
注入する。
Further, as shown in FIG. 7(C), a silicon nitride film pattern 14 is formed on this upper layer, a PSG film 21 is deposited by CVD method to flatten the surface, and a polycrystalline silicon layer 26 is further formed on this upper layer. is deposited and impurities are injected into it.

そして通常の方法でコンタクト(図示せず)などを形成
した後、第7図(d)に示すように、PSG膜19およ
びPSG膜21を選択的にエツチング除去して、自由空
間を形成し、第5図および第6図に示したような加速度
センサが完成する。
After forming contacts (not shown) and the like in a usual manner, as shown in FIG. 7(d), the PSG film 19 and the PSG film 21 are selectively etched away to form a free space. An acceleration sensor as shown in FIGS. 5 and 6 is completed.

このようにして形成された加速度センサも実施例1の加
速度センサと同様、実装工程が不要であり、−枚のシリ
コン基板を半導体テクノロジーのみを用いて加工するこ
とによって形成され、極めて微細で高精度の形状加工が
可能である。
Like the acceleration sensor of Example 1, the acceleration sensor formed in this manner does not require a mounting process, and is formed by processing two silicon substrates using only semiconductor technology, and is extremely fine and highly accurate. shape processing is possible.

前記第1の実施例では容量型の加速度センサについて説
明したが、本発明の第3の実施例として、これに自己チ
エツク機能付きの加速度センサについて説明する。
In the first embodiment, a capacitive acceleration sensor has been described, but as a third embodiment of the present invention, an acceleration sensor with a self-check function will be described.

この加速度センサでは前記第1の実施例(第2図参照)
におけるキャツピング層としての多結晶シリコン層12
に代えて、第8図に示すように、これを電気的に2つに
分割した多結晶シリコン層27とし、一方28を励起用
とし、他方29を容量検出用に用いるようにしている。
In this acceleration sensor, the first embodiment (see Fig. 2)
Polycrystalline silicon layer 12 as a capping layer in
Instead, as shown in FIG. 8, the polycrystalline silicon layer 27 is electrically divided into two parts, one 28 being used for excitation and the other 29 used for capacitance detection.

すなわちこれら多結晶シリコン層28と29との商には
不純物を含まない分離領域30か存在し、これによって
電気的分離を達成している。
That is, an isolation region 30 containing no impurities exists in the quotient of these polycrystalline silicon layers 28 and 29, thereby achieving electrical isolation.

そしてチエツクに際しては、梁の一方28の部分に電圧
が印加され、容量検出に際しては測定部である他方29
て測定される。
When checking, a voltage is applied to one part 28 of the beam, and when detecting the capacitance, the other part 29, which is the measuring part, is applied.
It is measured by

また、この自己チエツク機能付きの加速度センサの変形
例として前記第1の実施例で用いた加速度センサを第9
図に示すようにキャツピング層としての多結晶シリコン
層12全体に励起電圧を印加し、片持ち梁10とシリコ
ン基板16との間の容量を検出するように構成しても良
い。
Further, as a modification of the acceleration sensor with a self-check function, the acceleration sensor used in the first embodiment is replaced with a ninth embodiment.
As shown in the figure, an excitation voltage may be applied to the entire polycrystalline silicon layer 12 as a capping layer, and the capacitance between the cantilever beam 10 and the silicon substrate 16 may be detected.

〔発明の効果〕〔Effect of the invention〕

以上説明したように、本発明によれば、シリコン基板表
面に形成した2層の多結晶シリコン層を用いてマイクロ
マシン加工によって一体的に形成されているため、実装
工程か不要となり、高精度で信頼性の高い半導体加速度
センサを得ることが可能となる。
As explained above, according to the present invention, two polycrystalline silicon layers formed on the surface of a silicon substrate are integrally formed by micromachining, eliminating the need for a mounting process and providing high precision and reliability. This makes it possible to obtain a semiconductor acceleration sensor with high performance.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図乃至第3図は本発明の第1の実施例の半導体加速
度センサを示す図、第4図(a)乃至第4図(e)は同
半導体加速度センサの製造工程を示す図、第5図および
第6図は本発明の第2の実施例の半導体加速度センサを
示す図、第7図(a)乃至第7図(d)は同半導体加速
度センサの製造工程を示す図、第8図は本発明の第3の
実施例の半導体加速度センサを示す図、第9図は本発明
の第3の実施例の半導体加速度センサの変形例を示す図
、第10図および第11図は従来例の半導体加速度セシ
サを示す図である。 1・・・シリコン基板、   2.3・・・ガラス基板
4・・・肉薄領域、     5・・・ピエゾ抵抗6・
・・ピエゾ抵抗     7・・・振動部8・・・空間
        9・・・支持リング10・・・片持ち
梁 11・・・p+シリコン領域 12・・・多結晶シリコン層 13・・・第1の窒化シリコン膜 14・・・第2の窒化シリコン膜 15・・・幅広部、 19,21 PSG膜23・・・
支持部  24.25・・窒化シリコン膜26.27.
28・・・多結晶ンリコン層30・・・分離領域   
 32・酸化シリコン膜。 出願人代理人   三 好 秀 和 第1図 第5図 第8図
1 to 3 are diagrams showing a semiconductor acceleration sensor according to a first embodiment of the present invention, and FIGS. 4(a) to 4(e) are diagrams showing the manufacturing process of the semiconductor acceleration sensor. 5 and 6 are diagrams showing a semiconductor acceleration sensor according to a second embodiment of the present invention, FIGS. 7(a) to 7(d) are diagrams showing the manufacturing process of the semiconductor acceleration sensor, and FIG. The figure shows a semiconductor acceleration sensor according to a third embodiment of the present invention, FIG. 9 shows a modification of the semiconductor acceleration sensor according to a third embodiment of the present invention, and FIGS. 10 and 11 show a conventional example. FIG. 3 is a diagram illustrating an example semiconductor acceleration sensor. 1... Silicon substrate, 2.3... Glass substrate 4... Thin region, 5... Piezoresistor 6.
...Piezoresistance 7...Vibration part 8...Space 9...Support ring 10...Cantilever beam 11...P+ silicon region 12...Polycrystalline silicon layer 13...First Silicon nitride film 14... Second silicon nitride film 15... Wide portion, 19, 21 PSG film 23...
Support portion 24.25...Silicon nitride film 26.27.
28... Polycrystalline silicon layer 30... Separation region
32・Silicon oxide film. Applicant's agent Hidekazu Miyoshi Figure 1 Figure 5 Figure 8

Claims (1)

【特許請求の範囲】[Claims]  半導体基板から構成される固定部と、前記固定部上に
スペーサ層を介して積層され先端に質量部を有する多結
晶シリコンからなる片持ち梁と、さらにこの上層にスペ
ーサ層を介して形成された多結晶シリコン膜からなるキ
ャップ部とを具備し、前記キャップ部によって、前記片
持ち梁のまわりに形成された空間を多結晶シリコン膜で
閉じるようにしたことを特徴とする半導体加速度センサ
A fixed part made of a semiconductor substrate, a cantilever made of polycrystalline silicon laminated on the fixed part with a spacer layer interposed therebetween and having a mass part at the tip, and a cantilever made of polycrystalline silicon laminated on the fixed part with a spacer layer interposed therebetween. 1. A semiconductor acceleration sensor comprising: a cap portion made of a polycrystalline silicon film; the cap portion closes a space formed around the cantilever with the polycrystalline silicon film.
JP31804690A 1990-11-26 1990-11-26 Semiconductor acceleration sensor Pending JPH04192370A (en)

Priority Applications (1)

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JP31804690A JPH04192370A (en) 1990-11-26 1990-11-26 Semiconductor acceleration sensor

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