JP4704959B2 - Product management method and dangerous goods management method - Google Patents
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Description
本発明は、非接触でデータの送受信が可能である半導体装置に関し、特に当該半導体装置の通信距離を変化させることが可能となる半導体装置に関する。 The present invention relates to a semiconductor device capable of transmitting and receiving data without contact, and more particularly to a semiconductor device capable of changing a communication distance of the semiconductor device.
近年、個々の対象物にID(個体識別番号)を与えることで、その対象物の履歴等の情報を明確にし、生産・管理等に役立てるといった個体認識技術が注目されている。その中でも、非接触でデータの送受信が可能な半導体装置の開発が進められている。このような半導体装置として、RFID(Radio Frequency Identification)(IDタグ、ICタグ、ICチップ、RFタグ(Radio Frequency)、無線タグ、電子タグ、無線チップともよばれる)等が企業内、市場等で導入され始めている。 2. Description of the Related Art In recent years, attention has been focused on an individual recognition technique in which an ID (individual identification number) is given to an individual object to clarify information such as a history of the object and to be useful for production and management. Among them, development of semiconductor devices capable of transmitting and receiving data without contact is underway. As such a semiconductor device, RFID (Radio Frequency Identification) (ID tag, IC tag, IC chip, RF tag (Radio Frequency), wireless tag, electronic tag, also referred to as wireless chip) has been introduced in the company, the market, etc. Being started.
現在実用化されているRFID等の半導体装置の多くは、トランジスタ等から構成される回路を有する素子群(IC(Integrated Circuit)チップとも呼ばれる)とアンテナとして機能する導電膜とを有している。これらの半導体装置は、電磁波によってアンテナを介してリーダ/ライタ間とデータのやりとりを行うことができる。 Many of semiconductor devices such as RFID that are currently in practical use include an element group (also referred to as an IC (Integrated Circuit) chip) having a circuit including transistors and a conductive film functioning as an antenna. These semiconductor devices can exchange data with a reader / writer via an antenna using electromagnetic waves.
しかしながら、これらの半導体装置(RFIDとも記す)を商品に搭載した場合に、消費者のプライバシーが侵害される恐れも指摘されている(例えば、非特許文献1)。例えば、商品にRFIDが埋め込まれている場合、購入後にその商品を携帯している消費者の位置が追跡される可能性がある。また、ブランド品等の高級品にRFIDが埋め込まれている場合には、当該RFIDの情報を盗み見ることにより、一種の購買力の識別に用いられる可能性もある。さらには、第三者によって当該RFIDの情報が書き換えられる(偽造)される恐れもある。このように、商品にRFIDを搭載した場合、通信距離が長ければ長いほど流通過程における管理や監視には便利であるが、特定の個人に商品が渡った場合等には、通信距離が長ければ長いほど購入した商品の内容を第三者把握されたり、偽造されたりする恐れがある。 However, it has been pointed out that when these semiconductor devices (also referred to as RFID) are mounted on products, the privacy of consumers may be infringed (for example, Non-Patent Document 1). For example, if RFID is embedded in a product, the location of the consumer carrying the product may be tracked after purchase. In addition, when an RFID is embedded in a luxury product such as a brand product, there is a possibility that the RFID information may be used for identifying a kind of purchasing power by stealing information of the RFID. Furthermore, there is a possibility that information of the RFID is rewritten (forged) by a third party. Thus, when RFID is mounted on a product, the longer the communication distance is, the more convenient it is for management and monitoring in the distribution process. However, when the product reaches a specific individual, the communication distance is long. The longer the product is purchased, the more likely it is that the content of the purchased product will be understood by a third party or forged.
このような問題点への対策として、商品自体にはRFIDを埋め込まず、購入後に取り外せるように値札や包装紙等にRFIDを取り付ける等の対策が考えられる。しかし、タグを簡単に取り外すことができる場合には偽造や盗難等に対するセキュリティーの低下が懸念される。また、購入後に商品に埋め込まれているRFIDを破壊することにより外部からデータを読み取られないようにする等の対策も考えられるが、商品を破棄する際には有効となるが、商品購入後に、消費者や生産者がRFIDに含まれている商品の情報を活用することができなくなり、例えば、商品の修理やメンテナンスに有用な情報も失われることになる。
本発明は、商品に非接触でデータのやりとりが可能である半導体装置を搭載した場合であっても、当該商品の所有者のプライバシーを保護し、利用に応じて通信距離を制御可能な半導体装置を提供することを目的とする。 The present invention is a semiconductor device capable of protecting the privacy of the owner of the product and controlling the communication distance according to the use even when the product is equipped with a semiconductor device capable of exchanging data without contact. The purpose is to provide.
上記目的を達成するために本発明は以下の手段を講じる。 In order to achieve the above object, the present invention takes the following measures.
本発明の半導体装置は、基板上に設けられた複数のトランジスタを有する素子群と、素子群の上方に設けられたアンテナとして機能する第1の導電膜と第1の導電膜を囲んで配置された第2の導電膜とを有し、第1の導電膜は、コイル状に設けられ、第2の導電膜は、第1の端部と第2の端部を有し且つ第1の端部および第2の端部がスイッチング手段を介して環状に設けられていることを特徴としている。なお、本明細書でいう環状とは、導電膜の第1の端部と第2の端部とが直接接続されている状態はもちろん、導電膜の第1の端部と第2の端部が電気的に接続可能なもの(接続のオン/オフの制御が可能なものを含む)を介して接続されている状態をいう。 A semiconductor device of the present invention is disposed so as to surround an element group having a plurality of transistors provided over a substrate, a first conductive film functioning as an antenna provided above the element group, and the first conductive film. A second conductive film, the first conductive film is provided in a coil shape, the second conductive film has a first end and a second end, and the first end The second portion and the second end portion are provided in an annular shape through the switching means. Note that the term “annular” as used in this specification refers to a state where the first end and the second end of the conductive film are directly connected, as well as the first end and the second end of the conductive film. Is connected through an electrically connectable device (including a device that can control connection on / off).
また、本発明の半導体装置の他の構成として、基板上に設けられた複数のトランジスタを有する素子群と、素子群の上方に、アンテナとして機能する第1の導電膜と第1の端部および第2の端部を有し且つ第1の導電膜を囲んで配置された第2の導電膜と、第1の端部および第2の端部を覆うように絶縁膜を介して設けられた第3の導電膜とを有し、第1の導電膜は、コイル状に設けられ且つ第1の導電膜の両端部がそれぞれ複数のトランジスタと接続し、第2の導電膜は、第1の端部と第2の端部を有し且つ第1の端部と第2の端部が絶縁されて配置されていることを特徴としている。 As another structure of the semiconductor device of the present invention, an element group including a plurality of transistors provided over a substrate, a first conductive film functioning as an antenna, a first end portion, A second conductive film which has a second end portion and is disposed so as to surround the first conductive film; and is provided via an insulating film so as to cover the first end portion and the second end portion The first conductive film is provided in a coil shape, and both end portions of the first conductive film are connected to the plurality of transistors, respectively, and the second conductive film is formed of the first conductive film. It has an end portion and a second end portion, and the first end portion and the second end portion are insulated and arranged.
また、本発明の半導体装置の他の構成として、基板上に設けられた複数のトランジスタを有する素子群と、素子群の上方に、アンテナとして機能する第1の導電膜と第1の端部および第2の端部を有し且つ第1の導電膜を囲んで配置された第2の導電膜と、第1の端部および第2の端部を覆うように絶縁膜を介して設けられた第3の導電膜とを有し、第1の導電膜は、コイル状に設けられ且つ第1の導電膜の両端部がそれぞれ複数のトランジスタと接続し、第1の端部と第2の端部のいずれか一方と第3の導電膜とが電気的に接続し、他方が絶縁されていることを特徴としている。 As another structure of the semiconductor device of the present invention, an element group including a plurality of transistors provided over a substrate, a first conductive film functioning as an antenna, a first end portion, A second conductive film which has a second end portion and is disposed so as to surround the first conductive film; and is provided via an insulating film so as to cover the first end portion and the second end portion A first conductive film, the first conductive film is provided in a coil shape, and both ends of the first conductive film are connected to a plurality of transistors, respectively, and the first end and the second end One of the portions is electrically connected to the third conductive film, and the other is insulated.
また、本発明の半導体装置の他の構成として、基板上に設けられた複数のトランジスタを有する素子群と、素子群の上方に、アンテナとして機能する第1の導電膜と第1の導電膜を囲んで配置された第2の導電膜とを有し、第1の導電膜は、コイル状に設けられ且つ第1の導電膜の両端部がそれぞれ複数の薄膜トランジスタと接続し、第2の導電膜は、環状に設けられていることを特徴としている。 As another structure of the semiconductor device of the present invention, an element group including a plurality of transistors provided over a substrate, and a first conductive film and a first conductive film functioning as an antenna are provided above the element group. The first conductive film is provided in a coil shape, and both end portions of the first conductive film are connected to the plurality of thin film transistors, respectively, and the second conductive film is provided. Is characterized by being annularly provided.
本発明の半導体装置の他の構成としては、基板上に設けられた複数のトランジスタを有する素子群と、素子群の上方に設けられたアンテナとして機能する第1の導電膜と第1の導電膜を囲んで配置された第2の導電膜とを有し、第1の導電膜は、コイル状に設けられ、第2の導電膜は、第1の端部と第2の端部を有し且つ第1の端部および第2の端部がスイッチング手段を介して環状に設けられていることを特徴としている。 As another structure of the semiconductor device of the present invention, an element group including a plurality of transistors provided over a substrate, and a first conductive film and a first conductive film that function as an antenna provided above the element group A first conductive film is provided in a coil shape, and the second conductive film has a first end and a second end. In addition, the first end portion and the second end portion are provided in an annular shape via the switching means.
また、本発明の半導体装置の他の構成として、基板上に設けられた複数のトランジスタを有する素子群と、素子群の上方に設けられたアンテナとして機能する第1の導電膜と第1の導電膜を囲んで配置された第2の導電膜とを有し、第1の導電膜は、コイル状に設けられ、第2の導電膜は、第1の端部と第2の端部を有し且つ第1の端部および第2の端部が複数のトランジスタのいずれかのトランジスタを介して環状に設けられていることを特徴としている。 As another structure of the semiconductor device of the present invention, an element group having a plurality of transistors provided over a substrate, a first conductive film functioning as an antenna provided above the element group, and a first conductive film A second conductive film disposed around the film, the first conductive film is provided in a coil shape, and the second conductive film has a first end and a second end. In addition, the first end portion and the second end portion are provided in a ring shape through one of a plurality of transistors.
また、本発明の半導体装置の他の構成として、基板上に設けられた複数のトランジスタを有する素子群と、素子群の上方に設けられたアンテナとして機能する第1の導電膜と第1の導電膜を囲んで配置された複数の第2の導電膜とを有し、アンテナとして機能する第1の導電膜は、コイル状に設けられ、複数の第2の導電膜は各々、第1の端部と第2の端部を有し且つ第1の端部および第2の端部が前記複数のトランジスタのいずれかのトランジスタを介して環状に設けられていることを特徴としている。 As another structure of the semiconductor device of the present invention, an element group having a plurality of transistors provided over a substrate, a first conductive film functioning as an antenna provided above the element group, and a first conductive film A plurality of second conductive films disposed around the film, and the first conductive film functioning as an antenna is provided in a coil shape, and each of the plurality of second conductive films has a first end. And a second end portion, and the first end portion and the second end portion are provided in an annular shape through one of the plurality of transistors.
また、本発明の半導体装置は、上記構成において、素子群に記憶部が設けられており、前記記憶部は、第1の方向に延びた複数のビット線と、第1の方向と垂直な第2の方向に延びた複数のワード線と、記憶素子を備えたメモリセルと、複数の前記メモリセルからなるメモリセルアレイとを有し、記憶素子部は、ビット線を構成する導電膜とワード線を構成する導電膜との間に設けられた有機化合物層を有していることを特徴としている。 In the semiconductor device of the present invention having the above structure, a memory portion is provided in the element group, and the memory portion includes a plurality of bit lines extending in the first direction and a first line perpendicular to the first direction. A plurality of word lines extending in two directions, a memory cell including a storage element, and a memory cell array including the plurality of memory cells, wherein the storage element portion includes a conductive film and a word line forming a bit line It has the organic compound layer provided between the electrically conductive films which comprise this, It is characterized by the above-mentioned.
本発明の半導体装置は、通信距離の制御を行うことができるため、個人の利用に応じて半導体装置の通信距離を制御することによって、当該半導体装置が搭載された商品を購入した者のプライバシーを保護することが可能となる。 Since the semiconductor device of the present invention can control the communication distance, by controlling the communication distance of the semiconductor device according to personal use, the privacy of the person who purchased the product on which the semiconductor device is mounted can be protected. It becomes possible to protect.
本発明の実施の形態について、図面を用いて以下に説明する。但し、本発明は以下の説明に限定されず、本発明の趣旨及びその範囲から逸脱することなくその形態及び詳細を様々に変更し得ることは当業者であれば容易に理解される。従って、本発明は以下に示す実施の形態の記載内容に限定して解釈されるものではない。なお、以下に説明する本発明の構成において、同じものを指す符号は異なる図面間で共通して用いる場合がある。 Embodiments of the present invention will be described below with reference to the drawings. However, the present invention is not limited to the following description, and it is easily understood by those skilled in the art that modes and details can be variously changed without departing from the spirit and scope of the present invention. Therefore, the present invention should not be construed as being limited to the description of the embodiments below. Note that in the structures of the present invention described below, the same reference numerals may be used in common in different drawings.
(実施の形態1)
本実施の形態では、本発明の半導体装置の一例について図面を参照して説明する。
(Embodiment 1)
In this embodiment, an example of a semiconductor device of the present invention will be described with reference to drawings.
本実施の形態で示す半導体装置は、少なくとも基板401上に設けられた素子群402と、当該素子群402の上方に設けられたアンテナとして機能する導電膜403と、当該導電膜403を囲むように配置されたダミーパターンとなる導電膜404とを有している(図1(A))。また、アンテナとして機能する導電膜403は、コイル状に設けられ、当該導電膜403の両端部はそれぞれ素子群402に電気的に接続されている。また、導電膜404は、第1の端部405aと第2の端部405bとを有しており、第1の端部405aおよび第2の端部405bはそれぞれスイッチング手段410に接続し、スイッチング手段410を介して環状に設けられている(図1(B)、(C))。なお、本明細書でいう環状とは、導電膜404の第1の端部405aと第2の端部405bが直接接続されている状態はもちろん、第1の端部405aと第2の端部405bが電気的に接続可能なもの(ここではスイッチング手段410)を介して接続されている状態をいう。
The semiconductor device described in this embodiment includes at least an
基板401は、バリウムホウケイ酸ガラスや、アルミノホウケイ酸ガラスなどのガラス基板、石英基板、セラミック基板またはステンレスを含む金属基板等を用いることができる。また、Si等の半導体基板を用いてもよい。他にも、ポリエチレンテレフタレート(PET)、ポリエチレンナフタレート(PEN)、ポリエーテルサルフォン(PES)に代表されるプラスチックや、アクリル等の可撓性を有する合成樹脂からなる基板を用いることも可能である。可撓性を有する基板を用いることによって、折り曲げが可能である半導体装置を作製することが可能となる。また、このような基板であれば、その面積や形状に大きな制限はないため、基板401として、例えば、1辺が1メートル以上であって、矩形状のものを用いれば、生産性を格段に向上させることができる。このような利点は、円形のシリコン基板を用いる場合と比較すると、大きな優位点である。
As the
素子群402は、少なくともトランジスタを含んでおり、当該トランジスタによって、CPU、メモリまたはマイクロプロセッサ等のありとあらゆる集積回路を設けることができる。具体的に、素子群402を構成するトランジスタとしては、ガラスやプラスチック等からなる基板401上に薄膜トランジスタ(TFT)を形成したり、基板401としてSi等の半導体基板を用いて当該半導体基板をトランジスタのチャネル領域として用いた電界効果型トランジスタ(FET)を形成したりすることによって設けることができる。また、基板401としてSOI基板を用いて当該基板にトランジスタを形成することによって設けることも可能である。なお、SOI基板を用いる場合には、Siウェハの貼り合わせによる方法や酸素イオンをSi基板内に打ち込むことにより内部に絶縁層を形成するSIMOXと呼ばれる方法を用いて素子群のトランジスタを形成することができる。
The
導電膜403、導電膜404は、銅(Cu)、アルミニウム(Al)、銀(Ag)、金(Au)、クロム(Cr)、モリブデン(Mo)、チタン(Ti)、タンタル(Ta)、タングステン(W)およびニッケル(Ni)等の金属または金属化合物を1つまたは複数有する導電材料を用いて、スパッタ法やCVD方等の方法を用いて形成することができる。また、他にも、液滴吐出法(インクジェット法とも呼ばれる)やスクリーン印刷法等の印刷法を用いて導電性のペーストを用いて形成することができる。導電性のペーストとしては、粒径が数nmから数十μmの導電体粒子を有機樹脂に溶解または分散させたものを用いることができる。導電性粒子としては、銀(Ag)、金(Au)、銅(Cu)、ニッケル(Ni)、白金(Pt)、パラジウム(Pd)、タンタル(Ta)、モリブデン(Mo)およびチタン(Ti)等のいずれか一つ以上の金属粒子やハロゲン化銀の微粒子、または分散性ナノ粒子を用いることができる。また、導電性ペーストに含まれる有機樹脂は、金属粒子のバインダー、溶媒、分散剤および被覆材として機能する有機樹脂から選ばれた一つまたは複数を用いることができる。代表的には、エポキシ樹脂、珪素樹脂等の有機樹脂が挙げられる。また、導電膜の形成にあたり、ペーストを押し出した後に焼成することが好ましい。例えば、ペーストの材料として、銀を主成分とする微粒子(例えば粒径1nm以上100nm以下)を用いる場合、150〜300℃の温度範囲で焼成することにより硬化させて導電膜を得ることができる。また、導電膜403と導電膜404は、上記方法を用いて同時に形成することもできるし、別々に形成することもできる。
The
スイッチング手段410は、ダミーパターンとなる導電膜404の第1の端部405aと第2の端部405bと接続しており、第1の端部405aと第2の端部405bとの電気的な接続を切り換える(オン/オフする)手段を有している。スイッチング手段410としては、導電膜404の第1の端部405aと第2の端部405bとの電気的な接続を切り換える手段を有していればどのような構造で設けてもよい。また、スイッチング手段410は、電気的な接続の切り替えを1回のみ行える構造で設けることもできるし、複数回行える構造で設けることもできる。
The switching means 410 is connected to the
本実施の形態で示す半導体装置では、スイッチング手段410を用いて導電膜404の第1の端部405aと第2の端部405bとの電気的な接続を切り換えることにより、当該半導体装置の通信距離の制御を行うことができる。以下に、導電膜403をコイル状に設けた電磁結合方式または電磁誘導方式を用いた場合に関して説明する。
In the semiconductor device described in this embodiment, the switching distance is used to switch the electrical connection between the
一般的に、電磁結合方式または電磁誘導方式を用いる場合、外部機器(リーダ/ライタ)から送られてきた電磁波を利用して、素子群402において電源電圧を生成し情報のやりとりを行う。そのため、図3に示すように、コイル状に設けられた導電膜403や環状(導電膜404の第1の端部405aと第2の端部405bが直接接続されている場合、または第1の端部405aと第2の端部405bがスイッチング手段を介して電気的に接続している場合(スイッチング手段410がオンの場合))に設けられた導電膜404に囲まれた領域で磁界が発生すると(図3においては紙面上→下方向)、導電膜403および導電膜404には発生した磁界を打ち消すように電流が生じる。
In general, when an electromagnetic coupling method or an electromagnetic induction method is used, a power supply voltage is generated in the
例えば、半導体装置にリーダ/ライタから電磁波が送られてきた場合、半導体装置はアンテナとして機能する導電膜403を介して素子群402に電源電圧や信号を供給する。一方、ダミーパターンとなる導電膜404にも電磁波が送られ磁界が変化している間に導電膜404に電流が流れ続けるが、この導電膜404に生じた電流によってリーダ/ライタから送られてきた電磁波を打ち消すように磁界(紙面下→上方向)が発生する。また、半導体装置からリーダ/ライタに電磁波を送る際にも、同様に導電膜404の存在により当該電磁波を打ち消すように磁界が発生する。
For example, when an electromagnetic wave is transmitted from a reader / writer to the semiconductor device, the semiconductor device supplies a power supply voltage and a signal to the
その結果、リーダ/ライタから送られてくる磁界または半導体装置から送る磁界が導電膜404に生じた電流によって発生した磁界に打ち消されるため通信距離が低下する。逆に、導電膜404の第1の端部405aと第2の端部405bが環状でない場合、または第1の端部405aと第2の端部405bがスイッチング手段410を介して環状に設けられている場合であっても電気的に接続していない場合(スイッチング手段410がオフの状態)には、磁界の変化によって導電膜404に電流が流れ続けないため、通信距離が低下することはない。
As a result, the communication distance is reduced because the magnetic field sent from the reader / writer or the magnetic field sent from the semiconductor device is canceled by the magnetic field generated by the current generated in the
このように、スイッチング手段410のオン/オフにより半導体装置の通信距離を制御することができる。スイッチング手段としては、上述したように、導電膜404の第1の端部405aと第2の端部405bとの電気的な接続を切り換える手段を有していればどのような構造で設けてもよく、例えば、トランジスタ、メカニカルスイッチ、メンブレンスイッチ、導電ゴムスイッチ、静電容量スイッチ等を用いることができる。
Thus, the communication distance of the semiconductor device can be controlled by turning on / off the switching means 410. As described above, the switching means may have any structure as long as it has means for switching the electrical connection between the
スイッチング手段410として、トランジスタを用いた場合について図面を参照して以下に説明する。トランジスタとしては、ガラスやプラスチック等からなる基板上に形成した薄膜トランジスタ(TFT)や、Si等の半導体基板を用いて当該半導体基板をトランジスタのチャネル領域として用いた電界効果型トランジスタ(FET)等を用いることができるが、ここでは薄膜トランジスタを用いた場合に関して説明する。 The case where a transistor is used as the switching means 410 will be described below with reference to the drawings. As the transistor, a thin film transistor (TFT) formed on a substrate made of glass, plastic, or the like, a field effect transistor (FET) using a semiconductor substrate such as Si and using the semiconductor substrate as a channel region of the transistor, or the like is used. However, a case where a thin film transistor is used will be described here.
トランジスタ410aをスイッチング手段として用いた場合(図2(A))、導電膜404の第1の端部405aおよび第2の端部405bのいずれか一方を、トランジスタ410aのソース領域と電気的に接続するように設け、他方をトランジスタ410aのドレイン領域と電気的に接続するように設けことができる(図2(B))。また、トランジスタ410aは、素子群402と同一の層に設けることができる(図2(C))。この場合、素子群402を構成するトランジスタ409とスイッチング手段として機能するトランジスタ410aを同時に形成することができる。
In the case where the
トランジスタ410aのゲート電極に電圧が加えられている場合(トランジスタ410aがオンの場合)、トランジスタ410aのソース領域およびドレイン領域間を介して接続された導電膜404に電流が流れるため、リーダ/ライタから電磁波が送られてきた際にはそれに伴う磁界の変化を打ち消すように電流が流れ通信距離を低下させることができる。
When voltage is applied to the gate electrode of the
記憶部の不揮発性のメモリを用いてトランジスタのオン/オフを制御することが可能である。つまり、ある時点でのトランジスタのオン・オフのいずれかの状態であるかを不揮発性のメモリに記憶させておくことができる。また、トランジスタのゲート電極に電圧を加え続ける手段としては、トランジスタのゲート電極に容量素子や強誘電体材料(例えば、PZT(ジルコン酸チタン酸鉛)等のペロブスカイト化合物や、SBZ(チタン酸バリウム・ストロンチウム)等の層状ペロブスカイト化合物等)を接続することによって行うことができる。また、電源(バッテリー)をトランジスタのゲート電極と接続することによって、トランジスタに電圧を加え続けることも可能である。 The on / off state of the transistor can be controlled using a nonvolatile memory in the memory portion. That is, it is possible to store in the nonvolatile memory whether the transistor is on or off at a certain time. As means for continuously applying a voltage to the gate electrode of the transistor, a capacitive element or a ferroelectric material (for example, a perovskite compound such as PZT (lead zirconate titanate)), SBZ (barium titanate, It can be carried out by connecting a layered perovskite compound such as strontium). Further, by connecting a power source (battery) to the gate electrode of the transistor, voltage can be continuously applied to the transistor.
スイッチング手段として、上述した方法の他にも、導電膜404の第1の端部405aと第2の端部405bとを接続する構造を用いることができる。その具体例について、図5を用いて以下に説明する。
As a switching means, in addition to the above-described method, a structure in which the
図5に示す半導体装置は、少なくとも基板401上に設けられた素子群402と、当該素子群402の上方に設けられたアンテナとして機能する導電膜403と、当該導電膜403を囲むように配置された第1の端部405aと第2の端部405bを含む導電膜404とを有し、当該導電膜404の上方に絶縁膜406を介して導電膜407が設けられている(図5(A)、(B))。なお、絶縁膜406は全面に形成してもよいし、導電膜404の第1の端部405aおよび第2の端部405bを覆う部分のみ選択的に形成してもよい。
The semiconductor device illustrated in FIG. 5 is arranged so as to surround at least the
絶縁膜406は、CVD法やスパッタ法等を用いて、酸化珪素(SiOx)、窒化珪素(SiNx)、酸化窒化珪素(SiOxNy)(x>y)、窒化酸化珪素(SiNxOy)(x>y)等の酸素または窒素を有する絶縁膜やDLC(ダイヤモンドライクカーボン)等の炭素を含む膜等で設けることができる。また、他にも液滴吐出法、スクリーン印刷法またはスピンコート法等エポキシ、ポリイミド、ポリアミド、ポリビニルフェノール、ベンゾシクロブテン、アクリル等の有機材料、シロキサン系材料等の単層または積層構造で設けることができる。
The insulating
導電膜407は、銅(Cu)、アルミニウム(Al)、銀(Ag)、金(Au)、クロム(Cr)、モリブデン(Mo)、チタン(Ti)、タンタル(Ta)、タングステン(W)およびニッケル(Ni)等の金属または金属化合物を1つまたは複数有する導電材料を用いて、スパッタ法やCVD方等の方法を用いて形成することができる。また、他にも、液滴吐出法やスクリーン印刷法等の印刷法を用いて導電性のペーストを用いて形成することができる。導電性のペーストとしては、粒径が数nmから数十μmの導電体粒子を有機樹脂に溶解または分散させたものを用いることができる。導電性粒子としては、銀(Ag)、金(Au)、銅(Cu)、ニッケル(Ni)、白金(Pt)、パラジウム(Pd)、タンタル(Ta)、モリブデン(Mo)およびチタン(Ti)等のいずれか一つ以上の金属粒子やハロゲン化銀の微粒子、または分散性ナノ粒子を用いることができる。また、導電性ペーストに含まれる有機樹脂は、金属粒子のバインダー、溶媒、分散剤および被覆材として機能する有機樹脂から選ばれた一つまたは複数を用いることができる。代表的には、エポキシ樹脂、珪素樹脂等の有機樹脂が挙げられる。また、導電膜の形成にあたり、ペーストを押し出した後に焼成することが好ましい。例えば、ペーストの材料として、銀を主成分とする微粒子(例えば粒径1nm以上100nm以下)を用いる場合、150〜300度の温度範囲で焼成することにより硬化させて導電膜を得ることができる。
The
図5(B)に示す半導体装置は、導電膜404の両端部(第1の端部405aと第2の端部405b)が接続されていない。つまり、導電膜404が環状となっていないため、リーダ/ライタから電磁波が送られてきた場合であっても、導電膜404には電流が流れないため、半導体装置の通信距離は低下しない。
In the semiconductor device illustrated in FIG. 5B, both end portions (the
一方、導電膜404の第1の端部405aおよび第2の端部405bの各々と、導電膜407を電気的に接続させることによって、第1の端部405aと第2の端部405bが導電膜407を介して電気的に接続され、その結果、導電膜404を環状とみなすことができる(図5(C)、(D))。この場合、リーダ/ライタから電磁波が送られてきた際(磁界の変化が生じた際)、上述したように導電膜404に生じる電流によって、当該電磁波が弱められるため、半導体装置の通信距離が短くなる。通信距離の減衰は、導電膜404の形状や断面積によるため、実施者が適宜導電膜404の形状や断面積を選択することによって、通信距離を制御することができる。例えば、通信距離をゼロ(接触しないと半導体装置のデータを読み取れない状態)とすることも可能である。
On the other hand, each of the
第1の端部405aおよび第2の端部405bの各々と導電膜407とを接続する方法としては、レーザ光の照射や導電性を有する針等を物理的に押し込む手段等を用いることができる。具体的には、レーザ光の照射を用いた場合、第1の端部405aと第2の端部405bの上方に位置する導電膜407にそれぞれ選択的にレーザ光を照射することによって、導電膜407と絶縁膜406を溶融させて第1の端部405aと第2の端部405bの各々と導電膜407とを電気的に接続することができる(図5(C))。一方、導電性を有する針を物理的に押し込む方法を用いる場合には、第1の端部405aと第2の端部405bの上方に位置する導電膜407にそれぞれ選択的に導電性を有する針等を導電膜407、絶縁膜406および導電膜404の一部を貫通させるように押し込むことによって、第1の端部405aと第2の端部405bの各々と導電膜407とを電気的に接続することができる(図5(D))。
As a method for connecting each of the
また、あらかじめ導電膜404の第1の端部405aと第2の端部405bのうちいずれか一方を導電膜407と電気的に接続させておいてもよい。導電膜404の第1の端部405aと第2の端部405bのいずれか一方のみが導電膜407と電気的に接続している場合であっても、導電膜404が環状となっていないため、半導体装置の通信距離に影響がない。この場合、導電膜404の第1の端部405aと第2の端部405bのうち導電膜407と電気的に接続していない一方を接続させるだけで通信距離を低下させることが可能となる。
In addition, one of the
また、図5に示した半導体装置は、1回に限って通信距離が長い状態から短い状態に変えることができる。これは、外部から第三者に半導体装置の情報を盗み見られることを防止する時に有効となる。例えば、商品に半導体装置を搭載した場合、消費者の手に渡るまでの間は、商品の管理や監視等のため通信距離を長くしておく必要があるが、消費者に商品が渡った際には通信距離を短くして消費者の意志によってのみ商品の情報を表示できればよい。従って、消費者が商品を購入した際に、図5(C)、(D)に示したように、導電膜404の第1の端部405aと第2の端部405bを電気的に接続して半導体装置の通信距離を短くすることによって、外部から商品の情報を盗まれることを抑制し、プライバシーの侵害を防止することができる。特に、通信距離をゼロ(接触しないと半導体装置の情報を読み取れない状態)にすることによって、限りなく第三者に情報を盗み見られることを防止できる。
In addition, the semiconductor device illustrated in FIG. 5 can be changed from a long communication distance to a short state only once. This is effective for preventing information on the semiconductor device from being stolen from outside by a third party. For example, when a semiconductor device is mounted on a product, it is necessary to increase the communication distance for product management or monitoring until the product reaches the consumer. It is only necessary to shorten the communication distance and display product information only at the consumer's will. Therefore, when a consumer purchases a product, as shown in FIGS. 5C and 5D, the
また、上記構成において、導電膜404およびスイッチング手段410は複数設けることができる(図4(A)、(B))。具体的には、導電膜403を囲むように、各々の両端部がそれぞれスイッチング手段410に接続するように複数の導電膜404を設ける。スイッチング手段410としては、上述したいずれかの手段を用いることが可能である。例えば、複数の導電膜404の各々の両端部に、それぞれトランジスタ410aを設け、当該複数のトランジスタ410aを制御することによって、半導体装置の通信距離を段階的に制御することができる。また、図4に示した方法を用いた場合、1回に限らず複数回に分けて、段階的に通信距離を制御することができるため、消費者の利用形態に応じて通信距離を変化させることができる。
In the above structure, a plurality of the
(実施の形態2)
本実施の形態では、上記実施の形態とは異なる半導体装置に関して図面を参照して説明する。具体的には、スイッチング手段として物理的な手段を用いて、半導体装置の通信距離を制御する方法に関して説明する。
(Embodiment 2)
In this embodiment, a semiconductor device different from that in the above embodiment is described with reference to drawings. Specifically, a method for controlling a communication distance of a semiconductor device using a physical means as a switching means will be described.
本実施の形態で示す半導体装置は、少なくとも基板401上に設けられた素子群402と、当該素子群402の上方に設けられたアンテナとして機能する導電膜403と、当該導電膜403を囲むように配置されたダミーパターンとなる導電膜404とを有している(図6(A))。また、アンテナとして機能する導電膜403は、コイル状に設けられ、当該導電膜403の両端部はそれぞれ素子群402に電気的に接続されている。導電膜404は、環状(上述した第1の端部405aと第2の端部405bとが直接接続した状態)に設けられている。
The semiconductor device described in this embodiment includes at least an
図6(A)に示す半導体装置は、リーダ/ライタから電磁波が送られてきた場合、上述したように環状に設けられた導電膜404の存在により通信距離が短くなる。しかしながら、導電膜404の一部を除去して導電膜404を非環状とした場合には、上述したように、半導体装置の通信距離を長くすることができる(図6(B))。導電膜404の除去する方法としては、レーザ光を選択的に照射することによって行うことが可能である。レーザ光以外にも、物理的に導電膜404を切断する方法を用いることもできる。本実施の形態の半導体装置は、1回に限って通信距離が短い状態から長い状態に変えることができる。これは例えば、危険物や産業廃棄物等の簡単には破棄できないモノに取り付けることによって、当該モノを管理または監視する際に利用することができる。
In the semiconductor device illustrated in FIG. 6A, when an electromagnetic wave is transmitted from a reader / writer, the communication distance is shortened due to the presence of the
なお、本実施の形態は上記実施の形態1と自由に組み合わせて実施することができる。 Note that this embodiment mode can be freely combined with Embodiment Mode 1.
(実施の形態3)
本実施の形態では、上記実施の形態とは異なる半導体装置に関して図面を参照して説明する。具体的には、アンテナとして機能する導電膜と素子群との接続をスイッチング手段を介して行う方法に関して説明する。
(Embodiment 3)
In this embodiment, a semiconductor device different from that in the above embodiment is described with reference to drawings. Specifically, a method for connecting a conductive film functioning as an antenna and an element group via a switching unit will be described.
本実施の形態で示す半導体装置は、少なくとも基板401上に設けられた素子群402と、当該素子群402の上方に設けられたアンテナとして機能する導電膜403と、当該導電膜403を囲むように配置されたダミーパターンとなる導電膜404とを有している(図7(A)、(B))。また、アンテナとして機能する導電膜403は、コイル状に設けられ、当該導電膜403の一方の端部421は、スイッチング手段420を介して素子群402と接続している。
The semiconductor device described in this embodiment includes at least an
スイッチング手段420としては、上記実施の形態1で示したスイッチング手段のいずれかの構成を用いることができる。例えば、スイッチング手段420としてトランジスタを用いた場合には、トランジスタがオンしている場合には、半導体装置はリーダ/ライタと通信することが可能であるが、トランジスタがオフになった場合には半導体装置はリーダ/ライタと通信することができなくなる。これは、商品に搭載された半導体装置の情報が不要となった場合に有効となる。一方、上記図5で示したように、物理的手段を用いて導電膜403の一方の端部421と素子群402とを接続する構成としてもよい。この場合、導電膜403の一方の端部421と素子群402とを接続する前は半導体装置の情報を非接触で読み取ることはできないが、接続後には、半導体装置の情報を非接触で読み取ることが可能となる。
As the switching means 420, any of the configurations of the switching means shown in the first embodiment can be used. For example, when a transistor is used as the switching means 420, the semiconductor device can communicate with the reader / writer when the transistor is on, but the semiconductor device can communicate with the reader / writer when the transistor is off. The device cannot communicate with the reader / writer. This is effective when information on a semiconductor device mounted on a product is no longer necessary. On the other hand, as shown in FIG. 5 above, one
また、スイッチング手段として、上記実施の形態2で示したように、導電膜403の一方の端部421と素子群402をと接続しているスイッチング手段420を除去した場合には、半導体装置は外部との通信が不可能となる。これは、商品に設けた半導体装置の情報が不要となった場合や上記実施の形態2で示した場合であって半導体装置の情報が不要になった場合等に有効となる。
As the switching means, as shown in Embodiment Mode 2, when the switching means 420 connecting the one
なお、本実施の形態は上記実施の形態1〜2と自由に組み合わせて実施することができる。 Note that this embodiment mode can be freely combined with Embodiment Modes 1 and 2 described above.
(実施の形態4)
本実施の形態では、薄膜トランジスタおよびアンテナを含む本発明の半導体装置の作製方法の一例について、図面を参照して説明する。
(Embodiment 4)
In this embodiment, an example of a method for manufacturing a semiconductor device of the present invention including a thin film transistor and an antenna will be described with reference to drawings.
まず、基板701の表面に剥離層702を形成し、その後当該剥離層702上に絶縁膜703を介して非晶質半導体膜704(例えば非晶質珪素を含む膜)を形成する(図8(A))。
First, a
基板701は、ガラス基板、石英基板、金属基板やステンレス基板の一表面に絶縁膜を形成したもの、本工程の処理温度に耐えうる耐熱性があるプラスチック基板等を用いるとよい。このような基板701であれば、その面積や形状に大きな制限はないため、基板701として、例えば、1辺が1メートル以上であって、矩形状のものを用いることによって、生産性を格段に向上させることができる。このような利点は、円形のシリコン基板を用いる場合と比較すると、大きな優位点である。なお、本工程では、剥離層702は、基板701の全面に設けているが、必要に応じて、基板701の全面に剥離層を設けた後に、フォトリソグラフィ法によりエッチングして、選択的に設けてもよい。また、基板701に接するように剥離層702を形成しているが、必要に応じて、基板701に接するように下地となる絶縁膜を形成し、当該絶縁膜に接するように剥離層702を形成してもよい。
As the
剥離層702は、金属膜や金属膜と金属酸化膜の積層構造等を用いることができる。金属膜としては、タングステン(W)、モリブデン(Mo)、チタン(Ti)、タンタル(Ta)、ニオブ(Nb)、ニッケル(Ni)、コバルト(Co)、ジルコニウム(Zr)、亜鉛(Zn)、ルテニウム(Ru)、ロジウム(Rh)、パラジウム(Pd)、オスミウム(Os)、イリジウム(Ir)から選択された元素または前記元素を主成分とする合金材料若しくは化合物材料からなる膜を単層又は積層して形成する。また、これらの材料は、スパッタ法やプラズマCVD法等の各種CVD法等を用いて形成することができる。金属膜と金属酸化膜の積層構造としては、上述した金属膜を形成した後に、酸素雰囲気化におけるプラズマ処理、酸素雰囲気化における加熱処理を行うことによって、金属膜表面に当該金属膜の酸化物を設けることができる。例えば、金属膜としてスパッタ法により形成したタングステン膜を設けた場合、タングステン膜にプラズマ処理を行うことによって、タングステン膜表面にタングステン酸化物からなる金属酸化膜を形成することができる。また、この場合、タングステンの酸化物は、WOxで表され、Xは2〜3であり、Xが2の場合(WO2)、Xが2.5の場合(W2O5)、Xが2.75の場合(W4O11)、Xが3の場合(WO3)などがある。タングステンの酸化物を形成するにあたり、上記に挙げたXの値に特に制約はなく、エッチングレート等を基に、どの酸化物を形成するかを決めるとよい。また、プラズマ処理の条件として、例えば、高周波(マイクロ波等)を用いて高密度(好ましくは、1×1011cm−3以上1×1013cm−3以下)、且つ低電子温度(好ましくは0.5eV以上1.5eV以下)の条件下(以下、「高密度プラズマ」とも記す)で行うことにより、金属膜表面に酸化膜を形成することも可能である。また、金属酸化膜の他にも、金属窒化物や金属酸化窒化物を用いてもよい。この場合、金属膜に窒素雰囲気下または窒素と酸素雰囲気下でプラズマ処理や加熱処理を行えばよい。プラズマ処理の条件としては、上記と同様にして行うことが可能である。
For the
絶縁膜703は、スパッタ法やプラズマCVD法等により、珪素の酸化物または珪素の窒化物を含む膜を、単層又は積層で形成する。下地となる絶縁膜が2層構造の場合、例えば、1層目として窒化酸化珪素膜を形成し、2層目として酸化窒化珪素膜を形成するとよい。下地となる絶縁膜が3層構造の場合、1層目の絶縁膜として酸化珪素膜を形成し、2層目の絶縁膜として窒化酸化珪素膜を形成し、3層目の絶縁膜として酸化窒化珪素膜を形成するとよい。または、1層目の絶縁膜として酸化窒化珪素膜を形成し、2層目の絶縁膜として窒化酸化珪素膜を形成し、3層目の絶縁膜として酸化窒化珪素膜を形成するとよい。下地となる絶縁膜は、基板701からの不純物の侵入を防止するブロッキング膜として機能する。
The insulating
非晶質半導体膜704は、スパッタ法、LPCVD法、プラズマCVD法等により、25〜200nm(好ましくは30〜150nm)の厚さで形成する。
The
次に、非晶質半導体膜704を結晶化法(レーザ結晶化法、RTA又はファーネスアニール炉を用いる熱結晶化法、結晶化を助長する金属元素を用いる熱結晶化法、結晶化を助長する金属元素を用いる熱結晶化法とレーザ結晶化法を組み合わせた方法等)により結晶化して、結晶質半導体膜を形成する。その後、得られた結晶質半導体膜を所望の形状にエッチングして、結晶質半導体膜706〜710を形成する(図8(B))。
Next, the
結晶質半導体膜706〜710の作製工程の一例を以下に簡単に説明すると、まず、プラズマCVD法を用いて、膜厚66nmの非晶質半導体膜を形成する。次に、結晶化を助長する金属元素であるニッケルを含む溶液を非晶質半導体膜上に保持させた後、非晶質半導体膜に脱水素化の処理(500℃、1時間)と、熱結晶化の処理(550℃、4時間)を行って結晶質半導体膜を形成する。その後、必要に応じてレーザ光を照射し、フォトリソグラフィ法を用いることによって結晶質半導体膜706〜710を形成する。
An example of a manufacturing process of the
連続発振型のレーザビーム(CWレーザビーム)やパルス発振型のレーザビーム(パルスレーザビーム)を用いることができる。ここで用いることができるレーザビームは、Arレーザ、Krレーザ、エキシマレーザなどの気体レーザ、単結晶のYAG、YVO4、フォルステライト(Mg2SiO4)、YAlO3、GdVO4、若しくは多結晶(セラミック)のYAG、Y2O3、YVO4、YAlO3、GdVO4に、ドーパントとしてNd、Yb、Cr、Ti、Ho、Er、Tm、Taのうち1種または複数種添加されているものを媒質とするレーザ、ガラスレーザ、ルビーレーザ、アレキサンドライトレーザ、Ti:サファイアレーザ、銅蒸気レーザまたは金蒸気レーザのうち一種または複数種から発振されるものを用いることができる。このようなレーザビームの基本波、及びこれらの基本波の第2高調波から第4高調波のレーザビームを照射することで、大粒径の結晶を得ることができる。例えば、Nd:YVO4レーザ(基本波1064nm)の第2高調波(532nm)や第3高調波(355nm)を用いることができる。このときレーザのエネルギー密度は0.01〜100MW/cm2程度(好ましくは0.1〜10MW/cm2)が必要である。そして、走査速度を10〜2000cm/sec程度として照射する。なお、単結晶のYAG、YVO4、フォルステライト(Mg2SiO4)、YAlO3、GdVO4、若しくは多結晶(セラミック)のYAG、Y2O3、YVO4、YAlO3、GdVO4に、ドーパントとしてNd、Yb、Cr、Ti、Ho、Er、Tm、Taのうち1種または複数種添加されているものを媒質とするレーザ、Arイオンレーザ、またはTi:サファイアレーザは、連続発振をさせることが可能であり、Qスイッチ動作やモード同期などを行うことによって10MHz以上の発振周波数でパルス発振をさせることも可能である。10MHz以上の発振周波数でレーザビームを発振させると、半導体膜がレーザによって溶融してから固化するまでの間に、次のパルスが半導体膜に照射される。従って、発振周波数が低いパルスレーザを用いる場合と異なり、半導体膜中において固液界面を連続的に移動させることができるため、走査方向に向かって連続的に成長した結晶粒を得ることができる。 A continuous wave laser beam (CW laser beam) or a pulsed laser beam (pulse laser beam) can be used. The laser beam that can be used here is a gas laser such as an Ar laser, a Kr laser, or an excimer laser, single crystal YAG, YVO 4 , forsterite (Mg 2 SiO 4 ), YAlO 3 , GdVO 4 , or polycrystalline ( (Ceramics) YAG, Y 2 O 3 , YVO 4 , YAlO 3 , GdVO 4 with one or more of Nd, Yb, Cr, Ti, Ho, Er, Tm, Ta added as dopants A laser oscillated from one or more of laser, glass laser, ruby laser, alexandrite laser, Ti: sapphire laser, copper vapor laser, or gold vapor laser as a medium can be used. By irradiating the fundamental wave of such a laser beam and the second to fourth harmonic laser beams of these fundamental waves, a crystal having a large grain size can be obtained. For example, a second harmonic (532 nm) or a third harmonic (355 nm) of an Nd: YVO 4 laser (fundamental wave 1064 nm) can be used. Energy density of the laser is about 0.01 to 100 MW / cm 2 (preferably 0.1 to 10 MW / cm 2) is required. Then, irradiation is performed at a scanning speed of about 10 to 2000 cm / sec. Note that single crystal YAG, YVO 4 , forsterite (Mg 2 SiO 4 ), YAlO 3 , GdVO 4 , or polycrystalline (ceramic) YAG, Y 2 O 3 , YVO 4 , YAlO 3 , GdVO 4 , dopants Nd, Yb, Cr, Ti, Ho, Er, Tm, Ta, a laser using a medium added with one or more, an Ar ion laser, or a Ti: sapphire laser should oscillate continuously It is also possible to perform pulse oscillation at an oscillation frequency of 10 MHz or more by performing Q switch operation, mode synchronization, or the like. When the laser beam is oscillated at an oscillation frequency of 10 MHz or more, the semiconductor film is irradiated with the next pulse during the period from when the semiconductor film is melted by the laser to solidification. Therefore, unlike the case of using a pulse laser having a low oscillation frequency, the solid-liquid interface can be continuously moved in the semiconductor film, so that crystal grains continuously grown in the scanning direction can be obtained.
また、結晶化を助長する金属元素を用いて非晶質半導体膜の結晶化を行うと、低温で短時間の結晶化が可能となるうえ、結晶の方向が揃うという利点がある一方、金属元素が結晶質半導体膜に残存するためにオフ電流が上昇し、特性が安定しないという欠点がある。そこで、結晶質半導体膜上に、ゲッタリングサイトとして機能する非晶質半導体膜を形成するとよい。ゲッタリングサイトとなる非晶質半導体膜には、リンやアルゴンの不純物元素を含有させる必要があるため、好適には、アルゴンを高濃度に含有させることが可能なスパッタ法で形成するとよい。その後、加熱処理(RTA法やファーネスアニール炉を用いた熱アニール等)を行って、非晶質半導体膜中に金属元素を拡散させ、続いて、当該金属元素を含む非晶質半導体膜を除去する。そうすると、結晶質半導体膜中の金属元素の含有量を低減又は除去することができる。 In addition, when an amorphous semiconductor film is crystallized using a metal element that promotes crystallization, it is possible to perform crystallization at a low temperature for a short time, and the crystal orientation is aligned. Remains in the crystalline semiconductor film, so that the off-current increases and the characteristics are not stable. Therefore, an amorphous semiconductor film functioning as a gettering site is preferably formed over the crystalline semiconductor film. Since the amorphous semiconductor film serving as a gettering site needs to contain an impurity element such as phosphorus or argon, it is preferably formed by a sputtering method which can contain argon at a high concentration. Then, heat treatment (RTA method or thermal annealing using a furnace annealing furnace) is performed to diffuse the metal element in the amorphous semiconductor film, and then the amorphous semiconductor film containing the metal element is removed. To do. Then, the content of the metal element in the crystalline semiconductor film can be reduced or removed.
次に、結晶質半導体膜706〜710を覆うゲート絶縁膜705を形成する。ゲート絶縁膜705は、プラズマCVD法やスパッタ法等により、珪素の酸化物又は珪素の窒化物を含む膜を、単層又は積層して形成する。具体的には、酸化珪素を含む膜、酸化窒化珪素を含む膜、窒化酸化珪素を含む膜を、単層又は積層して形成する。
Next, a
また、ゲート絶縁膜705は、結晶質半導体膜706〜710に対し前述の高密度プラズマ処理を行い、表面を酸化又は窒化することで形成しても良い。例えば、He、Ar、Kr、Xeなどの希ガスと、酸素、酸化窒素(NO2)、アンモニア、窒素、水素などの混合ガスを導入したプラズマ処理で形成する。この場合のプラズマの励起は、マイクロ波の導入により行うと、低電子温度で高密度のプラズマを生成することができる。この高密度プラズマで生成された酸素ラジカル(OHラジカルを含む場合もある)や窒素ラジカル(NHラジカルを含む場合もある)によって、半導体膜の表面を酸化又は窒化することができる。
Alternatively, the
このような高密度プラズマを用いた処理により、1〜20nm、代表的には5〜10nmの絶縁膜が半導体膜に形成される。この場合の反応は、固相反応であるため、当該絶縁膜と半導体膜との界面準位密度はきわめて低くすることができる。このような、高密度プラズマ処理は、半導体膜(結晶性シリコン、或いは多結晶シリコン)を直接酸化(若しくは窒化)するため、形成される絶縁膜の厚さは理想的には、ばらつきをきわめて小さくすることができる。加えて、結晶性シリコンの結晶粒界でも酸化が強くされることがないため、非常に好ましい状態となる。すなわち、ここで示す高密度プラズマ処理で半導体膜の表面を固相酸化することにより、結晶粒界において異常に酸化反応をさせることなく、均一性が良く、界面準位密度が低い絶縁膜を形成することができる。 By such treatment using high-density plasma, an insulating film with a thickness of 1 to 20 nm, typically 5 to 10 nm, is formed over the semiconductor film. Since the reaction in this case is a solid-phase reaction, the interface state density between the insulating film and the semiconductor film can be extremely low. Such high-density plasma treatment directly oxidizes (or nitrides) a semiconductor film (crystalline silicon or polycrystalline silicon), so that the thickness of the formed insulating film ideally has extremely small variation. can do. In addition, since oxidation is not strengthened even at the crystal grain boundaries of crystalline silicon, a very favorable state is obtained. That is, the surface of the semiconductor film is solid-phase oxidized by the high-density plasma treatment shown here, thereby forming an insulating film with good uniformity and low interface state density without causing an abnormal oxidation reaction at the grain boundaries. can do.
ゲート絶縁膜は、高密度プラズマ処理によって形成される絶縁膜のみを用いても良いし、それにプラズマや熱反応を利用したCVD法で酸化シリコン、酸窒化シリコン、窒化シリコンなどの絶縁膜を堆積し、積層させても良い。いずれにしても、高密度プラズマで形成した絶縁膜をゲート絶縁膜の一部又は全部に含んで形成されるトランジスタは、特性のばらつきを小さくすることができる。 As the gate insulating film, only an insulating film formed by high-density plasma treatment may be used, or an insulating film such as silicon oxide, silicon oxynitride, or silicon nitride is deposited by a CVD method using plasma or thermal reaction. , May be laminated. In any case, a transistor formed by including an insulating film formed by high-density plasma in part or all of the gate insulating film can reduce variation in characteristics.
次に、ゲート絶縁膜705上に、第1の導電膜と第2の導電膜とを積層して形成する。第1の導電膜は、プラズマCVD法やスパッタリング法等により、20〜100nmの厚さで形成する。第2の導電膜は、100〜400nmの厚さで形成する。第1の導電膜と第2の導電膜は、タンタル(Ta)、タングステン(W)、チタン(Ti)、モリブデン(Mo)、アルミニウム(Al)、銅(Cu)、クロム(Cr)、ニオブ(Nb)等から選択された元素又はこれらの元素を主成分とする合金材料若しくは化合物材料で形成する。または、リン等の不純物元素をドーピングした多結晶珪素に代表される半導体材料により形成する。第1の導電膜と第2の導電膜の組み合わせの例を挙げると、窒化タンタル(TaN)膜とタングステン(W)膜、窒化タングステン(WN)膜とタングステン膜、窒化モリブデン(MoN)膜とモリブデン(Mo)膜等が挙げられる。タングステンや窒化タンタルは、耐熱性が高いため、第1の導電膜と第2の導電膜を形成した後に、熱活性化を目的とした加熱処理を行うことができる。また、2層構造ではなく、3層構造の場合は、モリブデン膜とアルミニウム膜とモリブデン膜の積層構造を採用するとよい。
Next, a first conductive film and a second conductive film are stacked over the
次に、フォトリソグラフィ法を用いてレジストからなるマスクを形成し、ゲート電極とゲート線を形成するためのエッチング処理を行って、ゲート電極として機能する導電膜(ゲート電極とよぶことがある)716〜725を形成する。 Next, a resist mask is formed using a photolithography method, etching treatment for forming a gate electrode and a gate line is performed, and a conductive film functioning as a gate electrode (also referred to as a gate electrode) 716 ~ 725 are formed.
次に、フォトリソグラフィ法により、レジストからなるマスクを形成して、結晶質半導体膜706、708〜710に、イオンドープ法又はイオン注入法により、N型を付与する不純物元素を低濃度に添加して、N型不純物領域711、713〜715とチャネル形成領域780、782〜784を形成する。N型を付与する不純物元素は、15族に属する元素を用いれば良く、例えばリン(P)、砒素(As)を用いる。
Next, a resist mask is formed by photolithography, and an impurity element imparting N-type is added to the
次に、フォトリソグラフィ法によりレジストからなるマスクを形成して、結晶質半導体膜707に、P型を付与する不純物元素を添加して、P型不純物領域712とチャネル形成領域781を形成する。P型を付与する不純物元素は、例えばボロン(B)を用いる。
Next, a resist mask is formed by photolithography, and an impurity element imparting P-type conductivity is added to the
次に、ゲート絶縁膜705と導電膜716〜725を覆うように、絶縁膜を形成する。絶縁膜は、プラズマCVD法やスパッタ法等により、珪素、珪素の酸化物又は珪素の窒化物の無機材料を含む膜や、有機樹脂などの有機材料を含む膜を、単層又は積層して形成する。次に、絶縁膜を、垂直方向を主体とした異方性エッチングにより選択的にエッチングして、導電膜716〜725の側面に接する絶縁膜(サイドウォールともよばれる)739〜743を形成する(図8(C))。また、絶縁膜739〜743の作製と同時に、ゲート絶縁膜705がエッチングされた絶縁膜734〜738を形成する。絶縁膜739〜743は、後にLDD(Lightly Doped drain)領域を形成する際のドーピング用のマスクとして用いる。
Next, an insulating film is formed so as to cover the
次に、フォトリソグラフィ法により形成したレジストからなるマスクと、絶縁膜739〜743をマスクとして用いて、結晶質半導体膜706、708〜710にN型を付与する不純物元素を添加して、第1のN型不純物領域(LDD領域ともよぶ)727、729、731、733と、第2のN型不純物領域726、728、730、732とを形成する。第1のN型不純物領域727、729、731、733が含む不純物元素の濃度は、第2のN型不純物領域726、728、730、732の不純物元素の濃度よりも低い。上記工程を経て、N型の薄膜トランジスタ744、746〜748と、P型の薄膜トランジスタ745が完成する。
Next, an impurity element imparting n-type conductivity is added to the
なお、LDD領域を形成するためには、サイドウォールの絶縁膜をマスクとして用いる手法がある。サイドウォールの絶縁膜をマスクとして用いることによって、LDD領域の幅の制御が容易であり、また、LDD領域を確実に形成することができる。 In order to form the LDD region, there is a method using an insulating film on the sidewall as a mask. By using the sidewall insulating film as a mask, the width of the LDD region can be easily controlled, and the LDD region can be reliably formed.
続いて、薄膜トランジスタ744〜748を覆うように、絶縁膜を単層又は積層して形成する(図9(A))。薄膜トランジスタ744〜748を覆う絶縁膜は、SOG法、液滴吐出法等により、珪素の酸化物や珪素の窒化物等の無機材料、ポリイミド、ポリアミド、ベンゾシクロブテン、アクリル、エポキシ、シロキサン等の有機材料等により、単層又は積層で形成する。シロキサン系の材料とは、例えば、シリコンと酸素との結合で骨格構造が構成され、置換基に少なくとも水素を含む物質、又は、シリコンと酸素との結合で骨格構造が構成され、置換基にフッ素、アルキル基、芳香族炭化水素の少なくとも1つを含む物質に相当する。例えば、薄膜トランジスタ744〜748を覆う絶縁膜が3層構造の場合、1層目の絶縁膜749として酸化珪素を含む膜を形成し、2層目の絶縁膜750として樹脂を含む膜を形成し、3層目の絶縁膜751として窒化珪素を含む膜を形成するとよい。
Next, an insulating film is formed as a single layer or a stacked layer so as to cover the
なお、絶縁膜749〜751を形成する前、又は絶縁膜749〜751のうちの1つ又は複数の薄膜を形成した後に、半導体膜の結晶性の回復や半導体膜に添加された不純物元素の活性化、半導体膜の水素化を目的とした加熱処理を行うとよい。加熱処理には、熱アニール、レーザアニール法又はRTA法などを適用するとよい。
Note that before the insulating
次に、フォトリソグラフィ法により絶縁膜749〜751をエッチングして、N型不純物領域726、728〜732、P型不純物領域785を露出させるコンタクトホールを形成する。続いて、コンタクトホールを充填するように、導電膜を形成し、当該導電膜をパターン加工して、ソース配線又はドレイン配線として機能する導電膜752〜761を形成する。
Next, the insulating
導電膜752〜761は、プラズマCVD法やスパッタリング法等により、チタン(Ti)、アルミニウム(Al)、ネオジウム(Nd)から選択された元素、又はこれらの元素を主成分とする合金材料若しくは化合物材料で、単層又は積層で形成する。アルミニウムを主成分とする合金材料とは、例えば、アルミニウムを主成分としニッケルを含む材料、又は、アルミニウムを主成分とし、ニッケルと、炭素と珪素の一方又は両方とを含む合金材料に相当する。導電膜752〜761は、例えば、バリア膜とアルミニウムシリコン(Al−Si)膜とバリア膜の積層構造、バリア膜とアルミニウムシリコン(Al−Si)膜と窒化チタン(TiN)膜とバリア膜の積層構造を採用するとよい。なお、バリア膜とは、チタン、チタンの窒化物、モリブデン、又はモリブデンの窒化物からなる薄膜に相当する。アルミニウムやアルミニウムシリコンは抵抗値が低く、安価であるため、導電膜752〜761を形成する材料として最適である。また、上層と下層のバリア層を設けると、アルミニウムやアルミニウムシリコンのヒロックの発生を防止することができる。また、還元性の高い元素であるチタンからなるバリア膜を形成すると、結晶質半導体膜上に薄い自然酸化膜ができていたとしても、この自然酸化膜を還元し、結晶質半導体膜と良好なコンタクトをとることができる。
The
次に、導電膜752〜761を覆うように、絶縁膜762を形成する(図9(B))。絶縁膜762は、SOG法、液滴吐出法等を用いて、無機材料又は有機材料により、単層又は積層で形成する。また、絶縁膜762は、好適には、0.75μm〜3μmの厚さで形成する。
Next, an insulating
続いて、フォトリソグラフィ法により絶縁膜762をエッチングして、導電膜752を露出させるコンタクトホールを形成する。続いて、コンタクトホールを充填するように、導電膜を形成する。導電膜は、プラズマCVD法やスパッタリング法等を用いて、導電性材料により形成する。次に、導電膜をパターン加工して、導電膜765を形成する。なお、導電膜765は、アンテナとして機能する導電膜との接続部分となる。従って、好適には、導電膜765は、チタン、又はチタンを主成分とする合金材料若しくは化合物材料により、単層又は積層で形成するとよい。また、導電膜765を形成するためのフォトリソグラフィ工程においては、下層の薄膜トランジスタ744〜748にダメージを与えないために、ウエットエッチング加工を行うとよく、エッチング剤にはフッ化水素(HF)又はアンモニア過水を用いるとよい。
Subsequently, the insulating
次に、導電膜765に接し、アンテナとして機能する導電膜766a〜766dおよびダミーパターンとして機能する導電膜767を形成する(図10(A))。導電膜766a〜766dおよび導電膜767は、ここではスクリーン印刷法を用いて形成する。ここでは、銀(Ag)を含むペースト806をスキージ805を用いて開口部802から押し出し、その後50〜350度の加熱処理を行って導電膜766a〜766dおよび導電膜767を形成する。
Next,
次に、アンテナとして機能する導電膜766a〜766dおよび導電膜767を覆うように、SOG法、液滴吐出法等により、保護膜として機能する絶縁膜772を形成する(図10(B))。絶縁膜772は、DLC(ダイヤモンドライクカーボン)などの炭素を含む膜、窒化珪素を含む膜、窒化酸化珪素を含む膜、有機材料により形成し、好ましくはエポキシ樹脂により形成する。
Next, an insulating
次に、剥離層702が露出するように、フォトリソグラフィ法またはレーザ光の照射により絶縁膜をエッチングして、開口部773、774を形成する(図11(A))。
Next, the insulating film is etched by photolithography or laser light irradiation so that the
次に、基板701から素子形成層791の剥離を行う。素子形成層791の剥離は、素子形成層791に選択的にレーザ光を照射して開口部773、774を形成後(図11(A))、物理的な力を用いて行う。また、他の方法として開口部773、774を形成して剥離層702を露出させた後エッチング剤を導入することによって、剥離層702を除去した後に剥離を行ってもよい(図11(B))。エッチング剤は、フッ化ハロゲンまたはハロゲン間化合物を含む気体又は液体を使用する。例えば、フッ化ハロゲンを含む気体として三フッ化塩素(ClF3)を使用する。そうすると、素子形成層791は、基板701から剥離された状態となる。なお、素子形成層791とは、ここでは、薄膜トランジスタ744〜748、アンテナとして機能する導電膜766a〜766dを合わせたものとする。なお、剥離層702は、全て除去せず一部分を残存させてもよい。こうすることによって、エッチング剤の消費量を抑え剥離層の除去に要する処理時間を短縮することが可能となる。また、剥離層702の除去を行った後にも、基板701上に素子形成層791を保持しておくことが可能となる。
Next, the
素子形成層791が剥離された基板701は、コストの削減のために、再利用するとよい。また、絶縁膜772は、剥離層702を除去した後に、素子形成層791が飛散しないように形成したものである。素子形成層791は小さく薄く軽いために、剥離層702を除去した後は、基板701に密着していないために飛散しやすい。しかしながら、素子形成層791上に絶縁膜772を形成することで、素子形成層791に重みが付き、基板701からの飛散を防止することができる。また、素子形成層791単体では薄くて軽いが、絶縁膜772を形成することで、基板701から剥離した素子形成層791が応力等により巻かれた形状になることがなく、ある程度の強度を確保することができる。
The
次に、素子形成層791の一方の面を、第1のシート材775に接着させて基板701から完全に剥離する(図12(A))。剥離層702を全て除去せず一部を残した場合には、物理的手段を用いて基板701から素子形成層を剥離する。続いて、素子形成層791の他方の面に、第2のシート材776を設け、その後加熱処理と加圧処理の一方または両方を行って、第2のシート材776を貼り合わせる。また、第2のシート材776を設けると同時または設けた後に第1のシート材775を剥離し、代わりに第3のシート材777を設ける。そして、加熱処理と加圧処理の一方または両方を行って、第3のシート材777を貼り合わせる。そうすると、第2のシート材776と第3のシート材777により封止された半導体装置が完成する(図12(B))。
Next, one surface of the
なお、第1のシート材775と第2のシート材776によって封止を行っても良いが、基板701から素子形成層791を剥離するためのシート材と素子形成層791を封止するためのシート材に異なるシート材を用いる場合には、上述したように、第2のシート材776と第3のシート材777で素子形成層791を封止する。これは、例えば、基板701から素子形成層791を剥離する際に、第1のシート材775が素子形成層791のみならず基板701への接着が懸念される場合等、粘着力が弱いシート材を利用したいときに有効となる。
Note that the
封止に用いる第2のシート材776、第3のシート材777として、ポリプロピレン、ポリエステル、ビニル、ポリフッ化ビニル、塩化ビニルなどからなるフィルム、繊維質な材料からなる紙、基材フィルム(ポリエステル、ポリアミド、無機蒸着フィルム、紙類等)と接着性合成樹脂フィルム(アクリル系合成樹脂、エポキシ系合成樹脂等)との積層フィルム等を利用することができる。また、フィルムは、被処理体と共に加熱処理と加圧処理が行われるものであり、加熱処理と加圧処理を行う際には、フィルムの最表面に設けられた接着層か、又は最外層に設けられた層(接着層ではない)を加熱処理によって溶かし、加圧により接着する。また、第2のシート材776と第3のシート材777の表面には接着層が設けられていてもよいし、接着層が設けられていなくてもよい。接着層は、熱硬化樹脂、紫外線硬化樹脂、エポキシ樹脂系接着剤、樹脂添加剤等の接着剤を含む層に相当する。また、封止後に内部への水分等の侵入を防ぐために封止するシート材にシリカコートを行うことが好ましく、例えば、接着層とポリエステル等のフィルムとシリカコートを積層指せたシート材を利用することができる。
As the
なお、本実施の形態は、上記実施の形態1〜3と自由に組み合わせて行うことができる。つまり、上記実施の形態で示した材料や形成方法は、本実施の形態でも利用することができるし、本実施の形態で示した材料や形成方法は上記実施の形態でも利用することができる。 Note that this embodiment mode can be freely combined with Embodiment Modes 1 to 3 described above. That is, the material and the formation method described in the above embodiment can be used in this embodiment, and the material and the formation method described in this embodiment can be used in the above embodiment.
(実施の形態5)
本実施の形態では、本発明の半導体装置における、記憶素子(メモリ)、デコーダー、セレクタ、書き込み回路、読み出し回路などの論理回路部に用いる薄膜トランジスタ(TFT)を同時に作製する方法について図13を用いて説明する。なお、本実施の形態では記憶素子として、フローティングゲートを有するnチャネル型の記憶素子3040、nチャネル型TFT3041、pチャネル型TFT3042を例に挙げて示すが、本発明において記憶部および論理回路部に含まれる素子群はこれに限定されない。また、この作製方法は一例であって、絶縁基板上での作製方法を限定するものではない。
(Embodiment 5)
In this embodiment mode, a method for simultaneously manufacturing a thin film transistor (TFT) used in a logic circuit portion such as a memory element (memory), a decoder, a selector, a writing circuit, and a reading circuit in a semiconductor device of the present invention is described with reference to FIGS. explain. Note that in this embodiment, an n-channel memory element 3040 having a floating gate, an n-channel TFT 3041, and a p-channel TFT 3042 are shown as examples of the memory element. The element group included is not limited to this. Further, this manufacturing method is an example, and the manufacturing method over an insulating substrate is not limited.
まず、ガラス基板3000上に酸化シリコン膜、窒化シリコン膜または酸化窒化シリコン膜などの絶縁膜から成る下地膜3001及び3002を形成する。例えば、下地膜3001として酸化窒化シリコン膜を10〜200nm、下地膜3002として酸化窒化水素化シリコン膜を50〜200nmの厚さに順に積層形成する。
First,
島状半導体層3003〜3005は、非晶質構造を有する半導体膜をレーザ結晶化法や熱結晶化法を用いて作製した結晶質半導体膜で形成する。この島状半導体層3003〜3005の厚さは25〜80nmの厚さで形成する。結晶質半導体膜の材料に限定はないが、好ましくはシリコンまたはシリコンゲルマニウム(SiGe)合金などで形成すると良い。
The island-
ここで、記憶素子3040に用いる半導体層3003のソース領域またはドレイン領域の片側に電荷を引き抜くためのオーバーラップ領域を設ける為の処理を行ってもよい。
Here, treatment for providing an overlap region for extracting charge on one side of the source region or the drain region of the
次いで、島状半導体層3003〜3005を覆うゲート絶縁膜3006を形成する。ゲート絶縁膜3006はプラズマCVD法またはスパッタ法を用い、厚さを10〜80nmとしてシリコンを含む絶縁膜で形成する。特に、OTP(One−time programmable)タイプの不揮発性メモリではホットエレクトロン注入による書き込みと電荷保持が重要であるから、ゲート絶縁膜はトンネル電流の流れにくい40〜80nmとすることが好ましい。
Next, a
そして、ゲート絶縁膜3006上に第1の導電膜3007〜3009を形成し、後にフローティングゲート電極となる領域と通常のTFT3041、3042のゲート電極となる領域を含む領域を除いて、エッチングにより除去する。
Then, first
次いで、第2のゲート絶縁膜3010を形成する。第2のゲート絶縁膜3010はプラズマCVD法またはスパッタ法を用い、厚さを10〜80nmとしてシリコンを含む絶縁膜で形成する。第2のゲート絶縁膜3010は、記憶素子3040の存在する領域を除いて、エッチングにより除去する。
Next, a second
続いて第2の導電膜3011〜3013を形成し、積層された第1の導電膜3007/第2のゲート絶縁膜3010/第2の導電膜3011(記憶素子3040)あるいは、積層された第1の導電膜3008/第2の導電膜3012、第1の導電膜3009/第2の導電膜3013(通常のTFT3041、3042)を一括でエッチングを行い、記憶素子3040のフローティングゲート電極、コントロールゲート電極、および通常のTFT3041、3042のゲート電極を形成する。
Subsequently, second
本実施例では、第1の導電膜3007〜3009をTaNで50〜100nmの厚さに形成し、第2の導電膜3011〜3013をWで100〜300nmの厚さに形成したが、導電膜の材料は特に限定されず、いずれもTa、W、Ti、Mo、Al、Cuなどから選ばれた元素、または前記元素を主成分とする合金材料もしくは化合物材料で形成しても良い。
In this embodiment, the first
続いて、記憶素子3040に用いるTFTにn型を付与するドーピングを行い、第1の不純物領域3014、3015を形成する。次に論理回路部で用いるpチャネル型TFT3041にp型を付与するドーピングを行い、第2の不純物領域3016、3017を形成する。続いて論理回路部で用いるnチャネル型TFT3042のLDD領域を形成するために、n型を付与するドーピングを行い、第3の不純物領域3018、3019を形成する。その後、サイドウォール3020、3021を形成して、論理回路部で用いるnチャネル型TFT3041にn型を付与するドーピングを行い第4の不純物領域3022、3023を形成する。これらのドーピング方法はイオンドープ法もしくはイオン注入法で行えば良い。以上までの工程でそれぞれの島状半導体層に不純物領域が形成される。
Subsequently, doping for imparting n-type to the TFT used for the memory element 3040 is performed, so that first impurity regions 3014 and 3015 are formed. Next, doping for imparting p-type conductivity is performed on the p-channel TFT 3041 used in the logic circuit portion, so that
次に、それぞれの島状半導体層に添加された不純物元素を活性化する工程を行う。この工程はファーネスアニール炉を用いる熱アニール法で行う。その他に、レーザアニール法、またはラピッドサーマルアニール法(RTA法)を適用することができる。さらに、3〜100%の水素を含む雰囲気中で、300〜450℃で1〜12時間の熱処理を行い、島状半導体層を水素化する工程を行う。水素化の他の手段として、プラズマ水素化(プラズマにより励起された水素を用いる)を行っても良い。 Next, a step of activating the impurity element added to each island-like semiconductor layer is performed. This step is performed by a thermal annealing method using a furnace annealing furnace. In addition, a laser annealing method or a rapid thermal annealing method (RTA method) can be applied. Further, a heat treatment is performed at 300 to 450 ° C. for 1 to 12 hours in an atmosphere containing 3 to 100% hydrogen to perform a step of hydrogenating the island-shaped semiconductor layer. As another means of hydrogenation, plasma hydrogenation (using hydrogen excited by plasma) may be performed.
次いで、第1の層間絶縁膜3024を酸化窒化シリコン膜で形成する。第1の層間絶縁膜3024の膜厚は、ゲート絶縁膜と同程度の10〜80nmとする。続いてアクリルなどの有機絶縁物材料から成る第2の層間絶縁膜3025を形成する。また、第2の層間絶縁膜3025として有機絶縁物材料の代わりに無機材料を用いることもできる。無機材料としては無機SiO2やプラズマCVD法で作製したSiO2(PCVD‐SiO2)、SOG(Spin on Glass;塗布珪素酸化膜)等が用いられる。2つの層間絶縁膜を形成した後にコンタクトホールを形成するためのエッチング工程を行う。
Next, a first
そして、記憶部において島状半導体層のソース領域、ドレイン領域とコンタクトをとる電極3026、3027を形成する。また、論理回路部においても同様に、電極3028〜3030を形成する。
Then,
以上のようにして、フローティングゲートを有するnチャネル型の記憶素子3040を有する記憶部と、LDD構造のnチャネル型TFT3041およびシングルドレイン構造のpチャネル型TFT3042を有する論理回路部とを同一の基板上に形成することができる(図13)。 As described above, the memory portion including the n-channel memory element 3040 having the floating gate and the logic circuit portion including the n-channel TFT 3041 having the LDD structure and the p-channel TFT 3042 having the single drain structure are formed over the same substrate. (FIG. 13).
なお、本実施の形態は上記実施の形態1〜4と自由に組み合わせて実施することができる。 Note that this embodiment mode can be freely combined with any of Embodiment Modes 1 to 4 described above.
(実施の形態6)
本実施の形態は、本発明の半導体装置について上記実施の形態とは異なる構造に関して図面を参照して説明する。具体的には、半導体装置に設けられた記憶素子に関して説明する。
(Embodiment 6)
In this embodiment mode, a structure different from the above embodiment mode of a semiconductor device of the present invention is described with reference to drawings. Specifically, a memory element provided in the semiconductor device will be described.
図14に示すように、記憶部7580は記憶素子が形成されたメモリセルアレイ7560及び駆動回路を有する。駆動回路は、カラムデコーダ7510、ローデコーダ7520、読み出し回路7540、書き込み回路7550、セレクタ7530を有する。
As illustrated in FIG. 14, the
メモリセルアレイ7560はビット線Bm(m=1〜x)、ワード線Wn(n=1〜y)、ビット線とワード線とそれぞれの交点にメモリセル7570を有する。なお、メモリセル7570はトランジスタが接続されたアクティブ型であっても、パッシブ素子だけで構成されるパッシブ型であってもよい。パッシブ型の場合、メモリセル7570は、ビット線を構成する導電膜とワード線を構成する導電膜との間に記憶素子が設けられることにより、記憶素子部が形成されている。またビット線Bmはセレクタ7530により制御され、ワード線Wnはローデコーダ7520により制御される。
The
カラムデコーダ7510は、任意のビット線を指定するアドレス信号を受けて、セレクタ7530に信号を与える。セレクタ7530は、カラムデコーダ7510の信号を受けて指定のビット線を選択する。ローデコーダ7520は、任意のワード線を指定するアドレス信号を受けて、指定のワード線を選択する。上記動作によりアドレス信号に対応する一つのメモリセル7570が選択される。読み出し回路7540は選択されたメモリセルが有する情報を読み出して出力する。書き込み回路7550は書き込みに必要な電圧を生成し、選択されたメモリセルに電圧を印加することで、情報の書き込みを行う。
The
次に、メモリセル7570の回路構成を説明する。本実施の形態では、下部電極、上部電極を有し、当該一対の電極間にメモリ材料層が介在した記憶素子7830を有するメモリセルについて説明する。
Next, a circuit configuration of the
図15(A)に示すメモリセル7570は、トランジスタ7810と記憶素子7830とを有するアクティブ型のメモリセルである。トランジスタ7810としては、例えば、薄膜トランジスタを適用することができる。トランジスタ7810が有するゲート電極は、ワード線Wyに接続される。また当該トランジスタ7810が有するソース電極及びドレイン電極の一方は、ビット線Bxに接続され、他方は記憶素子7830と接続される。記憶素子7830の下部電極は、トランジスタ7810のソース電極及びドレイン電極の一方と電気的に接続している。また記憶素子7830の上部電極(7820に相当)は、共通電極として、各記憶素子で共有することができる。
A
また、図15(B)に示すように、記憶素子7830がダイオード7840に接続された構成を用いてもよい。ダイオード7840は、トランジスタのソース電極及びドレイン電極の一方と、ゲート電極とが接続された所謂ダイオード接続構造を採用することができる。またダイオード7840として、メモリ材料層と下部電極とのコンタクトによるショットキーダイオードを用いたり、メモリ材料の積層によって形成されるダイオードなどを用いたりすることもできる。
Alternatively, as illustrated in FIG. 15B, a structure in which the
メモリ材料層としては、電気的作用、光学的作用又は熱的作用等により、その性質や状態が変化する材料を用いることができる。例えば、ジュール熱による溶融、絶縁破壊等により、その性質や状態が変化し、下部電極と、上部電極とが短絡(ショート)することができる材料を用いればよい。そのためメモリ材料層の厚さは、5nmから100nm、好ましくは10nmから60nmとするとよい。このようなメモリ材料層は、無機材料又は有機材料を用いることができ、蒸着法、スピンコーティング法、液滴吐出法等により形成することができる。 As the memory material layer, a material whose property or state is changed by an electric action, an optical action, a thermal action, or the like can be used. For example, a material whose property or state changes due to melting due to Joule heat, dielectric breakdown, or the like, and which can short-circuit the lower electrode and the upper electrode may be used. Therefore, the thickness of the memory material layer is 5 nm to 100 nm, preferably 10 nm to 60 nm. Such a memory material layer can be formed using an inorganic material or an organic material, and can be formed by an evaporation method, a spin coating method, a droplet discharge method, or the like.
無機材料としては、酸化珪素、窒化珪素、酸化窒化珪素等がある。このような無機材料であっても、その膜厚を制御することによって、絶縁破壊を生じさせ、下部電極と上部電極とを短絡させることができる。 Examples of the inorganic material include silicon oxide, silicon nitride, and silicon oxynitride. Even with such an inorganic material, by controlling the film thickness, dielectric breakdown can be caused and the lower electrode and the upper electrode can be short-circuited.
有機材料としては、例えば、4、4’−ビス[N−(1−ナフチル)−N−フェニル−アミノ]−ビフェニル(略称:α−NPD)や4,4’−ビス[N−(3−メチルフェニル)−N−フェニル−アミノ]−ビフェニル(略称:TPD)や4,4’,4’’−トリス(N,N−ジフェニル−アミノ)−トリフェニルアミン(略称:TDATA)、4,4’,4’’−トリス[N−(3−メチルフェニル)−N−フェニル−アミノ]−トリフェニルアミン(略称:MTDATA)や4,4’−ビス(N−(4−(N,N−ジ−m−トリルアミノ)フェニル)−N−フェニルアミノ)ビフェニル(略称:DNTPD)などの芳香族アミン系(即ち、ベンゼン環−窒素の結合を有する)の化合物、ポリビニルカルバゾール(略称:PVK)やフタロシアニン(略称:H2Pc)、銅フタロシアニン(略称:CuPc)、バナジルフタロシアニン(略称:VOPc)等のフタロシアニン化合物等を用いることができる。これら材料は、正孔輸送性の高い物質である。 Examples of the organic material include 4,4′-bis [N- (1-naphthyl) -N-phenyl-amino] -biphenyl (abbreviation: α-NPD) and 4,4′-bis [N- (3- Methylphenyl) -N-phenyl-amino] -biphenyl (abbreviation: TPD), 4,4 ′, 4 ″ -tris (N, N-diphenyl-amino) -triphenylamine (abbreviation: TDATA), 4,4 ', 4' '-tris [N- (3-methylphenyl) -N-phenyl-amino] -triphenylamine (abbreviation: MTDATA) and 4,4'-bis (N- (4- (N, N- Aromatic amine-based compounds (that is, having a benzene ring-nitrogen bond) such as di-m-tolylamino) phenyl) -N-phenylamino) biphenyl (abbreviation: DNTPD), polyvinylcarbazole (abbreviation: PVK) and lids Cyanine (abbreviation: H2Pc), copper phthalocyanine (abbreviation: CuPc), or vanadyl phthalocyanine (abbreviation: VOPc), and can be used phthalocyanine compounds such as. These materials are substances having a high hole transporting property.
また、他にも有機材料として、例えばトリス(8−キノリノラト)アルミニウム(略称:Alq3)、トリス(4−メチル−8−キノリノラト)アルミニウム(略称:Almq3)、ビス(10−ヒドロキシベンゾ[h]−キノリナト)ベリリウム(略称:BeBq2)、ビス(2−メチル−8−キノリノラト)−4−フェニルフェノラト−アルミニウム(略称:BAlq)等キノリン骨格またはベンゾキノリン骨格を有する金属錯体等からなる材料や、ビス[2−(2−ヒドロキシフェニル)ベンゾオキサゾラト]亜鉛(略称:Zn(BOX)2)、ビス[2−(2−ヒドロキシフェニル)ベンゾチアゾラト]亜鉛(略称:Zn(BTZ)2)などのオキサゾール系、チアゾール系配位子を有する金属錯体などの材料も用いることができる。これら材料は、電子輸送性が高い物質である。 As other organic materials, for example, tris (8-quinolinolato) aluminum (abbreviation: Alq 3 ), tris (4-methyl-8-quinolinolato) aluminum (abbreviation: Almq 3 ), bis (10-hydroxybenzo [h ] -Quinolinato) beryllium (abbreviation: BeBq 2 ), bis (2-methyl-8-quinolinolato) -4-phenylphenolato-aluminum (abbreviation: BAlq), etc. And bis [2- (2-hydroxyphenyl) benzoxazolate] zinc (abbreviation: Zn (BOX) 2 ), bis [2- (2-hydroxyphenyl) benzothiazolate] zinc (abbreviation: Zn (BTZ) 2 ) It is also possible to use materials such as metal complexes having oxazole and thiazole ligands such as it can. These materials are substances having a high electron transporting property.
さらに、金属錯体以外にも、2−(4−ビフェニリル)−5−(4−tert−ブチルフェニル)−1,3,4−オキサジアゾール(略称:PBD)、1,3−ビス[5−(p−tert−ブチルフェニル)−1,3,4−オキサジアゾール−2−イル]ベンゼン(略称:OXD−7)、3−(4−tert−ブチルフェニル)−4−フェニル−5−(4−ビフェニリル)−1,2,4−トリアゾール(略称:TAZ)、3−(4−tert−ブチルフェニル)−4−(4−エチルフェニル)−5−(4−ビフェニリル)−1,2,4−トリアゾール(略称:p−EtTAZ)、バソフェナントロリン(略称:BPhen)、バソキュプロイン(略称:BCP)等の化合物等を用いることができる。 In addition to metal complexes, 2- (4-biphenylyl) -5- (4-tert-butylphenyl) -1,3,4-oxadiazole (abbreviation: PBD), 1,3-bis [5- (P-tert-butylphenyl) -1,3,4-oxadiazol-2-yl] benzene (abbreviation: OXD-7), 3- (4-tert-butylphenyl) -4-phenyl-5- ( 4-biphenylyl) -1,2,4-triazole (abbreviation: TAZ), 3- (4-tert-butylphenyl) -4- (4-ethylphenyl) -5- (4-biphenylyl) -1,2, Compounds such as 4-triazole (abbreviation: p-EtTAZ), bathophenanthroline (abbreviation: BPhen), bathocuproin (abbreviation: BCP), and the like can be used.
またメモリ材料層は単層構造であっても、積層構造であってもよい。積層構造の場合、上記材料から選び、積層構造することができる。また上記有機材料と、発光材料とを積層してもよい。発光材料として、4−ジシアノメチレン−2−メチル−6−(1,1,7,7−テトラメチルジュロリジル−9−エニル)−4H−ピラン(略称:DCJT)、4−ジシアノメチレン−2−t−ブチル−6−(1,1,7,7−テトラメチルジュロリジル−9−エニル)−4H−ピラン、ペリフランテン、2,5−ジシアノ−1,4−ビス(10−メトキシ−1,1,7,7−テトラメチルジュロリジル−9−エニル)ベンゼン、N,N’−ジメチルキナクリドン(略称:DMQd)、クマリン6、クマリン545T、トリス(8−キノリノラト)アルミニウム(略称:Alq3)、9,9’−ビアントリル、9,10−ジフェニルアントラセン(略称:DPA)や9,10−ビス(2−ナフチル)アントラセン(略称:DNA)、2,5,8,11−テトラ−t−ブチルペリレン(略称:TBP)等がある。 The memory material layer may have a single layer structure or a stacked structure. In the case of a laminated structure, a laminated structure can be selected from the above materials. Alternatively, the organic material and the light-emitting material may be stacked. As a light-emitting material, 4-dicyanomethylene-2-methyl-6- (1,1,7,7-tetramethyljulolidyl-9-enyl) -4H-pyran (abbreviation: DCJT), 4-dicyanomethylene-2 -T-butyl-6- (1,1,7,7-tetramethyljulolidyl-9-enyl) -4H-pyran, periflanthene, 2,5-dicyano-1,4-bis (10-methoxy-1) , 1,7,7-tetramethyljulolidyl-9-enyl) benzene, N, N′-dimethylquinacridone (abbreviation: DMQd), coumarin 6, coumarin 545T, tris (8-quinolinolato) aluminum (abbreviation: Alq 3) ), 9,9′-bianthryl, 9,10-diphenylanthracene (abbreviation: DPA), 9,10-bis (2-naphthyl) anthracene (abbreviation: DNA), 2, 5, 8 , 11-tetra-t-butylperylene (abbreviation: TBP).
また、上記発光材料を分散してなる層を用いてもよい。発光材料分散してなる層において、母体となる材料としては、9,10−ジ(2−ナフチル)−2−tert−ブチルアントラセン(略称:t−BuDNA)等のアントラセン誘導体、4,4’−ビス(N−カルバゾリル)ビフェニル(略称:CBP)等のカルバゾール誘導体、ビス[2−(2−ヒドロキシフェニル)ピリジナト]亜鉛(略称:Znpp2)、ビス[2−(2−ヒドロキシフェニル)ベンゾオキサゾラト]亜鉛(略称:ZnBOX)などの金属錯体等を用いることができる。また、トリス(8−キノリノラト)アルミニウム(略称:Alq3)、9,10−ビス(2−ナフチル)アントラセン(略称:DNA)、ビス(2−メチル−8−キノリノラト)−4−フェニルフェノラト−アルミニウム(略称:BAlq)等を用いることができる。 Alternatively, a layer in which the light emitting material is dispersed may be used. In the layer in which the light emitting material is dispersed, the base material includes an anthracene derivative such as 9,10-di (2-naphthyl) -2-tert-butylanthracene (abbreviation: t-BuDNA), 4,4′- Carbazole derivatives such as bis (N-carbazolyl) biphenyl (abbreviation: CBP), bis [2- (2-hydroxyphenyl) pyridinato] zinc (abbreviation: Znpp 2 ), bis [2- (2-hydroxyphenyl) benzoxazola G] A metal complex such as zinc (abbreviation: ZnBOX) can be used. In addition, tris (8-quinolinolato) aluminum (abbreviation: Alq 3 ), 9,10-bis (2-naphthyl) anthracene (abbreviation: DNA), bis (2-methyl-8-quinolinolato) -4-phenylphenolato- Aluminum (abbreviation: BAlq) or the like can be used.
このような有機材料は、熱的作用等によりその性質を変化させるため、ガラス転移温度(Tg)が50℃から300℃、好ましくは80℃から120℃であるとよい。 Such an organic material has a glass transition temperature (Tg) of 50 ° C. to 300 ° C., preferably 80 ° C. to 120 ° C., in order to change its properties by a thermal action or the like.
また、有機材料や発光材料に金属酸化物を混在させた材料を用いてもよい。なお金属酸化物を混在させた材料とは、上記有機材料又は発光材料と、金属酸化物とが混合した状態、又は積層された状態を含む。具体的には複数の蒸着源を用いた共蒸着法により形成された状態を指す。このような材料を有機無機複合材料と呼ぶことができる。 Alternatively, a material in which a metal oxide is mixed in an organic material or a light emitting material may be used. Note that the material in which the metal oxide is mixed includes a state where the organic material or the light-emitting material and the metal oxide are mixed or stacked. Specifically, it refers to a state formed by a co-evaporation method using a plurality of evaporation sources. Such a material can be called an organic-inorganic composite material.
例えば正孔輸送性の高い物質と、金属酸化物を混在させる場合、当該金属酸化物にはバナジウム酸化物、モリブデン酸化物、ニオブ酸化物、レニウム酸化物、タングステン酸化物、ルテニウム酸化物、チタン酸化物、クロム酸化物、ジルコニウム酸化物、ハフニウム酸化物、タンタル酸化物を用いると好ましい。 For example, when a metal oxide is mixed with a substance having a high hole transporting property, the metal oxide includes vanadium oxide, molybdenum oxide, niobium oxide, rhenium oxide, tungsten oxide, ruthenium oxide, titanium oxide. It is preferable to use an oxide, chromium oxide, zirconium oxide, hafnium oxide, or tantalum oxide.
また電子輸送性の高い物質と、金属酸化物を混在させる場合、当該金属酸化物にはリチウム酸化物、カルシウム酸化物、ナトリウム酸化物、カリウム酸化物、マグネシウム酸化物を用いると好ましい。 In the case where a substance having a high electron transporting property and a metal oxide are mixed, it is preferable to use lithium oxide, calcium oxide, sodium oxide, potassium oxide, or magnesium oxide as the metal oxide.
メモリ材料層には、電気的作用、光学的作用又は熱的作用により、その性質が変化する材料を用いればよいため、例えば光を吸収することによって酸を発生する化合物(光酸発生剤)をドープした共役高分子を用いることもできる。共役高分子として、ポリアセチレン類、ポリフェニレンビニレン類、ポリチオフェン類、ポリアニリン類、ポリフェニレンエチニレン類等を用いることができる。また、光酸発生剤としては、アリールスルホニウム塩、アリールヨードニウム塩、o−ニトロベンジルトシレート、アリールスルホン酸p−ニトロベンジルエステル、スルホニルアセトフェノン類、Fe−アレン錯体PF6塩等を用いることができる。 For the memory material layer, a material whose properties are changed by an electric action, an optical action, or a thermal action may be used. For example, a compound that generates an acid by absorbing light (photo acid generator) is used. Doped conjugated polymers can also be used. As the conjugated polymer, polyacetylenes, polyphenylene vinylenes, polythiophenes, polyanilines, polyphenylene ethynylenes, and the like can be used. As the photoacid generator, arylsulfonium salts, aryliodonium salts, o-nitrobenzyl tosylate, arylsulfonic acid p-nitrobenzyl esters, sulfonylacetophenones, Fe-allene complex PF6 salts and the like can be used.
次に、図15(A)に示したようなアクティブ型のメモリセル7570に情報の書き込みを行うときの動作について説明する。なお本実施の形態では、初期状態の記憶素子が格納する値を「0」、電気的作用等によって特性を変化させた記憶素子が格納する値を「1」とする。また、初期状態の記憶素子は抵抗値が高く、変化後の記憶素子は抵抗値は低いものとする。
Next, an operation when data is written to the
書き込みを行う場合、カラムデコーダ7510、ローデコーダ7520、セレクタ7530により、m列目のビット線Bmと、n行目のワード線Wnが選択され、m列目n行目のメモリセル7570に含まれるトランジスタ7810がオンとなる。
When writing, the
続いて、書き込み回路7550により、m列目のビット線Bmに、所定の電圧が所定の期間印加される。この印加電圧および印加時間は、記憶素子7830が初期状態から抵抗値の低い状態へと変化するような条件を用いる。m列目のビット線Bmに印加された電圧は、記憶素子7830の下部電極に伝達され、上部電極との間には電位差が生じる。すると、記憶素子7830に電流が流れ、メモリ材料層の状態に変化が生じ、記憶素子特性が変化する。そして、記憶素子7830が格納する値を「0」から「1」へ変化させる。
Subsequently, the
次に、情報の読み出しを行う動作について説明する。図16に示すように読み出し回路7540は、抵抗素子7900とセンスアンプ7910を有する。情報の読み出しは、下部電極と上部電極の間に電圧を印加して、記憶素子が、初期の状態か変化後の低い状態であるかを判定することで行う。具体的には、抵抗分割方式によって、情報の読み出しを行うことができる。
Next, an operation for reading information will be described. As shown in FIG. 16, the
例えば、メモリセルアレイ7560が含む複数の記憶素子7830から、m列目n行目の記憶素子7830の情報の読み出しを行う場合について説明する。まずカラムデコーダ7510、ローデコーダ7520、セレクタ7530により、m列目のビット線Bmと、n行目のワード線Wnが選択される。すると、m列目n行目に配置されたメモリセル7570が有するトランジスタ7810がオン状態になり、記憶素子7830と、抵抗素子7900とが直列に接続された状態となる。その結果、記憶素子7830の電流特性に応じて図16に示したP点の電位が決まる。
For example, the case where information is read from the
記憶素子が初期状態である場合のP点の電位をV1、記憶素子が変化後の低抵抗状態である場合のP点の電位をV2とし、V1>Vref>V2となる参照電位Vrefを用いることで、記憶素子に格納されている情報を読み出すことができる。具体的には、記憶素子が初期状態である場合、センスアンプ7910の出力電位はLoとなり、記憶素子が低抵抗状態である場合、センスアンプ7910の出力電位はHiとなる。
The potential at the point P when the memory element is in the initial state is V1, the potential at the point P when the memory element is in the low resistance state after the change is V2, and a reference potential Vref that satisfies V1> Vref> V2 is used. Thus, the information stored in the storage element can be read out. Specifically, when the memory element is in an initial state, the output potential of the
上記の方法によると、記憶素子7830の抵抗値の相違と抵抗分割を利用して、電圧値で読み取っている。しかしながら、記憶素子7830が有する情報を、電流値により読み取ってもよい。なお本発明の読み出し回路7540は、上記構成に限定されず、記憶素子が有する情報を読み出すことができればどのような構成を有していてもよい。
According to the above method, the voltage value is read by using the difference in resistance value of the
このような構成を有する記憶素子は、「0」から「1」の状態へ変化させ、「0」から「1」の状態へ変化は不可逆的であるためライトワンス記憶素子となる。そのため、外部から第三者によって情報を書き換えられることによる偽造を防止することができる。 The memory element having such a configuration changes from “0” to “1”, and the change from “0” to “1” is irreversible, and thus becomes a write-once memory element. Therefore, forgery due to rewriting of information by a third party from the outside can be prevented.
このような記憶素子7830へ初期情報を書き込むことができ、またセンサー装置からの情報を逐次書き込むことができる。そして書き込まれた情報は、無線通信により読み出すことができる。
Initial information can be written to such a
次に、絶縁基板310上にメモリセル部301と駆動回路部302とが一体形成された記憶素子の断面図の一例を示す(図17(A))。
Next, an example of a cross-sectional view of a memory element in which the
絶縁基板310上には下地膜311が設けられている。駆動回路部302では下地膜311を介して薄膜トランジスタ320、321が設けられ、メモリセル部301には下地膜311を介して薄膜トランジスタ621が設けられている。各薄膜トランジスタは、島状にエッチングされた半導体膜312、ゲート絶縁膜を介して設けられたゲート電極314、ゲート電極側面に設けられた絶縁物(所謂サイドウォール)313、ゲート電極314が設けられている。半導体膜312は、膜厚が0.2μm以下、代表的には40nm〜170nm、好ましくは50nm〜150nmとなるように形成する。さらに、サイドウォール313、及び半導体膜312を覆う絶縁膜316、半導体膜312に形成された不純物領域に接続する電極315を有する。なお電極315は不純物領域と接続するため、ゲート絶縁膜及び絶縁膜316にコンタクトホールを形成し、当該コンタクトホールに導電膜を形成し、当該導電膜を選択的にエッチングして形成することができる。なお、絶縁基板310には、ガラス基板、石英基板、珪素からなる基板、金属基板等を用いることができる。
A
なお平坦性を高めるため、絶縁膜317、318が設けられているとよい。このとき絶縁膜317は有機材料から形成し、絶縁膜318は無機材料から形成するとよい。絶縁膜317、318が設けられている場合、電極315は、これら絶縁膜317、318にコンタクトホールを介して不純物領域と接続するように形成することができる。
Note that insulating
さらに絶縁膜325が設けられ、電極315と接続するように下部電極327を形成する。下部電極327の端部を覆い、下部電極327が露出するように開口部が設けられた絶縁膜328を形成する。開口部内に、メモリ材料層329を形成し、上部電極330を形成する。このようにして、下部電極327、メモリ材料層329、上部電極330を有する記憶素子622が形成される。メモリ材料層329は、有機材料又は無機材料から形成することができる。下部電極327又は上部電極330は、導電性材料から形成することができる。例えば、アルミニウム(Al)、チタン(Ti)、モリブデン(Mo)、タングステン(W)もしくはシリコン(Si)の元素からなる膜又はこれらの元素を用いた合金膜等から形成することができる。またインジウム錫酸化物(ITO)、酸化珪素を含むインジウム錫酸化物、2〜20%の酸化亜鉛を含む酸化インジウム等の透光性材料を用いることができる。
Further, an insulating
さらに平坦性を高め、不純物元素の侵入を防止するため、絶縁膜331を形成するとよい。
In addition, an insulating
本実施の形態で説明した絶縁膜は、無機材料又は有機材料を用いることができる。無機材料は、酸化珪素、窒化珪素を用いることができる。有機材料はポリイミド、アクリル、ポリアミド、ポリイミドアミド、レジスト又はベンゾシクロブテン、シロキサン、ポリシラザンを用いることができる。なお、シロキサン樹脂とは、Si−O−Si結合を含む樹脂に相当する。シロキサンは、シリコン(Si)と酸素(O)との結合で骨格構造が構成される。置換基として、少なくとも水素を含む有機基(例えばアルキル基、芳香族炭化水素)が用いられる。置換基として、フルオロ基を用いてもよい。または置換基として、少なくとも水素を含む有機基と、フルオロ基とを用いてもよい。ポリシラザンは、珪素(Si)と窒素(N)の結合を有するポリマー材料を出発原料として形成される。 For the insulating film described in this embodiment, an inorganic material or an organic material can be used. As the inorganic material, silicon oxide or silicon nitride can be used. As the organic material, polyimide, acrylic, polyamide, polyimide amide, resist, benzocyclobutene, siloxane, or polysilazane can be used. Note that a siloxane resin corresponds to a resin including a Si—O—Si bond. Siloxane has a skeleton structure formed of a bond of silicon (Si) and oxygen (O). As a substituent, an organic group containing at least hydrogen (for example, an alkyl group or an aromatic hydrocarbon) is used. A fluoro group may be used as a substituent. Alternatively, an organic group containing at least hydrogen and a fluoro group may be used as a substituent. Polysilazane is formed using a polymer material having a bond of silicon (Si) and nitrogen (N) as a starting material.
図17(B)は、図17(A)と異なり、電極315のコンタクトホール351内にメモリ材料層を形成した記憶素子の断面図を示す。図17(A)と同様に、下部電極として電極315を用い、電極315上にメモリ材料層329、上部電極330を形成し、記憶素子622を形成することができる。その後絶縁膜331を形成する。その他の構成は図17(A)と同様であるため、説明を省略する。
FIG. 17B is a cross-sectional view of a memory element in which a memory material layer is formed in a
このようにコンタクトホール351に記憶素子を形成すると、記憶部の小型化を図ることができる。またメモリ用の電極が不要となるため製造工程を削減し、低コスト化されたメモリ装置を提供することができる。
When the memory element is formed in the
なお、本実施の形態は上記実施の形態1〜5と自由に組み合わせて実施することができる。 Note that this embodiment mode can be freely combined with any of Embodiment Modes 1 to 5.
(実施の形態7)
本実施の形態では、本発明の半導体装置の利用形態に関して図18を用いて説明する。
(Embodiment 7)
In this embodiment mode, a usage mode of a semiconductor device of the present invention will be described with reference to FIGS.
半導体装置80は、非接触でデータを交信する機能を有し、電源回路81、クロック発生回路82、データ復調回路83、データ変調回路84、他の回路を制御する制御回路85、記憶回路86およびアンテナ87を有している(図18(A))。なお、記憶回路は1つに限定されず、複数であっても良く、SRAM、フラッシュメモリ、ROMまたはFeRAM等や上記実施の形態で示した有機化合物層を記憶素子部に用いたものを用いることができる。
The
リーダ/ライタ88から電波として送られてきた信号は、アンテナ87において電磁誘導により交流の電気信号に変換される。電源回路81では、交流の電気信号を用いて電源電圧を生成し、電源配線を用いて各回路へ電源電圧を供給する。クロック発生回路82は、アンテナ87から入力された交流信号を基に、各種クロック信号を生成し、制御回路85に供給する。復調回路83では、当該交流の電気信号を復調し、制御回路85に供給する。制御回路85では、入力された信号に従って各種演算処理を行う。記憶回路86では、制御回路85において用いられるプログラムやデータ等が記憶されている他、演算処理時の作業エリアとしても用いることができる。そして、制御回路85から変調回路84にデータが送られ、変調回路84から当該データに従ってアンテナ87に負荷変調を加えることができる。リーダ/ライタ88は、アンテナ87に加えられた負荷変調を電波で受け取ることにより、結果的にデータを読み取ることが可能となる。
A signal transmitted as a radio wave from the reader / writer 88 is converted into an AC electrical signal by electromagnetic induction in the
また、半導体装置は、各回路への電源電圧の供給を電源(バッテリ)を搭載せず電波により行うタイプとしてもよいし、電源(バッテリ)を搭載して電波と電源(バッテリ)により各回路に電源電圧を供給するタイプとしてもよい。 In addition, the semiconductor device may be a type in which the power supply voltage is supplied to each circuit by radio waves without mounting a power source (battery), or the power source (battery) is mounted and each circuit is supplied by radio waves and the power source (battery). The power supply voltage may be supplied.
本発明の半導体装置は、非接触で通信を行う点、複数読取りが可能である点、データの書き込みが可能である点、様々な形状に加工可能である点、選択する周波数によっては、指向性が広く、認識範囲が広い点等の利点を有する。本発明の半導体装置は、非接触による無線通信で人や物の個々の情報を識別可能なICタグ、ラベル加工を施して目標物への貼り付けを可能としたラベル、イベントやアミューズメント向けのリストバンド等に適用することができる。また、半導体装置を樹脂材料により成型加工してもよいし、無線通信を阻害する金属に直接固定してもよい。さらに、本発明の半導体装置は、入退室管理システムや精算システムといった、システムの運用に活用することができる。 The semiconductor device of the present invention has a point of directivity depending on the point of non-contact communication, the point that multiple reading is possible, the point that data can be written, the point that it can be processed into various shapes, and the selected frequency. Has advantages such as a wide recognition range. The semiconductor device of the present invention is an IC tag that can identify individual information of a person or an object by non-contact wireless communication, a label that can be attached to a target by applying label processing, a list for an event or an amusement It can be applied to bands and the like. Further, the semiconductor device may be molded using a resin material, or may be directly fixed to a metal that hinders wireless communication. Furthermore, the semiconductor device of the present invention can be used for system operations such as an entrance / exit management system and a payment system.
次に、非接触でデータのやりとりが可能である半導体装置を実際に使用するときの一形態について説明する。表示部3210を含む携帯端末の側面には、リーダ/ライタ3200が設けられ、品物3220の側面には半導体装置3230が設けられる(図18(B))。品物3220が含む半導体装置3230にリーダ/ライタ3200をかざすと、表示部3210に品物の原材料や原産地、生産工程ごとの検査結果や流通過程の履歴等、更に商品の説明等の商品に関する情報が表示される。また、商品3260をベルトコンベアにより搬送する際に、リーダ/ライタ3200と、商品3260に設けられた半導体装置3250を用いて、該商品3260の検品を行うことができる(図18(C))。このように、システムに半導体装置を活用することで、情報の取得を簡単に行うことができ、高機能化と高付加価値化を実現する。
Next, one mode when a semiconductor device capable of exchanging data without contact is actually used will be described. A reader /
なお、本実施の形態は、上記実施の形態1〜6と自由に組み合わせて行うことができる。 Note that this embodiment mode can be freely combined with any of Embodiment Modes 1 to 6.
(実施の形態8)
本発明の半導体装置の用途は広範にわたり、非接触で対象物の履歴等の情報を明確にし、生産・管理等に役立てる商品であればどのようなものにも適用することができる。例えば、紙幣、硬貨、有価証券類、証書類、無記名債券類、包装用容器類、書籍類、記録媒体、身の回り品、乗物類、食品類、衣類、保健用品類、生活用品類、薬品類及び電子機器等に設けて使用することができる。これらの例に関して図19を用いて説明する。
(Embodiment 8)
The application of the semiconductor device of the present invention is wide-ranging, and can be applied to any product that can be used for production and management by clarifying information such as the history of an object without contact. For example, banknotes, coins, securities, certificate documents, bearer bonds, packaging containers, books, recording media, personal belongings, vehicles, foods, clothing, health supplies, daily necessities, chemicals, etc. It can be provided and used in an electronic device or the like. These examples will be described with reference to FIG.
紙幣、硬貨とは、市場に流通する金銭であり、特定の地域で貨幣と同じように通用するもの(金券)、記念コイン等を含む。有価証券類とは、小切手、証券、約束手形等を指す(図19(A)参照)。証書類とは、運転免許証、住民票等を指す(図19(B)参照)。無記名債券類とは、切手、おこめ券、各種ギフト券等を指す(図19(C)参照)。包装用容器類とは、お弁当等の包装紙、ペットボトル等を指す(図19(D)参照)。書籍類とは、書物、本等を指す(図19(E)参照)。記録媒体とは、DVDソフト、ビデオテープ等を指す(図19(F)参照)。乗物類とは、自転車等の車両、船舶等を指す(図19(G)参照)。身の回り品とは、鞄、眼鏡等を指す(図19(H)参照)。食品類とは、食料品、飲料等を指す。衣類とは、衣服、履物等を指す。保健用品類とは、医療器具、健康器具等を指す。生活用品類とは、家具、照明器具等を指す。薬品類とは、医薬品、農薬等を指す。電子機器とは、液晶表示装置、EL表示装置、テレビジョン装置(テレビ受像機、薄型テレビ受像機)、携帯電話等を指す。 Banknotes and coins are money that circulates in the market, and include those that are used in the same way as money in a specific area (cash vouchers), commemorative coins, and the like. Securities refer to checks, securities, promissory notes, and the like (see FIG. 19A). The certificate refers to a driver's license, a resident card, etc. (see FIG. 19B). Bearer bonds refer to stamps, gift cards, various gift certificates, and the like (see FIG. 19C). Packaging containers refer to wrapping paper for lunch boxes, plastic bottles, and the like (see FIG. 19D). Books refer to books, books, and the like (see FIG. 19E). The recording media refer to DVD software, video tapes, and the like (see FIG. 19F). The vehicles refer to vehicles such as bicycles, ships, and the like (see FIG. 19G). Personal belongings refer to bags, glasses, and the like (see FIG. 19H). Foods refer to food products, beverages, and the like. Clothing refers to clothing, footwear, and the like. Health supplies refer to medical equipment, health equipment, and the like. Livingware refers to furniture, lighting equipment, and the like. Chemicals refer to pharmaceuticals, agricultural chemicals, and the like. Electronic devices refer to liquid crystal display devices, EL display devices, television devices (TV receivers, flat-screen TV receivers), mobile phones, and the like.
紙幣、硬貨、有価証券類、証書類、無記名債券類等に上記実施の形態で示した半導体装置を設けることにより、偽造を防止することができる。また、包装用容器類、書籍類、記録媒体等、身の回り品、食品類、生活用品類、電子機器等に上記実施の形態で示した半導体装置を設けることにより、検品システムやレンタル店のシステムなどの効率化を図ることができる。乗物類、保健用品類、薬品類等に上記実施の形態で示した半導体装置を設けることにより、偽造や盗難の防止、薬品類ならば、薬の服用の間違いを防止することができる。半導体装置の設け方としては、物品の表面に貼ったり、物品に埋め込んだりして設ける。例えば、本ならば紙に埋め込んだり、有機樹脂からなるパッケージなら当該有機樹脂に埋め込んだりするとよい。また、後に光学的作用を加えて書き込み(追記)をする場合には、チップに設けられた記憶素子の部分に光が照射できるように透明な材料で形成しておくことが好ましい。さらに、一度書き込んだデータの書き換えが不可能である記憶素子を用いることによって、効果的に偽造を防止することが可能となる。また、ユーザーが商品を購入した後のプライバシー等の問題についても、半導体装置に設けられた記憶素子のデータを消去するシステムを設けておくことによって解決することができる。 Forgery can be prevented by providing the semiconductor device shown in the above embodiment mode on bills, coins, securities, certificates, bearer bonds, or the like. In addition, by providing the semiconductor devices described in the above embodiments in personal items such as packaging containers, books, recording media, personal items, foods, daily necessities, electronic devices, inspection systems, rental store systems, etc. Can be made more efficient. By providing the semiconductor device described in the above embodiment to vehicles, health supplies, medicines, and the like, counterfeiting and theft prevention can be prevented. As a method for providing the semiconductor device, the semiconductor device is provided on the surface of the article or embedded in the article. For example, a book may be embedded in paper, and a package made of an organic resin may be embedded in the organic resin. Further, when writing (additional writing) is performed by applying an optical action later, it is preferable to form the transparent element so that light can be applied to the portion of the memory element provided on the chip. Furthermore, forgery can be effectively prevented by using a memory element in which data once written cannot be rewritten. In addition, problems such as privacy after a user purchases a product can be solved by providing a system for erasing data stored in a memory element provided in a semiconductor device.
このように、包装用容器類、記録媒体、身の回り品、食品類、衣類、生活用品類、電子機器等に上記実施の形態で示した半導体装置を設けることにより、検品システムやレンタル店のシステムなどの効率化を図ることができる。また乗物類に上記実施の形態で示した半導体装置を設けることにより、偽造や盗難を防止することができる。また、動物等の生き物に埋め込むことによって、個々の生き物の識別を容易に行うことができる。例えば、家畜等の生き物にセンサーを備えた上記実施の形態で示した半導体装置を埋め込むことによって、生まれた年や性別または種類等はもちろん現在の体温等の健康状態を容易に管理することが可能となる。また、通信距離を短く制御することによって、第三者に盗み見られることを防止することができる。 As described above, by providing the semiconductor device described in the above embodiment in packaging containers, recording media, personal items, foods, clothing, daily necessities, electronic devices, etc., an inspection system, a rental store system, etc. Can be made more efficient. Further, forgery or theft can be prevented by providing the semiconductor device described in the above embodiment mode in a vehicle. Moreover, by embedding it in creatures such as animals, it is possible to easily identify individual creatures. For example, by embedding the semiconductor device shown in the above embodiment with a sensor in a living creature such as livestock, it is possible to easily manage the current health condition such as body temperature as well as the year of birth, gender or type. It becomes. Further, by controlling the communication distance to be short, it is possible to prevent a third party from seeing it.
以上のように、本発明の半導体装置はどのようなものにでも設けて使用することができる。なお、本実施の形態は上記実施の形態1〜7と自由に組み合わせて行うことができる。 As described above, the semiconductor device of the present invention can be provided and used in any device. Note that this embodiment mode can be freely combined with any of Embodiment Modes 1 to 7.
80 半導体装置
81 電源回路
82 クロック発生回路
83 復調回路
84 変調回路
85 制御回路
86 記憶回路
87 アンテナ
88 リーダ/ライタ
301 メモリセル部
302 駆動回路部
310 絶縁基板
311 下地膜
312 半導体膜
313 サイドウォール
314 ゲート電極
315 電極
316 絶縁膜
317 絶縁膜
318 絶縁膜
320 薄膜トランジスタ
325 絶縁膜
327 下部電極
328 絶縁膜
329 メモリ材料層
330 上部電極
331 絶縁膜
351 コンタクトホール
401 基板
402 素子群
403 導電膜
404 導電膜
406 絶縁膜
407 導電膜
409 トランジスタ
410 スイッチング手段
420 スイッチング手段
421 端部
621 薄膜トランジスタ
622 記憶素子
701 基板
702 剥離層
703 絶縁膜
704 非晶質半導体膜
705 ゲート絶縁膜
706 結晶質半導体膜
707 結晶質半導体膜
711 N型不純物領域
712 P型不純物領域
716 導電膜
726 N型不純物領域
727 N型不純物領域
734 絶縁膜
739 絶縁膜
744 薄膜トランジスタ
745 薄膜トランジスタ
749 絶縁膜
750 絶縁膜
751 絶縁膜
752 導電膜
762 絶縁膜
765 導電膜
767 導電膜
772 絶縁膜
773 開口部
775 シート材
776 シート材
777 シート材
780 チャネル形成領域
781 チャネル形成領域
783 記憶素子
785 P型不純物領域
786 導電膜
789 記憶素子部
791 素子形成層
802 開口部
805 スキージ
806 ペースト
3000 ガラス基板
3001 下地膜
3002 下地膜
3003 半導体層
3003 半導体層
3006 ゲート絶縁膜
3007 第1の導電膜
3008 第1の導電膜
3009 第1の導電膜
3010 ゲート絶縁膜
3011 第2の導電膜
3012 第2の導電膜
3013 第2の導電膜
3014 不純物領域
3016 不純物領域
3018 不純物領域
3020 サイドウォール
3022 不純物領域
3024 層間絶縁膜
3025 層間絶縁膜
3026 電極
3028 電極
3040 記憶素子
3200 リーダ/ライタ
3210 表示部
3220 品物
3230 半導体装置
3250 半導体装置
3260 商品
405a 端部
405b 端部
410a トランジスタ
7510 カラムデコーダ
7520 ローデコーダ
7530 セレクタ
7540 回路
7550 回路
7560 メモリセルアレイ
7570 メモリセル
7580 記憶部
766a 導電膜
7810 トランジスタ
7830 記憶素子
7840 ダイオード
7900 抵抗素子
7910 センスアンプ
80 Semiconductor Device 81 Power Supply Circuit 82 Clock Generation Circuit 83 Demodulation Circuit 84 Modulation Circuit 85 Control Circuit 86 Memory Circuit 87 Antenna 88 Reader / Writer 301 Memory Cell Unit 302 Drive Circuit Unit 310 Insulating Substrate 311 Base Film 312 Semiconductor Film 313 Side Wall 314 Gate Electrode 315 Electrode 316 Insulating film 317 Insulating film 318 Insulating film 320 Thin film transistor 325 Insulating film 327 Lower electrode 328 Insulating film 329 Memory material layer 330 Upper electrode 331 Insulating film 351 Contact hole 401 Substrate 402 Element group 403 Conductive film 404 Conductive film 406 Insulating film 407 conductive film 409 transistor 410 switching means 420 switching means 421 end 621 thin film transistor 622 memory element 701 substrate 702 release layer 703 insulating film 704 amorphous semiconductor 705 Gate insulating film 706 Crystalline semiconductor film 707 Crystalline semiconductor film 711 N-type impurity region 712 P-type impurity region 716 Conductive film 726 N-type impurity region 727 N-type impurity region 734 Insulating film 739 Insulating film 744 Thin film transistor 745 Thin film transistor 749 Insulating film 750 Insulating film 751 Insulating film 752 Conductive film 762 Insulating film 765 Conductive film 767 Conductive film 772 Insulating film 773 Opening 775 Sheet material 776 Sheet material 777 Sheet material 780 Channel forming region 781 Channel forming region 783 Memory element 785 P-type impurity region 786 Conductive film 789 Memory element portion 791 Element formation layer 802 Opening 805 Squeegee 806 Paste 3000 Glass substrate 3001 Base film 3002 Base film 3003 Semiconductor layer 3003 Semiconductor layer 3006 Gate insulating film 3007 Conductive film 3008 first conductive film 3009 first conductive film 3010 gate insulating film 3011 second conductive film 3012 second conductive film 3013 second conductive film 3014 impurity region 3016 impurity region 3018 impurity region 3020 sidewall 3022 Impurity region 3024 Interlayer insulating film 3025 Interlayer insulating film 3026 Electrode 3028 Electrode 3040 Storage element 3200 Reader / writer 3210 Display unit 3220 Product 3230 Semiconductor device 3250 Semiconductor device 3260 Product 405a End 405b End 410a Transistor 7510 Column decoder 7520 Row decoder 7530 Selector 7540 circuit 7550 circuit 7560 memory cell array 7570 memory cell 7580 memory portion 766a conductive film 7810 transistor 7830 memory element 7840 diode De 7900 resistance element 7910 sense amplifier
Claims (13)
前記半導体装置は、
基板と、
前記基板に設けられた複数のトランジスタを有する素子群と、
前記素子群の上方に設けられたアンテナとして機能する第1の導電膜と前記第1の導電膜を囲んで配置された第2の導電膜とを有し、
前記第1の導電膜は、コイル状に設けられ、
前記第2の導電膜は、第1の端部と第2の端部を有し、
前記第1の端部および前記第2の端部がスイッチング手段を介して接続されていることを特徴とする商品の管理方法。 Product management method for protecting the consumer's privacy by mounting a semiconductor device capable of transmitting and receiving data in a contactless manner on a product, and controlling the communication distance of the semiconductor device after the consumer purchases the product Because
The semiconductor device includes:
A substrate,
The element group having a plurality of transistors provided in the base plate,
A first conductive film functioning as an antenna provided above the element group, and a second conductive film disposed surrounding the first conductive film;
The first conductive film is provided in a coil shape,
The second conductive film has a first end and a second end,
The product management method, wherein the first end and the second end are connected via a switching means.
前記半導体装置は、
基板と、
前記基板に設けられた複数のトランジスタを有する素子群と、
前記素子群の上方に設けられたアンテナとして機能する第1の導電膜と、
第1の端部および第2の端部を有し且つ前記第1の導電膜を囲んで配置された第2の導電膜と、
前記第1の端部および前記第2の端部を覆うように絶縁膜を介して設けられた第3の導電膜とを有し、
前記第1の導電膜は、コイル状に設けられ且つ前記第1の導電膜の両端部がそれぞれ前記素子群と電気的に接続し、
前記第1の端部と前記第2の端部が絶縁されていることを特徴とする商品の管理方法。 Product management method for protecting the consumer's privacy by mounting a semiconductor device capable of transmitting and receiving data in a contactless manner on a product, and controlling the communication distance of the semiconductor device after the consumer purchases the product Because
The semiconductor device includes:
A substrate,
The element group having a plurality of transistors provided in the base plate,
A first conductive film functioning as an antenna provided above the element group;
A second conductive film having a first end and a second end and disposed surrounding the first conductive film;
A third conductive film provided via an insulating film so as to cover the first end and the second end;
The first conductive film is provided in a coil shape, and both ends of the first conductive film are electrically connected to the element group,
The product management method, wherein the first end and the second end are insulated.
前記半導体装置は、
基板と、
前記基板に設けられた複数のトランジスタを有する素子群と、
前記素子群の上方に設けられたアンテナとして機能する第1の導電膜と、
第1の端部および第2の端部を有し且つ前記第1の導電膜を囲んで配置された第2の導電膜と、
前記第1の端部および前記第2の端部を覆うように絶縁膜を介して設けられた第3の導電膜とを有し、
前記第1の導電膜は、コイル状に設けられ且つ前記第1の導電膜の両端部がそれぞれ前記素子群と電気的に接続し、
前記第1の端部と前記第2の端部とを電気的に接続するか否かによって、通信距離の制御を行うことを特徴とする商品の管理方法。 Product management method for protecting the consumer's privacy by mounting a semiconductor device capable of transmitting and receiving data in a contactless manner on a product, and controlling the communication distance of the semiconductor device after the consumer purchases the product Because
The semiconductor device includes:
A substrate,
The element group having a plurality of transistors provided in the base plate,
A first conductive film functioning as an antenna provided above the element group;
A second conductive film having a first end and a second end and disposed surrounding the first conductive film;
A third conductive film provided via an insulating film so as to cover the first end and the second end;
The first conductive film is provided in a coil shape, and both ends of the first conductive film are electrically connected to the element group,
A method for managing a product, comprising: controlling a communication distance depending on whether or not the first end and the second end are electrically connected.
前記半導体装置は、
基板と、
前記基板に設けられた複数のトランジスタを有する素子群と、
前記素子群の上方に設けられたアンテナとして機能する第1の導電膜と、
第1の端部および第2の端部を有し且つ前記第1の導電膜を囲んで配置された第2の導電膜と、
前記第1の端部および前記第2の端部を覆うように絶縁膜を介して設けられた第3の導電膜とを有し、
前記第1の導電膜は、コイル状に設けられており、
前記第1の端部と前記第2の端部のいずれか一方と前記第3の導電膜とが電気的に接続し、他方が絶縁されていることを特徴とする商品の管理方法。 Product management method for protecting the consumer's privacy by mounting a semiconductor device capable of transmitting and receiving data in a contactless manner on a product, and controlling the communication distance of the semiconductor device after the consumer purchases the product Because
The semiconductor device includes:
A substrate,
The element group having a plurality of transistors provided in the base plate,
A first conductive film functioning as an antenna provided above the element group;
A second conductive film having a first end and a second end and disposed surrounding the first conductive film;
A third conductive film provided via an insulating film so as to cover the first end and the second end;
The first conductive film is provided in a coil shape,
One of said 1st edge part and said 2nd edge part, and said 3rd electrically conductive film are electrically connected, and the other is insulated , The management method of the goods characterized by the above-mentioned.
前記半導体装置は、
基板と、
前記基板に設けられた複数のトランジスタを有する素子群と、
前記素子群の上方に設けられたアンテナとして機能する第1の導電膜と、
第1の端部および第2の端部を有し且つ前記第1の導電膜を囲んで配置された第2の導電膜と、
前記第1の端部および前記第2の端部を覆うように絶縁膜を介して設けられた第3の導電膜とを有し、
前記第1の導電膜は、コイル状に設けられており、
前記第1の端部及び前記第2の端部と前記第3の導電膜とを電気的に接続することによって、通信距離の制御を行うことを特徴とする商品の管理方法。 Product management method for protecting the consumer's privacy by mounting a semiconductor device capable of transmitting and receiving data in a contactless manner on a product, and controlling the communication distance of the semiconductor device after the consumer purchases the product Because
The semiconductor device includes:
A substrate,
The element group having a plurality of transistors provided in the base plate,
A first conductive film functioning as an antenna provided above the element group;
A second conductive film having a first end and a second end and disposed surrounding the first conductive film;
A third conductive film provided via an insulating film so as to cover the first end and the second end;
The first conductive film is provided in a coil shape,
A method for managing a product, comprising: controlling a communication distance by electrically connecting the first end portion and the second end portion to the third conductive film.
前記通信距離の制御を行う際は、前記第1の端部と前記第2の端部の上方に位置する前記第3の導電膜にそれぞれ選択的にレーザ光を照射することによって、前記第3の導電膜と前記絶縁膜を溶融させて前記第1の端部と前記第2の端部の各々と前記第3の導電膜とを電気的に接続することを特徴とする商品の管理方法。When performing the control of the communication distance, the third conductive film positioned above the first end and the second end is selectively irradiated with laser light, respectively. A product management method comprising melting the conductive film and the insulating film to electrically connect each of the first end portion, the second end portion, and the third conductive film.
前記通信距離の制御を行う際は、前記第1の端部と前記第2の端部の上方に位置する前記第3の導電膜にそれぞれ選択的に導電性を有する針を前記第3の導電膜、前記絶縁膜および前記第2の導電膜の一部を貫通させるように押し込むことによって、前記第1の端部と前記第2の端部の各々と前記第3の導電膜とを電気的に接続することを特徴とする商品の管理方法。When the communication distance is controlled, the third conductive film is selectively connected to the third conductive film positioned above the first end and the second end. The first end portion, the second end portion, and the third conductive film are electrically connected to each other by being pushed through the film, the insulating film, and a part of the second conductive film. A method for managing merchandise, comprising:
前記半導体装置は、
基板と、
前記基板に設けられた複数のトランジスタを有する素子群と、
前記素子群の上方に設けられたアンテナとして機能する第1の導電膜と前記第1の導電膜を囲んで配置された環状の第2の導電膜とを有し、
前記第1の導電膜は、コイル状に設けられており、
前記第2の導電膜の一部を除去することによって、通信距離を制御することを特徴とする危険物の管理方法。 A method for managing a dangerous substance, wherein a non-contact semiconductor device capable of transmitting and receiving data is mounted on a dangerous substance, and the communication distance of the semiconductor device is controlled when managing the dangerous substance,
The semiconductor device includes:
A substrate,
The element group having a plurality of transistors provided in the base plate,
A first conductive film functioning as an antenna provided above the element group, and an annular second conductive film disposed to surround the first conductive film;
The first conductive film is provided in a coil shape,
A dangerous substance management method , wherein a communication distance is controlled by removing a part of the second conductive film.
前記半導体装置は、
基板と、
前記基板に設けられた複数のトランジスタを有する素子群と、
前記素子群の上方に設けられたアンテナとして機能する第1の導電膜と前記第1の導電膜を囲んで配置された第2の導電膜とを有し、
前記第1の導電膜は、コイル状に設けられ、
前記第2の導電膜は、第1の端部と第2の端部を有し且つ前記第1の端部および前記第2の端部が前記複数のトランジスタのいずれかを介して環状に設けられていることを特徴とする商品の管理方法。 Product management method for protecting the consumer's privacy by mounting a semiconductor device capable of transmitting and receiving data in a contactless manner on a product, and controlling the communication distance of the semiconductor device after the consumer purchases the product Because
The semiconductor device includes:
A substrate,
The element group having a plurality of transistors provided in the base plate,
A first conductive film functioning as an antenna provided above the element group, and a second conductive film disposed surrounding the first conductive film;
The first conductive film is provided in a coil shape,
The second conductive film has a first end and a second end, and the first end and the second end are provided in an annular shape via any of the plurality of transistors. The management method of the goods characterized by being characterized.
前記半導体装置は、
基板と、
前記基板に設けられた複数のトランジスタを有する素子群と、
前記素子群の上方に設けられたアンテナとして機能する第1の導電膜と前記アンテナとして機能する第1の導電膜を囲んで配置された複数の第2の導電膜とを有し、
前記アンテナとして機能する第1の導電膜は、コイル状に設けられ、
前記複数の第2の導電膜の各々は、第1の端部と第2の端部を有し且つ前記第1の端部および前記第2の端部が前記複数のトランジスタのいずれかのトランジスタを介して環状に設けられていることを特徴とする商品の管理方法。 Product management method for protecting the consumer's privacy by mounting a semiconductor device capable of transmitting and receiving data in a contactless manner on a product, and controlling the communication distance of the semiconductor device after the consumer purchases the product Because
The semiconductor device includes:
A substrate,
The element group having a plurality of transistors provided in the base plate,
A first conductive film functioning as an antenna provided above the element group and a plurality of second conductive films disposed surrounding the first conductive film functioning as the antenna;
The first conductive film functioning as the antenna is provided in a coil shape,
Each of the plurality of second conductive films has a first end and a second end, and the first end and the second end are one of the plurality of transistors. A product management method, wherein the product is provided in a ring shape.
前記第1の端部および前記第2の端部の一方が前記複数のトランジスタにおけるいずれかのトランジスタのソース領域と接続され、且つ他方がドレイン領域と接続されていることを特徴とする商品の管理方法。 In claim 9 or claim 10 ,
Administration of the product, characterized in that one of said first end and said second end connected to the source region of one of the transistors in the plurality of transistors, which and connected the other is a drain region Way .
前記素子群は、不揮発性のメモリを有していることを特徴とする商品の管理方法。 In any one of Claim 1 thru | or Claim 7, Claim 9 thru | or 11 ,
The element group management method of the product being characterized by having a non-volatile memory.
前記メモリは、
第1の方向に延びた複数のビット線と、前記第1の方向と垂直な第2の方向に延びた複数のワード線と、
記憶素子を備えたメモリセルと、
複数の前記メモリセルからなるメモリセルアレイとを有し、
前記記憶素子は、前記ビット線を構成する導電層と前記ワード線を構成する導電層との間に設けられた有機化合物層を有していることを特徴とする商品の管理方法。 In claim 12 ,
The memory is
A plurality of bit lines extending in a first direction; a plurality of word lines extending in a second direction perpendicular to the first direction;
A memory cell comprising a storage element;
A memory cell array comprising a plurality of the memory cells,
The storage element management method of the product being characterized in that it has an organic compound layer provided between the conductive layer constituting the conductive layer and the word lines constituting the bit line.
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