JP4308163B2 - 歪補償装置 - Google Patents
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Description
域IIで大きくなる。そこで,高出力の送信用電力増幅器とするためには,線形領域Iを広くする必要がある。しかし,このためには実際に必要な能力以上の増幅器が必要となり,コスト及び装置サイズにおいて不利となる問題がある。そこで,送信電力の歪を補償する歪補償機能を無線装置に付することが行われている。
e(t)=x(t)−y(t)
y(t)=hn-1(p)x(t)f(p)
u*(t)=x(t)f(p)=hn-1(p) y*(t)
p=|x(t)|2
ただし,x,y,f,h,u,eは複素数,*は共役複素数である。
が大きい時にステップサイズパラメータμを大きくすると(図6B参照),外乱要素(位相回転やA/D変換器等の量子化誤差)の影響が大きくなり立ち上がりパルスが多くなる。このために誤差演算時における補償係数を発散してしまうという傾向になる。
前記歪補償部は,更に、前記歪補償係数の更新値を演算する際に,前記誤差成分が前記更新値に与える影響度を変更する制御を行う機能を備えたことを特徴とする。
上記の課題を達成する本発明に従う歪補償装置の第4の態様は,第1の態様において,前記影響度の変更は、前記誤差成分に乗算されるパラメータの大きさの変更により実現され、 前記増幅器による増幅後の送信信号をファーストフーリエ変換するファーストフーリエ変換回路と,前記ファーストフーリエ変換回路の出力に基づき最適なパラメータの値を設定する制御手段を有し,前記制御手段は,前記パラメータの大きさを1/2nで表すとき,前記n値を±1ずつ変化させ,歪補償係数更新後の前記ファーストフーリエ変換回路の出力におけるノイズフロアの電力量の小さくなる方向に前記n値を変化させることを特徴とする。
[第1の実施例]
図8は,本発明を適用した歪補償装置の第1の実施例構成ブロック図である。図5の従来例構成と同様の機能を有する部位には同じ参照番号を付している。したがって,図5と同様部位についての更なる説明は省略する。以下,他の実施例についても同様である。
[第2の実施例]
図9は,本発明を適用した歪補償装置の第2の実施例構成ブロック図である。図8の第1の実施例に対して,積分器20に代えファーストフーリエ変換(FFT:Fast Fourier Transform)回路21を備えている。
[第3の実施例]
図10は,本発明を適用した歪補償装置の第3の実施例構成ブロック図である。他の実施例構成と同様の機能を有する部位には同じ参照番号を付している。
指定された書き込みアドレスに歪補償係数を記憶し、指定された読み出しアドレスに記憶している歪み補償係数を出力する記憶部と、
該記憶部から出力された歪補償係数を用いて送信信号に歪補償処理を施すプリディストーション部と,
該歪補償処理の前の送信信号と増幅器による増幅後の送信信号との誤差成分に基づいて前記歪補償係数の更新値を演算する歪補償部とを供え,
該歪補償部は,更に、前記歪補償係数の更新値を演算する際に,前記誤差成分が前記更新値に与える影響度を変更する制御を行う機能を備えた,
ことを特徴とする歪補償装置。
付記1において,
前記影響度の変更は、前記誤差成分に乗算されるパラメータの大きさの変更により実現され、
前記歪補償部は,前記歪補償処理の前の送信信号又は,前記増幅器による増幅後の送信信号の積分値に対応させてパラメータを予め記憶するメモリと,
前記歪補償処理の前の送信信号又は,前記増幅器による増幅後の送信信号の積分値を生成する積分器と,
前記積分器の出力に対応するパラメータを前記メモリから読み出す制御手段を有し,
前記積分値に対応するパラメータは,前記積分値が大きくなるほど小さくなる値に設定されている,
ことを特徴とする歪補償装置。
付記2において,
前記積分値が所定値以下であるとき,前記制御手段は,前記パラメータの値を0に設定することを特徴とする歪補償器。
付記1において,
前記影響度の変更は、前記誤差成分に乗算されるパラメータの大きさの変更により実現され、
前記増幅器による増幅後の送信信号をファーストフーリエ変換するファーストフーリエ変換回路と,
前記ファーストフーリエ変換回路の出力に基づき最適なパラメータの値を設定する制御手段を有し,
該制御手段は,前記パラメータの大きさを1/2nで表すとき,該n値を±1ずつ変化させ,歪補償係数更新後の前記ファーストフーリエ変換回路の出力におけるノイズフロアの電力量の小さくなる方向に前記n値を変化させる,
ことを特徴とする歪補償装置。
付記4において,
前記制御手段は,前記ノイズフロアの電力量が変わらないときは,パラメータの値の小さい方を選択することを特徴とする歪補償装置。
付記1乃至5において,
前記制御手段は,送信開始時又は,送信出力に所定以上の大きさの変動が有るとき,該送信開始時及び,変動時から一定時間を経過するまでは,前記ステップサイズパラメータの値を所定の大きさに設定し,前記一定時間の経過後は,前記所定の大きさより小さい値になるように制御することを特徴とする歪補償装置。
2 シリアル/パラレル変換回路
9 歪保証部
3 D/A変換器
4 直交変調器
5 周波数変換器
6 電力増幅器
7 アンテナ
15a 乗算器
15d アドレス生成回路
15e 歪補償係数ルックアップテーブル
15g 減算器
16 歪補償係数生成回路
30 制御ブロック
31 バス
32 CPU
33 不揮発性メモリ
20 積分器
21 FFT(Fast Fourier Transform)
22 誤差平均回路
Claims (5)
- 送信信号のパワーレベルに応じた歪補償係数を記憶する記憶部と、
前記記憶部に記憶された歪補償係数を用いて送信信号に歪補償処理を施す歪補償処理部と、
前記歪補償処理が施された前記送信信号を増幅する増幅部と、
前記歪補償処理が施される前の送信信号と前記増幅部により増幅された送信信号との誤差成分に、前記歪補償処理が施される前の送信信号の信号レベル又は前記増幅された送信信号の信号レベルに応じたパラメータを乗算し、前記歪補償係数の更新値を演算する演算部とを備え、
前記パラメータは、前記歪補償処理が施される前の送信信号の前記信号レベルまたは前記増幅された送信信号の送信信号レベルが大きいほど小さい値に設定された
ことを特徴とする歪補償装置。 - 指定された書き込みアドレスに歪補償係数を記憶し、指定された読み出しアドレスに記憶している歪補償係数を出力する記憶部と、
該記憶部から出力された歪補償係数を用いて送信信号に歪補償処理を施すプリディストーション部と,
該歪補償処理の前の送信信号と増幅器による増幅後の送信信号との誤差成分に基づいて前記歪補償係数の更新値を演算する歪補償部とを備え,
該歪補償部は,更に、前記歪補償係数の更新値を演算する際に,前記誤差成分が前記更新値に与える影響度を変更する制御を行う機能を備え,
前記影響度の変更は、前記誤差成分に乗算されるパラメータの大きさの変更により実現され、
前記歪補償部は,前記歪補償処理の前の送信信号又は,前記増幅器による増幅後の送信信号の積分値に対応させてパラメータを予め記憶するメモリと,
前記歪補償処理の前の送信信号又は,前記増幅器による増幅後の送信信号の積分値を生成する積分器と,
前記積分器の出力に対応するパラメータを前記メモリから読み出す制御手段を有し,
前記積分値に対応するパラメータは,前記積分値が大きくなるほど小さくなる値に設定されている,
ことを特徴とする歪補償装置。 - 請求項2において,
前記積分値が所定値以下であるとき,前記制御手段は,前記パラメータの値を0に設定することを特徴とする歪補償器。 - 指定された書き込みアドレスに歪補償係数を記憶し、指定された読み出しアドレスに記憶している歪補償係数を出力する記憶部と、
該記憶部から出力された歪補償係数を用いて送信信号に歪補償処理を施すプリディストーション部と,
該歪補償処理の前の送信信号と増幅器による増幅後の送信信号との誤差成分に基づいて前記歪補償係数の更新値を演算する歪補償部とを備え,
該歪補償部は,更に、前記歪補償係数の更新値を演算する際に,前記誤差成分が前記更新値に与える影響度を変更する制御を行う機能を備え,
前記影響度の変更は、前記誤差成分に乗算されるパラメータの大きさの変更により実現され、
前記増幅器による増幅後の送信信号をファーストフーリエ変換するファーストフーリエ変換回路と,
前記ファーストフーリエ変換回路の出力に基づき最適なパラメータの値を設定する制御手段を有し,
該制御手段は,前記パラメータの大きさを1/2nで表すとき,該n値を±1ずつ変化させ,歪補償係数更新後の前記ファーストフーリエ変換回路の出力におけるノイズフロアの電力量の小さくなる方向に前記n値を変化させる,
ことを特徴とする歪補償装置。 - 請求項4において,
前記制御手段は,前記ノイズフロアの電力量が変わらないときは,パラメータの値の小さい方を選択することを特徴とする歪補償装置。
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