JP2642983B2 - データ設定回路 - Google Patents
データ設定回路Info
- Publication number
- JP2642983B2 JP2642983B2 JP1062193A JP6219389A JP2642983B2 JP 2642983 B2 JP2642983 B2 JP 2642983B2 JP 1062193 A JP1062193 A JP 1062193A JP 6219389 A JP6219389 A JP 6219389A JP 2642983 B2 JP2642983 B2 JP 2642983B2
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Description
【発明の詳細な説明】 ［産業上の利用分野］ 本発明はデータ設定回路に関し、特に、データを設定
するための設定スイッチ部を含んだデータ設定回路に関
するものである。
するための設定スイッチ部を含んだデータ設定回路に関
するものである。
［従来の技術及びその問題点］ 設定スイッチ部の各スイッチの開閉状態に応じて設定
されたデータに基づいて信号処理を行う種々の場合があ
る。例えば、火災受信機に複数の火災感知器あるいは中
継器等の端末機器を接続してなる火災警報装置におい
て、火災受信機との情報のやりとりのため、各火災感知
器あるいは中継器側で、例えば自己アドレスのようなデ
ィジタル・データを設定する場合が挙げられ、該ディジ
タル・データの各ビットにおける「０」または「１」に
対応させて設定スイッチ部の各スイッチが開または閉に
設定される。設定スイッチ部において設定されたディジ
タル・データの各ビットにおける「０」、「１」は、ス
イッチの開閉状態に応じた電流もしくは電圧を設定状態
監視部により監視することにより検出される。このよう
にして検出された自己アドレスのようなディジタル・デ
ータを火災受信機側に送出する等により、火災受信機で
は当該端末機器の設置場所等の情報を知ることができ
る。
されたデータに基づいて信号処理を行う種々の場合があ
る。例えば、火災受信機に複数の火災感知器あるいは中
継器等の端末機器を接続してなる火災警報装置におい
て、火災受信機との情報のやりとりのため、各火災感知
器あるいは中継器側で、例えば自己アドレスのようなデ
ィジタル・データを設定する場合が挙げられ、該ディジ
タル・データの各ビットにおける「０」または「１」に
対応させて設定スイッチ部の各スイッチが開または閉に
設定される。設定スイッチ部において設定されたディジ
タル・データの各ビットにおける「０」、「１」は、ス
イッチの開閉状態に応じた電流もしくは電圧を設定状態
監視部により監視することにより検出される。このよう
にして検出された自己アドレスのようなディジタル・デ
ータを火災受信機側に送出する等により、火災受信機で
は当該端末機器の設置場所等の情報を知ることができ
る。
この種の従来のデータ設定回路の例が第２図に示され
ており、電源Vdd及び接地Ｇ間にそれぞれ抵抗Ｒと直列
接続されたスイッチSW1′〜SWn′が設けられている。ス
イッチSW1′〜SWn′と対応の抵抗Ｒとの接続点の電位が
それぞれのスイッチの開閉状態に応じて異なり、それら
電位をマイクロプロセッサMPUが監視することにより設
定データを知ることができる。
ており、電源Vdd及び接地Ｇ間にそれぞれ抵抗Ｒと直列
接続されたスイッチSW1′〜SWn′が設けられている。ス
イッチSW1′〜SWn′と対応の抵抗Ｒとの接続点の電位が
それぞれのスイッチの開閉状態に応じて異なり、それら
電位をマイクロプロセッサMPUが監視することにより設
定データを知ることができる。
この第２図の回路構成においては、ｎ個のスイッチSW
1′〜SWn′がすべて閉じられた状態を考えると、式 Ｉ＝（Vdd/R）×ｎ で示される電流Ｉが定常的に流れることとなり、Vdd＝
（５）、Ｒ＝１（ＫΩ）、ｎ＝８とすると、Ｉ＝40mAも
の電流が流れることとなり、消費電流の低減化の障害と
なっていた。
1′〜SWn′がすべて閉じられた状態を考えると、式 Ｉ＝（Vdd/R）×ｎ で示される電流Ｉが定常的に流れることとなり、Vdd＝
（５）、Ｒ＝１（ＫΩ）、ｎ＝８とすると、Ｉ＝40mAも
の電流が流れることとなり、消費電流の低減化の障害と
なっていた。
［問題を解決するための手段］ 従って、本発明の目的は、電流消費量が少なくて済み
かつ簡単な回路構成のデータ設定回路を実現しようとす
るものである。
かつ簡単な回路構成のデータ設定回路を実現しようとす
るものである。
このため、本発明によれば、電源及び接地間に接続さ
れて第１または第２の状態に設定可能な複数のスイッチ
回路を含む設定スイッチ部と、該設定スイッチ部の各ス
イッチ回路の設定状態を監視することにより設定データ
を検出する設定状態監視部と、を備えたデータ設定回路
において、 前記設定スイッチ部の前記各スイッチ回路は、第１の
抵抗とスイッチとの並列回路で構成され、 前記設定スイッチ部は、電源及び接地間で、前記複数
のスイッチ回路と、前記第１の抵抗よりも充分に大きい
抵抗値を有する第２の抵抗とを直列接続することにより
構成され、 前記設定状態監視部は、前記設定スイッチ部における
前記第２の抵抗並びに前記各スイッチ回路間の接続点の
電位から前記各スイッチ回路の設定状態を監視するよう
にしたことを特徴とするデータ設定回路が提供される。
れて第１または第２の状態に設定可能な複数のスイッチ
回路を含む設定スイッチ部と、該設定スイッチ部の各ス
イッチ回路の設定状態を監視することにより設定データ
を検出する設定状態監視部と、を備えたデータ設定回路
において、 前記設定スイッチ部の前記各スイッチ回路は、第１の
抵抗とスイッチとの並列回路で構成され、 前記設定スイッチ部は、電源及び接地間で、前記複数
のスイッチ回路と、前記第１の抵抗よりも充分に大きい
抵抗値を有する第２の抵抗とを直列接続することにより
構成され、 前記設定状態監視部は、前記設定スイッチ部における
前記第２の抵抗並びに前記各スイッチ回路間の接続点の
電位から前記各スイッチ回路の設定状態を監視するよう
にしたことを特徴とするデータ設定回路が提供される。
［作用］ 設定スイッチ部における各スイッチ回路を、第１の抵
抗とスイッチとの並列回路で構成し、設定スイッチ部
を、電源及び接地間で、前記複数のスイッチ回路と、前
記第１の抵抗よりも充分に大きい抵抗値を雄する第２の
抵抗とを直列接続することにより構成し、設定スイッチ
部における第２の抵抗並びに各スイッチ回路間の接続点
の電位から各スイッチ回路の設定状態を監視するように
したので、スイッチ回路のすべてのスイッチが閉じた場
合でも流れる電流は第２の抵抗により制限され、従っ
て、電流消費量の少ないデータ設定回路が実現できる。
抗とスイッチとの並列回路で構成し、設定スイッチ部
を、電源及び接地間で、前記複数のスイッチ回路と、前
記第１の抵抗よりも充分に大きい抵抗値を雄する第２の
抵抗とを直列接続することにより構成し、設定スイッチ
部における第２の抵抗並びに各スイッチ回路間の接続点
の電位から各スイッチ回路の設定状態を監視するように
したので、スイッチ回路のすべてのスイッチが閉じた場
合でも流れる電流は第２の抵抗により制限され、従っ
て、電流消費量の少ないデータ設定回路が実現できる。
［実施例］ 以下、本発明の一実施例について第１図で説明する。
第１図のデータ設定回路において、設定スイッチ部Ｓ
は、電源Vdd及び接地Ｇ間で、スイッチSW1′〜SWn′の
各々に対して抵抗Ｒの並列に接続した回路A1〜Anを直列
に接続し、さらに抵抗Ｒよりもかなりの高抵抗ｒ（例え
ば、ｒ＝100R）を直列に接続して構成される。
第１図のデータ設定回路において、設定スイッチ部Ｓ
は、電源Vdd及び接地Ｇ間で、スイッチSW1′〜SWn′の
各々に対して抵抗Ｒの並列に接続した回路A1〜Anを直列
に接続し、さらに抵抗Ｒよりもかなりの高抵抗ｒ（例え
ば、ｒ＝100R）を直列に接続して構成される。
抵抗ｒ及び回路A1〜Anの間の各接続点は設定状態監視
部すなわちマイクロプロセッサMPUの入力端子T1〜Tnに
接続されており、これにより、該マイクロプロセッサMP
Uではそれら接続点の電圧を内蔵のアナログ・ディジタ
ル変換器を介して検出判別することで各スイッチSW1〜S
Wnの開閉状態を知ることが可能である。すなわち、ｎ個
のスイッチの各々は、開状態の場合は抵抗Ｒの両端間に
電圧が生じるのでそれを検知することにより、また、閉
状態の場合は抵抗Ｒの両端間には電圧が生じないので０
電圧を検知することにより、それぞれのスイッチの開閉
状態を知ることができる。従って、各スイッチを手動で
開または閉の状態にそれぞれ設定することにより、閉の
状態が例えばディジタルの「１」、開の状態がディジタ
ルの「０」として、アドレスのようなデイジタル情報が
設定され得、該情報は設定状態監視部すなわちマイクロ
プロセッサMPUにて検出され得る。
部すなわちマイクロプロセッサMPUの入力端子T1〜Tnに
接続されており、これにより、該マイクロプロセッサMP
Uではそれら接続点の電圧を内蔵のアナログ・ディジタ
ル変換器を介して検出判別することで各スイッチSW1〜S
Wnの開閉状態を知ることが可能である。すなわち、ｎ個
のスイッチの各々は、開状態の場合は抵抗Ｒの両端間に
電圧が生じるのでそれを検知することにより、また、閉
状態の場合は抵抗Ｒの両端間には電圧が生じないので０
電圧を検知することにより、それぞれのスイッチの開閉
状態を知ることができる。従って、各スイッチを手動で
開または閉の状態にそれぞれ設定することにより、閉の
状態が例えばディジタルの「１」、開の状態がディジタ
ルの「０」として、アドレスのようなデイジタル情報が
設定され得、該情報は設定状態監視部すなわちマイクロ
プロセッサMPUにて検出され得る。
第１図に示した本発明によるデータ設定回路の消費電
流は、すべてのスイッチSW1〜SWnが閉状態の場合につい
て見ると、Vdd＝10（Ｖ）、Ｒ＝１（ＫΩ）、ｒ＝100
R、ｎ＝８のとき、 Ｉ′＝Vdd/r＝Vdd/100r＝ ＝10（Ｖ）/100（ＫΩ）＝0.1（mA） となり、第２図に示した従来の回路構成と比較して消費
電流は400分の１となり、第１図のものが電流消費量を
低減させるという点で一段と優れているのが分かる。
流は、すべてのスイッチSW1〜SWnが閉状態の場合につい
て見ると、Vdd＝10（Ｖ）、Ｒ＝１（ＫΩ）、ｒ＝100
R、ｎ＝８のとき、 Ｉ′＝Vdd/r＝Vdd/100r＝ ＝10（Ｖ）/100（ＫΩ）＝0.1（mA） となり、第２図に示した従来の回路構成と比較して消費
電流は400分の１となり、第１図のものが電流消費量を
低減させるという点で一段と優れているのが分かる。
［発明の効果］ 以上、本発明によれば、データを設定するための設定
スイッチ部を、スイッチ及び第１の抵抗の並列回路で構
成した複数のスイッチ回路と、第１の抵抗よりも充分に
高い抵抗値を有する第２の抵抗との直列接続で構成し、
各第１の抵抗間の電圧を監視することにより各スイッチ
回路間の設定状態を監視するようにしたので、すべての
スイッチ回路のスイッチの閉の状態でも電源及び接地間
に流れる電流は第２の抵抗により制限され、従って、電
流消費量の少ないデータ設定回路を簡単な回路構成で実
現できるという効果がある。
スイッチ部を、スイッチ及び第１の抵抗の並列回路で構
成した複数のスイッチ回路と、第１の抵抗よりも充分に
高い抵抗値を有する第２の抵抗との直列接続で構成し、
各第１の抵抗間の電圧を監視することにより各スイッチ
回路間の設定状態を監視するようにしたので、すべての
スイッチ回路のスイッチの閉の状態でも電源及び接地間
に流れる電流は第２の抵抗により制限され、従って、電
流消費量の少ないデータ設定回路を簡単な回路構成で実
現できるという効果がある。
第１図は、本発明の一実施例によるデータ設定回路を示
す回路図、第２図は、従来のデータ設定回路を示す回路
図である。図において、MPUはマイクロプロセッサ（設
定状態監視部）、Ｓは設定スイッチ部、A1〜Anはスイッ
チ回路、SW1〜SWnはスイッチ、Ｒは第１の抵抗、ｒは第
２の抵抗、Vddは電源、Ｇは接地、である。
す回路図、第２図は、従来のデータ設定回路を示す回路
図である。図において、MPUはマイクロプロセッサ（設
定状態監視部）、Ｓは設定スイッチ部、A1〜Anはスイッ
チ回路、SW1〜SWnはスイッチ、Ｒは第１の抵抗、ｒは第
２の抵抗、Vddは電源、Ｇは接地、である。
Claims (1)
- 【請求項１】電源及び接地間に接続されて第１または第
２の状態に設定可能な複数のスイッチ回路を含む設定ス
イッチ部と、該設定スイッチ部の各スイッチ回路の設定
状態を監視することにより設定データを検出する設定状
態監視部と、を備えたデータ設定回路において、 前記設定スイッチ部の前記各スイッチ回路は、第１の抵
抗とスイッチとの並列回路で構成され、 前記設定スイッチ部は、電源及び接地間で、前記複数の
スイッチ回路と、前記第１の抵抗よりも充分に大きい抵
抗値を有する第２の抵抗とを直列接続することにより構
成され、 前記設定状態監視部は、前記設定スイッチ部における前
記第２の抵抗並びに前記各スイッチ回路間の接続点の電
位から前記各スイッチ回路の設定状態を監視するように
したことを特徴とするデータ設定回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1062193A JP2642983B2 (ja) | 1989-03-16 | 1989-03-16 | データ設定回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1062193A JP2642983B2 (ja) | 1989-03-16 | 1989-03-16 | データ設定回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02242415A JPH02242415A (ja) | 1990-09-26 |
| JP2642983B2 true JP2642983B2 (ja) | 1997-08-20 |
Family
ID=13193067
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1062193A Expired - Lifetime JP2642983B2 (ja) | 1989-03-16 | 1989-03-16 | データ設定回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2642983B2 (ja) |
-
1989
- 1989-03-16 JP JP1062193A patent/JP2642983B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH02242415A (ja) | 1990-09-26 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
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Free format text: PAYMENT UNTIL: 20070818 Year of fee payment: 7 |
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