JP2522258B2 - 信号処理装置 - Google Patents
信号処理装置Info
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- JP2522258B2 JP2522258B2 JP61209143A JP20914386A JP2522258B2 JP 2522258 B2 JP2522258 B2 JP 2522258B2 JP 61209143 A JP61209143 A JP 61209143A JP 20914386 A JP20914386 A JP 20914386A JP 2522258 B2 JP2522258 B2 JP 2522258B2
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- data
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/0703—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
- G06F11/0751—Error or fault detection not based on redundancy
- G06F11/0754—Error or fault detection not based on redundancy by exceeding limits
- G06F11/076—Error or fault detection not based on redundancy by exceeding limits by exceeding a count or rate limit, e.g. word- or bit count limit
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/18—Error detection or correction; Testing, e.g. of drop-outs
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
- G11B27/005—Reproducing at a different information rate from the information rate of recording
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
- G11B27/10—Indexing; Addressing; Timing or synchronising; Measuring tape travel
- G11B27/19—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier
- G11B27/28—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording
- G11B27/30—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording on the same track as the main recording
- G11B27/3027—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording on the same track as the main recording used signal is digitally coded
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/76—Television signal recording
- H04N5/91—Television signal processing therefor
- H04N5/93—Regeneration of the television signal or of selected parts thereof
- H04N5/937—Regeneration of the television signal or of selected parts thereof by assembling picture element blocks in an intermediate store
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B2220/00—Record carriers by type
- G11B2220/90—Tape-like record carriers
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- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Theoretical Computer Science (AREA)
- Multimedia (AREA)
- Quality & Reliability (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
- Television Signal Processing For Recording (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、例えばディジタルビデオテープレコーダ
においてシャトル（変速）再生を行う場合等に用いて好
適な信号処理装置に関する。
においてシャトル（変速）再生を行う場合等に用いて好
適な信号処理装置に関する。
この発明は、所定数のアドレス単位毎に上記メモリ
（３）から上記映像データが読み出された読出回数をカ
ウントする手段（６）と、上記所定数のアドレス単位毎
に上記再生された映像データが上記メモリ（３）に書き
込まれたときにその所定数のアドレス単位についての上
記読出回数をゼロにリセットする手段（２）と、上記所
定数のアドレス単位毎の各読出回数にしたがって、上記
読出回数が所定数以上になったときに、上記メモリ
（３）の対応する上記所定数のアドレス単位からの上記
映像データの読み出しに替えて固定データを出力する切
換手段（８）とを備えるようにしたことにより、変速再
生時に、メモリ（３）内に更新されない映像データが残
るときに、この更新されない古い映像データに替えて、
例えば、黒の固定データを出力するようにしているの
で、変速再生時の再生映像の識別を行い易くすることが
できるものである。
（３）から上記映像データが読み出された読出回数をカ
ウントする手段（６）と、上記所定数のアドレス単位毎
に上記再生された映像データが上記メモリ（３）に書き
込まれたときにその所定数のアドレス単位についての上
記読出回数をゼロにリセットする手段（２）と、上記所
定数のアドレス単位毎の各読出回数にしたがって、上記
読出回数が所定数以上になったときに、上記メモリ
（３）の対応する上記所定数のアドレス単位からの上記
映像データの読み出しに替えて固定データを出力する切
換手段（８）とを備えるようにしたことにより、変速再
生時に、メモリ（３）内に更新されない映像データが残
るときに、この更新されない古い映像データに替えて、
例えば、黒の固定データを出力するようにしているの
で、変速再生時の再生映像の識別を行い易くすることが
できるものである。
複数のトラックを走査して１フィールドを再生するビ
デオテープレコーダにおいて、変速再生を行うために
は、再生基準側と再生信号の間に大きな時間軸のずれが
生じるため、この補正を行う必要がある。
デオテープレコーダにおいて、変速再生を行うために
は、再生基準側と再生信号の間に大きな時間軸のずれが
生じるため、この補正を行う必要がある。
そこで従来は、第４図に示すように、入力端子（１）
からの再生データをシンク再生回路（２）に供給してデ
ータと書込みアドレスを抽出し、抽出した書込みアドレ
スに基づいてデータをメモリ（３）に書き込み、これを
基準信号に応答して形成された読出しアドレス発生回路
（４）からの読出しアドレスに基づいて読み出し、出力
端子（５）に取り出すようにしている。出力端子（５）
に取り出されたデータは、図示せずも誤り検出・訂正回
路で誤りを検出して訂正される等所定の信号処理を受け
て出力される。なお、変速再生を行う従来例としては、
特開昭56−144682号，特開昭60−40573号等がある。
からの再生データをシンク再生回路（２）に供給してデ
ータと書込みアドレスを抽出し、抽出した書込みアドレ
スに基づいてデータをメモリ（３）に書き込み、これを
基準信号に応答して形成された読出しアドレス発生回路
（４）からの読出しアドレスに基づいて読み出し、出力
端子（５）に取り出すようにしている。出力端子（５）
に取り出されたデータは、図示せずも誤り検出・訂正回
路で誤りを検出して訂正される等所定の信号処理を受け
て出力される。なお、変速再生を行う従来例としては、
特開昭56−144682号，特開昭60−40573号等がある。
ところで、上述の如き従来装置では、メモリ（３）に
１度書き込んだデータは、新しいデータが書き込まれる
までホールドされるので、変速再生の倍速の関係で長い
間拾えないフィールドのアドレスのデータがあると、そ
のデータがホールドされて画面の他の部分と相関のない
データとなり、誤りのように見えてしまう欠点があると
共に、また画面の動きが悪くなり、動く画面に尾を引く
ような症状を呈するような欠点があった。
１度書き込んだデータは、新しいデータが書き込まれる
までホールドされるので、変速再生の倍速の関係で長い
間拾えないフィールドのアドレスのデータがあると、そ
のデータがホールドされて画面の他の部分と相関のない
データとなり、誤りのように見えてしまう欠点があると
共に、また画面の動きが悪くなり、動く画面に尾を引く
ような症状を呈するような欠点があった。
この発明は斯る点に鑑みてなされたもので、変速再生
時に相関のない画素が残らないようにすると共に画面が
動いたり画面が切換わったりするときに追従性を良く
し、残像を少なくすることができる信号処理装置を提供
するものである。
時に相関のない画素が残らないようにすると共に画面が
動いたり画面が切換わったりするときに追従性を良く
し、残像を少なくすることができる信号処理装置を提供
するものである。
この発明は、変速再生された映像データが該映像デー
タに対応した書込アドレスに従ってメモリ（３）に書き
込まれ、上記メモリ（３）に書き込まれた映像データが
基準の読出アドレスに従って読み出されるようになされ
た信号処理装置において、所定数のアドレス単位毎に上
記メモリ（３）から上記映像データが読み出された読出
回数をカウントする手段（６）と、上記所定数のアドレ
ス単位毎に上記再生された映像データが上記メモリ
（３）に書き込まれたときにその所定数のアドレス単位
についての上記読出回数をゼロにリセットする手段
（２）と、上記所定数のアドレス単位毎の各読出回数に
したがって、上記読出回数が所定数以上になったとき
に、上記メモリ（３）の対応する上記所定数のアドレス
単位からの上記映像データの読み出しに替えて固定デー
タを出力する切換手段（８）とを備えたことを特徴とす
る信号処理装置である。
タに対応した書込アドレスに従ってメモリ（３）に書き
込まれ、上記メモリ（３）に書き込まれた映像データが
基準の読出アドレスに従って読み出されるようになされ
た信号処理装置において、所定数のアドレス単位毎に上
記メモリ（３）から上記映像データが読み出された読出
回数をカウントする手段（６）と、上記所定数のアドレ
ス単位毎に上記再生された映像データが上記メモリ
（３）に書き込まれたときにその所定数のアドレス単位
についての上記読出回数をゼロにリセットする手段
（２）と、上記所定数のアドレス単位毎の各読出回数に
したがって、上記読出回数が所定数以上になったとき
に、上記メモリ（３）の対応する上記所定数のアドレス
単位からの上記映像データの読み出しに替えて固定デー
タを出力する切換手段（８）とを備えたことを特徴とす
る信号処理装置である。
この発明によれば、所定数のアドレス単位毎にメモリ
（３）から映像データが読み出された読出回数をカウン
トし、所定数のアドレス単位毎に再生された映像データ
がメモリ（３）に書き込まれたときにその所定数のアド
レス単位についての読出回数をゼロにリセットし、所定
数のアドレス単位毎の各読出回数にしたがって、読出回
数が所定数以上になったときに、メモリ（３）の対応す
る所定数のアドレス単位からの映像データの読み出しに
替えて固定データを切り換えて出力する。
（３）から映像データが読み出された読出回数をカウン
トし、所定数のアドレス単位毎に再生された映像データ
がメモリ（３）に書き込まれたときにその所定数のアド
レス単位についての読出回数をゼロにリセットし、所定
数のアドレス単位毎の各読出回数にしたがって、読出回
数が所定数以上になったときに、メモリ（３）の対応す
る所定数のアドレス単位からの映像データの読み出しに
替えて固定データを切り換えて出力する。
以下、この発明の一実施例を第１図〜第３図に基づい
て詳しく説明する。
て詳しく説明する。
第１図は本実施例の回路構成を示すもので、同図にお
いて、第４図と対応する部分には同一符号を付し、その
詳細説明は省略する。
いて、第４図と対応する部分には同一符号を付し、その
詳細説明は省略する。
本実施例では第２のメモリとしてのデータホールドタ
イマ（６）を設け、このタイマ（６）にはシンク再生回
路（２）からの書込みアドレス及び読出しアドレス発生
回路（４）からの読出しアドレスが供給されると共に端
子（７）からの変速再生モード信号が供給されるように
なされている。タイマ（６）は端子（７）からの変速再
生モード信号が供給されたときのみ動作し、一度メモリ
（３）に書き込まれたデータが所定回数読み出されると
切換信号を発生し、メモリ（３）の出力側に設けられた
スイッチ（８）を接点ａ側よりｂ側に切換える。これに
よりデータをホールドする時間を制御している。このデ
ータをホールドする時間は倍速等のモードに応じて切換
えることも可能である。なお、スイッチ（８）の接点ａ
にはメモリ（３）の出力側が接続され、スイッチ（８）
の接点ｂには固定データが印加されている端子（９）が
接続されている。従ってスイッチ（８）が接点ａ側に接
続されているときは読出しアドレスに応じたメモリ
（３）からのデータが出力端子（５）に出力され、スイ
ッチ（８）が接点ｂ側に接続されているときは端子
（９）からの固定データが出力端子（５）に出力され
る。
イマ（６）を設け、このタイマ（６）にはシンク再生回
路（２）からの書込みアドレス及び読出しアドレス発生
回路（４）からの読出しアドレスが供給されると共に端
子（７）からの変速再生モード信号が供給されるように
なされている。タイマ（６）は端子（７）からの変速再
生モード信号が供給されたときのみ動作し、一度メモリ
（３）に書き込まれたデータが所定回数読み出されると
切換信号を発生し、メモリ（３）の出力側に設けられた
スイッチ（８）を接点ａ側よりｂ側に切換える。これに
よりデータをホールドする時間を制御している。このデ
ータをホールドする時間は倍速等のモードに応じて切換
えることも可能である。なお、スイッチ（８）の接点ａ
にはメモリ（３）の出力側が接続され、スイッチ（８）
の接点ｂには固定データが印加されている端子（９）が
接続されている。従ってスイッチ（８）が接点ａ側に接
続されているときは読出しアドレスに応じたメモリ
（３）からのデータが出力端子（５）に出力され、スイ
ッチ（８）が接点ｂ側に接続されているときは端子
（９）からの固定データが出力端子（５）に出力され
る。
第２図はタイマ（６）の一例を示すもので、タイマ
（６）は例えば２トラックで１フィールドを構成するシ
ンクの数例えば256しかアドレスを持っていない。デー
タのホールド回数をｎとするとタイマ（６）は256×ｎ
ビットの容量を持つことになる。因みに、メモリ（３）
は１シンクを例えば768サンプルとすると768×256のア
ドレスを有し、データを例えば８ビットとすると768×2
56×８ビットの容量をもつことになる。
（６）は例えば２トラックで１フィールドを構成するシ
ンクの数例えば256しかアドレスを持っていない。デー
タのホールド回数をｎとするとタイマ（６）は256×ｎ
ビットの容量を持つことになる。因みに、メモリ（３）
は１シンクを例えば768サンプルとすると768×256のア
ドレスを有し、データを例えば８ビットとすると768×2
56×８ビットの容量をもつことになる。
さて、第２図ではｎビットを４ビットの場合を例にと
り説明する。タイマ（６）は４ビットに夫々対応してR1
〜R4のレジスタを有し、これ等のレジスタR1〜R4は変速
再生モード時シンク再生回路（２）よりあるシンクに対
応した書込みアドレスが発生されてこの書込みアドレス
に従ってデータがメモリ（３）に書き込まれると、これ
に対応してレジスタのあるシンクに対応した部分の内容
を第２図Ａに示すように全て“0"とする。
り説明する。タイマ（６）は４ビットに夫々対応してR1
〜R4のレジスタを有し、これ等のレジスタR1〜R4は変速
再生モード時シンク再生回路（２）よりあるシンクに対
応した書込みアドレスが発生されてこの書込みアドレス
に従ってデータがメモリ（３）に書き込まれると、これ
に対応してレジスタのあるシンクに対応した部分の内容
を第２図Ａに示すように全て“0"とする。
次に、読出しアドレス発生回路（４）より読出しアド
レスが発生されて上述の如く書き込まれたデータがメモ
リ（３）より読み出され、スイッチ（８）の接点ａ側を
通って出力端子（５）に出力されると、その第１回目の
読出しアドレスに対応して例えば第２図Ｂに示すように
レジスタR1〜R3の内容は“0"に保持するもレジスタR4の
内容を“1"とする。
レスが発生されて上述の如く書き込まれたデータがメモ
リ（３）より読み出され、スイッチ（８）の接点ａ側を
通って出力端子（５）に出力されると、その第１回目の
読出しアドレスに対応して例えば第２図Ｂに示すように
レジスタR1〜R3の内容は“0"に保持するもレジスタR4の
内容を“1"とする。
次に読出しアドレス発生回路（４）からの第２回目の
読出しアドレスによりメモリ（３）より先にデータが読
み出されると、この第２回目の読出しアドレスに対応し
て例えば第２図Ｃに示すように、レジスタR1,R2の内容
は“0"に保持するもレジスタR3,R4の内容を“1"とす
る。
読出しアドレスによりメモリ（３）より先にデータが読
み出されると、この第２回目の読出しアドレスに対応し
て例えば第２図Ｃに示すように、レジスタR1,R2の内容
は“0"に保持するもレジスタR3,R4の内容を“1"とす
る。
また、読出しアドレス発生回路（４）からの第３回目
の読出しアドレスによりメモリ（３）より先のデータが
読み出されると、この第３回目の読出しアドレスに対応
して例えば第２図Ｄに示すように、レジスタR1の内容は
“0"に保持するもレジスタR2〜R4の内容を“1"とする。
の読出しアドレスによりメモリ（３）より先のデータが
読み出されると、この第３回目の読出しアドレスに対応
して例えば第２図Ｄに示すように、レジスタR1の内容は
“0"に保持するもレジスタR2〜R4の内容を“1"とする。
更に読出しアドレス発生回路（４）からの第４回目の
読出しアドレスによりメモリ（３）より先のデータが読
み出されると、この第４回目の読出しアドレスに対応し
て例えば第２図Ｅに示すように、レジスタR1〜R4の内容
を全て“1"とする。つまり、読出しアドレスがあるたび
にレジスタR4の内容“1"をレジスタR1に向って順次シフ
トしてゆく。そしてこの場合レジスタR1側を出力側とす
ると、レジスタR1より“1"が出力された時点で、つまり
第５回目の読出しアドレスがあった時点で、この出力を
切換信号としてスイッチ（８）に供給し、スイッチ
（８）を接点ａ側よりｂ側に切換える。すると、端子
（９）からの固定データが出力端子（５）に出力され
る。
読出しアドレスによりメモリ（３）より先のデータが読
み出されると、この第４回目の読出しアドレスに対応し
て例えば第２図Ｅに示すように、レジスタR1〜R4の内容
を全て“1"とする。つまり、読出しアドレスがあるたび
にレジスタR4の内容“1"をレジスタR1に向って順次シフ
トしてゆく。そしてこの場合レジスタR1側を出力側とす
ると、レジスタR1より“1"が出力された時点で、つまり
第５回目の読出しアドレスがあった時点で、この出力を
切換信号としてスイッチ（８）に供給し、スイッチ
（８）を接点ａ側よりｂ側に切換える。すると、端子
（９）からの固定データが出力端子（５）に出力され
る。
従ってこの場合４ビットのレジスタを用いているので
読出しアドレスに対して４回ホールドを行い、５回目に
固定データを出すことになる。つまり、本実施例では、
ｎビットのレジスタを用いた場合読出しアドレスに対し
てｎ回ホールドを行い、ｎ＋１回以上は固定データを出
すことになる。
読出しアドレスに対して４回ホールドを行い、５回目に
固定データを出すことになる。つまり、本実施例では、
ｎビットのレジスタを用いた場合読出しアドレスに対し
てｎ回ホールドを行い、ｎ＋１回以上は固定データを出
すことになる。
第３図はタイマ（６）の他の例を示すもので、こゝで
は例えば２つのレジスタR1及びR2を２進カウンタとして
用いる場合である。変速再生モード時シンク再生回路
（２）よりあるシンクに対応した書込みアドレスが発生
されてこの書込アドレスに従ってデータがメモリ（３）
に書き込まれると、これに対応してレジスタR1,R2のあ
るシンクに対応した部分の内容を第３図Ａに示すように
“00"とする。
は例えば２つのレジスタR1及びR2を２進カウンタとして
用いる場合である。変速再生モード時シンク再生回路
（２）よりあるシンクに対応した書込みアドレスが発生
されてこの書込アドレスに従ってデータがメモリ（３）
に書き込まれると、これに対応してレジスタR1,R2のあ
るシンクに対応した部分の内容を第３図Ａに示すように
“00"とする。
次に、読出しアドレス発生回路（４）より読出しアド
レスが発生されて上述の如き書き込まれたデータがメモ
リ（３）より読み出され、スイッチ（８）の接点ａ側を
通って出力端子（５）に出力されると、その第１回目の
読出しアドレスに対応して例えば第３図Ｂに示すよう
に、レジスタR1,R2の内容は“01"となる。
レスが発生されて上述の如き書き込まれたデータがメモ
リ（３）より読み出され、スイッチ（８）の接点ａ側を
通って出力端子（５）に出力されると、その第１回目の
読出しアドレスに対応して例えば第３図Ｂに示すよう
に、レジスタR1,R2の内容は“01"となる。
次に読出しアドレス発生回路（４）からの第２回目の
読出しアドレスによりメモリ（３）より先のデータが読
み出されると、この第２回目の読出しアドレスに対応し
て例えば第３図Ｃに示すように、レジスタR1,R2の内容
は“10"となる。
読出しアドレスによりメモリ（３）より先のデータが読
み出されると、この第２回目の読出しアドレスに対応し
て例えば第３図Ｃに示すように、レジスタR1,R2の内容
は“10"となる。
更に読出しアドレス発生回路（４）からの第３回目の
読出しアドレスに対応して例えば第３図Ｄに示すよう
に、レジスタR1,R2の内容は“11"となる。
読出しアドレスに対応して例えば第３図Ｄに示すよう
に、レジスタR1,R2の内容は“11"となる。
そこで、この“11"の信号をアンドゲート（図示せ
ず）を介して取り出すようにすれば切換信号が得られ、
この切換信号をスイッチ（８）に供給して接点ａ側より
ｂ側に切換え、端子（９）からの固定データを出力端子
（５）に出力するようにすればよい。
ず）を介して取り出すようにすれば切換信号が得られ、
この切換信号をスイッチ（８）に供給して接点ａ側より
ｂ側に切換え、端子（９）からの固定データを出力端子
（５）に出力するようにすればよい。
従って、この場合２進カウンタを用いるので読出しア
ドレスに対して３回ホールドを行い、４回目に固定デー
タを出すことになる。つまり、本実施例ではｎ進カウン
タを用いた場合読出しアドレスに対して2n−１回ホール
ドを行い、2n回以上は固定データを出すことになる。
ドレスに対して３回ホールドを行い、４回目に固定デー
タを出すことになる。つまり、本実施例ではｎ進カウン
タを用いた場合読出しアドレスに対して2n−１回ホール
ドを行い、2n回以上は固定データを出すことになる。
なお、上述の各実施例において、ホールド中つまり読
出しアドレスが供給される途中に書込みアドレスが発生
されると、その時点でタイマ（６）の各レジスタは全て
“0"となり、従ってメモリ（３）から更新されたデータ
がスイッチ（８）の接点ａ側を介して出力端子（５）に
出力される。
出しアドレスが供給される途中に書込みアドレスが発生
されると、その時点でタイマ（６）の各レジスタは全て
“0"となり、従ってメモリ（３）から更新されたデータ
がスイッチ（８）の接点ａ側を介して出力端子（５）に
出力される。
この発明によれば、所定数のアドレス単位毎に上記メ
モリ（３）から上記映像データが読み出された読出回数
をカウントする手段（６）と、上記所定数のアドレス単
位毎に上記再生された映像データが上記メモリ（３）に
書き込まれたときにその所定数のアドレス単位について
の上記読出回数をゼロにリセットする手段（２）と、上
記所定数のアドレス単位毎の各読出回数にしたがって、
上記読出回数が所定数以上になったときに、上記メモリ
（３）の対応する上記所定数のアドレス単位からの上記
映像データの読み出しに替えて固定データを出力する切
換手段（８）とを備えるようにしたことにより、変速再
生時に、メモリ（３）内に更新されない映像データが残
るときに、この更新されない古い映像データに替えて、
例えば、黒の固定データを出力するようにしているの
で、変速再生時の再生映像の識別を行い易くすることが
できるという効果を奏する。従って、変速再生時に相関
のない画素が残らないようになり、しかも、変速再生時
に画面が動いたり、画面が切り替わったりするときに追
従性が良くなって、残像が少なくなり、動く画面に尾を
引くような症状がなくなるという効果を奏する。
モリ（３）から上記映像データが読み出された読出回数
をカウントする手段（６）と、上記所定数のアドレス単
位毎に上記再生された映像データが上記メモリ（３）に
書き込まれたときにその所定数のアドレス単位について
の上記読出回数をゼロにリセットする手段（２）と、上
記所定数のアドレス単位毎の各読出回数にしたがって、
上記読出回数が所定数以上になったときに、上記メモリ
（３）の対応する上記所定数のアドレス単位からの上記
映像データの読み出しに替えて固定データを出力する切
換手段（８）とを備えるようにしたことにより、変速再
生時に、メモリ（３）内に更新されない映像データが残
るときに、この更新されない古い映像データに替えて、
例えば、黒の固定データを出力するようにしているの
で、変速再生時の再生映像の識別を行い易くすることが
できるという効果を奏する。従って、変速再生時に相関
のない画素が残らないようになり、しかも、変速再生時
に画面が動いたり、画面が切り替わったりするときに追
従性が良くなって、残像が少なくなり、動く画面に尾を
引くような症状がなくなるという効果を奏する。
第１図はこの発明の一実施例を示す回路構成図、第２図
はこの発明の要部の一例を示す線図、第３図はこの発明
の要部の他の例を示す線図、第４図は従来装置の一例を
示す回路構成図である。 （２）はシンク再生回路、（３）はメモリ、（４）は読
出しアドレス発生回路、（６）はデータホールドタイ
マ、（８）はスイッチ、（９）は固定データ印加端子で
ある。
はこの発明の要部の一例を示す線図、第３図はこの発明
の要部の他の例を示す線図、第４図は従来装置の一例を
示す回路構成図である。 （２）はシンク再生回路、（３）はメモリ、（４）は読
出しアドレス発生回路、（６）はデータホールドタイ
マ、（８）はスイッチ、（９）は固定データ印加端子で
ある。
Claims (1)
- 【請求項１】変速再生された映像データが該映像データ
に対応した書込アドレスに従ってメモリに書き込まれ、
上記メモリに書き込まれた映像データが基準の読出アド
レスに従って読み出されるようになされた信号処理装置
において、 所定数のアドレス単位毎に上記メモリから上記映像デー
タが読み出された読出回数をカウントする手段と、 上記所定数のアドレス単位毎に上記再生された映像デー
タが上記メモリに書き込まれたときにその所定数のアド
レス単位についての上記読出回数をゼロにリセットする
手段と、 上記所定数のアドレス単位毎の各読出回数にしたがっ
て、上記読出回数が所定数以上になったときに、上記メ
モリの対応する上記所定数のアドレス単位からの上記映
像データの読み出しに替えて固定データを出力する切換
手段とを備えたことを特徴とする信号処理装置。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61209143A JP2522258B2 (ja) | 1986-09-05 | 1986-09-05 | 信号処理装置 |
| GB8720692A GB2194851B (en) | 1986-09-05 | 1987-09-03 | Apparatus for processing digital data |
| US07/092,542 US4799113A (en) | 1986-09-05 | 1987-09-03 | Apparatus for processing digital data |
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| CA000546161A CA1310108C (en) | 1986-09-05 | 1987-09-04 | Apparatus for processing digital data |
Applications Claiming Priority (1)
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|---|---|---|---|
| JP61209143A JP2522258B2 (ja) | 1986-09-05 | 1986-09-05 | 信号処理装置 |
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- 1987-09-04 DE DE3729730A patent/DE3729730C2/de not_active Expired - Fee Related
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| EXPY | Cancellation because of completion of term |