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JP2015195976A5 - - Google Patents

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JP2015195976A5 JP2014075604A JP2014075604A JP2015195976A5 JP 2015195976 A5 JP2015195976 A5 JP 2015195976A5 JP 2014075604 A JP2014075604 A JP 2014075604A JP 2014075604 A JP2014075604 A JP 2014075604A JP 2015195976 A5 JP2015195976 A5 JP 2015195976A5
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CPU710は、CPUバス720を介してメモリ726と接続している。CPU710はまた、GPUバス718を介してGPU724とも接続している。CPU710は、これらのバスとはブリッジ12を介して接続する。また、メモリ726はGPUバス718とCPUバス720とに接続する。このため、メモリ726におけるCPU710またはGPU724との間でのデータのやりとりは、メモリ制御部714を介して実行する。CPU710とGPU724とはメモリ726を共有し、メモリ726を介してデータを共有する。GPUバス718とCPUバス720とはともに、データ交換に用いられるデータバスとして機能する。
図4は、異なるプロセッシングシステム700間のデータ転送を説明するための図である。図4に示す例では、2つの異なるプロセッシングシステム700aおよび700bが、入出力ブリッジ722aおよび722bを介して接続している。より具体的に、プロセッシングシステム700aが備える入出力ブリッジ722aは、他のプロセッシングシステム700との間でデータを送受信するための複数の入出力ポート730a、731a、732a、および733aを備える。同様にプロセッシングシステム700bが備える入出力ブリッジ722bも、複数の入出力ポート730b、731b、732b、および733bを備える。プロセッシングシステム700aおよび700bは、入出力ポート730aおよび入出力ポート730bを介して接続している。
図4において、プロセッシングシステム700aはプロセッシングシステム700bの他、入出力ポート732aを介してプロセッシングシステム700cと接続し、入出力ポート733aを介してプロセッシングシステム700dとも接続している。また、プロセッシングシステム700bは、プロセッシングシステム700aの他、入出力ポート731b、732、および733bを介して、それぞれプロセッシングシステム700c、700d、および700eとも接続している。このように、入出力ポートを介して異なるプロセッシングシステム700間を接続するバスが、それらのプロセッシングシステム700間でデータを送受信するための外部バスとして機能する。
実施の形態に係るプロセッシングシステム700において、GPU724は、CPU710の制御によらず、DMAコントローラ716に対してメモリ726が格納するデータのデータ転送命令を発行することができる。例えばGPU724aが、DMAコントローラ716aに対してメモリ726aが格納するデータを、プロセッシングシステム700bに転送することを指示するデータ転送命令を発行したとする。データ転送命令を発行する契機としては、GPU724aが自発的にデータ転送命令を発行する場合もある。あるいは、プロセッシングシステム700bがブロードキャストしたデータ読み出し命令に応答して、データ転送命令を発行する場合もある。いずれにしても、DMAコントローラ716aは、データ転送命令を受信すると、入出力ブリッジ722に、プロセッシングシステム700bへメモリ726が格納するデータを転送させる。
4つのブレード600a、600b、600c、および600dはそれぞれ、各ブレードにおけるいずれかのプロセッシングシステム700が備える入出力ブリッジ722を介して、1対1で通信可能に接続される。例えば、ブレード600aとブレード600dとは、ブレード600a内のプロセッシングシステム700dの入出力ブリッジ722と、ブレード600d内のプロセッシングシステム700の入出力ブリッジ722とを介して、互いにポイント・ツー・ポイントで接続する。プロセッシングシステム700dは、ブレード600a内においてプロセッシングシステム700a、700b、および700cとも接続するが、入出力ブリッジ722は4つの入出力ポート730、731、732、および733備えるため、4つの異なるプロセッシングシステム700と同時に接続することができる。
記号Bで示すメモリ領域(以下、「領域B」という。)は、領域Aのデータを使って、GPU724が演算処理した結果を格納するメモリ領域を示す。記号Cで示す領域(以下、「領域C」という。)は、領域Aのデータと領域Bのデータとの両方を用いて、GPU724が演算処理した結果を格納するメモリ領域を示す。記号Dで示す領域(以下、「領域D」という。)は、領域Cのデータが完全に揃った後に、そのデータを使ってCPU710が演算処理した結果を格納するメモリ領域である。記号FBで示す領域(以下、「領域FB」という。)は、領域Aのデータ、領域のデータ、および領域Dのデータを使って描画した結果を格納するフレームバッファ(Frame Buffer)を示す。
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