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JP2012128717A - Communication apparatus and communication system - Google Patents

Communication apparatus and communication system Download PDF

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JP2012128717A JP2010280393A JP2010280393A JP2012128717A JP 2012128717 A JP2012128717 A JP 2012128717A JP 2010280393 A JP2010280393 A JP 2010280393A JP 2010280393 A JP2010280393 A JP 2010280393A JP 2012128717 A JP2012128717 A JP 2012128717A
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Abstract

PROBLEM TO BE SOLVED: To provide a communication apparatus and a communication system capable of realizing appropriate communication between hosts while suppressing deterioration in usability.SOLUTION: An NT port 23 of a first PCI Express switch 20 provided in a first apparatus C and an NT port 33 of a second PCI Express switch 30 provided in a second apparatus D are connected in a way that allows communication between them. When the communication is performed between the first apparatus C and the second apparatus D, the first PCI Express switch 20 performs address conversion between the address which the first apparatus C uses and the address which the NT port 23 uses, and the second PCI Express switch 30 performs address conversion between the address which the second apparatus D uses and the address which the NT port 33 uses.

Description

本発明は、通信機器および通信システムに関する。   The present invention relates to a communication device and a communication system.

高速シリアルインターフェースの規格として、PCI Express(登録商標)が知られている。PCI Expressは、高いデータ転送速度と様々なアプリケーションに適合できる柔軟性を兼ね備えており、グラフィックスカードなどの拡張ボードに広く利用されている。また、近年では、異なる機器の間での通信にもPCI Expressの通信プロトコルが使われ始めており、PCI Express規格に準拠したケーブルアダプタも知られている。   PCI Express (registered trademark) is known as a high-speed serial interface standard. PCI Express combines high data transfer speed and flexibility to adapt to various applications, and is widely used for expansion boards such as graphics cards. In recent years, the PCI Express communication protocol has begun to be used for communication between different devices, and cable adapters conforming to the PCI Express standard are also known.

PCI Expressは、1つのルートコンプレックスを頂点としたデバイスツリー構造をとることを前提としており、デバイスツリーの中に複数のルートコンプレックスが存在することを想定していない。このため、PCI Expressの標準的な適用では、ルートコンプレックスとなるデバイスを個別に持つ複数のホスト間での通信を行うことができない。   PCI Express assumes a device tree structure with one root complex as a vertex, and does not assume that a plurality of root complexes exist in the device tree. For this reason, with standard application of PCI Express, it is not possible to perform communication between a plurality of hosts having individual devices as root complexes.

このような問題の解決策として、PCI Express規格に準拠したスイッチ(以下、PCI Expressスイッチという。)を提供するベンダーから、ノントランスペアレントポートを持つPCI Expressスイッチが提供されている。ノントランスペアレントポートとは、通信の相手方を非透過にするポートである。PCI Expressスイッチのノントランスペアレントポートを用いて2つのホストを接続すれば、ホスト間で互いに邪魔されることなく個別に初期化などを行うことが可能となり、また、各ホストの制御主体(CPU)は、別々に動作しながら互いのリソースにアクセス可能となる。   As a solution to such a problem, a PCI Express switch having a non-transparent port is provided by a vendor that provides a switch compliant with the PCI Express standard (hereinafter referred to as a PCI Express switch). A non-transparent port is a port that makes a communication partner non-transparent. If two hosts are connected using a non-transparent port of a PCI Express switch, it is possible to perform initialization and the like without interfering with each other, and the control entity (CPU) of each host , They can access each other's resources while operating separately.

PCI Expressスイッチのノントランスペアレントポートを用いて2つのホストを接続した構成の一例として、特許文献1に開示されたものが知られている。特許文献1には、デジタル複合機から外部のコンピュータもしくは情報処理ユニット部にデータ転送する際に、ネットワークを占有しないようにする目的で、画像処理ユニット部(ホスト)と情報処理ユニット部(ホスト)にそれぞれデータ転送ユニットを設け、画像処理ユニット部のデータ転送ユニットと情報処理ユニット部のデータ転送ユニットとを、PCI Expressスイッチのノントランスペアレントポートを用いて接続する構成が開示されている。   As an example of a configuration in which two hosts are connected using a non-transparent port of a PCI Express switch, the one disclosed in Patent Document 1 is known. Patent Document 1 discloses an image processing unit (host) and an information processing unit (host) for the purpose of not occupying a network when transferring data from a digital multifunction peripheral to an external computer or information processing unit. A configuration is disclosed in which a data transfer unit is provided, and a data transfer unit of an image processing unit unit and a data transfer unit of an information processing unit unit are connected using a non-transparent port of a PCI Express switch.

しかしながら、PCI Expressスイッチのノントランスペアレントポートを用いて2つのホストを接続する従来の構成では、例えば、2つのホスト間をケーブル接続した場合に、ホスト間を繋ぐケーブルが抜けるとシステムがハングアップするといった問題や、ホストの立ち上げ順に制約が加わるといった問題があり、ホスト間で通信を行うシステムとして使い勝手が悪いという問題があった。   However, in the conventional configuration in which two hosts are connected using a non-transparent port of a PCI Express switch, for example, when a cable is connected between two hosts, the system hangs up when the cable connecting the hosts is disconnected. There have been problems such as problems and restrictions in the order in which the hosts are started up, and there has been a problem that the system is not convenient for communication between hosts.

本発明は、上記に鑑みてなされたものであって、使い勝手の悪化を招くことなく適切なホスト間通信を実現することができる通信機器および通信システムを提供することを目的としている。   The present invention has been made in view of the above, and an object of the present invention is to provide a communication device and a communication system capable of realizing appropriate host-to-host communication without causing deterioration in usability.

上述した課題を解決し、目的を達成するために、本発明に係る通信機器は、第1のノントランスペアレントポートを有し、該第1のノントランスペアレントポートを用いた通信を中継する第1の中継部を備えた外部機器との間で通信を行う通信機器であって、前記第1のノントランスペアレントポートに通信可能に接続された第2のノントランスペアレントポートを有し、該第2のノントランスペアレントポートを用いた通信を中継する第2の中継部を備え、前記第2の中継部は、前記通信機器が前記外部装置との間で通信を行う際に、前記通信機器が使用するアドレスと前記第2のノントランスペアレントポートが使用するアドレスとの間のアドレス変換を行うこと、を特徴とする。   In order to solve the above-described problems and achieve the object, a communication device according to the present invention has a first non-transparent port, and a first relay that relays communication using the first non-transparent port A second non-transparent port, the second non-transparent port communicably connected to the first non-transparent port. A second relay unit that relays communication using the communication device, and the second relay unit uses the address used by the communication device and the first address when the communication device communicates with the external device. And performing address conversion between addresses used by the two non-transparent ports.

また、本発明に係る通信システムは、第1の機器と第2の機器とが通信可能に接続された通信システムであって、前記第1の機器に設けられ、第1のノントランスペアレントポートを有し、該第1のノントランスペアレントポートを用いた通信を中継する第1の中継部と、前記第2の機器に設けられ、前記第1のノントランスペアレントポートに通信可能に接続された第2のノントランスペアレントポートを有し、該第2のノントランスペアレントポートを用いた通信を中継する第2の中継部と、を備え、前記第1の中継部は、前記第1の機器が前記第2の機器との間で通信を行う際に、前記第1の機器が使用するアドレスと前記第1のノントランスペアレントポートが使用するアドレスとの間のアドレス変換を行い、前記第2の中継部は、前記第2の機器が前記第1の機器との間で通信を行う際に、前記第2の機器が使用するアドレスと前記第2のノントランスペアレントポートが使用するアドレスとの間のアドレス変換を行うこと、を特徴とする。   The communication system according to the present invention is a communication system in which a first device and a second device are communicably connected, and is provided in the first device and has a first non-transparent port. A first relay unit that relays communication using the first non-transparent port, and a second non-transmission port provided in the second device and connected to the first non-transparent port so as to be communicable A second relay unit that has a transparent port and relays communication using the second non-transparent port, and the first relay unit includes the first device and the second device. When performing communication between the two, the address conversion between the address used by the first device and the address used by the first non-transparent port is performed, and the second relay unit includes: When the second device communicates with the first device, address conversion is performed between the address used by the second device and the address used by the second non-transparent port. It is characterized by this.

本発明によれば、使い勝手の悪化を招くことなく適切なホスト間通信を実現することができるという効果を奏する。   According to the present invention, there is an effect that appropriate host-to-host communication can be realized without deteriorating usability.

図1は、2つのホスト間でPCI Expressの規格に準拠した情報通信を行う従来の通信システムの概念図である。FIG. 1 is a conceptual diagram of a conventional communication system that performs information communication based on the PCI Express standard between two hosts. 図2は、図1に示した従来の通信システムにおけるアドレスマップの概念図である。FIG. 2 is a conceptual diagram of an address map in the conventional communication system shown in FIG. 図3は、本発明を適用した通信システムの概念図である。FIG. 3 is a conceptual diagram of a communication system to which the present invention is applied. 図4は、図3に示した通信システムにおけるアドレスマップの概念図である。FIG. 4 is a conceptual diagram of an address map in the communication system shown in FIG. 図5は、図3に示した通信システムにおいて、第1の機器から第2の機器にデータを送信する際の動作を説明するタイミングチャートである。FIG. 5 is a timing chart for explaining the operation when data is transmitted from the first device to the second device in the communication system shown in FIG. 図6は、本発明の具体的な実施例としてのプリントシステムの概略構成図である。FIG. 6 is a schematic configuration diagram of a printing system as a specific embodiment of the present invention. 図7は、サーバおよびプリンタが備えるデバイス群の一例を説明する図である。FIG. 7 is a diagram illustrating an example of a device group included in the server and the printer. 図8は、サーバとプリンタとの間の伝送路を説明する図である。FIG. 8 is a diagram illustrating a transmission path between the server and the printer. 図9は、サーバにおけるコントローラの構成を説明するブロック図である。FIG. 9 is a block diagram illustrating the configuration of the controller in the server. 図10は、プリンタにおけるコントローラの構成を説明するブロック図である。FIG. 10 is a block diagram illustrating the configuration of the controller in the printer. 図11は、カードアダプタの一例を示す平面図である。FIG. 11 is a plan view showing an example of a card adapter. 図12は、カードエッジコネクタにおける複数の端子のレイアウトの一例を示す図である。FIG. 12 is a diagram illustrating an example of a layout of a plurality of terminals in the card edge connector. 図13は、ケーブルコネクタにおける複数の端子のレイアウトの一例を示す図である。FIG. 13 is a diagram illustrating an example of a layout of a plurality of terminals in the cable connector. 図14は、カードエッジコネクタにおけるシリアル信号用端子とPCI Expressスイッチとケーブルコネクタにおけるシリアル信号用端子とを電気的に接続する複数の配線パターンを説明する図である。FIG. 14 is a diagram for explaining a plurality of wiring patterns for electrically connecting the serial signal terminals in the card edge connector, the PCI Express switch, and the serial signal terminals in the cable connector. 図15は、PCI ExpressスイッチのNTポート同士を接続することによってサーバとプリンタとが通信可能に接続されている状態を説明する図である。FIG. 15 is a diagram for explaining a state in which the server and the printer are communicably connected by connecting NT ports of the PCI Express switch.

以下に添付図面を参照して、この発明に係る通信機器および通信システムの最良な実施の形態を詳細に説明する。以下では、PCI Express規格に準拠した情報通信を行う通信システムへの適用例について説明するが、適用可能なシステムはこれに限定されるものではない。   Exemplary embodiments of a communication device and a communication system according to the present invention will be explained below in detail with reference to the accompanying drawings. In the following, an example of application to a communication system that performs information communication in conformity with the PCI Express standard will be described, but an applicable system is not limited to this.

(本発明の概要)
まず、本発明の概要について、従来技術と対比しながら説明する。PCI Expressの規格に準拠したシステムは、通常、1つのルートコンプレックスを頂点としたツリー構造のトポロジとなる。2つのホスト間で通信を行う通信システムにおいては、各ホストがそれぞれルートコンプレックスを持つため、ノントランスペアレントポート(以下、NTポートという。)を有するスイッチを用いて2つのホストを接続することにより、ホスト間での通信を可能にする。
(Outline of the present invention)
First, the outline of the present invention will be described in comparison with the prior art. A system conforming to the PCI Express standard usually has a tree-structure topology with one root complex as a vertex. In a communication system that performs communication between two hosts, each host has a root complex. Therefore, by connecting two hosts using a switch having a non-transparent port (hereinafter referred to as NT port) Communication between the two.

図1は、2つのホスト間でPCI Expressの規格に準拠した情報通信を行う従来の通信システムの概念図である。この図1に示す通信システムは、第1の機器Aと第2の機器Bとを通信可能に接続した通信システムである。第1の機器Aは、制御主体となるCPU1aを備えたホストであり、第2の機器Bは、制御主体となるCPU1bを備えたホストである。   FIG. 1 is a conceptual diagram of a conventional communication system that performs information communication based on the PCI Express standard between two hosts. The communication system shown in FIG. 1 is a communication system in which a first device A and a second device B are communicably connected. The first device A is a host provided with a CPU 1a as a control subject, and the second device B is a host provided with a CPU 1b as a control subject.

第1の機器Aには、PCI Expressスイッチ10が設けられている。PCI Expressスイッチ10の上流ポート11は、ルートコンプレックス2aと接続されている。また、PCI Expressスイッチ10の下流ポート12には、エンドポイント3aが接続されている。PCI Expressスイッチ10は、上流ポート11に接続されたルートコンプレックス2aと、下流ポート12に接続されたエンドポイント3aとの間の通信を中継する。   The first device A is provided with a PCI Express switch 10. The upstream port 11 of the PCI Express switch 10 is connected to the root complex 2a. An end point 3 a is connected to the downstream port 12 of the PCI Express switch 10. The PCI Express switch 10 relays communication between the route complex 2 a connected to the upstream port 11 and the endpoint 3 a connected to the downstream port 12.

PCI Expressスイッチ10は、下流側のポートとして、通常の下流ポート12のほかに、NTポート13を有している。このNTポート13は、第2の機器Bのルートコンプレックス2bと接続されている。PCI Expressスイッチ10は、上流ポート11に接続された第1の機器Aのルートコンプレックス2aと、NTポート13に接続された第2の機器Bのルートコンプレックス2bとの間の通信を中継する。   The PCI Express switch 10 has an NT port 13 in addition to a normal downstream port 12 as a downstream port. This NT port 13 is connected to the root complex 2b of the second device B. The PCI Express switch 10 relays communication between the route complex 2 a of the first device A connected to the upstream port 11 and the route complex 2 b of the second device B connected to the NT port 13.

以上のような構成の通信システムでは、第1の機器Aに設けられたPCI Expressスイッチ10のNTポート13に、第2の機器Bのルートコンプレックス2bが接続されているため、第1の機器Aのルートコンプレックス2aからは、第2の機器Bのルートコンプレックス2bが非透過の状態(遮蔽された状態)で、第2の機器Bのルートコンプレックス2bからも、第1の機器Aのルートコンプレックス2aが非透過の状態となる。したがって、システム内に2つのルートコンプレックス2a,2bが存在していたとしてもPCI Expressの規格に準拠した情報通信が可能であり、第1の機器Aと第2の機器Bとの間のホスト間通信を実現することができる。   In the communication system configured as described above, since the root complex 2b of the second device B is connected to the NT port 13 of the PCI Express switch 10 provided in the first device A, the first device A From the root complex 2a of the first device A, the root complex 2b of the second device B is in a non-transparent state (shielded state), and the root complex 2b of the first device A is also from the root complex 2b of the second device B. Becomes non-transparent. Therefore, even if there are two root complexes 2a and 2b in the system, information communication based on the PCI Express standard is possible, and between the first device A and the second device B Communication can be realized.

しかしながら、図1に示した従来の通信システムでは、第2の機器Bのルートコンプレックス2bから第1の機器AのNTポート13が透過の状態となる。よって、第2の機器Bは第1の機器AのNTポート13をデバイスとして認識していることになる。このため、例えば、PCI Expressスイッチ10のNTポート13と第2の機器Bのルートコンプレックス2bとを通信ケーブルを用いて接続した場合に、この通信ケーブルが抜けると、第2の機器Bは第1の機器AのNTポート13をデバイスとして認識できなくなるため、エラーとなりハングアップするという問題がある。   However, in the conventional communication system shown in FIG. 1, the NT port 13 of the first device A is in a transparent state from the route complex 2b of the second device B. Therefore, the second device B recognizes the NT port 13 of the first device A as a device. Therefore, for example, when the NT port 13 of the PCI Express switch 10 and the route complex 2b of the second device B are connected using a communication cable, if the communication cable is disconnected, the second device B is Since the NT port 13 of the device A cannot be recognized as a device, an error occurs and the device hangs up.

また、システムを立ち上げる際には、第1の機器Aを先に立ち上げて安定した後に第2の機器Bを立ち上げないと正常にリンクしないため、機器の立ち上げ順に制約が加わるという問題もある。   In addition, when starting up the system, the first device A is started up first and stabilized, and then the second device B is not started up. There is also.

さらに、図1に示した従来の通信システムでは、第1の機器Aと第2の機器Bとの間で通信を行う際に、PCI Expressスイッチ10において、第1の機器Aが使用するアドレスと第2の機器Bが使用するアドレスとの間のアドレス変換を行う必要があるが、このアドレス変換が煩雑になるといった問題がある。   Further, in the conventional communication system shown in FIG. 1, when communication is performed between the first device A and the second device B, the PCI Express switch 10 uses the address used by the first device A. Although it is necessary to perform address conversion between addresses used by the second device B, there is a problem that this address conversion becomes complicated.

図2は、図1に示した従来の通信システムにおけるアドレスマップの概念図である。第1の機器Aは、第1の機器Aのアドレス空間の利用可能領域に設定されたアドレス変換領域内のアドレスを使用する。一方、第2の機器Bは、第2の機器Bのアドレス空間の利用可能領域に設定されたアドレス変換領域内のアドレスを使用する。PCI Expressスイッチ10は、第1の機器Aと第2の機器Bとの間で通信を行う際に、これら第1の機器Aが使用するアドレスと第2の機器Bが使用するアドレスとの間のアドレス変換を行うため、第1の機器Aのアドレス変換領域だけでなく、第2の機器Bのアドレス変換領域も知る必要がある。   FIG. 2 is a conceptual diagram of an address map in the conventional communication system shown in FIG. The first device A uses the address in the address conversion area set in the usable area of the address space of the first device A. On the other hand, the second device B uses the address in the address conversion area set in the available area of the address space of the second device B. When the PCI Express switch 10 performs communication between the first device A and the second device B, the PCI Express switch 10 is between the address used by the first device A and the address used by the second device B. Therefore, it is necessary to know not only the address conversion area of the first device A but also the address conversion area of the second device B.

しかしながら、第1の機器Aからは第2の機器Bのアドレス空間が遮蔽されているため、第1の機器Aに設けられたPCI Expressスイッチ10が、第2の機器Bのアドレス変換領域を知ることは容易ではない。また、各機器のアドレス空間における利用不可領域は各機器が使用しているメモリやI/Oによって変化するため、アドレス変換領域もそれに対応させて変えていく必要があり、PCI Expressスイッチ10が第2の機器Bのアドレス変換領域を常に把握しておくことは非常に困難である。その結果、PCI Expressスイッチ10によるアドレス変換は極めて煩雑なものとなる。   However, since the address space of the second device B is shielded from the first device A, the PCI Express switch 10 provided in the first device A knows the address conversion area of the second device B. It is not easy. Further, since the unusable area in the address space of each device changes depending on the memory and I / O used by each device, it is necessary to change the address conversion area accordingly. The PCI Express switch 10 It is very difficult to always grasp the address translation area of the second device B. As a result, the address conversion by the PCI Express switch 10 becomes extremely complicated.

以上のように、図1に示した従来の通信システムでは、第1の機器Aと第2の機器Bとの間のホスト間通信を実現することができるものの、通信ケーブルが抜けるとシステムがハングアップするといった問題や、機器の立ち上げ順に制約が加わると行った問題、PCI Expressスイッチ10でのアドレス変換が煩雑になるといった問題があり、システムとしての使い勝手が悪い。   As described above, the conventional communication system shown in FIG. 1 can realize inter-host communication between the first device A and the second device B, but the system hangs when the communication cable is disconnected. The system is not easy to use because there are problems such as a problem that the system is up, a problem that occurs when restrictions are imposed on the startup order of the devices, and a problem that address conversion by the PCI Express switch 10 becomes complicated.

図3は、本発明を適用した通信システムの概念図である。この図3に示す通信システムは、図1に示した従来の通信システムと同様に、第1の機器Cと第2の機器Dとを通信可能に接続した通信システムである。第1の機器Cは、制御主体となるCPU1cを備えたホストであり、第2の機器Dは、制御主体となるCPU1dを備えたホストである。   FIG. 3 is a conceptual diagram of a communication system to which the present invention is applied. The communication system shown in FIG. 3 is a communication system in which a first device C and a second device D are communicably connected as in the conventional communication system shown in FIG. The first device C is a host provided with a CPU 1c as a control subject, and the second device D is a host provided with a CPU 1d as a control subject.

第1の機器Cには、第1のPCI Expressスイッチ20が設けられている。第1のPCI Expressスイッチ20の上流ポート21は、ルートコンプレックス2cと接続されている。また、第1のPCI Expressスイッチ20の下流ポート22には、エンドポイント3cが接続されている。第1のPCI Expressスイッチ20は、上流ポート21に接続されたルートコンプレックス2cと、下流ポート22に接続されたエンドポイント3cとの間の通信を中継する。   The first device C is provided with a first PCI Express switch 20. The upstream port 21 of the first PCI Express switch 20 is connected to the root complex 2c. The end point 3 c is connected to the downstream port 22 of the first PCI Express switch 20. The first PCI Express switch 20 relays communication between the route complex 2 c connected to the upstream port 21 and the endpoint 3 c connected to the downstream port 22.

第1のPCI Expressスイッチ20は、下流側のポートとして、通常の下流ポート22のほかに、NTポート23を有している。このNTポート23は、第2の機器Dに設けられた後述する第2のPCI Expressスイッチ30のNTポート33に接続されている。第1のPCI Expressスイッチ20は、第1の機器Cが第2の機器Dとの間で通信を行う際に、第1の機器Cが使用するアドレスとNTポート23が使用するアドレスとの間のアドレス変換を行って、NTポート23を用いた通信を中継する。   The first PCI Express switch 20 has an NT port 23 in addition to the normal downstream port 22 as a downstream port. The NT port 23 is connected to an NT port 33 of a second PCI Express switch 30 (described later) provided in the second device D. When the first device C communicates with the second device D, the first PCI Express switch 20 is between the address used by the first device C and the address used by the NT port 23. The communication using the NT port 23 is relayed.

第2の機器Dには、第2のPCI Expressスイッチ30が設けられている。第2のPCI Expressスイッチ30の上流ポート31は、ルートコンプレックス2dと接続されている。また、第2のPCI Expressスイッチ30の下流ポート32には、エンドポイント3dが接続されている。第2のPCI Expressスイッチ30は、上流ポート31に接続されたルートコンプレックス2dと、下流ポート23に接続されたエンドポイント3dとの間の通信を中継する。   The second device D is provided with a second PCI Express switch 30. The upstream port 31 of the second PCI Express switch 30 is connected to the root complex 2d. An end point 3 d is connected to the downstream port 32 of the second PCI Express switch 30. The second PCI Express switch 30 relays communication between the route complex 2 d connected to the upstream port 31 and the end point 3 d connected to the downstream port 23.

第2のPCI Expressスイッチ30は、下流側のポートとして、通常の下流ポート32のほかに、NTポート33を有している。このNTポート33は、第1の機器Cに設けられた第1のPCI Expressスイッチ20のNTポート23に接続されている。第2のPCI Expressスイッチ30は、第2の機器Dが第1の機器Cとの間で通信を行う際に、第2の機器Dが使用するアドレスとNTポート33が使用するアドレスとの間のアドレス変換を行って、NTポート33を用いた通信を中継する。   The second PCI Express switch 30 has an NT port 33 in addition to the normal downstream port 32 as a downstream port. The NT port 33 is connected to the NT port 23 of the first PCI Express switch 20 provided in the first device C. When the second device D communicates with the first device C, the second PCI Express switch 30 is between the address used by the second device D and the address used by the NT port 33. The communication using the NT port 33 is relayed.

以上のような構成の通信システムでは、第1の機器Cに設けられた第1のPCI Expressスイッチ20のNTポート23と、第2の機器Dに設けられた第2のPCI Expressスイッチ30のNTポート33とが接続されているので、第1の機器Cからは第2の機器Dが非透過の状態となり、第2の機器Dからは第1の機器Cが非透過の状態となる。また、第1の機器Cは第2の機器DのNTポート33をデバイスとして認識しておらず、第2の機器Dも第1の機器CのNTポート23をデバイスとして認識していない。このため、第1のPCI Expressスイッチ20のNTポート23と第2のPCI Expressスイッチ30のNTポート33とを通信ケーブルを用いて接続した場合、この通信ケーブルが抜けたとしてもエラーとはならず、システムがハングアップすることはない。   In the communication system configured as described above, the NT port 23 of the first PCI Express switch 20 provided in the first device C and the NT of the second PCI Express switch 30 provided in the second device D are used. Since the port 33 is connected, the second device D is in a non-transparent state from the first device C, and the first device C is in a non-transparent state from the second device D. The first device C does not recognize the NT port 33 of the second device D as a device, and the second device D also does not recognize the NT port 23 of the first device C as a device. Therefore, when the NT port 23 of the first PCI Express switch 20 and the NT port 33 of the second PCI Express switch 30 are connected using a communication cable, no error will occur even if the communication cable is disconnected. The system never hangs.

また、システムを立ち上げる際には、第1の機器Cを先に立ち上げても第2の機器Dを先に立ち上げても正常にリンクするため、機器の立ち上げ順に制約が加わることもない。   In addition, when starting up the system, the first device C is started up first and the second device D is started up first, so that the link is made normally. Absent.

さらに、第1のPCI Expressスイッチ20のNTポート23と第2のPCI Expressスイッチ30のNTポート33とを接続する構成により、第1の機器Cと第2の機器Dとの間で通信を行う際のアドレス変換が、図1に示した従来の通信システムと比較して極めて容易になる。   Further, communication is performed between the first device C and the second device D by connecting the NT port 23 of the first PCI Express switch 20 and the NT port 33 of the second PCI Express switch 30. The address conversion at that time is extremely easy as compared with the conventional communication system shown in FIG.

図4は、図3に示した通信システムにおけるアドレスマップの概念図である。本例の場合、NTポート23およびNTポート33のNTポート同士の接続となるため、NT空間という独立した一つのアドレス空間を設けることができる。そして、このNT空間におけるアドレス変換領域を、固定の領域として予め定めておくことが可能である。   FIG. 4 is a conceptual diagram of an address map in the communication system shown in FIG. In this example, the NT port 23 and the NT port 33 are connected to each other, so that an independent address space called an NT space can be provided. The address conversion area in the NT space can be determined in advance as a fixed area.

第1の機器Cと第2の機器Dとの間で通信を行う場合、第1の機器Cは、第1の機器Cのアドレス空間におけるアドレス変換領域内のアドレスを使用し、第2の機器Dは、第2の機器Dのアドレス空間におけるアドレス変換領域内のアドレスを使用する。第1のPCI Expressスイッチ20のNTポート23は、第1の機器Cが使用するアドレスとNT空間におけるアドレス変換領域内のアドレスとの間のアドレス変換を行う。また、第2のPCI Expressスイッチ30のNTポート33は、第2の機器Dが使用するアドレスとNT空間におけるアドレス変換領域内のアドレスとの間のアドレス変換を行う。   When communication is performed between the first device C and the second device D, the first device C uses the address in the address translation area in the address space of the first device C, and the second device D uses an address in the address translation area in the address space of the second device D. The NT port 23 of the first PCI Express switch 20 performs address conversion between the address used by the first device C and the address in the address conversion area in the NT space. The NT port 33 of the second PCI Express switch 30 performs address conversion between the address used by the second device D and the address in the address conversion area in the NT space.

ここで、NT空間におけるアドレス変換領域は予め固定の領域として定められ、第1のPCI Expressスイッチ20および第2のPCI Expressスイッチ30は、このアドレス変換領域内のアドレスを共有する。このため、第1のPCI Expressスイッチ20は、第1の機器Cのアドレス変換領域だけ把握していればよく、第2のPCI Expressスイッチ30は、第2の機器Dのアドレス変換領域だけ把握していればよい。つまり、第1のPCI Expressスイッチ20は、第2の機器Dのアドレス変換領域を把握することなくアドレス変換を適切に行うことができ、第2のPCI Expressスイッチ30は、第1の機器Cのアドレス変換領域を把握することなくアドレス変換を適切に行うことができるので、第1の機器Cと第2の機器Dとの間で通信を行う際のアドレス変換が容易となる。   Here, the address translation area in the NT space is determined as a fixed area in advance, and the first PCI Express switch 20 and the second PCI Express switch 30 share the address in the address translation area. For this reason, the first PCI Express switch 20 only needs to know the address translation area of the first device C, and the second PCI Express switch 30 knows only the address translation area of the second device D. It only has to be. That is, the first PCI Express switch 20 can appropriately perform address conversion without grasping the address conversion area of the second device D, and the second PCI Express switch 30 can perform the conversion of the first device C. Since the address conversion can be appropriately performed without grasping the address conversion area, the address conversion when performing communication between the first device C and the second device D is facilitated.

以上のように、本発明を適用した通信システムでは、通信ケーブルが抜けるとシステムがハングアップするといった問題や、機器の立ち上げ順に制約が加わるといった問題が解消され、また、通信時のアドレス変換も容易となる。このように、本発明を適用した通信システムによれば、使い勝手の悪化を招くことなく適切なホスト間通信を実現することができる。   As described above, in the communication system to which the present invention is applied, the problem that the system hangs up when the communication cable is disconnected and the problem that restrictions are imposed in the order in which the devices are started up are solved. It becomes easy. Thus, according to the communication system to which the present invention is applied, appropriate host-to-host communication can be realized without incurring usability.

図5は、図3に示した通信システムにおいて、第1の機器Cから第2の機器Dにデータを送信する際の動作を説明するタイミングチャートである。   FIG. 5 is a timing chart for explaining the operation when data is transmitted from the first device C to the second device D in the communication system shown in FIG.

第1の機器Cから第2の機器Dにデータを送信する場合、まず、送信するデータが、第1のPCI Expressスイッチ20に入力される(ステップS101)。第1のPCI Expressスイッチ20は、データが入力されると、このデータの送信において第1の機器Cが使用するアドレスを、NTポート23が使用するNT空間におけるアドレスに変換して、NTポート23からデータを送信する(ステップS102)。   When data is transmitted from the first device C to the second device D, first, the data to be transmitted is input to the first PCI Express switch 20 (step S101). When data is input, the first PCI Express switch 20 converts the address used by the first device C in the transmission of this data into an address in the NT space used by the NT port 23, and the NT port 23 The data is transmitted from (step S102).

第1のPCI Expressスイッチ20のNTポート23から送信されたデータは、第2のPCI Expressスイッチ30のNTポート33に入力される(ステップS103)。第2のPCI Expressスイッチ30は、NTポート33からデータが入力されると、第1のPCI Expressスイッチ20によって変換(設定)されたNT空間におけるアドレスを、第2の機器Dが使用するアドレスに変換する(ステップS104)。これにより、第2の機器Dは、第1の機器Cから送信されたデータを受信することができる。   The data transmitted from the NT port 23 of the first PCI Express switch 20 is input to the NT port 33 of the second PCI Express switch 30 (step S103). When data is input from the NT port 33, the second PCI Express switch 30 uses the address in the NT space converted (set) by the first PCI Express switch 20 as the address used by the second device D. Conversion is performed (step S104). Thereby, the second device D can receive the data transmitted from the first device C.

なお、第2の機器Dから第1の機器Cにデータを送信する場合は、上記の例とは逆に、第2のPCI Expressスイッチ30が、データの送信において第2の機器Dが使用するアドレスを、NTポート33が使用するNT空間におけるアドレスに変換し、第1のPCI Expressスイッチ20が、第2のPCI Expressスイッチ30によって変換(設定)されたNT空間におけるアドレスを、第1の機器Cが使用するアドレスに変換する。   Note that when data is transmitted from the second device D to the first device C, the second PCI Express switch 30 uses the second device D to transmit data, contrary to the above example. The address is converted to an address in the NT space used by the NT port 33, and the first PCI Express switch 20 converts the address in the NT space converted (set) by the second PCI Express switch 30 to the first device. Convert to address used by C.

ところで、通信システムにおける不要輻射(EMI)の低減を図るためには、第1の機器Cにおける基準クロックおよび第2の機器Dにおける基準クロックとして、スペクトラム拡散クロック(SSC)を用いることが有効である。しかしながら、SSCで動作する第1の機器CとSSCで動作する第2の機器Dとの間では、通信の同期が取れないため、ホスト間通信が行えなくなってしまう。   By the way, in order to reduce unnecessary radiation (EMI) in the communication system, it is effective to use a spread spectrum clock (SSC) as a reference clock in the first device C and a reference clock in the second device D. . However, since communication cannot be synchronized between the first device C operating in the SSC and the second device D operating in the SSC, communication between hosts cannot be performed.

そこで、第1のPCI Expressスイッチ20および第2のPCI Expressスイッチ30としては、クロックアイソレーション機能を持つスイッチを用いることが望ましい。クロックアイソレーション機能とは、スイッチを境界としてクロックドメインを分割する機能である。   Therefore, it is desirable to use a switch having a clock isolation function as the first PCI Express switch 20 and the second PCI Express switch 30. The clock isolation function is a function of dividing a clock domain with a switch as a boundary.

第1のPCI Expressスイッチ20のクロックアイソレーション機能により、第1の機器Cのクロックドメインを、NTポート23側とそれ以外の部分とに分割することができる。また、第2のPCI Expressスイッチ30のクロックアイソレーション機能により、第2の機器Dのクロックドメインを、NTポート33側とそれ以外の部分とに分割することができる。これにより、第1のPCI Expressスイッチ20のNTポート23と第2のPCI Expressスイッチ30のNTポート33との間のクロックを、第1の機器Cおよび第2の機器Dのクロックから独立させることができ、これらNTポート23,33間のクロックとして非スペクトラム拡散クロック(非SSC)を用いることで、第1の機器Cおよび第2の機器DをSSCで動作させてEMIの低減を図りながら、第1の機器Cと第2の機器Dとの間の通信を適切に行うことができる。   With the clock isolation function of the first PCI Express switch 20, the clock domain of the first device C can be divided into the NT port 23 side and other parts. Further, the clock domain of the second device D can be divided into the NT port 33 side and other parts by the clock isolation function of the second PCI Express switch 30. Thus, the clock between the NT port 23 of the first PCI Express switch 20 and the NT port 33 of the second PCI Express switch 30 is made independent of the clocks of the first device C and the second device D. By using a non-spread spectrum clock (non-SSC) as a clock between the NT ports 23 and 33, the first device C and the second device D are operated by the SSC to reduce EMI. Communication between the first device C and the second device D can be performed appropriately.

なお、第1のPCI Expressスイッチ20のNTポート23側と、第2のPCI Expressスイッチ30のNTポート33側には、第1の機器Cや第2の機器Dのクロック源とは異なる別のクロック源から非SSCを供給し、第1のPCI Expressスイッチ20のNTポート23側の非SSCと、第2のPCI Expressスイッチ30のNTポート33側の非SSCとを同期させればよい。   In addition, the NT port 23 side of the first PCI Express switch 20 and the NT port 33 side of the second PCI Express switch 30 are different from the clock sources of the first device C and the second device D. A non-SSC is supplied from a clock source, and the non-SSC on the NT port 23 side of the first PCI Express switch 20 and the non-SSC on the NT port 33 side of the second PCI Express switch 30 may be synchronized.

(実施例)
次に、本発明の具体的な実施例として、サーバおよびプリンタを備えるプリントシステムに本発明を適用した例について詳細に説明する。
(Example)
Next, as a specific embodiment of the present invention, an example in which the present invention is applied to a printing system including a server and a printer will be described in detail.

図6は、本実施例のプリントシステム100の概略構成図である。このプリントシステム100は、サーバ200と、通信ケーブル300によってサーバ200と接続されたプリンタ400とを備える。サーバ200は、いわゆるプリントサーバであり、ネットワーク700を介して複数の端末(例えば、PC)600と接続されている。   FIG. 6 is a schematic configuration diagram of the printing system 100 of the present embodiment. The print system 100 includes a server 200 and a printer 400 connected to the server 200 via a communication cable 300. The server 200 is a so-called print server, and is connected to a plurality of terminals (for example, PCs) 600 via a network 700.

サーバ200およびプリンタ400は、一例として図7に示すように、それぞれ、PCI Expressの規格にて規定されたツリー構造のトポロジに従って接続されたデバイス群を有する。PCI Expressの規格にて規定されたツリー構造のトポロジとは、図3に示したように、ルートコンプレックスを頂点としたツリー型の構成であり、ルートコンプレックスとエンドポイントとが接続されるトポロジである。   As shown in FIG. 7 as an example, the server 200 and the printer 400 each have a group of devices connected in accordance with a tree structure topology defined by the PCI Express standard. As shown in FIG. 3, the tree structure topology defined in the PCI Express standard is a tree-type configuration with the root complex as the apex, and is a topology in which the root complex and the endpoint are connected. .

本実施例のプリントシステム100において、サーバ200およびプリンタ400はそれぞれホストとして機能し、サーバ200が図3に示した第1の機器Cに相当し、プリンタ400が図3に示した第2の機器Dに相当する。   In the printing system 100 of the present embodiment, the server 200 and the printer 400 each function as a host, the server 200 corresponds to the first device C shown in FIG. 3, and the printer 400 is the second device shown in FIG. Corresponds to D.

サーバ200は、図8に示すように、そのマザーボード210にPCI Expressの規格に準拠したソケット(PCI Expressソケット)220が搭載されている。そして、このPCI Expressソケット220には、カードアダプタ500が装着されている。   As shown in FIG. 8, the server 200 has a socket (PCI Express socket) 220 compliant with the PCI Express standard mounted on its motherboard 210. A card adapter 500 is attached to the PCI Express socket 220.

プリンタ400は、図8に示すように、そのマザーボード410にPCI Expressの規格に準拠したソケット(PCI Expressソケット)420が搭載されている。そして、このPCI Expressソケット420には、カードアダプタ500が装着されている。   As shown in FIG. 8, the printer 400 has a socket (PCI Express socket) 420 compliant with the PCI Express standard mounted on a motherboard 410. A card adapter 500 is attached to the PCI Express socket 420.

サーバ200側のカードアダプタ500とプリンタ400側のカードアダプタ500とは、通信ケーブル300によって相互に接続されている。これにより、サーバ200とプリンタ400とが通信ケーブル300を介して通信可能に接続され、サーバ200とプリンタ400との間で高速の情報通信が行われる。   The card adapter 500 on the server 200 side and the card adapter 500 on the printer 400 side are connected to each other by a communication cable 300. As a result, the server 200 and the printer 400 are communicably connected via the communication cable 300, and high-speed information communication is performed between the server 200 and the printer 400.

本実施例では、画像情報(ブラックの画像情報、シアンの画像情報、マゼンタの画像情報、およびイエローの画像情報)が、ラスターイメージデータの形で、サーバ200からプリンタ400に伝送される。そして、プリンタ400は、受信した画像情報に応じてカラーの画像を形成する。   In this embodiment, image information (black image information, cyan image information, magenta image information, and yellow image information) is transmitted from the server 200 to the printer 400 in the form of raster image data. The printer 400 forms a color image according to the received image information.

なお、通信ケーブル300としては、PCI Express規格に準拠した銅線ケーブルや光アクティブケーブル、その他の高速差動信号を伝送可能なケーブルなど、様々な通信ケーブルを用いることができる。   As the communication cable 300, various communication cables such as a copper wire cable compliant with the PCI Express standard, an optical active cable, and other cables capable of transmitting high-speed differential signals can be used.

サーバ200は、一例として図9に示されるように、端末600からの要求に応じて、該端末600からの画像情報をプリンタ400に向けて出力するコントローラ250を備えている。   As shown in FIG. 9 as an example, the server 200 includes a controller 250 that outputs image information from the terminal 600 to the printer 400 in response to a request from the terminal 600.

このコントローラ250は、2つの通信制御回路(211、216)、画像処理回路212、メモリ214、およびメモリ制御回路215などを有している。   The controller 250 includes two communication control circuits (211 and 216), an image processing circuit 212, a memory 214, and a memory control circuit 215.

通信制御回路211は、ネットワーク700を介した複数の端末600との通信を制御する。   The communication control circuit 211 controls communication with a plurality of terminals 600 via the network 700.

画像処理回路212は、通信制御回路211で受信した端末600からの画像情報を、ラスターイメージデータに変換し、メモリ214に一時的に格納する。   The image processing circuit 212 converts the image information from the terminal 600 received by the communication control circuit 211 into raster image data and temporarily stores it in the memory 214.

メモリ制御回路215は、メモリ214に蓄積されたデータを監視し、データが揃うとメモリ214からラスターイメージデータを読み出して通信制御回路216に出力する。   The memory control circuit 215 monitors the data stored in the memory 214, and when the data is ready, reads the raster image data from the memory 214 and outputs it to the communication control circuit 216.

通信制御回路216は、通信ケーブル300を介したプリンタ400との間の通信を制御し、メモリ制御回路215によりメモリ214から読み出されたラスターイメージデータをプリンタ400に送信する。   The communication control circuit 216 controls communication with the printer 400 via the communication cable 300, and transmits raster image data read from the memory 214 by the memory control circuit 215 to the printer 400.

プリンタ400は、一例として図10に示されるように、サーバ200からのラスターイメージデータをプロッタに出力するコントローラ450を備えている。   As shown in FIG. 10 as an example, the printer 400 includes a controller 450 that outputs raster image data from the server 200 to a plotter.

このコントローラ450は、通信制御回路411、メモリ412、メモリ制御回路413、および印刷制御回路415などを有している。   The controller 450 includes a communication control circuit 411, a memory 412, a memory control circuit 413, a print control circuit 415, and the like.

通信制御回路411は、通信ケーブル300を介したサーバ200との間の通信を制御し、通信ケーブル300を介して受信したラスターイメージデータをメモリ412に一時的に格納する。   The communication control circuit 411 controls communication with the server 200 via the communication cable 300, and temporarily stores raster image data received via the communication cable 300 in the memory 412.

メモリ制御回路413は、メモリ412に蓄積されたデータを監視し、データが揃うとメモリ412からラスターイメージデータを読み出して印刷制御回路415に出力する。   The memory control circuit 413 monitors the data stored in the memory 412, reads the raster image data from the memory 412 and outputs it to the print control circuit 415 when the data is ready.

印刷制御回路415は、メモリ制御回路413によりメモリ412から読み出されたラスターイメージデータをプロッタに出力する。   The print control circuit 415 outputs the raster image data read from the memory 412 by the memory control circuit 413 to the plotter.

次に、カードアダプタ500の詳細について説明する。図11は、カードアダプタ500の一例を示す平面図である。   Next, details of the card adapter 500 will be described. FIG. 11 is a plan view showing an example of the card adapter 500.

このカードアダプタ500は、ボード510上に、2つのケーブルコネクタ512A,512Bと、PCI Expressスイッチ517とが実装されている。2つのケーブルコネクタ512A,512Bは、それぞれ通信ケーブル300が接続されるコネクタである。なお、以下では、2つのケーブルコネクタ512A,512Bを区別する必要がないときは、これらを総称してケーブルコネクタ512という。   In the card adapter 500, two cable connectors 512A and 512B and a PCI Express switch 517 are mounted on a board 510. The two cable connectors 512A and 512B are connectors to which the communication cable 300 is connected, respectively. In the following, when it is not necessary to distinguish between the two cable connectors 512A and 512B, they are collectively referred to as a cable connector 512.

また、ボード510の一端部近傍には、両面にカードエッジコネクタ515が形成されている。カードエッジコネクタ515は、カードアダプタ500をサーバ200側のPCI Expressソケット220またはプリンタ400側のPCI Expressソケット420に装着した際に、これらPCI Expressソケット220,420の端子に接続される端子を備えたコネクタである。ここでは、便宜上、ボード510のケーブルコネクタ512が実装されている面をA面とし、それと反対側の面をB面という。なお、図11における符号L11で示すボード510の長さは例えば105mm、符号L12で示すボード510の長さは例えば130mmである。   In addition, card edge connectors 515 are formed on both sides near one end of the board 510. The card edge connector 515 is a connector having terminals that are connected to the terminals of the PCI Express sockets 220 and 420 when the card adapter 500 is attached to the PCI Express socket 220 on the server 200 side or the PCI Express socket 420 on the printer 400 side. It is. Here, for the sake of convenience, the surface on which the cable connector 512 of the board 510 is mounted is referred to as the A surface, and the surface on the opposite side is referred to as the B surface. In addition, the length of the board 510 shown by the code | symbol L11 in FIG. 11 is 105 mm, for example, and the length of the board 510 shown by the code | symbol L12 is 130 mm, for example.

また、図11には、ボード510上におけるシリアル信号線が最優先で配線されている領域がハッチングで示されている。このシリアル信号線とは、PCI Expressの伝送路であり、具体的には、カードエッジコネクタ515とPCI Expressスイッチ517との間、PCI Expressスイッチ517とケーブルコネクタ512Aとの間、およびPCI Expressスイッチ517とケーブルコネクタ512Bとの間の配線である。なお、該配線領域に対応するB面側の領域も配線領域である。   In FIG. 11, the area where the serial signal lines on the board 510 are wired with the highest priority is indicated by hatching. The serial signal line is a PCI Express transmission line. Specifically, the serial signal line is between the card edge connector 515 and the PCI Express switch 517, between the PCI Express switch 517 and the cable connector 512A, and the PCI Express switch 517. And the cable connector 512B. Note that a region on the B surface side corresponding to the wiring region is also a wiring region.

ここでは、カードエッジコネクタ515は、8レーンに対応している。そして、各ケーブルコネクタ512A,512Bは、それぞれ4レーンに対応している。   Here, the card edge connector 515 corresponds to 8 lanes. Each cable connector 512A, 512B corresponds to 4 lanes.

図12は、カードエッジコネクタ515における複数の端子のレイアウトの一例を示す図である。この図12に示す例において、第1のレーンのシリアル信号用端子は、PET0P、PET0N、PER0P、PER0Nの4つである。PET0PとPET0Nは送信用、PER0PとPER0Nは受信用である。   FIG. 12 is a diagram illustrating an example of a layout of a plurality of terminals in the card edge connector 515. In the example shown in FIG. 12, there are four serial signal terminals in the first lane: PET0P, PET0N, PER0P, and PER0N. PET0P and PET0N are for transmission, and PER0P and PER0N are for reception.

また、第2のレーンのシリアル信号用端子は、PET1P、PET1N、PER1P、PER1Nの4つである。PET1PとPET1Nは送信用、PER1PとPER1Nは受信用である。   Further, there are four serial signal terminals in the second lane: PET1P, PET1N, PER1P, and PER1N. PET1P and PET1N are for transmission, and PER1P and PER1N are for reception.

また、第3のレーンのシリアル信号用端子は、PET2P、PET2N、PER2P、PER2Nの4つである。PET2PとPET2Nは送信用、PER2PとPER2Nは受信用である。   Further, there are four serial signal terminals in the third lane: PET2P, PET2N, PER2P, and PER2N. PET2P and PET2N are for transmission, and PER2P and PER2N are for reception.

また、第4のレーンのシリアル信号用端子は、PET3P、PET3N、PER3P、PER3Nの4つである。PET3PとPET3Nは送信用、PER3PとPER3Nは受信用である。   The fourth lane has four serial signal terminals, PET3P, PET3N, PER3P, and PER3N. PET3P and PET3N are for transmission, and PER3P and PER3N are for reception.

また、第5のレーンのシリアル信号用端子は、PET4P、PET4N、PER4P、PER4Nの4つである。PET4PとPET4Nは送信用、PER4PとPER4Nは受信用である。   The fifth lane has four serial signal terminals, PET4P, PET4N, PER4P, and PER4N. PET4P and PET4N are for transmission, and PER4P and PER4N are for reception.

また、第6のレーンのシリアル信号用端子は、PET5P、PET5N、PER5P、PER5Nの4つである。PET5PとPET5Nは送信用、PER5PとPER5Nは受信用である。   The sixth lane has four serial signal terminals, PET5P, PET5N, PER5P, and PER5N. PET5P and PET5N are for transmission, and PER5P and PER5N are for reception.

また、第7のレーンのシリアル信号用端子は、PET6P、PET6N、PER6P、PER6Nの4つである。PET6PとPET6Nは送信用、PER6PとPER6Nは受信用である。   The seventh lane has four serial signal terminals, PET6P, PET6N, PER6P, and PER6N. PET6P and PET6N are for transmission, and PER6P and PER6N are for reception.

また、第8のレーンのシリアル信号用端子は、PET7P、PET7N、PER7P、PER7Nの4つである。PET7PとPET7Nは送信用、PER7PとPER7Nは受信用である。   The eighth lane has four serial signal terminals, PET7P, PET7N, PER7P, and PER7N. PET7P and PET7N are for transmission, and PER7P and PER7N are for reception.

図13は、ケーブルコネクタ512における複数の端子のレイアウトの一例を示す図である。この図13に示す例において、第1のレーンのシリアル信号用端子は、TX1p、TX1n、RX1p、RX1nの4つである。TX1pとTX1nは送信用、RX1pとRX1nは受信用である。   FIG. 13 is a diagram illustrating an example of a layout of a plurality of terminals in the cable connector 512. In the example shown in FIG. 13, there are four serial signal terminals of the first lane, TX1p, TX1n, RX1p, and RX1n. TX1p and TX1n are for transmission, and RX1p and RX1n are for reception.

また、第2のレーンのシリアル信号用端子は、TX2p、TX2n、RX2p、RX2nの4つである。TX2pとTX2nは送信用、RX2pとRX2nは受信用である。   Further, there are four serial signal terminals in the second lane: TX2p, TX2n, RX2p, RX2n. TX2p and TX2n are for transmission, and RX2p and RX2n are for reception.

また、第3のレーンのシリアル信号用端子は、TX3p、TX3n、RX3p、RX3nの4つである。TX3pとTX3nは送信用、RX3pとRX3nは受信用である。   The third lane has four serial signal terminals, TX3p, TX3n, RX3p, and RX3n. TX3p and TX3n are for transmission, and RX3p and RX3n are for reception.

また、第4のレーンのシリアル信号用端子は、TX4p、TX4n、RX4p、RX4nの4つである。TX4pとTX4nは送信用、RX4pとRX4nは受信用である。   The fourth lane has four serial signal terminals, TX4p, TX4n, RX4p, and RX4n. TX4p and TX4n are for transmission, and RX4p and RX4n are for reception.

図14は、カードエッジコネクタ515におけるシリアル信号用端子とPCI Expressスイッチ517とケーブルコネクタ512におけるシリアル信号用端子とを電気的に接続する複数の配線パターンを説明する図である。この図14では、カードエッジコネクタ515におけるシリアル信号用端子(合計32個)とPCI Expressスイッチ517とを電気的に接続する複数の配線パターンからなる配線群を配線群A、PCI Expressスイッチ517とケーブルコネクタ512Aにおけるシリアル信号用端子(合計16個)とを電気的に接続する複数の配線パターンからなる配線群を配線群B、PCI Expressスイッチ517とケーブルコネクタ512Bにおけるシリアル信号用端子(合計16個)とを電気的に接続する複数の配線パターンからなる配線群を配線群Cとして示している。   FIG. 14 is a diagram illustrating a plurality of wiring patterns that electrically connect the serial signal terminals in the card edge connector 515, the PCI Express switch 517, and the serial signal terminals in the cable connector 512. In FIG. 14, a wiring group consisting of a plurality of wiring patterns for electrically connecting serial signal terminals (32 in total) in the card edge connector 515 and the PCI Express switch 517 is a wiring group A, a PCI Express switch 517 and a cable. A wiring group consisting of a plurality of wiring patterns for electrically connecting the serial signal terminals (total 16) in the connector 512A is defined as a wiring group B, and the serial signal terminals (total 16) in the PCI Express switch 517 and the cable connector 512B. A wiring group composed of a plurality of wiring patterns that are electrically connected to each other is shown as a wiring group C.

ここでは、配線群A、配線群Bおよび配線群Cでのクロックは、いずれも5GHzである。   Here, the clocks in the wiring group A, the wiring group B, and the wiring group C are all 5 GHz.

また、配線群Aでは、クロックはスペクトラム拡散クロック(SSC)であり、配線群Bおよび配線群Cでは、クロックは非スペクトラム拡散クロック(非SSC)である。スペクトラム拡散クロックとは、クロック信号の周波数スペクトラムのピーク値を下げて放射ノイズを軽減するためにクロック周波数がわずかに変動されているクロックである。また、非スペクトラム拡散クロックとは、クロック周波数に変動がない固定周波数のクロックである。   In the wiring group A, the clock is a spread spectrum clock (SSC), and in the wiring group B and the wiring group C, the clock is a non-spread spectrum clock (non-SSC). The spread spectrum clock is a clock whose clock frequency is slightly changed in order to reduce the radiation noise by lowering the peak value of the frequency spectrum of the clock signal. The non-spread spectrum clock is a fixed frequency clock that does not vary in clock frequency.

すなわち、PCI Expressスイッチ517は、カードエッジコネクタ515と2つのケーブルコネクタ512A,512Bとの間を電気的に接続する複数の配線パターンの途中に設けられ、該複数の配線パターンのクロックドメインを、クロックがスペクトラム拡散クロックであるクロックドメイン(第1のクロックドメイン)と、クロックが非スペクトラム拡散クロックであるクロックドメイン(第2のクロックドメイン)とに分割している。このようなクロックドメインの分割は、PCI Expressスイッチ517が備えるクロックアイソレーション機能によって実現することができる。   In other words, the PCI Express switch 517 is provided in the middle of a plurality of wiring patterns that electrically connect the card edge connector 515 and the two cable connectors 512A and 512B. Is divided into a clock domain (first clock domain) that is a spread spectrum clock and a clock domain (second clock domain) that is a non-spread spectrum clock. Such division of the clock domain can be realized by a clock isolation function provided in the PCI Express switch 517.

配線群Bおよび配線群Cにおける各配線長は、クロック周波数の整数倍、クロック周波数の1/2倍、1/4倍のいずれとも異なるように設定されている。具体的には、クロック周波数が5GHzなので、各配線長は、1.5cm、3cm、6cm、12cmなどにならないように設定されている。なお、クロック周波数が2.5GHzの場合には、各配線長は、3cm、6cm、12cm、及び24cmなどにならないように設定する。そこで、5GHzと2.5GHzの両方に対応させる場合には、例えば、各配線長は、1cmなどが好ましい。   Each wiring length in the wiring group B and the wiring group C is set to be different from any of an integral multiple of the clock frequency, a half of the clock frequency, and a quarter of the clock frequency. Specifically, since the clock frequency is 5 GHz, each wiring length is set not to be 1.5 cm, 3 cm, 6 cm, 12 cm, or the like. When the clock frequency is 2.5 GHz, each wiring length is set so as not to be 3 cm, 6 cm, 12 cm, 24 cm, or the like. Therefore, in order to cope with both 5 GHz and 2.5 GHz, for example, each wiring length is preferably 1 cm.

PCI Expressスイッチ517は、上流側のポートと下流側のNTポートを有し、上流側のポートが配線群Aを介してカードエッジコネクタ515に接続され、下流側のNTポートが配線群Bを介してケーブルコネクタ512A、配線群Cを介してケーブルコネクタ512Bにそれぞれ接続されている。なお、本実施例において、サーバ200側のカードアダプタ500に設けられたPCI Expressスイッチ517が、図3に示した第1のPCI Expressスイッチ20に相当し、プリンタ400側のカードアダプタ500に設けられたPCI Expressスイッチ517が、図3に示した第2のPCI Expressスイッチ30に相当する。つまり、これらPCI Expressスイッチ517は、NTポート同士が通信ケーブル300を介して接続され、NTポートを利用したサーバ200とプリンタ400との間の通信を中継する機能を持つ。また、PCI Expressスイッチ517は、サーバ200とプリンタ400との間で通信が行われる際、上述したアドレス変換を行う機能を持つ。   The PCI Express switch 517 has an upstream port and a downstream NT port. The upstream port is connected to the card edge connector 515 via the wiring group A, and the downstream NT port is connected to the wiring group B. The cable connector 512A and the wiring group C are connected to the cable connector 512B. In this embodiment, the PCI Express switch 517 provided in the card adapter 500 on the server 200 side corresponds to the first PCI Express switch 20 shown in FIG. 3, and the PCI provided in the card adapter 500 on the printer 400 side. The Express switch 517 corresponds to the second PCI Express switch 30 shown in FIG. In other words, the PCI Express switch 517 has a function of relaying communication between the server 200 and the printer 400 using the NT port, in which the NT ports are connected to each other via the communication cable 300. The PCI Express switch 517 has a function of performing the address conversion described above when communication is performed between the server 200 and the printer 400.

すなわち、サーバ200とプリンタ400との間で通信を行う際、サーバ200側のカードアダプタ500に設けられたPCI Expressスイッチ517は、サーバ200のアドレス空間におけるアドレス変換領域内のアドレスと、NT空間における固定のアドレス変換領域内のアドレスとの間のアドレス変換を行う。また、プリンタ400側のカードアダプタ500に設けられたPCI Expressスイッチ517は、プリンタ400のアドレス空間におけるアドレス変換領域内のアドレスと、NT空間における固定のアドレス変換領域内のアドレスとの間のアドレス変換を行う。   That is, when communication is performed between the server 200 and the printer 400, the PCI Express switch 517 provided in the card adapter 500 on the server 200 side fixes the address in the address conversion area in the address space of the server 200 and the fixed in the NT space. Address translation between addresses in the address translation area. The PCI Express switch 517 provided in the card adapter 500 on the printer 400 side performs address conversion between an address in the address conversion area in the address space of the printer 400 and an address in a fixed address conversion area in the NT space. Do.

カードエッジコネクタ515における第1のレーンから第4のレーンまでのシリアル信号用端子(合計16個)は、PCI Expressスイッチ517のNTポートを介して、ケーブルコネクタ512Aにおけるシリアル信号用端子(合計16個)と接続されている。   Serial signal terminals (total 16) from the first lane to the fourth lane in the card edge connector 515 are serial signal terminals (total 16) in the cable connector 512A via the NT port of the PCI Express switch 517. ).

具体的には、PET0PとTX1p、PET0NとTX1n、PER0PとRX1p、PER0NとRX1nが接続されている。また、PET1PとTX2p、PET1NとTX2n、PER1PとRX2p、PER1NとRX2nが接続されている。また、PET2PとTX3p、PET2NとTX3n、PER2PとRX3p、PER2NとRX3nが接続されている。また、PET3PとTX4p、PET3NとTX4n、PER3PとRX4p、PER3NとRX4nが接続されている。   Specifically, PET0P and TX1p, PET0N and TX1n, PER0P and RX1p, and PER0N and RX1n are connected. Further, PET1P and TX2p, PET1N and TX2n, PER1P and RX2p, and PER1N and RX2n are connected. Further, PET2P and TX3p, PET2N and TX3n, PER2P and RX3p, and PER2N and RX3n are connected. Further, PET3P and TX4p, PET3N and TX4n, PER3P and RX4p, and PER3N and RX4n are connected.

そして、カードエッジコネクタ515における第5のレーンから第8のレーンまでのシリアル信号用端子(合計16個)は、PCI Expressスイッチ517のNTポートを介して、ケーブルコネクタ512Bにおけるシリアル信号用端子(合計16個)と接続されている。   The serial signal terminals (total 16) from the fifth lane to the eighth lane in the card edge connector 515 are serial signal terminals (total) in the cable connector 512B via the NT port of the PCI Express switch 517. 16).

具体的には、PET4PとTX1p、PET4NとTX1n、PER4PとRX1p、PER4NとRX1nが接続されている。また、PET5PとTX2p、PET5NとTX2n、PER5PとRX2p、PER5NとRX2nが接続されている。また、PET6PとTX3p、PET6NとTX3n、PER6PとRX3p、PER6NとRX3nが接続されている。また、PET7PとTX4p、PET7NとTX4n、PER7PとRX4p、PER7NとRX4nが接続されている。   Specifically, PET4P and TX1p, PET4N and TX1n, PER4P and RX1p, and PER4N and RX1n are connected. Further, PET5P and TX2p, PET5N and TX2n, PER5P and RX2p, and PER5N and RX2n are connected. Moreover, PET6P and TX3p, PET6N and TX3n, PER6P and RX3p, and PER6N and RX3n are connected. Further, PET7P and TX4p, PET7N and TX4n, PER7P and RX4p, and PER7N and RX4n are connected.

そして、サーバ200側のカードアダプタ500に設けられたケーブルコネクタ512と、プリンタ400側のカードアダプタ500に設けられたケーブルコネクタ512とが、通信ケーブル300を介して接続されている。つまり、本実施例のプリントシステム100では、図15に示すように、サーバ200とプリンタ400とが、互いのカードアダプタ500に設けられたPCI Expressスイッチ517のNTポート同士を接続することで、通信可能に接続されている。   A cable connector 512 provided on the card adapter 500 on the server 200 side and a cable connector 512 provided on the card adapter 500 on the printer 400 side are connected via the communication cable 300. That is, in the print system 100 of the present embodiment, as shown in FIG. 15, the server 200 and the printer 400 can communicate by connecting the NT ports of the PCI Express switch 517 provided in each other's card adapter 500. It is connected to the.

以上のように、本実施例のプリントシステム100は、サーバ200とプリンタ400とが、互いのカードアダプタ500に設けられたPCI Expressスイッチ517のNTポート同士を接続することで通信可能に接続されているので、サーバ200から見てプリンタ400が非透過の状態となるとともに、プリンタ400から見てサーバ200が非透過の状態となる。また、サーバ200は、プリンタ400側のカードアダプタ500に設けられたPCI Expressスイッチ517のNTポートをデバイスとして認識しておらず、プリンタ400も、サーバ200側のカードアダプタ500に設けられたPCI Expressスイッチ517のNTポートをデバイスとして認識していない。このため、これらサーバ200とプリンタ400とを繋ぐ通信ケーブル300が抜けたとしても、システムがハングアップすることはない。   As described above, in the print system 100 according to the present embodiment, the server 200 and the printer 400 are connected so that they can communicate with each other by connecting the NT ports of the PCI Express switch 517 provided in each other's card adapter 500. Therefore, the printer 400 is in a non-transparent state when viewed from the server 200 and the server 200 is in a non-transparent state when viewed from the printer 400. Further, the server 200 does not recognize the NT port of the PCI Express switch 517 provided in the card adapter 500 on the printer 400 side as a device, and the printer 400 also uses the PCI Express switch 517 provided in the card adapter 500 on the server 200 side. NT port is not recognized as a device. For this reason, even if the communication cable 300 connecting the server 200 and the printer 400 is disconnected, the system does not hang up.

また、このプリントシステム100では、システムを立ち上げる際に、サーバ200を先に立ち上げてもプリンタ400を先に立ち上げても正常にリンクするため、立ち上げ順に制約が加わることがない。   In the print system 100, when the system is started up, the server 200 is started up first, and the printer 400 is started up first, so that the link is made normally.

また、このプリントシステム100では、サーバ200とプリンタ400との間で通信を行う際にアドレス変換を行う必要があるが、PCI Expressスイッチ517のNTポート同士を接続する構成としているため、アドレス変換を容易に行うことができる。すなわち、PCI Expressスイッチ517のNTポート同士を接続する構成により、サーバ200側のカードアダプタ500に設けられたPCI Expressスイッチ517と、プリンタ400側のカードアダプタ500に設けられたPCI Expressスイッチ517とで、NTポートが使用するアドレスを、予め定めた共通のアドレス空間において設定することができる。そのため、PCI Expressスイッチ517は、アドレス変換の際に通信の相手方の機器(プリンタ400またはサーバ200)の状態を知る必要がなく、容易にアドレス変換を行うことができる。   In the print system 100, it is necessary to perform address conversion when communicating between the server 200 and the printer 400. However, since the NT port of the PCI Express switch 517 is connected, the address conversion is performed. It can be done easily. That is, with the configuration in which the NT ports of the PCI Express switch 517 are connected to each other, an NT Express switch 517 provided on the card adapter 500 on the server 200 side and a PCI Express switch 517 provided on the card adapter 500 on the printer 400 side The address used by the port can be set in a predetermined common address space. Therefore, the PCI Express switch 517 does not need to know the state of the communication partner device (the printer 400 or the server 200) at the time of address conversion, and can easily perform address conversion.

また、このプリントシステム100では、PCI Expressスイッチ517のクロックアイソレーション機能により、カードアダプタ500上のクロックドメインを、クロックがスペクトラム拡散クロックである第1のクロックドメインと、クロックが非スペクトラム拡散クロックである第2のクロックドメインとに分割し、2つのPCI Expressスイッチ517のNTポート間のクロックドメインは、クロックが非スペクトラム拡散クロックである第2のクロックドメインとしているので、不要輻射(EMI)を極力低減させながら、サーバ200とプリンタ400との間の通信を適切に行うことができる。   In the print system 100, the clock isolation function of the PCI Express switch 517 is used to change the clock domain on the card adapter 500, the first clock domain whose clock is a spread spectrum clock, and the first clock domain whose clock is a non-spread spectrum clock. The clock domain between the NT ports of the two PCI Express switches 517 is divided into two clock domains, and the second clock domain, which is a non-spread spectrum clock, is used to reduce unnecessary radiation (EMI) as much as possible. However, communication between the server 200 and the printer 400 can be performed appropriately.

なお、以上説明したプリントシステム100は本発明の一実施例であり、本発明の趣旨を逸脱しない範囲で様々な変形が可能である。例えば、カードアダプタ500上のコネクタなどの実装位置やレイアウトは、上記の例に限定されるものではなく、必要に応じて適宜変更可能である。   The print system 100 described above is an embodiment of the present invention, and various modifications can be made without departing from the spirit of the present invention. For example, the mounting position and layout of the connector on the card adapter 500 are not limited to the above example, and can be changed as needed.

また、例えば、サーバ200から出力されるシリアルデータのクロックが2.5GHzであり、該シリアルデータを5GHzのクロックでプリンタ400に転送する場合には、PCI Expressスイッチ517として、クロック周波数を変更する機能、およびブリッジ機能を備えたスイッチを用いればよい。この場合は、ケーブルコネクタ512は1つでよい。   Further, for example, when the serial data clock output from the server 200 is 2.5 GHz and the serial data is transferred to the printer 400 with the 5 GHz clock, the PCI Express switch 517 functions to change the clock frequency. And a switch having a bridge function may be used. In this case, one cable connector 512 is sufficient.

また、上記の実施例では、カードエッジコネクタ515が、8レーンに対応している場合について説明したが、これに限定されるものではない。   In the above embodiment, the case where the card edge connector 515 corresponds to 8 lanes has been described. However, the present invention is not limited to this.

また、上記の実施例で説明したクロック周波数は一例であり、これに限定されるものではない。   The clock frequency described in the above embodiment is an example, and the present invention is not limited to this.

また、上記の実施例は、サーバ200とプリンタ400とを通信可能に接続したプリントシステム100に本発明を適用した例であるが、本発明が適用可能なシステムはこれに限定されるものではなく、複数のホスト間で情報通信を行う様々な通信システムに適用可能である。   The above embodiment is an example in which the present invention is applied to the print system 100 in which the server 200 and the printer 400 are communicably connected. However, the system to which the present invention is applicable is not limited to this. The present invention can be applied to various communication systems that perform information communication between a plurality of hosts.

また、上記の実施例では、PCI Expressの規格に準拠した情報通信を行う場合について説明したが、PCI Express以外の他の規格であっても、ホスト間の通信に制約がある規格に準拠した情報通信を行う場合において、本発明は有効に適用可能である。   In the above-described embodiments, the case where information communication conforming to the PCI Express standard is described. However, information conforming to a standard that restricts communication between hosts, even other standards other than PCI Express. In the case of performing communication, the present invention can be effectively applied.

20 第1のPCI Expressスイッチ
23 NTポート
30 第2のPCI Expressスイッチ
33 NTポート
100 プリントシステム
200 サーバ
300 通信ケーブル
400 プリンタ
500 カードアダプタ
510 ボード
517 PCI Expressスイッチ
20 First PCI Express Switch 23 NT Port 30 Second PCI Express Switch 33 NT Port 100 Print System 200 Server 300 Communication Cable 400 Printer 500 Card Adapter 510 Board 517 PCI Express Switch

特開2008−67242号公報JP 2008-67242 A

Claims (7)

第1のノントランスペアレントポートを有し、該第1のノントランスペアレントポートを用いた通信を中継する第1の中継部を備えた外部機器との間で通信を行う通信機器であって、
前記第1のノントランスペアレントポートに通信可能に接続された第2のノントランスペアレントポートを有し、該第2のノントランスペアレントポートを用いた通信を中継する第2の中継部を備え、
前記第2の中継部は、前記通信機器が前記外部装置との間で通信を行う際に、前記通信機器が使用するアドレスと前記第2のノントランスペアレントポートが使用するアドレスとの間のアドレス変換を行うこと、を特徴とする通信機器。
A communication device that has a first non-transparent port and performs communication with an external device including a first relay unit that relays communication using the first non-transparent port,
A second relay unit having a second non-transparent port communicably connected to the first non-transparent port and relaying communication using the second non-transparent port;
The second relay unit converts an address between an address used by the communication device and an address used by the second non-transparent port when the communication device communicates with the external device. Performing communication equipment.
第1の機器と第2の機器とが通信可能に接続された通信システムであって、
前記第1の機器に設けられ、第1のノントランスペアレントポートを有し、該第1のノントランスペアレントポートを用いた通信を中継する第1の中継部と、
前記第2の機器に設けられ、前記第1のノントランスペアレントポートに通信可能に接続された第2のノントランスペアレントポートを有し、該第2のノントランスペアレントポートを用いた通信を中継する第2の中継部と、を備え、
前記第1の中継部は、前記第1の機器が前記第2の機器との間で通信を行う際に、前記第1の機器が使用するアドレスと前記第1のノントランスペアレントポートが使用するアドレスとの間のアドレス変換を行い、
前記第2の中継部は、前記第2の機器が前記第1の機器との間で通信を行う際に、前記第2の機器が使用するアドレスと前記第2のノントランスペアレントポートが使用するアドレスとの間のアドレス変換を行うこと、を特徴とする通信システム。
A communication system in which a first device and a second device are communicably connected,
A first relay unit that is provided in the first device, has a first non-transparent port, and relays communication using the first non-transparent port;
A second non-transparent port provided in the second device and communicatively connected to the first non-transparent port, and relaying communication using the second non-transparent port; A relay section;
The first relay unit includes an address used by the first device and an address used by the first non-transparent port when the first device communicates with the second device. Address conversion between
The second relay unit includes an address used by the second device and an address used by the second non-transparent port when the second device communicates with the first device. A communication system characterized by performing address conversion between the two.
前記第1のノントランスペアレントポートが使用するアドレスと、前記第2のノントランスペアレントポートが使用するアドレスとが、予め定めた共通のアドレス空間に設定されること、を特徴とする請求項2に記載の通信システム。   The address used by the first non-transparent port and the address used by the second non-transparent port are set in a predetermined common address space. Communications system. 前記第1の中継部は、前記第1の機器のクロックドメインを、クロックがスペクトラム拡散クロックである第1のクロックドメインと、クロックが非スペクトラム拡散クロックである第2のクロックドメインとに分割し、
前記第2の中継部は、前記第2の機器のクロックドメインを、前記第1のクロックドメインと、前記第2のクロックドメインとに分割し、
前記第1のノントランスペアレントポートと前記第2のノントランスペアレントポートとの間のクロックドメインは、前記第2のクロックドメインであること、を特徴とする請求項2または3に記載の通信システム。
The first relay unit divides the clock domain of the first device into a first clock domain whose clock is a spread spectrum clock and a second clock domain whose clock is a non-spread spectrum clock,
The second relay unit divides the clock domain of the second device into the first clock domain and the second clock domain,
4. The communication system according to claim 2, wherein a clock domain between the first non-transparent port and the second non-transparent port is the second clock domain. 5.
前記第1のノントランスペアレントポートと前記第2のノントランスペアレントポートとが、通信ケーブルを介して通信可能に接続されていることを特徴とする請求項2〜4のいずれか一項に記載の通信システム。   The communication system according to any one of claims 2 to 4, wherein the first non-transparent port and the second non-transparent port are communicably connected via a communication cable. . 前記第1の中継部および前記第2の中継部は、PCI Expressの規格に準拠したスイッチであること、を特徴とする請求項2〜5のいずれか一項に記載の通信システム。   The communication system according to any one of claims 2 to 5, wherein the first relay unit and the second relay unit are switches compliant with a PCI Express standard. 前記第1の中継部は、前記第1の機器の拡張スロットに装着されたカードアダプタのボード上に設けられ、
前記第2の中継部は、前記第2の機器の拡張スロットに装着されたカードアダプタのボード上に設けられていること、を特徴とする請求項2〜6のいずれか一項に記載の通信システム。
The first relay unit is provided on a card adapter board mounted in an expansion slot of the first device,
The communication system according to any one of claims 2 to 6, wherein the second relay unit is provided on a card adapter board mounted in an expansion slot of the second device. .
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Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2014057263A (en) * 2012-09-13 2014-03-27 Ricoh Co Ltd Communication apparatus, communication system, and image forming apparatus
EP2851801A1 (en) 2013-09-24 2015-03-25 Hitachi Ltd. Computer system, control method for computer system and coupling module
US9178691B2 (en) 2013-03-18 2015-11-03 Fujitsu Limited Apparatus for correcting signal, transmission apparatus, method of correcting signal, and transmission system
WO2018101136A1 (en) * 2016-11-30 2018-06-07 株式会社ソシオネクスト Information processing system, semiconductor integrated circuit, and information processing method
JP2018125028A (en) * 2013-06-28 2018-08-09 ホアウェイ・テクノロジーズ・カンパニー・リミテッド System and method for extended peripheral component interconnect express fabrics
US10187976B2 (en) 2016-03-01 2019-01-22 Lenovo (Singapore) Pte Ltd Flexible printer circuit board

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP7579186B2 (en) 2021-03-19 2024-11-07 Tdk株式会社 Band Elimination Filter

Citations (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20050117578A1 (en) * 2003-11-18 2005-06-02 Heath Stewart Switching with transparent and non-transparent ports
US7062594B1 (en) * 2004-06-30 2006-06-13 Emc Corporation Root complex connection system
US20080052443A1 (en) * 2006-08-23 2008-02-28 Sun Microsystems, Inc. Cross-coupled peripheral component interconnect express switch
WO2009105095A1 (en) * 2008-02-20 2009-08-27 Hewlett-Packard Development Company, L.P. Redriver with two reference clocks and method of operation thereof
US20090248947A1 (en) * 2008-03-25 2009-10-01 Aprius Inc. PCI-Express Function Proxy
JP2011186968A (en) * 2010-03-11 2011-09-22 Ricoh Co Ltd Adaptor, information device, information system and communication method
US20120096192A1 (en) * 2010-10-19 2012-04-19 Hitachi, Ltd. Storage apparatus and virtual port migration method for storage apparatus
JP2012083979A (en) * 2010-10-13 2012-04-26 Nec Corp Communication controller, network, and network system

Patent Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20050117578A1 (en) * 2003-11-18 2005-06-02 Heath Stewart Switching with transparent and non-transparent ports
US7062594B1 (en) * 2004-06-30 2006-06-13 Emc Corporation Root complex connection system
US20080052443A1 (en) * 2006-08-23 2008-02-28 Sun Microsystems, Inc. Cross-coupled peripheral component interconnect express switch
WO2009105095A1 (en) * 2008-02-20 2009-08-27 Hewlett-Packard Development Company, L.P. Redriver with two reference clocks and method of operation thereof
JP2011519077A (en) * 2008-02-20 2011-06-30 ヒューレット−パッカード デベロップメント カンパニー エル.ピー. Redriver having two reference clocks and operation method thereof
US20090248947A1 (en) * 2008-03-25 2009-10-01 Aprius Inc. PCI-Express Function Proxy
JP2011186968A (en) * 2010-03-11 2011-09-22 Ricoh Co Ltd Adaptor, information device, information system and communication method
JP2012083979A (en) * 2010-10-13 2012-04-26 Nec Corp Communication controller, network, and network system
US20120096192A1 (en) * 2010-10-19 2012-04-19 Hitachi, Ltd. Storage apparatus and virtual port migration method for storage apparatus

Cited By (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2014057263A (en) * 2012-09-13 2014-03-27 Ricoh Co Ltd Communication apparatus, communication system, and image forming apparatus
US9178691B2 (en) 2013-03-18 2015-11-03 Fujitsu Limited Apparatus for correcting signal, transmission apparatus, method of correcting signal, and transmission system
US10922259B2 (en) 2013-06-28 2021-02-16 Futurewei Technologies, Inc. System and method for extended peripheral component interconnect express fabrics
US11429550B2 (en) 2013-06-28 2022-08-30 Futurewei Technologies, Inc. System and method for extended peripheral component interconnect express fabrics
JP2018125028A (en) * 2013-06-28 2018-08-09 ホアウェイ・テクノロジーズ・カンパニー・リミテッド System and method for extended peripheral component interconnect express fabrics
US10417160B2 (en) 2013-06-28 2019-09-17 Futurewei Technologies, Inc. System and method for extended peripheral component interconnect express fabrics
EP2851801A1 (en) 2013-09-24 2015-03-25 Hitachi Ltd. Computer system, control method for computer system and coupling module
US9304842B2 (en) 2013-09-24 2016-04-05 Hitachi, Ltd. Computer system, control method for computer system and coupling module
US10187976B2 (en) 2016-03-01 2019-01-22 Lenovo (Singapore) Pte Ltd Flexible printer circuit board
US10853287B2 (en) 2016-11-30 2020-12-01 Socionext Inc. Information processing system, semiconductor integrated circuit, and information processing method
JPWO2018101136A1 (en) * 2016-11-30 2019-10-24 株式会社ソシオネクスト Information processing system, semiconductor integrated circuit, and information processing method
WO2018101136A1 (en) * 2016-11-30 2018-06-07 株式会社ソシオネクスト Information processing system, semiconductor integrated circuit, and information processing method
JP2022176236A (en) * 2016-11-30 2022-11-25 株式会社ソシオネクスト Information processing system, semiconductor integrated circuit, and information processing method
JP7206485B2 (en) 2016-11-30 2023-01-18 株式会社ソシオネクスト Information processing system, semiconductor integrated circuit and information processing method
JP7401811B2 (en) 2016-11-30 2023-12-20 株式会社ソシオネクスト Information processing system, semiconductor integrated circuit, and information processing method

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