JP2012029438A - Power conversion apparatus - Google Patents
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Abstract
Description
本発明は、半導体スイッチング素子を有する電力変換装置に関し、特に、ヒステリシスコンパレータを使用して電流指令に追従したスイッチング制御を行なう電力変換装置に関するものである。 The present invention relates to a power converter having a semiconductor switching element, and more particularly to a power converter that performs switching control following a current command using a hysteresis comparator.
電流指令に追従した出力電流が得られるように、ヒステリシスコンパレータによってスイッチ素子のオン/オフ制御を行なう電力変換装置が従来から提案されている。たとえば出力電流が大きくなる過負荷時には、ヒステリシス幅を大きくすることによりスイッチング周波数を低下させる。一方、出力電流が小さくなるときには、ヒステリシス幅を小さくすることにより、スイッチング周波数を上昇させる。 2. Description of the Related Art Conventionally, a power conversion device that performs on / off control of a switch element by a hysteresis comparator has been proposed so that an output current that follows a current command can be obtained. For example, at the time of overload when the output current increases, the switching frequency is lowered by increasing the hysteresis width. On the other hand, when the output current is reduced, the switching frequency is increased by reducing the hysteresis width.
たとえば特開2007−20262号公報(特許文献1)は、スイッチング周波数を所望の値に精度よく制御するための電力変換装置の構成を開示する。具体的には、電力変換装置は、半導体スイッチング素子のスイッチング周波数を検出する手段と、検出されたスイッチング周波数が指令値に追従するようにヒステリシス幅を調整する調整手段とを備える。スイッチング周波数をフィードバック制御することによって、電力変換装置の変換効率の安定化を図ることができる。 For example, Japanese Patent Laying-Open No. 2007-20262 (Patent Document 1) discloses a configuration of a power converter for accurately controlling a switching frequency to a desired value. Specifically, the power conversion device includes means for detecting the switching frequency of the semiconductor switching element, and adjustment means for adjusting the hysteresis width so that the detected switching frequency follows the command value. By performing feedback control of the switching frequency, the conversion efficiency of the power conversion device can be stabilized.
従来の電力変換装置の構成によれば、ヒステリシスコンパレータのヒステリシス幅を増減させることによってスイッチング周波数の制御が可能である。しかし、一定のスイッチング周波数では、ヒステリシス幅が一定すなわち直線的になる。 According to the configuration of the conventional power converter, the switching frequency can be controlled by increasing or decreasing the hysteresis width of the hysteresis comparator. However, at a constant switching frequency, the hysteresis width is constant, that is, linear.
一方、電流指令と出力電流との差、すなわち電流偏差は、当該出力電流の波形のピーク近傍では小さくなるが、その波形のゼロ点近傍では大きくなる。ヒステリシス幅が一定のまま電流偏差が上記のように変化した場合、出力電流の波形のピーク近傍では電流偏差が小さくなるため、出力電流が電流指令に追従する速度が下がる。一方、出力電流の波形のゼロ点近傍では、電流偏差が大きくなるために出力電流が電流指令に追従する速度が上がる。 On the other hand, the difference between the current command and the output current, that is, the current deviation is small near the peak of the waveform of the output current, but is large near the zero point of the waveform. When the current deviation changes as described above with the hysteresis width kept constant, the current deviation becomes small near the peak of the waveform of the output current, so the speed at which the output current follows the current command decreases. On the other hand, in the vicinity of the zero point of the output current waveform, the current deviation increases, so the speed at which the output current follows the current command increases.
追従速度が低下することによって、出力電流には大きなリプル成分(リプル電流)が生じる。このため出力電圧の歪み率が悪化するという課題が生じうる。 When the tracking speed is reduced, a large ripple component (ripple current) is generated in the output current. For this reason, the subject that the distortion rate of an output voltage deteriorates may arise.
本発明は、上述の課題を解決するためになされたものであって、半導体スイッチング素子の出力電流に含まれるリプル成分を低減可能な電力変換装置を提供することである。 The present invention has been made to solve the above-described problems, and provides a power conversion device capable of reducing a ripple component included in an output current of a semiconductor switching element.
本発明の一局面に係る電力変換装置は、自励式半導体スイッチング素子と、自励式半導体スイッチング素子の出力電流を電流指令に追従させるために、出力電流と電流指令との偏差をヒステリシス幅と比較することによって、自励式半導体スイッチング素子のスイッチング周波数を変更するヒステリシスコンパレータと、自励式半導体スイッチング素子のスイッチング周波数を検出するための検出部と、検出部によって検出されたスイッチング周波数の検出値と、スイッチング周波数の指令値との間の偏差に基づいて、ヒステリシス幅を設定する設定部と、設定部により設定されたヒステリシス幅を補正して、その補正されたヒステリ幅をヒステリシスコンパレータに与える補正部とを備える。補正部は、出力電流の波形のピーク近傍において、ヒステリシス幅を、設定部によって設定された幅よりも小さくする一方で、出力電流の波形のゼロ点近傍において、ヒステリシス幅を、設定部によって設定された幅よりも大きくする。 A power conversion device according to one aspect of the present invention compares a deviation between an output current and a current command with a hysteresis width so that the self-excited semiconductor switching device and the output current of the self-excited semiconductor switching device follow the current command. A hysteresis comparator for changing the switching frequency of the self-excited semiconductor switching element, a detection unit for detecting the switching frequency of the self-excited semiconductor switching element, a detected value of the switching frequency detected by the detection unit, and the switching frequency A setting unit that sets a hysteresis width based on a deviation between the command value and a correction unit that corrects the hysteresis width set by the setting unit and applies the corrected hysteresis width to the hysteresis comparator. . The correction unit sets the hysteresis width near the peak of the output current waveform to be smaller than the width set by the setting unit, while the hysteresis width is set by the setting unit near the zero point of the output current waveform. Larger than the width.
本発明によれば、半導体スイッチング素子の出力電流の波形のピークにおいて、出力電流が電流指令に追従する速度を高めることができる。これによりリプル電流を低減することができる。 According to the present invention, the speed at which the output current follows the current command can be increased at the peak of the waveform of the output current of the semiconductor switching element. Thereby, a ripple current can be reduced.
以下において、本発明の実施の形態について図面を参照して詳しく説明する。なお、図中同一または相当部分には同一符号を付してその説明は繰り返さない。 Hereinafter, embodiments of the present invention will be described in detail with reference to the drawings. In the drawings, the same or corresponding parts are denoted by the same reference numerals and description thereof will not be repeated.
図1は、本発明の実施の形態に係る電力変換装置の構成図である。図1を参照して、本発明の実施の形態に係る電力変換装置100は、3相のインバータ50を備える無停電電源装置である。電力変換装置100は、直流電源1と、インバータ50と、リアクトル3と、コンデンサ4とを備える。
FIG. 1 is a configuration diagram of a power conversion device according to an embodiment of the present invention. Referring to FIG. 1,
インバータ50は、直流電源1からの直流電力を交流電力に変換する。インバータ50は、半導体スイッチング素子として、IGBT素子2a〜2fを備える。IGBT素子2a,2bは直列に接続される。IGBT素子2c,2dは直列に接続される。IGBT素子2e,2fは直列に接続される。IGBT素子2a〜2fの各々にはダイオードDが逆並列接続される。インバータ50からの交流出力は、リアクトル3およびコンデンサ4から成るフィルタ回路を介して負荷5に供給される。
The
電力変換装置100は、さらに、電流センサ6a〜6cと、減算部8a〜8c,17a〜17cと、ヒステリシスコンパレータ9a〜9cと、ゲート回路10a〜10cと、スイッチング周波数制御増幅器11a〜11cと、リミッタ回路14a〜14cと、2倍周波数(2f)成分加算回路15a〜15cとを備える。
The
電流センサ6a〜6cは、インバータ50の出力電流を検出する。減算部8a〜8cは、電流指令7と電流センサ6a〜6cにより検出された出力電流との偏差(電流偏差)を算出する。ヒステリシスコンパレータ9a〜9cは、電流偏差とヒステリシス幅18a〜18cとを比較する。ゲート回路10a〜10cは、ヒステリシスコンパレータ9a〜9cのそれぞれからの出力に基づいて、IGBT素子2a〜2fのゲート駆動信号を生成する。スイッチング周波数制御増幅器11a〜11cは、ヒステリシス幅を設定する。周波数/電圧変換器13a〜13cは、スイッチング周波数16を検出する。減算部17a〜17cは、スイッチング周波数16と周波数指令12との偏差(周波数偏差)を算出するとともに、その周波数偏差をスイッチング周波数制御増幅器11a〜11cに与える。リミッタ回路14a〜14cは、スイッチング周波数制御増幅器11a〜11cによって設定されたヒステリシス幅を所定の範囲内に制限する。
次にインバータ50の1相分の動作について説明する。なお、残りの2相分の動作も以下に説明する動作と同様であり、以下に説明する1相分の動作に対して位相が120°ずつ異なる点においてのみ相違する。このため残りの2相分の動作に関する以後の詳細な説明は繰り返さない。具体的には、IGBT素子2a,2b(U相分)の動作について以下に説明する。
Next, the operation for one phase of the
IGBT素子2a,2bの出力交流電圧が一定となるように、電流指令Isu*が与えられる。電流センサ6aで検出された出力電流Iuと電流指令Isu*との偏差(=Isu*−Iu)がヒステリシスコンパレータ9aに入力される。
A current command Isu * is applied so that the output AC voltage of
周波数/電圧変換器13aは、ヒステリシスコンパレータ9aの出力に基づいて、IGBT素子2a,2bのスイッチング周波数13aを検出する。減算部8aは、該スイッチング周波数とスイッチング周波数指令Fu*との偏差(=Fu*−Fu)を算出する。その偏差は、スイッチング周波数制御増幅器11aによって増幅され、リミッタ回路14によって制限される。これによりヒステリシス幅が生成される。
The frequency /
周波数/電圧変換器13aにより検出されたスイッチング周波数Fuが、スイッチング周波数指令Fu*よりも大きい場合、スイッチング周波数制御増幅器11aにより、ヒステリシス幅が大きくなる。これによりスイッチング周波数Fuが低下する。一方、スイッチング周波数Fuが、スイッチング周波数指令Fu*よりも小さい場合には、スイッチング周波数制御増幅器11aにより、ヒステリシス幅が小さくなる。これによりスイッチング周波数Fuが上昇する。
When the switching frequency Fu detected by the frequency /
このように本発明の実施の形態では、スイッチング周波数をスイッチング周波数指令に追従する制御を行なう。これによりリアクトル3のインダクタンス値のばらつき、直流電源1の電圧変動や出力交流電圧の値等により、スイッチング周波数が変動するのを抑制し、スイッチング周波数を指令値(スイッチング周波数指令)に精度良く制御することができる。
Thus, in the embodiment of the present invention, control is performed so that the switching frequency follows the switching frequency command. As a result, fluctuations in the inductance value of the
2倍周波数成分加算回路15aは、上記のヒステリシス幅に、出力電流の2倍の周波数成分を加算することによりヒステリシス幅を補正する。このようにして得られたヒステリシス幅18a(=ΔIu)がヒステリシスコンパレータ9aに入力される。
The double frequency
ヒステリシスコンパレータ9aは、電流偏差がヒステリシス幅18aを越えたときに出力を反転する。ゲート回路10aは、ヒステリシスコンパレータ9aのオン/オフ出力に基づいてIGBT素子2a,2bを駆動するためのゲート駆動信号を生成する。IGBT素子2a,2bはそのゲート駆動信号によりスイッチング制御(オン/オフ制御)されて、直流電源1からの直流電力を交流電力に変換する。IGBT素子2a,2bから出力された交流電力は、リアクトル3およびコンデンサ4から成るフィルタ回路を介して負荷5に供給される。これにより安定した交流電圧が負荷に供給される。
The
図2は、図1に示した2倍周波数成分加算回路15a〜15cの各々に適用可能な回路の構成例を示す図である。図2を参照して、2倍周波数成分加算回路15は、アンプ(Amp)21と、乗算器22と、正弦波発生器23と、加算器24とを備える。
FIG. 2 is a diagram illustrating a configuration example of a circuit applicable to each of the double frequency
アンプ21は、図示されないリミッタ回路(たとえばリミッタ回路14a)からのヒステリシス幅を増幅する。乗算器22は、インバータ50(たとえば直列接続されたIGBT素子2a,2b)の出力電流の位相θを2倍する。位相θは、たとえば電流指令7(たとえば電流指令Isu*)に基づいて生成することができる。正弦波発生器23は、乗算器22から与えられた位相2θを入力として正弦波を発生する。これにより出力電流の2倍周波数成分が生成される。加算器24は、アンプ21からのヒステリシス幅に、正弦波発生器23の出力を加算する。これによりヒステリシス幅が補正される。
The
図3および図4は、図1の構成から2倍周波数成分加算回路を省略した構成を有する電力変換装置の動作を説明する図である。図3および図4を参照して、スイッチング周波数を指令値(スイッチング周波数指令)に精度良く制御するために、スイッチング周波数制御増幅器11aおよびリミッタ回路14によって生成されるヒステリシス幅ΔIuが一定となる。
3 and 4 are diagrams illustrating the operation of the power conversion apparatus having a configuration in which the double frequency component addition circuit is omitted from the configuration in FIG. Referring to FIGS. 3 and 4, in order to accurately control the switching frequency to the command value (switching frequency command), the hysteresis width ΔIu generated by the switching
電流指令Isu*と出力電流Iuとの差、すなわち電流偏差は、当該出力電流Iuの波形のピーク近傍では小さくなる一方で、その波形のゼロ点近傍では大きくなる。 The difference between the current command Isu * and the output current Iu, that is, the current deviation is small near the peak of the waveform of the output current Iu, but is large near the zero point of the waveform.
上述のように、ヒステリシスコンパレータ9aは、電流偏差がヒステリシス幅ΔIuを越えた場合にその出力を反転させる。ゲート回路10aは、ヒステリシスコンパレータ9aの出力が反転したことによりIGBT素子2a,2bのオン/オフを切換える。したがって、出力電流Iuの波形のピーク近傍では、電流偏差が小さくなるためにヒステリシスコンパレータ9aの出力が反転しにくくなる一方で、出力電流Iuの波形のゼロ点近傍では、電流偏差が大きくなるためにヒステリシスコンパレータ9aの出力が反転しやすくなる。このため、出力電流Iuの波形のピーク近傍では、出力電流Iuが電流指令Isu*に追従する速度が小さいのに対して、出力電流Iuの波形のゼロ点では、出力電流Iuが電流指令Isu*に追従する速度が大きくなる。電流偏差が小さくなることにより追従速度が低下した場合、その出力電流に大きなリプル成分が生じる。このため出力電圧の歪み率が悪化するという課題が生じる。
As described above, the
図5は、図1に示した構成を備える本発明の実施の形態に係る電力変換装置の動作を説明する図である。図1および図5を参照して、本発明の実施の形態によれば、2倍周波数成分加算回路15aは、補正前のヒステリシス幅(すなわちスイッチング周波数制御増幅器およびリミッタ回路によって生成されたヒステリシス幅)に、出力電流の2倍の周波数成分を加算することで、ヒステリシス幅を補正する。これにより、補正後のヒステリシス幅が出力電流の2倍の周波数で周期的に変化する。出力電流の波形のピーク(波形の山および谷)ではヒステリシス幅が小さくなるので、スイッチング周波数を高くすることができる。これに対して出力電流の波形のゼロ点ではヒステリシス幅が大きくなるのでスイッチング周波数を低くすることができる。なお出力電流の波形の1周期の間におけるスイッチング周波数の平均値は、周波数指令12に追従した値となる。
FIG. 5 is a diagram for explaining the operation of the power conversion device according to the embodiment of the present invention having the configuration shown in FIG. Referring to FIGS. 1 and 5, according to the embodiment of the present invention, double frequency
出力電流の波形のピーク近傍においてスイッチング周波数が高まるので、出力電流が電流指令に追従する速度を上げることができる。これによりリプル電流を小さくすることができる。したがって本発明の実施の形態によれば、出力電圧の歪み率が悪化することを抑制することができる。一方、出力電流の波形のゼロ点近傍においてスイッチング周波数が低下する。この結果、出力電流の1周期で平均すれば、スイッチング素子をオンオフさせる周期は一定に保たれる。 Since the switching frequency increases near the peak of the output current waveform, the speed at which the output current follows the current command can be increased. As a result, the ripple current can be reduced. Therefore, according to the embodiment of the present invention, it is possible to suppress deterioration of the distortion rate of the output voltage. On the other hand, the switching frequency decreases near the zero point of the output current waveform. As a result, if the output current is averaged over one period, the period during which the switching element is turned on / off is kept constant.
なお、上記の実施の形態では、ヒステリシス幅の補正のために、周波数/電圧変換器13およびリミッタ回路によって生成されたヒステリシス幅に、出力電流の2倍の周波数成分が加算される。ただし、ヒステリシス幅の補正は、出力電流の2倍の周波数成分に限定されるものではない。たとえば偶数倍の周波数成分を用いることができる。この場合、図2の構成において、乗算器22は、位相θを2n(nは1以上の整数)倍すればよい。
In the above embodiment, in order to correct the hysteresis width, a frequency component that is twice the output current is added to the hysteresis width generated by the frequency / voltage converter 13 and the limiter circuit. However, the correction of the hysteresis width is not limited to the frequency component twice the output current. For example, even multiple frequency components can be used. In this case, in the configuration of FIG. 2, the
好ましくは、偶数倍の周波数成分は、出力電流の周期をTとすると、T/4の間に位相が(2m+1)π(mは0以上の任意の整数)変化する周波数成分、すなわち2×(2m+1)倍周波数成分であり、具体的には、2倍周波数成分、6倍周波数成分、10倍周波数成分、・・・である。この場合にも、当該周波数成分の波形の谷と、出力電流の波形の山とが時間的に重なる(周波数成分の波形の山と、出力電流の波形の谷とが時間的に重なる)ように位相を揃えることにより、周波数成分の山と出力電流の波形のゼロ点とを時間的に重ねることができる。したがって、出力電流の波形のピーク近傍においてヒステリシス幅を小さくすることができる。さらに、出力電流の波形のゼロ点近傍においてヒステリシス幅を大きくできる。ただし2倍周波数成分(すなわちm=0)を用いることでヒステリシス幅の補正の処理を簡素化できる。 Preferably, the even frequency component is a frequency component whose phase changes by (2m + 1) π (m is an arbitrary integer greater than or equal to 0) during T / 4, that is, 2 × ( 2m + 1) frequency components, specifically, a 2 × frequency component, a 6 × frequency component, a 10 × frequency component,... Also in this case, the valley of the waveform of the frequency component and the peak of the waveform of the output current overlap in time (the peak of the waveform of the frequency component and the valley of the waveform of the output current overlap in time). By aligning the phases, the peak of the frequency component and the zero point of the waveform of the output current can be overlapped in time. Therefore, the hysteresis width can be reduced in the vicinity of the peak of the waveform of the output current. Furthermore, the hysteresis width can be increased near the zero point of the output current waveform. However, the hysteresis width correction process can be simplified by using a double frequency component (that is, m = 0).
また、上記のように、ヒステリシス幅の補正は、出力電流の波形のピークにおいて、周波数/電圧変換器13およびリミッタ回路によって生成されたヒステリシス幅を小さくするとともに、出力電流の波形のゼロ点において、ヒステリシス幅を大きくすればよい。さらに、出力電流の1周期におけるスイッチング周波数(言い換えればスイッチング素子のオンオフ周期)の平均値が、ヒステリシス幅の補正によって変化しなければよい。したがって本発明では、周波数/電圧変換器13およびリミッタ回路によって生成されたヒステリシス幅の補正に用いられる波形は正弦波(または余弦波)に限定されるものではない。 As described above, the hysteresis width is corrected by reducing the hysteresis width generated by the frequency / voltage converter 13 and the limiter circuit at the peak of the output current waveform, and at the zero point of the output current waveform. What is necessary is just to enlarge a hysteresis width. Furthermore, the average value of the switching frequency in one cycle of the output current (in other words, the on / off cycle of the switching element) does not have to be changed by correcting the hysteresis width. Therefore, in the present invention, the waveform used for correcting the hysteresis width generated by the frequency / voltage converter 13 and the limiter circuit is not limited to a sine wave (or cosine wave).
図6は、本発明の実施の形態の第1の変形例を説明するための図である。図6を参照して、電力変換装置100Aは、2倍周波数成分加算回路15a〜15cに代えて三角波加算回路35a〜35cを備える。
FIG. 6 is a diagram for explaining a first modification of the embodiment of the present invention. Referring to FIG. 6,
図7は、図6に示した三角波加算回路の動作を説明するための図である。図6および図7を参照して、三角波の谷の部分が、出力電流の波形の山および谷の部分と時間軸上で重なりあう。一方、出力電流の波形のゼロ点と三角波の山とが時間軸上で重なり合う。これにより、出力電流の波形のピークではヒステリシス幅が小さくなり、出力電流の波形のゼロ点ではヒステリシス幅が大きくなる。 FIG. 7 is a diagram for explaining the operation of the triangular wave adder circuit shown in FIG. With reference to FIGS. 6 and 7, the valley portion of the triangular wave overlaps the peak and valley portions of the waveform of the output current on the time axis. On the other hand, the zero point of the waveform of the output current and the peak of the triangular wave overlap on the time axis. As a result, the hysteresis width decreases at the peak of the output current waveform, and the hysteresis width increases at the zero point of the output current waveform.
図8は、本発明の実施の形態の第2の変形例を説明するための図である。図8を参照して、電力変換装置100Bは、2倍周波数成分加算回路15に代えて矩形波加算回路45a〜45cを備える。
FIG. 8 is a diagram for explaining a second modification of the embodiment of the present invention. Referring to FIG. 8,
図9は、図8に示した矩形波加算回路の動作を説明するための図である。図8および図9を参照して、矩形波の谷の部分が、出力電流の波形の山および谷と時間軸上で重なりあう。一方、出力電流の波形のゼロ点と矩形波の山の部分とが時間軸上で重なりあう。したがって、出力電流の波形のピークではヒステリシス幅が小さくなり、出力電流の波形のゼロ点ではヒステリシス幅が大きくなる。 FIG. 9 is a diagram for explaining the operation of the rectangular wave adder circuit shown in FIG. Referring to FIGS. 8 and 9, the valley portion of the rectangular wave overlaps with the peak and valley of the waveform of the output current on the time axis. On the other hand, the zero point of the output current waveform and the peak portion of the rectangular wave overlap on the time axis. Therefore, the hysteresis width decreases at the peak of the output current waveform, and the hysteresis width increases at the zero point of the output current waveform.
また、この実施の形態では、3相のPWMインバータの場合を示したが、単相回路あるいは、交流を直流に変換するコンバータ回路など、ヒステリシスコンパレータを使用して電流指令に追従したスイッチング制御を行なう電力変換装置に適用できるので、同様の効果が得られる。 In this embodiment, the case of a three-phase PWM inverter is shown, but switching control that follows a current command is performed using a hysteresis comparator, such as a single-phase circuit or a converter circuit that converts alternating current into direct current. Since it can be applied to a power converter, the same effect can be obtained.
今回開示された実施の形態はすべての点で例示であって制限的なものではないと考えられるべきである。本発明の範囲は上記した説明ではなく、特許請求の範囲によって示され、特許請求の範囲と均等の意味および範囲内でのすべての変更が含まれることが意図される。 The embodiment disclosed this time should be considered as illustrative in all points and not restrictive. The scope of the present invention is defined by the terms of the claims, rather than the description above, and is intended to include any modifications within the scope and meaning equivalent to the terms of the claims.
1 直流電源、2a〜2f IGBT素子、3 リアクトル、4 コンデンサ、5 負荷、6a〜6c 電流センサ、7 電流指令、8a〜8c,17a〜17c 減算部、9a〜9c ヒステリシスコンパレータ、10a〜10c ゲート回路、11a〜11c スイッチング周波数制御増幅器、12 周波数指令、13a〜13c 周波数/電圧変換器、14a〜14c リミッタ回路、15a〜15c 2倍周波数成分加算回路、16 スイッチング周波数、18a〜18c ヒステリシス幅、21 アンプ、22 乗算器、23 正弦波発生器、24 加算器、35a〜35c 三角波加算回路、45a〜45c 矩形波加算回路、50 インバータ、100,100A,100B 電力変換装置、D ダイオード。
1 DC power supply, 2a to 2f IGBT element, 3 reactor, 4 capacitor, 5 load, 6a to 6c current sensor, 7 current command, 8a to 8c, 17a to 17c subtraction unit, 9a to 9c hysteresis comparator, 10a to
Claims (7)
前記自励式半導体スイッチング素子の出力電流を電流指令に追従させるために、前記出力電流と前記電流指令との偏差をヒステリシス幅と比較することによって、前記自励式半導体スイッチング素子のスイッチング周波数を変更するヒステリシスコンパレータと、
前記自励式半導体スイッチング素子のスイッチング周波数を検出するための検出部と、
前記検出部によって検出された前記スイッチング周波数の検出値と、前記スイッチング周波数の指令値との間の偏差に基づいて、前記ヒステリシス幅を設定する設定部と、
前記設定部により設定された前記ヒステリシス幅を補正して、その補正されたヒステリ幅を前記ヒステリシスコンパレータに与える補正部とを備え、
前記補正部は、前記出力電流の波形のピークにおいて、前記ヒステリシス幅を、前記設定部によって設定された幅よりも小さくする一方で、前記出力電流の波形のゼロ点において、前記ヒステリシス幅を、前記設定部によって設定された幅よりも大きくする、電力変換装置。 A self-excited semiconductor switching element;
Hysteresis for changing the switching frequency of the self-excited semiconductor switching element by comparing the deviation between the output current and the current command with a hysteresis width in order to make the output current of the self-excited semiconductor switching element follow the current command A comparator,
A detection unit for detecting a switching frequency of the self-excited semiconductor switching element;
A setting unit that sets the hysteresis width based on a deviation between a detected value of the switching frequency detected by the detecting unit and a command value of the switching frequency;
A correction unit that corrects the hysteresis width set by the setting unit and gives the corrected hysteresis width to the hysteresis comparator;
The correction unit reduces the hysteresis width at the peak of the output current waveform to be smaller than the width set by the setting unit, while setting the hysteresis width at the zero point of the output current waveform. A power converter that is larger than the width set by the setting unit.
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