[go: up one dir, main page]
More Web Proxy on the site http://driver.im/

JP2008088017A - Method for etching glass substrate - Google Patents

Method for etching glass substrate Download PDF

Info

Publication number
JP2008088017A
JP2008088017A JP2006271071A JP2006271071A JP2008088017A JP 2008088017 A JP2008088017 A JP 2008088017A JP 2006271071 A JP2006271071 A JP 2006271071A JP 2006271071 A JP2006271071 A JP 2006271071A JP 2008088017 A JP2008088017 A JP 2008088017A
Authority
JP
Japan
Prior art keywords
glass substrate
etching
silicon
substrate
mask
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2006271071A
Other languages
Japanese (ja)
Other versions
JP5124121B2 (en
Inventor
Yasuhiro Morikawa
泰宏 森川
Kouko Suu
紅コウ 鄒
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Ulvac Inc
Original Assignee
Ulvac Inc
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Ulvac Inc filed Critical Ulvac Inc
Priority to JP2006271071A priority Critical patent/JP5124121B2/en
Publication of JP2008088017A publication Critical patent/JP2008088017A/en
Application granted granted Critical
Publication of JP5124121B2 publication Critical patent/JP5124121B2/en
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Landscapes

  • Drying Of Semiconductors (AREA)
  • Micromachines (AREA)
  • Surface Treatment Of Glass (AREA)

Abstract

<P>PROBLEM TO BE SOLVED: To provide a method for etching a glass substrate which facilitates the fabrication of a silicon mask and improves workability. <P>SOLUTION: The dry etching method of a glass substrate masked by a silicon substrate comprises a step of bonding a silicon substrate 11 on the surface of a glass substrate 12, a step of forming a silicon mask 11M comprising the silicon substrate 11 on the glass substrate 12, a step of etching the glass substrate 12 through the silicon mask 11M, and a step of removing the silicon mask 11M from the glass substrate 12. Herewith, fabrication of the silicon mask 11M to the glass substrate 12 is facilitated, fabrication processes can be simplified because bonding work after forming the mask is dispensable and thereby workability can be improved. <P>COPYRIGHT: (C)2008,JPO&INPIT

Description

本発明は、ガラス基板の表面に凹部または貫通孔を形成する工程に用いて好適なガラス基板のエッチング方法に関する。   The present invention relates to a glass substrate etching method suitable for use in a step of forming a recess or a through hole on the surface of a glass substrate.

近年、半導体製造分野において広く実施されている薄膜製造技術、フォトリソグラフィ技術および微細加工技術を応用したMEMS(Micro-Electro-Mechanical System)と呼ばれるマイクロ構造体の開発が進められている。これらのマイクロ構造体としては、圧電素子を用いたポンプ装置やジャイロ装置、SAW(弾性表面波)素子を用いたフィルタ装置などが提案されており、例えば携帯型電子機器に搭載されるような小型、軽量化が求められる各種デバイス部品に応用が進められている。   In recent years, development of a microstructure called MEMS (Micro-Electro-Mechanical System) to which thin film manufacturing technology, photolithography technology, and microfabrication technology, which are widely practiced in the field of semiconductor manufacturing, has been advanced. As these microstructures, a pump device using a piezoelectric element, a gyro device, a filter device using a SAW (surface acoustic wave) element, and the like have been proposed. Applications are being made to various device parts that are required to be lighter.

MEMS部品は、半導体その他の電気・電子部品と同様に、配線基板上に実装されて使用される。従って、MEMS部品には、外部ストレスや熱ストレス等から内部の機能素子を有効に保護することができる筺体構造が不可欠である。そこで、MEMS部品の筺体に、石英や硼珪酸ガラス等のガラス材料が用いられるようになっている。例えば、下記特許文献1には、筺体部にガラス基板を用いた多層基板型マイクロポンプの製造方法が開示されている。   A MEMS component is used by being mounted on a wiring board in the same manner as a semiconductor or other electric / electronic component. Therefore, a casing structure that can effectively protect internal functional elements from external stress, thermal stress, and the like is indispensable for MEMS parts. Therefore, a glass material such as quartz or borosilicate glass is used for the casing of the MEMS component. For example, Patent Document 1 below discloses a method for manufacturing a multilayer substrate type micropump using a glass substrate for a housing part.

一方、MEMS部品の筺体部には、内部の機能素子と外部の配線基板との間を電気的に接続するために外部端子を設ける必要がある。この外部端子は、筺体部を構成するガラス基板に貫通孔を形成し、この貫通孔の内壁面または内部に導電材料を形成あるいは充填することによって構成することができる。例えば、下記特許文献2には、ガラス基板にサンドブラストにより貫通孔を形成し、この貫通孔の内壁面にめっき配線または導電性物質を充填して多層配線基板を形成する技術が開示されている。   On the other hand, it is necessary to provide an external terminal in the housing part of the MEMS component in order to electrically connect the internal functional element and the external wiring board. This external terminal can be formed by forming a through hole in a glass substrate that constitutes the casing and forming or filling a conductive material on the inner wall surface or inside of the through hole. For example, Patent Document 2 below discloses a technique for forming a multilayer wiring board by forming a through hole in a glass substrate by sand blasting and filling an inner wall surface of the through hole with a plated wiring or a conductive material.

サンドブラスト法は、図6A,Bに示すように、ガラス基板8の表面にマスク9を形成し、マスク9の開口領域に臨むガラス基板8の表面をブラスト処理して貫通孔10を形成する加工技術であり、加工スピードが速いというメリットがある。   In the sand blasting method, as shown in FIGS. 6A and 6B, a mask 9 is formed on the surface of the glass substrate 8, and the surface of the glass substrate 8 facing the opening region of the mask 9 is blasted to form a through hole 10. And there is an advantage that the processing speed is fast.

しかし、孔の直径が100μm以上と非常に大きいことと、貫通した孔の底部側でチッピングと呼ばれる逆テーパの形状を引き起こすこと、また多数の孔を同時に加工できない等のデメリットがある。図7に示すように、チッピング10pは、貫通孔10の底部の周縁にできる異常加工痕であり、貫通孔の外周側に向かう逆テーパ状に形成されるため、その後の貫通孔の導体化処理(めっき、充填)に重大な障害を引き起こす。 However, there are disadvantages in that the diameter of the hole is as large as 100 μm or more, a reverse taper shape called chipping is caused on the bottom side of the penetrating hole, and a large number of holes cannot be processed simultaneously. As shown in FIG. 7, the chipping 10p is an abnormally processed mark formed at the periphery of the bottom of the through hole 10 and is formed in a reverse taper shape toward the outer peripheral side of the through hole. Causes serious obstacles to plating and filling.

一方、ガラス基板に凹部または貫通孔を形成する他の技術として、ドライエッチング法がある。この方法は、ガラス基板に対し、その表面に形成したマスクを介してプラズマエッチングを施すことで、マスクの開口形状に対応した凹部あるいは貫通孔を形成するようにしたものである。例えば下記特許文献3には、ガラス基板に対して、その表面に形成したアルミニウムからなるメタルマスクを介してSF6ガスと酸素ガスの混合ガスのプラズマエッチングを施すことによって、凹部あるいは貫通孔を形成する方法が開示されている。 On the other hand, there is a dry etching method as another technique for forming a recess or a through hole in a glass substrate. In this method, a glass substrate is subjected to plasma etching through a mask formed on the surface thereof to form a recess or a through hole corresponding to the opening shape of the mask. For example, in Patent Document 3 below, a concave portion or a through hole is formed by performing plasma etching of a mixed gas of SF 6 gas and oxygen gas on a glass substrate through a metal mask made of aluminum formed on the surface of the glass substrate. A method is disclosed.

ガラス基板として現在広く利用されている硼珪酸ガラスのドライエッチングは、石英ガラスよりもエッチングが困難である。理由は、硼珪酸ガラスの成分に石英ガラスにはないNa(ナトリウム)やB(ホウ素)、K(カリウム)、Al(アルミニウム)等が含まれているため、これらの成分がエッチングガスと反応し、これによりエッチング速度が低下し、エッチング加工面が荒れ易くなる。このため、SF6などの反応性の高いエッチングガスや、Ar(アルゴン)やXe(キセノン)等の希ガスを添加して物理スパッタ的にエッチングする方法が採用されている。 Dry etching of borosilicate glass currently widely used as a glass substrate is more difficult to etch than quartz glass. The reason is that the components of borosilicate glass include Na (sodium), B (boron), K (potassium), Al (aluminum), etc., which are not found in quartz glass, so these components react with the etching gas. As a result, the etching rate is lowered, and the etched surface is easily roughened. For this reason, a method of performing physical sputter etching by adding a highly reactive etching gas such as SF 6 or a rare gas such as Ar (argon) or Xe (xenon) is employed.

一方、SF6をメインガスとしてエッチングする場合や物理スパッタをメインにエッチングする場合、マスクの加工量も大きくなるため、エッチング時の対マスク選択比が低くなるという問題がある。このため、硼珪酸ガラスの深掘り加工にはマスクの形成厚を大きくする必要があり、また、エッチング選択性の高いエッチングガスを用いる必要があった。 On the other hand, when etching is performed with SF 6 as the main gas or when physical sputtering is mainly performed, the amount of mask processing increases, and there is a problem that the selectivity with respect to the mask during etching is lowered. For this reason, it is necessary to increase the formation thickness of the mask for deep digging of borosilicate glass, and it is necessary to use an etching gas with high etching selectivity.

そこで、下記非特許文献1には、マスクにシリコン基板を用い、エッチングガスにCF系ガスを用いたガラス基板のエッチング方法が開示されている。以下、図8を参照して、この従来のシリコンマスクを用いたガラス基板のエッチング方法について説明する。   Therefore, Non-Patent Document 1 below discloses a glass substrate etching method using a silicon substrate as a mask and CF gas as an etching gas. Hereinafter, a glass substrate etching method using this conventional silicon mask will be described with reference to FIG.

(図8A)所定厚のシリコン基板1の表面と裏面にそれぞれシリコン酸化膜2A,2Bを形成し、表面側のシリコン酸化膜2A上にアルミニウム膜3を成膜する。そして、シリコン基板1の表面にシリコン酸化膜2Aとアルミニウム膜3の積層膜からなるマスクパターンをフォトリソグラフィ技術によって形成した後、このマスクパターンをマスクとするドライエッチングを施して、シリコン基板1の表面にマスク開口部形状に対応する凹部4を形成する。   (FIG. 8A) Silicon oxide films 2A and 2B are respectively formed on the front and back surfaces of a silicon substrate 1 having a predetermined thickness, and an aluminum film 3 is formed on the silicon oxide film 2A on the front surface side. Then, a mask pattern made of a laminated film of the silicon oxide film 2A and the aluminum film 3 is formed on the surface of the silicon substrate 1 by photolithography technique, and then dry etching is performed using the mask pattern as a mask. A recess 4 corresponding to the shape of the mask opening is formed.

(図8B)次に、シリコン基板1の表面からマスクパターンを除去した後、シリコン基板1の酸化処理を行って、凹部4を含むシリコン基板1の表面にシリコン酸化膜5を形成する。また、シリコン基板1の裏面側のシリコン酸化膜2Bを除去する。
(図8C)次に、シリコン基板1をエッチバックして200μm程度に薄厚化し、凹部4を被覆するシリコン酸化膜5をシリコン基板1の裏面側に露出させる。エッチバック処理は、TMAH(水酸化テトラメチルアンモニウム)溶液を用いたウェットエッチングで行う。
(FIG. 8B) Next, after removing the mask pattern from the surface of the silicon substrate 1, the silicon substrate 1 is oxidized to form a silicon oxide film 5 on the surface of the silicon substrate 1 including the recesses 4. Further, the silicon oxide film 2B on the back side of the silicon substrate 1 is removed.
(FIG. 8C) Next, the silicon substrate 1 is etched back to a thickness of about 200 μm, and the silicon oxide film 5 covering the recess 4 is exposed on the back side of the silicon substrate 1. The etch back process is performed by wet etching using a TMAH (tetramethylammonium hydroxide) solution.

(図8D)次に、薄厚化したシリコン基板1をガラス基板(パイレックスガラス( 「パイレックス」 は米国コーニング社の登録商標。)6の表面に陽極接合法により接合した後、シリコン基板1上のシリコン酸化膜5を除去する。これにより、ガラス基板6の上にシリコンマスク1Mが作製される。
(図8E)次に、シリコンマスク1Mを介してガラス基板6のドライエッチングを行い、ガラス基板6にシリコンマスク1Mの開口部形状に対応した凹部7を形成する。エッチングガスにはC48が用いられている。
(図8F)最後に、ガラス基板6からシリコンマスク1Mを除去する。シリコンマスク1Mの除去には、KOH(水酸化カリウム)水溶液が用いられる。
(FIG. 8D) Next, the thinned silicon substrate 1 is bonded to the surface of a glass substrate (Pyrex glass (“Pyrex” is a registered trademark of Corning, USA)) 6 by anodic bonding, and then silicon on the silicon substrate 1 is bonded. The oxide film 5 is removed, whereby a silicon mask 1M is produced on the glass substrate 6.
(FIG. 8E) Next, the glass substrate 6 is dry-etched through the silicon mask 1M to form a recess 7 in the glass substrate 6 corresponding to the shape of the opening of the silicon mask 1M. C 4 F 8 is used as the etching gas.
(FIG. 8F) Finally, the silicon mask 1M is removed from the glass substrate 6. A KOH (potassium hydroxide) aqueous solution is used to remove the silicon mask 1M.

特開2003−225898号公報JP 2003-225898 A 特開2002−359446号公報JP 2002-359446 A 特開平5−6874号公報JP-A-5-6874 T.Akashi, Y.Yoshimura, and S.Higashiyama 「Deep Reactive Ion Etching of Pyrex Glass Using a Bonded Silicon Wafer as an Etching Mask」 Proceedings of 18th IEEE Int.conf. on micro electro mechanical system (MEMS) 2005, 520-523T. Akashi, Y. Yoshimura, and S. Higashiyama `` Deep Reactive Ion Etching of Pyrex Glass Using a Bonded Silicon Wafer as an Etching Mask '' Proceedings of 18th IEEE Int.conf. On micro electro mechanical system (MEMS) 2005, 520- 523

図8に示した従来のガラス基板のエッチング方法においては、マスクにシリコン基板を用い、エッチングガスにCF系ガスを用いることで、エッチング時の対マスク選択比を高くでき、これによりガラス基板の深掘り加工を実現することが可能となる。   In the conventional method for etching a glass substrate shown in FIG. 8, a silicon substrate is used as a mask and a CF-based gas is used as an etching gas, so that the selectivity with respect to the mask at the time of etching can be increased. It is possible to realize digging.

しかしながら、図8に示したガラス基板のエッチング方法においては、マスクを構成するシリコン基板1の形状加工工程が非常に複雑であるという問題がある。また、形状加工がなされ薄厚化したシリコン基板1はハンドリング性が悪いため、このシリコン基板1をガラス基板6に接合する作業を容易に行えないという懸念もある。   However, the glass substrate etching method shown in FIG. 8 has a problem that the shape processing step of the silicon substrate 1 constituting the mask is very complicated. Further, since the silicon substrate 1 that has been processed and thinned has poor handling properties, there is a concern that the operation of joining the silicon substrate 1 to the glass substrate 6 cannot be easily performed.

本発明は上述の問題に鑑みてなされ、シリコンマスクの作製を容易に行うことができるとともに作業性の向上を図ることができるガラス基板のエッチング方法を提供することを課題とする。   The present invention has been made in view of the above-described problems, and an object of the present invention is to provide a method of etching a glass substrate that can easily produce a silicon mask and can improve workability.

以上の課題を解決するに当たり、本発明のガラス基板のエッチング方法は、ガラス基板の表面にシリコン基板を接合する工程と、上記ガラス基板上で上記シリコン基板からなるシリコンマスクを形成する工程と、上記シリコンマスクを介して上記ガラス基板をエッチングする工程と、上記シリコンマスクを上記ガラス基板から除去する工程とを有する。   In solving the above problems, the glass substrate etching method of the present invention includes a step of bonding a silicon substrate to the surface of the glass substrate, a step of forming a silicon mask made of the silicon substrate on the glass substrate, Etching the glass substrate through a silicon mask, and removing the silicon mask from the glass substrate.

本発明においては、マスクとなるシリコン基板を予めガラス基板の表面に接合しておき、ガラス基板でシリコン基板を支持した状態で、シリコンマスクの形状加工を行うようにしている。これにより、ガラス基板に対するシリコンマスクの作製を容易に行うことができるとともに、マスク形成後の接合作業を廃止できるので加工プロセスを簡素化でき、作業性の向上を図ることが可能となる。   In the present invention, a silicon substrate serving as a mask is bonded to the surface of the glass substrate in advance, and the shape processing of the silicon mask is performed with the silicon substrate supported by the glass substrate. Accordingly, it is possible to easily manufacture a silicon mask on the glass substrate, and it is possible to eliminate the joining work after the mask is formed, thereby simplifying the processing process and improving workability.

本発明において、ガラス基板のエッチングはドライエッチング法で行われる。エッチングガスにCF系、CHF系を用いることによって、ガラス基板とシリコンマスクの選択性向上を図ることができる。また、SF6ガスに比べて環境負荷の低減を図ることができる。なお、エッチング装置として磁気中性線放電(NLD)エッチング装置を用いることにより、上記エッチングガスでのエッチングレートを、例えば1μm/min程度にまで向上させることができることが確認されている。 In the present invention, the glass substrate is etched by a dry etching method. By using CF or CHF as the etching gas, the selectivity between the glass substrate and the silicon mask can be improved. In addition, the environmental load can be reduced compared to SF 6 gas. It has been confirmed that by using a magnetic neutral line discharge (NLD) etching apparatus as the etching apparatus, the etching rate with the etching gas can be improved to, for example, about 1 μm / min.

シリコンマスクは、シリコン基板の上に形成したレジストパターンをマスクとするシリコン基板のエッチング処理によって形成することができる。シリコン基板がガラス基板の上に支持されているので、シリコンマスクの作製が容易となり、加工工数の削減と作業性の向上を図ることができる。シリコン基板のエッチングはドライエッチングでもよいし、ウェットエッチングでもよい。   The silicon mask can be formed by etching the silicon substrate using a resist pattern formed on the silicon substrate as a mask. Since the silicon substrate is supported on the glass substrate, the production of the silicon mask is facilitated, and the number of processing steps can be reduced and the workability can be improved. The etching of the silicon substrate may be dry etching or wet etching.

ガラス基板としては、石英は勿論、NdやEr等の希土類イオンをドープしたガラス系材料、Li2O−Al23−SiO2系等の低膨張結晶化ガラス、珪酸ソーダガラス、硼珪酸ガラス、無アルカリガラス、白板ガラス、青板ガラスが適用可能である。また、ガラス基板とシリコン基板との接合には、陽極接合、常温接合、樹脂接合などが適用可能である。陽極接合は、ガラス基板とシリコン基板とを重ね合わせ、熱と電圧を加えることにより両基板を密着固定する接合方法である。常温接合は、接合界面をイオンビームの照射等で活性化し結合手を生成することで基板間を接合する技術である。また、樹脂接合には、例えば接着性樹脂材料を用いた接合技術が含まれる。 As a glass substrate, not only quartz but also glass-based materials doped with rare earth ions such as Nd and Er, low expansion crystallized glass such as Li 2 O—Al 2 O 3 —SiO 2 , sodium silicate glass, borosilicate glass Alkali-free glass, white plate glass, and blue plate glass are applicable. In addition, anodic bonding, room temperature bonding, resin bonding, or the like can be applied to the bonding of the glass substrate and the silicon substrate. The anodic bonding is a bonding method in which a glass substrate and a silicon substrate are overlapped, and both substrates are tightly fixed by applying heat and voltage. Room temperature bonding is a technique for bonding substrates by activating the bonding interface by ion beam irradiation or the like to generate bonds. Further, the resin bonding includes, for example, a bonding technique using an adhesive resin material.

以上述べたように、本発明のガラス基板のエッチング方法によれば、ガラス基板上でシリコンマスクを作製するようにしているので、シリコンマスクの作製を容易に行うことができるとともに、マスク形成後の接合作業を廃止できるので加工プロセスを簡素化でき、作業性の向上を図ることが可能となる。   As described above, according to the etching method of the glass substrate of the present invention, since the silicon mask is manufactured on the glass substrate, the silicon mask can be easily manufactured, and after the mask is formed. Since the joining work can be abolished, the machining process can be simplified and workability can be improved.

以下、本発明の実施形態について図面を参照して説明する。   Embodiments of the present invention will be described below with reference to the drawings.

図1A〜Eは、本発明の実施形態によるガラス基板のエッチング方法を説明する要部の工程断面図である。本実施形態によるガラス基板のエッチング方法は、ガラス基板の表面にシリコン基板を接合する工程(図1A)と、ガラス基板上でシリコン基板からなるシリコンマスクを形成する工程(図1B,C)と、シリコンマスクを介してガラス基板をエッチングする工程(図1D)と、シリコンマスクをガラス基板から除去する工程(図1E)とを有する。以下、各工程の詳細について説明する。   1A to 1E are process cross-sectional views of a main part for explaining a glass substrate etching method according to an embodiment of the present invention. The glass substrate etching method according to the present embodiment includes a step of bonding a silicon substrate to the surface of the glass substrate (FIG. 1A), a step of forming a silicon mask made of a silicon substrate on the glass substrate (FIGS. 1B and 1C), A step of etching the glass substrate through the silicon mask (FIG. 1D) and a step of removing the silicon mask from the glass substrate (FIG. 1E) are included. Details of each step will be described below.

(シリコン基板接合工程)
図1Aに示すように、まず、シリコン基板11がガラス基板12の表面に接合される。ガラス基板12は、パイレックスガラス( 「パイレックス」は米国コーニング社の登録商標。)に代表される硼珪酸ガラスが用いられている。シリコン基板11は、主面が(100)の方位面で切り出された単結晶基板である。本実施形態において、シリコン基板11とガラス基板12の接合には陽極接合法が採用されているが、常温接合や樹脂接合などの他の接合法を採用しても構わない。なお、シリコンとガラスは互いに同等の熱膨張係数を有しているので、特に加熱処理を伴うプロセスにおいて好適な組合せとなる。
(Silicon substrate bonding process)
As shown in FIG. 1A, first, the silicon substrate 11 is bonded to the surface of the glass substrate 12. The glass substrate 12 is made of borosilicate glass represented by Pyrex glass (“Pyrex” is a registered trademark of Corning, USA). The silicon substrate 11 is a single crystal substrate whose main surface is cut out in the (100) orientation plane. In this embodiment, the anodic bonding method is employed for bonding the silicon substrate 11 and the glass substrate 12, but other bonding methods such as room temperature bonding and resin bonding may be employed. Since silicon and glass have the same thermal expansion coefficient, they are a suitable combination particularly in a process involving heat treatment.

シリコン基板11は、マスクとして機能するのに十分な厚さ(例えば20μm以上)に形成される。当初より所定厚のシリコン基板を準備しこれをガラス基板12に接合する方法のほか、所定厚より厚めのシリコン基板をガラス基板12に接合した後、ガラス基板12をサポート材としてシリコン基板11の薄厚化処理を行い、シリコン基板を所定厚に形成する方法も適用可能である。一方、ガラス基板12の厚さは特に制限されず、仕様やプロセスに応じて適宜選択される。   The silicon substrate 11 is formed with a sufficient thickness (for example, 20 μm or more) to function as a mask. In addition to a method of preparing a silicon substrate having a predetermined thickness from the beginning and bonding it to the glass substrate 12, after bonding a silicon substrate thicker than the predetermined thickness to the glass substrate 12, the glass substrate 12 is used as a support material to reduce the thickness of the silicon substrate 11. It is also possible to apply a method of forming a silicon substrate with a predetermined thickness by performing a crystallization process. On the other hand, the thickness of the glass substrate 12 is not particularly limited, and is appropriately selected according to specifications and processes.

シリコン基板11とガラス基板12とを接合した後、この接合体の表面側および裏面側にレジスト層13,14を形成する。表面側のレジスト層13は、シリコン基板11を所定形状にパターニングするためのものである。また、裏面側のレジスト層14は、ガラス基板12に貫通孔が形成された際、このガラス基板12を支持するエッチング装置の基板ステージに内蔵されている基板冷却用のガスがガラス基板12の裏面側から漏出しないようにするためのものである。レジスト層13,14は感光性有機レジスト材が用いられる。なお、ガラス基板12に対して、貫通孔ではなく有底の凹部を形成する場合等においては、レジスト層14の形成は不要である。   After the silicon substrate 11 and the glass substrate 12 are bonded, resist layers 13 and 14 are formed on the front surface side and the back surface side of the bonded body. The resist layer 13 on the front side is for patterning the silicon substrate 11 into a predetermined shape. Further, the resist layer 14 on the back surface side has a substrate cooling gas built into the substrate stage of the etching apparatus that supports the glass substrate 12 when a through hole is formed in the glass substrate 12. This is to prevent leakage from the side. The resist layers 13 and 14 are made of a photosensitive organic resist material. In the case where a bottomed recess is formed on the glass substrate 12 instead of a through hole, the resist layer 14 need not be formed.

(シリコンマスク作製工程)
次に、図1Bに示すように、シリコン基板11の表面に形成したレジスト層13に対して露光・現像処理を施して所定形状のレジストマスク13Mを形成する工程が行われる。その後、レジストマスク13Mをエッチングマスクとするシリコン基板11のエッチング処理を施して、図1Cに示すシリコンマスク11Mを形成する。
(Silicon mask manufacturing process)
Next, as shown in FIG. 1B, a step of exposing and developing the resist layer 13 formed on the surface of the silicon substrate 11 to form a resist mask 13M having a predetermined shape is performed. Thereafter, the silicon substrate 11 is etched using the resist mask 13M as an etching mask to form the silicon mask 11M shown in FIG. 1C.

シリコン基板11のエッチング処理は、例えば、SF6ガスやHBrガスを用いたドライエッチングで行うことができる。なお、ドライエッチングに代えて、例えば、TMAHやKOH溶液を用いたウェットエッチングによって行うことも可能である。また、ガラス基板12とのエッチング選択性がとれるエッチャントを用いることで、シリコン基板11に対するエッチング処理の制御性を高めることができる。 The etching process of the silicon substrate 11 can be performed, for example, by dry etching using SF 6 gas or HBr gas. In place of dry etching, for example, wet etching using TMAH or KOH solution may be performed. In addition, by using an etchant that has etching selectivity with respect to the glass substrate 12, the controllability of the etching process for the silicon substrate 11 can be enhanced.

(ガラス基板エッチング工程)
次に、図1Dに示すように、シリコンマスク11Mをエッチングマスクとするエッチング処理を施して、ガラス基板12に貫通孔15を形成する。ガラス基板12のエッチングはドライエッチングで行う。エッチングガスは、シリコンマスク11Mとの選択性がとれるエッチングガスであれば特に制限されない。すなわち、ガラス基板12に貫通孔が形成される前に、シリコンマスク11Mがエッチング除去されない程度の選択性が必要である。具体的に、本実施形態では、エッチングガスとして、C38ガスが用いられるが、CF4、c−C48等の他のCF系ガスも適用可能である。また、CHF3等のCHF系ガスも適用可能である。また、これらのCF系ガス、CHF系ガスと酸素ガス(O2)との混合ガスを用いてもよい。
(Glass substrate etching process)
Next, as shown in FIG. 1D, an etching process using the silicon mask 11M as an etching mask is performed to form a through hole 15 in the glass substrate 12. Etching of the glass substrate 12 is performed by dry etching. The etching gas is not particularly limited as long as it is an etching gas that is selective with respect to the silicon mask 11M. That is, before the through-hole is formed in the glass substrate 12, it is necessary to be selective enough that the silicon mask 11M is not etched away. Specifically, in this embodiment, C 3 F 8 gas is used as the etching gas, but other CF-based gases such as CF 4 and c-C 4 F 8 are also applicable. A CHF gas such as CHF 3 is also applicable. Further, a mixed gas of these CF gas, CHF gas and oxygen gas (O 2 ) may be used.

なお、ガラス基板12に貫通孔15を形成する以外に、有底の凹部(孔)を形成する場合には、当該凹部の形成深さが所定値に達した時点でエッチング処理を停止すればよい。   In addition to forming the through hole 15 in the glass substrate 12, when forming a bottomed recess (hole), the etching process may be stopped when the formation depth of the recess reaches a predetermined value. .

最後に、ガラス基板12からシリコンマスク11Mおよびレジスト層14を除去する(図1E)。シリコンマスク11Mの除去は、シリコンの全面エッチバックのほか、TMAHやKOHなどのエッチング液を用いた溶解除去が適用可能である。また、レジスト層14の除去は、酸素プラズマによるアッシング処理のほか、所定の溶解液を用いた溶解除去が適用可能である。   Finally, the silicon mask 11M and the resist layer 14 are removed from the glass substrate 12 (FIG. 1E). The removal of the silicon mask 11M can be performed by removing the entire surface of the silicon by etching and using an etching solution such as TMAH or KOH. The resist layer 14 can be removed not only by ashing using oxygen plasma but also by dissolution using a predetermined solution.

なお、作製されたガラス基板12は、その後、貫通孔15が導電めっき被着又は導体物充填などの導体化処理がなされるとともに、ガラス基板12の表面および裏面に必要な配線層が形成されることで、MEMS部品やIC部品などが実装される配線基板として構成される。   The manufactured glass substrate 12 is then subjected to conductorization treatment such as conductive plating deposition or conductor filling, and necessary wiring layers are formed on the front and back surfaces of the glass substrate 12. Thus, the circuit board is configured as a wiring board on which MEMS parts, IC parts, and the like are mounted.

以上のようにして、ガラス基板12の所定領域に対して貫通孔15が形成される。本実施形態によれば、マスクとなるシリコン基板11を予めガラス基板12の表面に接合しておき、ガラス基板12でシリコン基板11を支持した状態で、シリコンマスク11Mの作製を行うようにしている。これにより、ガラス基板12に対するシリコンマスク11Mの作製を容易に行うことができるとともに、マスク形成後の接合作業を廃止できるので加工プロセスを簡素化でき、作業性の向上を図ることが可能となる。   As described above, the through hole 15 is formed in a predetermined region of the glass substrate 12. According to the present embodiment, the silicon substrate 11 serving as a mask is bonded to the surface of the glass substrate 12 in advance, and the silicon mask 11M is manufactured with the silicon substrate 11 supported by the glass substrate 12. . As a result, the silicon mask 11M can be easily fabricated on the glass substrate 12, and the bonding process after the mask formation can be eliminated, so that the processing process can be simplified and the workability can be improved.

また、シリコン基板11の上に形成したレジストパターンをマスクとするシリコン基板11のエッチング処理によってシリコンマスク11Mを形成しているので、シリコンマスク11Mの作製が容易であり、作業性の向上を図ることができる。   In addition, since the silicon mask 11M is formed by etching the silicon substrate 11 using the resist pattern formed on the silicon substrate 11 as a mask, the silicon mask 11M can be easily manufactured and workability can be improved. Can do.

また、本実施形態によれば、ガラス基板12に貫通孔15を形成するに際して、エッチングガスにCF系あるいはCHF系のエッチングガスを用いることにより、シリコンマスク11Mとの選択性に優れ、かつ、所定のエッチングレートを維持することが可能となる。   Further, according to the present embodiment, when the through hole 15 is formed in the glass substrate 12, by using a CF-based or CHF-based etching gas as the etching gas, the selectivity with respect to the silicon mask 11M is excellent, and a predetermined value is used. The etching rate can be maintained.

図2は、エッチングガスにC38ガスを用いてガラス基板(パイレックスガラス( 「パイレックス」は米国コーニング社の登録商標。))をエッチングしたときの基板バイアス電力とエッチングレートとの関係を示している。エッチング装置は、図3に示す磁気中性線放電(NLD)エッチング装置を用いた。バイアス電力の上昇に伴って、エッチング速度が向上することがわかり、最大1μm/min程度のエッチング速度が得られる。 FIG. 2 shows the relationship between the substrate bias power and the etching rate when a glass substrate (Pyrex glass (“Pyrex” is a registered trademark of Corning, USA)) is etched using C 3 F 8 gas as an etching gas. ing. As the etching apparatus, a magnetic neutral line discharge (NLD) etching apparatus shown in FIG. 3 was used. It can be seen that the etching rate is improved as the bias power is increased, and an etching rate of about 1 μm / min at maximum is obtained.

図3はNLDエッチング装置20の概略構成図である。21は真空チャンバであり、内部にプラズマ発生部21aと基板処理部21bとを形成している。真空チャンバ21にはターボ分子ポンプ(TMP)等の真空ポンプが接続され、真空チャンバ21の内部が所定の真空度に真空排気されている。   FIG. 3 is a schematic configuration diagram of the NLD etching apparatus 20. Reference numeral 21 denotes a vacuum chamber, in which a plasma generating unit 21a and a substrate processing unit 21b are formed. A vacuum pump such as a turbo molecular pump (TMP) is connected to the vacuum chamber 21, and the inside of the vacuum chamber 21 is evacuated to a predetermined degree of vacuum.

プラズマ発生部21aを構成するベルジャ22の周囲には、第1高周波電源RF1に接続されたプラズマ発生用の高周波コイル23と、この高周波コイル23の外周側に配置された三つの磁場コイル24A,24B,24Cがそれぞれ配置されている。磁場コイル24Aと磁場コイル24Cにはそれぞれ同一方向に電流が供給され、磁場コイル24Bには他の磁場コイル24A,24Cと逆方向に電流が供給される。その結果、プラズマ発生部21aにおいて、リング状に磁気中性線25が形成され、高周波コイル23により磁気中性線25に沿って誘導電場が印加されることで、放電プラズマが形成される。 Around the bell jar 22 constituting the plasma generator 21a, there are a high frequency coil 23 for plasma generation connected to the first high frequency power supply RF1, and three magnetic field coils 24A, 24B arranged on the outer peripheral side of the high frequency coil 23. , 24C are arranged. Current is supplied to the magnetic field coil 24A and the magnetic field coil 24C in the same direction, and current is supplied to the magnetic field coil 24B in the opposite direction to the other magnetic field coils 24A and 24C. As a result, in the plasma generator 21a, the magnetic neutral wire 25 is formed in a ring shape, and an induction electric field is applied along the magnetic neutral wire 25 by the high-frequency coil 23, whereby discharge plasma is formed.

一方、基板処理部21bには、被処理基板(本例ではガラス基板)を支持するステージ26が設置されている。このステージ26は、ブロッキングコンデンサ27を介してバイアス電源として第2高周波電源RF2に接続されている。また、ステージ26の対向電極としてプラズマ発生部21aの上部に形成される天板28には、コンデンサ29を介して第3高周波電源RF3が接続されている。   On the other hand, a stage 26 for supporting a substrate to be processed (a glass substrate in this example) is installed in the substrate processing unit 21b. The stage 26 is connected to the second high frequency power source RF2 as a bias power source via a blocking capacitor 27. A third high frequency power supply RF3 is connected to a top plate 28 formed on the upper part of the plasma generating unit 21a as a counter electrode of the stage 26 via a capacitor 29.

エッチングガスは、天板28の近傍に設置されたガス導入部30を介してプラズマ発生部21aに導入される。エッチングガスには上述のように例えばCF系、CHF系ガスが用いられる。導入されたエッチングガスは、プラズマ発生部21aでプラズマ化し、生成されたイオンとラジカルによりステージ26上のガラス基板(図示略)をエッチング処理する。高周波電源RF2は、基板バイアスによりイオンをステージ26側に加速させ、ガラス基板上のラジカル生成物をスパッタ除去してエッチング性を高める。高周波電源RF3は、エッチング領域の正イオンによるチャージアップを抑制し、ガラス基板の深掘り加工を実現する。   The etching gas is introduced into the plasma generation unit 21 a through the gas introduction unit 30 installed in the vicinity of the top plate 28. As described above, for example, CF or CHF gas is used as the etching gas. The introduced etching gas is turned into plasma by the plasma generation unit 21a, and the glass substrate (not shown) on the stage 26 is etched by the generated ions and radicals. The high-frequency power supply RF2 accelerates ions to the stage 26 side by the substrate bias, and removes radical products on the glass substrate by sputtering to improve the etching property. The high frequency power supply RF3 suppresses charge-up due to positive ions in the etching region, and realizes deep processing of the glass substrate.

図4A,Bは、以上の構成のNLDエッチング装置20を用いてガラス基板に凹部(有底孔)を形成したときのSEM写真である。シリコンマスクの開口部は直径50μmの円形であり、シリコンマスクの厚さは30μmである。また、ガラス基板は硼珪酸ガラス(コーニング7740(商品名))であり、孔の深さは80μm、底部の直径は30μmである。このときのエッチング装置の運転条件は、以下のとおりである。
[エッチング条件]
・圧力:1Pa
・高周波電源(RF1) 周波数:13.56MHz
電力:2300W
・高周波電源(RF2) 周波数:12.5MHz
電力:500W
・高周波電源(RF3) 周波数:12.5MHz
電力:500W
・磁場コイル電流 24A:30.6A
24B:52A
24C:30.6A
・エッチングガス C48:30sccm
CHF3:20sccm
2:10sccm
4A and 4B are SEM photographs when a recess (bottomed hole) is formed in a glass substrate using the NLD etching apparatus 20 having the above configuration. The opening of the silicon mask is circular with a diameter of 50 μm, and the thickness of the silicon mask is 30 μm. The glass substrate is borosilicate glass (Corning 7740 (trade name)), the hole depth is 80 μm, and the bottom diameter is 30 μm. The operating conditions of the etching apparatus at this time are as follows.
[Etching conditions]
・ Pressure: 1Pa
・ High frequency power supply (RF1) Frequency: 13.56 MHz
Power: 2300W
・ High frequency power supply (RF2) Frequency: 12.5MHz
Power: 500W
・ High frequency power supply (RF3) Frequency: 12.5MHz
Power: 500W
Magnetic field coil current 24A: 30.6A
24B: 52A
24C: 30.6A
Etching gas C 4 F 8 : 30 sccm
CHF 3 : 20 sccm
O 2 : 10 sccm

なお、エッチングガスにCF系ガスを用いることにより、SF6ガスに比べて、環境負荷の大幅な低減を図ることが可能となる。図5に、代表的なCF系ガスとSF6ガスの地球温暖化係数(GWP)を二酸化炭素(CO2)に対する相対値で示す。 Note that the use of a CF-based gas as the etching gas makes it possible to significantly reduce the environmental burden compared to SF 6 gas. FIG. 5 shows the global warming potential (GWP) of typical CF gas and SF 6 gas as a relative value to carbon dioxide (CO 2 ).

以上、本発明の実施形態について説明したが、勿論、本発明はこれに限定されることはなく本発明の技術的思想に基づいて種々の変形が可能である。   The embodiment of the present invention has been described above. Of course, the present invention is not limited to this, and various modifications can be made based on the technical idea of the present invention.

例えば以上の実施形態では、ガラス基板12に対して貫通孔あるいは有底孔を形成する例について説明したが、これに限らず、グルーブ(溝)あるいはスロット状の凹部をドライエッチングでガラス基板上に形成する場合にも、本発明は適用可能である。   For example, in the above embodiment, an example in which a through hole or a bottomed hole is formed in the glass substrate 12 has been described. However, the present invention is not limited to this, and a groove (a groove) or a slot-like recess is formed on the glass substrate by dry etching. The present invention can also be applied to the formation.

また、以上の実施形態では、ガラス基板のドライエッチング工程にNLDエッチング装置を用いる例について説明したが、これに限らず、シリコンマスクのエッチング加工に上記NLDエッチング装置を用いることも勿論可能である。なお、エッチング装置はNLDに限らず、ICP等の他の放電形式のプラズマエッチング装置を用いてもよい。   Moreover, although the above embodiment demonstrated the example which uses an NLD etching apparatus for the dry etching process of a glass substrate, it is needless to say that not only this but the said NLD etching apparatus can be used for the etching process of a silicon mask. The etching apparatus is not limited to the NLD, and other discharge type plasma etching apparatuses such as ICP may be used.

本発明の一実施形態によるガラス基板のエッチング方法を説明するための要部の工程断面図である。It is process sectional drawing of the principal part for demonstrating the etching method of the glass substrate by one Embodiment of this invention. エッチングガスとしてC38ガスを用いたときの基板バイアス出力とエッチングレートの関係を示す一実験結果である。It is an experimental result showing the relation between the substrate bias output and the etching rate when using C 3 F 8 gas as the etching gas. 本発明の実施形態において使用されるエッチング装置の概略構成図である。It is a schematic block diagram of the etching apparatus used in embodiment of this invention. 本発明の実施形態において作製したガラス基板サンプルのSEM写真である。It is a SEM photograph of the glass substrate sample produced in the embodiment of the present invention. 代表的なエッチングガスの地球温暖化係数を示す図である。It is a figure which shows the global warming potential of typical etching gas. 従来のサンドブラスト法を用いたガラス基板の加工方法を説明する模式図である。It is a schematic diagram explaining the processing method of the glass substrate using the conventional sandblasting method. サンドブラスト法による貫通孔形成の問題点を説明する要部断面図である。It is principal part sectional drawing explaining the problem of the through-hole formation by a sandblasting method. 従来のガラス基板のエッチング方法を説明するための要部の工程断面図である。It is process sectional drawing of the principal part for demonstrating the etching method of the conventional glass substrate.

符号の説明Explanation of symbols

11 シリコン基板
12 ガラス基板
13 レジスト層
15 貫通孔
20 NLDエッチング装置
21 真空チャンバ
21a プラズマ発生部
21b 基板処理部
23 高周波コイル
24A,24B,24C 磁場コイル
25 磁気中性線
26 ステージ
28 天板
RF1,RF2,RF3 高周波電源
DESCRIPTION OF SYMBOLS 11 Silicon substrate 12 Glass substrate 13 Resist layer 15 Through-hole 20 NLD etching apparatus 21 Vacuum chamber 21a Plasma generation part 21b Substrate processing part 23 High frequency coil 24A, 24B, 24C Magnetic field coil 25 Magnetic neutral line 26 Stage 28 Top plate RF1, RF2 , RF3 high frequency power supply

Claims (8)

ガラス基板の表面に凹部または貫通孔を形成するためのエッチング方法であって、
ガラス基板の表面にシリコン基板を接合する工程と、
前記ガラス基板上で前記シリコン基板からなるシリコンマスクを形成する工程と、
前記シリコンマスクを介して前記ガラス基板をエッチングする工程と、
前記シリコンマスクを前記ガラス基板から除去する工程とを有する
ことを特徴とするガラス基板のエッチング方法。
An etching method for forming a recess or a through hole on the surface of a glass substrate,
Bonding the silicon substrate to the surface of the glass substrate;
Forming a silicon mask made of the silicon substrate on the glass substrate;
Etching the glass substrate through the silicon mask;
And a step of removing the silicon mask from the glass substrate.
前記ガラス基板のエッチングをドライエッチングで行う
ことを特徴とする請求項1に記載のガラス基板のエッチング方法。
The glass substrate etching method according to claim 1, wherein the glass substrate is etched by dry etching.
前記ドライエッチングのエッチングガスとして、CF系ガスまたはCHF系ガスを用いる
ことを特徴とする請求項2に記載のガラス基板のエッチング方法。
The glass substrate etching method according to claim 2, wherein a CF-based gas or a CHF-based gas is used as an etching gas for the dry etching.
前記ガラス基板のエッチングを、磁気中性線放電エッチング装置を用いて行う
ことを特徴とする請求項2に記載のガラス基板のエッチング方法。
The method for etching a glass substrate according to claim 2, wherein the etching of the glass substrate is performed using a magnetic neutral wire discharge etching apparatus.
前記ガラス基板は、石英、希土類をドープしたガラス系材料、低膨張結晶化ガラス、珪酸ソーダガラス、硼珪酸ガラス、無アルカリガラス、白板ガラス、青板ガラスのいずれかである
ことを特徴とする請求項1に記載のガラス基板の製造方法。
The glass substrate is any of quartz, rare earth-doped glass-based material, low expansion crystallized glass, sodium silicate glass, borosilicate glass, alkali-free glass, white plate glass, and blue plate glass. The manufacturing method of the glass substrate of 1.
前記ガラス基板と前記シリコン基板との接合を陽極接合、常温接合または樹脂接合によって行う
ことを特徴とする請求項1に記載のガラス基板の製造方法。
The method for producing a glass substrate according to claim 1, wherein the glass substrate and the silicon substrate are bonded by anodic bonding, room temperature bonding, or resin bonding.
前記シリコンマスクを、前記シリコン基板の上に形成したレジストパターンをマスクとする前記シリコン基板のエッチング処理によって形成する
ことを特徴とする請求項1に記載のガラス基板のエッチング方法。
The method for etching a glass substrate according to claim 1, wherein the silicon mask is formed by etching the silicon substrate using a resist pattern formed on the silicon substrate as a mask.
前記シリコンマスクの形成をドライエッチングまたはウェットエッチングで行う
ことを特徴とする請求項7に記載のガラス基板の製造方法。

The method for manufacturing a glass substrate according to claim 7, wherein the silicon mask is formed by dry etching or wet etching.

JP2006271071A 2006-10-02 2006-10-02 Etching method of glass substrate Active JP5124121B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2006271071A JP5124121B2 (en) 2006-10-02 2006-10-02 Etching method of glass substrate

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2006271071A JP5124121B2 (en) 2006-10-02 2006-10-02 Etching method of glass substrate

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2011081498A Division JP5189666B2 (en) 2011-04-01 2011-04-01 Etching method of glass substrate

Publications (2)

Publication Number Publication Date
JP2008088017A true JP2008088017A (en) 2008-04-17
JP5124121B2 JP5124121B2 (en) 2013-01-23

Family

ID=39372542

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2006271071A Active JP5124121B2 (en) 2006-10-02 2006-10-02 Etching method of glass substrate

Country Status (1)

Country Link
JP (1) JP5124121B2 (en)

Cited By (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011096791A (en) * 2009-10-28 2011-05-12 Ulvac Japan Ltd Through-hole forming method
JP2011197386A (en) * 2010-03-19 2011-10-06 Seiko Epson Corp Optical filter and analytical instrument
DE102011084020A1 (en) 2011-05-09 2012-11-15 Mitsubishi Electric Corp. sensor element
JP2013531380A (en) * 2010-07-02 2013-08-01 ショット アクチエンゲゼルシャフト Interposer and method for generating holes in an interposer
KR101295889B1 (en) 2009-12-01 2013-08-12 도쿄엘렉트론가부시키가이샤 Method for manufacturing semiconductor device
JP2014225579A (en) * 2013-05-16 2014-12-04 株式会社アルバック Dry etching device and method
JP2015207551A (en) * 2014-04-08 2015-11-19 セイコーエプソン株式会社 Method for manufacturing organic el device, organic el device, and electronic equipment
JP2016066801A (en) * 2015-10-20 2016-04-28 株式会社日立ハイテクノロジーズ Plasma processing method

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002321941A (en) * 2001-04-20 2002-11-08 Sony Corp Method for producing optical element
JP2003043209A (en) * 2001-07-26 2003-02-13 Sony Corp Method and device for manufacturing microlens and method and device for manufacturing liquid crystal display device
JP2005298283A (en) * 2004-04-13 2005-10-27 Ulvac Japan Ltd Dry etching method, microlens array and forming method thereof
JP2005351774A (en) * 2004-06-10 2005-12-22 Seiko Epson Corp Manufacturing method of microarray manufacturing head, the microarray manufacturing head and microarray manufacturing apparatus

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002321941A (en) * 2001-04-20 2002-11-08 Sony Corp Method for producing optical element
JP2003043209A (en) * 2001-07-26 2003-02-13 Sony Corp Method and device for manufacturing microlens and method and device for manufacturing liquid crystal display device
JP2005298283A (en) * 2004-04-13 2005-10-27 Ulvac Japan Ltd Dry etching method, microlens array and forming method thereof
JP2005351774A (en) * 2004-06-10 2005-12-22 Seiko Epson Corp Manufacturing method of microarray manufacturing head, the microarray manufacturing head and microarray manufacturing apparatus

Cited By (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011096791A (en) * 2009-10-28 2011-05-12 Ulvac Japan Ltd Through-hole forming method
KR101295889B1 (en) 2009-12-01 2013-08-12 도쿄엘렉트론가부시키가이샤 Method for manufacturing semiconductor device
JP2011197386A (en) * 2010-03-19 2011-10-06 Seiko Epson Corp Optical filter and analytical instrument
US9703092B2 (en) 2010-03-19 2017-07-11 Seiko Epson Corporation Optical filter including a substrate having a groove with a pair of curved surfaces and analytical instrument
JP2013531380A (en) * 2010-07-02 2013-08-01 ショット アクチエンゲゼルシャフト Interposer and method for generating holes in an interposer
DE102011084020A1 (en) 2011-05-09 2012-11-15 Mitsubishi Electric Corp. sensor element
US8841734B2 (en) 2011-05-09 2014-09-23 Mitsubishi Electric Corporation Sensor element
JP2014225579A (en) * 2013-05-16 2014-12-04 株式会社アルバック Dry etching device and method
JP2015207551A (en) * 2014-04-08 2015-11-19 セイコーエプソン株式会社 Method for manufacturing organic el device, organic el device, and electronic equipment
JP2016066801A (en) * 2015-10-20 2016-04-28 株式会社日立ハイテクノロジーズ Plasma processing method

Also Published As

Publication number Publication date
JP5124121B2 (en) 2013-01-23

Similar Documents

Publication Publication Date Title
JP5124121B2 (en) Etching method of glass substrate
JP3859637B2 (en) Method for forming via hole in glass substrate
US20050103749A1 (en) Method and device for anisotropic etching of high aspect ratio
JPWO2009154173A1 (en) Multi-stage substrate manufacturing method
JP2002093749A (en) Method for dividing substrate wafer into a plurality of substrate chips
AU2008239010B2 (en) Dry etching method
JP2008030189A (en) Silicone-on-metal for mems device
JP5189666B2 (en) Etching method of glass substrate
JP5913830B2 (en) Etching method of silicon substrate
TW201604993A (en) Etching method of high aspect-ratio structure and manufacturing method of MEMS devices
JP2006211664A (en) Bandpath filter using film bulk acoustic resonator, and method of manufacturing same
US8232143B2 (en) Device formed using a hard mask and etch stop layer
CN109286886B (en) MEMS microphone and forming method thereof
JP2004152967A (en) Method for forming through hole by reactive ion etching and substrate having through hole formed by reactive ion etching
JPH10308447A (en) Manufacture of semiconductor device
JP2004314289A (en) Manufacturing method of micro machine
JP2005039078A (en) Wafer substrate for sheet substrate structure formation, method for manufacturing the same, and method for manufacturing mems element
JP3309620B2 (en) Manufacturing method of parts by dry etching
US6743731B1 (en) Method for making a radio frequency component and component produced thereby
JP6225005B2 (en) Laminated film and manufacturing method thereof
JP2006129096A (en) Mesa type piezoelectric vibrator and its manufacturing method
JP2011096791A (en) Through-hole forming method
JP2000315678A (en) Manufacture of device
RU2079865C1 (en) Method for making relief patterns in dielectric substrates
TW200848361A (en) Micro electro mechanical system and method of making the same

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20090615

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20100421

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20100427

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20100624

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20100803

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20101001

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20110104

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20110401

A911 Transfer to examiner for re-examination before appeal (zenchi)

Free format text: JAPANESE INTERMEDIATE CODE: A911

Effective date: 20110412

A912 Re-examination (zenchi) completed and case transferred to appeal board

Free format text: JAPANESE INTERMEDIATE CODE: A912

Effective date: 20110513

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20121029

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20151102

Year of fee payment: 3

R150 Certificate of patent or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

Ref document number: 5124121

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250