JP2006164737A - 表示素子、若しくはそれを備えた表示パネル及び表示装置 - Google Patents
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Abstract
【解決手段】有機EL素子1は、第1基板10と、第1基板10と離間して対向する封止基板28と、第1基板10と封止基板28とを封止し、第1基板10と封止基板28との間に封止空間を形成するシール29と、第1基板10上に設けられたソースライン12及びゲートライン13と、ゲートライン13とソースライン12とに電気的に接続された画素電極21と、を少なくとも有する。ソースライン12及びゲートライン13は封止空間内に設けられており、ソースライン12と接続され、封止空間内から引き出されたソース引き出し電極30を有し、ソース引き出し電極30はゲートライン13と同一膜から形成されている。
【選択図】図7
Description
10、110 第1基板
11 シリコン層
12、112 ソースライン
12a 第3導電層
12b 第1導電層
12c 第2導電層
13 ゲートライン
14 電源ライン
15、16 TFT
17a、117a 第1絶縁層
17b 第2絶縁層
18 ドレイン電極
19 第3絶縁層
20、120 樹脂層
21、121 画素電極
22 第4絶縁層
23 バンク
24 有機機能層
25 ホール輸送層
26 有機EL発光層
27 上部共通電極
28、128 封止基板
29、129 シール
30、130 ソース引き出し電極
31 ゲート引き出し電極
32 電源引き出し電極
33、133 ソース端子部
34 ゲート端子部
35 電源端子部
Claims (8)
- 第1基板と、
前記第1基板と離間して対向する第2基板と、
前記第1基板と前記第2基板とを封止し、前記第1基板と前記第2基板との間に封止空間を形成するシールと、
前記第1基板上にそれぞれ設けられたソースライン、ゲートライン、電源ライン、及び画素電極と、
を少なくとも有し、
前記ソースライン、前記ゲートライン、及び前記電源ラインが前記封止空間内に設けられた表示素子であって、
前記ソースラインと接続され、前記封止空間内から引き出されたソース引き出し電極と、
前記電源ラインと接続され、前記封止空間内から引き出された電源引き出し電極とを有し、
前記ソース引き出し電極及び/又は前記電源引き出し電極は前記ゲートライン又は前記画素電極と同一膜から形成されている表示素子。 - 請求項1に記載された表示素子において、
前記ゲートラインと前記画素電極との間に設けられた樹脂層をさらに有し、
前記樹脂層が前記シールと前記第1基板との間に形成されていない表示素子。 - 請求項1に記載された表示素子において、
前記ソース引き出し電極及び/又は前記電源引き出し電極の層厚が300nm以下である表示素子。 - 請求項1に記載された表示素子において、
前記ソース引き出し電極及び/又は電源引き出し電極は前記画素電極と同一膜から形成されており、
前記画素電極は前記有機発光層から出射された光を前記第2基板側に反射する表示素子。 - 請求項1に記載された表示素子において、
前記ソースラインは、第1導電層と、前記第1導電層の上に設けられた第2導電層とを有し、
前記第1導電層の幅は、前記第2導電層の幅よりも狭い表示素子。 - 請求項5に記載された表示素子において、
前記導第2導電層はアルミニウム又は銅を含む表示素子。 - 請求項1に記載された表示素子を備えた表示パネル。
- 請求項1に記載された表示素子を備えた表示装置。
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