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JP2005283689A - 液晶表示装置とその製造方法 - Google Patents

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JP2005283689A JP2004093944A JP2004093944A JP2005283689A JP 2005283689 A JP2005283689 A JP 2005283689A JP 2004093944 A JP2004093944 A JP 2004093944A JP 2004093944 A JP2004093944 A JP 2004093944A JP 2005283689 A JP2005283689 A JP 2005283689A
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Abstract

【課題】 ハーフトーン露光技術を用いて1回の写真食刻工程でチャネルエッチ型の絶縁ゲート型トランジスタの半導体層とソース・ドレイン配線を形成して製造工程数を削減した従来の製造方法では製造裕度(マージン)が小さくソース・ドレイン配線間の距離が短くなると歩留が低下する。
【解決手段】 透明導電層と金属層との積層よりなる走査線と擬似絵素電極を同時に形成し、ゲート絶縁層への開口部形成時に擬似絵素電極上の金属層を除去して透明導電性の絵素電極を形成する合理化に加えて感光性有機絶縁層を用いてエッチストップ型の絶縁ゲート型トランジスタのソース・ドレイン配線を形成し、感光性有機絶縁層をそのまま残すことでハーフトーン露光技術が不要な4枚マスク・プロセス案を構築する。
【選択図】 図2

Description

本発明はカラー画像表示機能を有する液晶表示装置、とりわけアクティブ型の液晶表示装置に関するものである。
近年の微細加工技術、液晶材料技術および高密度実装技術等の進歩により、5〜50cm対角の液晶表示装置でテレビジョン画像や各種の画像表示機器が商用ベースで大量に提供されている。また、液晶パネルを構成する2枚のガラス基板の一方にRGBの着色層を形成しておくことによりカラー表示も容易に実現している。特にスイッチング素子を絵素毎に内蔵させた、いわゆるアクティブ型の液晶パネルではクロストークも少なく、応答速度も早く高いコントラスト比を有する画像が保証されている。
これらの液晶表示装置(液晶パネル)は走査線としては200〜1200本、信号線としては300〜1600本程度のマトリクス編成が一般的であるが、最近は表示容量の増大に対応すべく大画面化と高精細化とが同時に進行している。
図9は液晶パネルへの実装状態を示し、液晶パネル1を構成する一方の透明性絶縁基板、例えばガラス基板2上に形成された走査線の電極端子群5に駆動信号を供給する半導体集積回路チップ3を導電性の接着剤を用いて接続するCOG(Chip−On−Glass)方式や、例えばポリイミド系樹脂薄膜をベースとし、金または半田メッキされた銅箔の端子を有するTCPフィルム4を信号線の電極端子群6に導電性媒体を含む適当な接着剤で圧接して固定するTCP(Tape−Carrier−Package)方式などの実装手段によって電気信号が画像表示部に供給される。ここでは便宜上二つの実装方式を同時に図示しているが実際には何れかの方式が適宜選択される。
液晶パネル1のほぼ中央部に位置する画像表示部内の画素と走査線及び信号線の電極端子5,6との間を接続する配線路が7、8で、必ずしも電極端子5,6と同一の導電材で構成される必要はない。9は全ての液晶セルに共通する透明導電性の対向電極を対向面上に有するもう1枚の透明性絶縁基板である対向ガラス基板またはカラーフィルタである。
図10はスイッチング素子として絶縁ゲート型トランジスタ10を絵素毎に配置したアクティブ型液晶表示装置の等価回路図を示し、11(図9では7)は走査線、12(図9では8)は信号線、13は液晶セルであって、液晶セル13は電気的には容量素子として扱われる。実線で描かれた素子類は液晶パネルを構成する一方のガラス基板2上に形成され、点線で描かれた全ての液晶セル13に共通な対向電極14はもう一方のガラス基板9の対向する主面上に形成されている。絶縁ゲート型トランジスタ10のOFF抵抗あるいは液晶セル13の抵抗が低い場合や表示画像の階調性を重視する場合には負荷としての液晶セル13の時定数を大きくするための補助の蓄積容量15を液晶セル13に並列に加える等の回路的工夫が加味される。なお16は蓄積容量15の共通母線となる蓄積容量線である。
図11は液晶表示装置の画像表示部の要部断面図を示し、液晶パネル1を構成する2枚のガラス基板2,9は樹脂性のファイバ、ビーズあるいはカラーフィルタ9上に形成された柱状スペーサ等のスペーサ材(図示せず)によって数μm程度の所定の距離を隔てて形成され、その間隙(ギャップ)はガラス基板9の周縁部において有機性樹脂よりなるシール材と封口材(何れも図示せず)とで封止された閉空間になっており、この閉空間に液晶17が充填されている。
カラー表示を実現する場合には、ガラス基板9の閉空間側に着色層18と称する染料または顔料のいずれか一方もしくは両方を含む厚さ1〜2μm程度の有機薄膜が被着されて色表示機能が与えられるので、その場合にはガラス基板9は別名カラーフィルタ(Color Filter 略語はCF)と呼称される。そして液晶材料17の性質によってはガラス基板9の上面またはガラス基板2の下面の何れかもしくは両面上に偏光板19が貼付され、液晶パネル1は電気光学素子として機能する。現在、市販されている大部分の液晶パネルでは液晶材料にTN(ツイスト・ネマチック)系の物を用いており、偏光板19は通常2枚必要である。図示はしないが、透過型液晶パネルでは光源として裏面光源が配置され、下方より白色光が照射される。
液晶17に接して2枚のガラス基板2,9上に形成された例えば厚さ0.1μm程度のポリイミド系樹脂薄膜20は液晶分子を決められた方向に配向させるための配向膜である。21は絶縁ゲート型トランジスタ10のドレインと透明導電性の絵素電極22とを接続するドレイン電極(配線)であり、信号線(ソース線)12と同時に形成されることが多い。信号線12とドレイン電極21との間に位置するのは半導体層23であり詳細は後述する。カラーフィルタ9上で隣り合った着色層18の境界に形成された厚さ0.1μm程度のCr薄膜層24は半導体層23と走査線11及び信号線12に外部光が入射するのを防止するための光遮蔽部材で、いわゆるブラックマトリクス(Black Matrix 略語はBM)として定着化した技術である。
ここでスイッチング素子として絶縁ゲート型トランジスタの構造と製造方法に関して説明する。現在絶縁ゲート型トランジスタには2種類のものが多用されており、そのうちの一つのエッチストップ型と呼称されるものを従来例として紹介する。図12は従来の液晶パネルを構成するアクティブ基板(表示装置用半導体装置)の単位絵素の平面図であり、図12(e)のA−A’、B−B’およびC−C’線上の断面図を図13に示し、その製造工程を以下に簡単に説明する。
先ず耐熱性と耐薬品性と透明性が高い絶縁性基板として厚さ0.5〜1.1mm程度のガラス基板2、例えばコーニング社製の商品名1737の一主面上にSPT(スパッタ)等の真空製膜装置を用いて膜厚0.1〜0.3μm程度の第1の金属層を被着し、図12(a)と図13(a)に示したように微細加工技術により感光性樹脂パターンを用いてゲート電極11Aも兼ねる走査線11と蓄積容量線16を選択的に形成する。走査線の材質は耐熱性と耐薬品性と耐弗酸性と導電性を総合的に勘案して選択するが一般的にはCr,Ta,MoW合金等の耐熱性の高い金属または合金が使用される。
液晶パネルの大画面化や高精細化に対応して走査線の抵抗値を下げるためには走査線の材料としてAL(アルミニウム)を用いるのが合理的であるが、ALは単体では耐熱性が低いので上記した耐熱金属であるCr,Ta,Moまたはそれらのシリサイドと積層化する、あるいはALの表面に陽極酸化で酸化層(Al2O3)を付加することも現在では一般的な技術である。すなわち走査線11は1層以上の金属層で構成される。
次にガラス基板2の全面にPCVD(プラズマ・シーブイディ)装置を用いてゲート絶縁層となる第1のSiNx(シリコン窒化)層30、不純物をほとんど含まず絶縁ゲート型トランジスタのチャネルとなる第1の非晶質シリコン(a−Si)層31、及びチャネルを保護する絶縁層となる第2のSiNx層32と3種類の薄膜層を例えば、0.3−0.05−0.1μm程度の膜厚で順次被着し、図12(b)と図13(b)に示したように微細加工技術により感光性樹脂パターンを用いてゲート電極11A上の第2のSiNx層をゲート電極11Aよりも幅細く選択的に残して保護絶縁層32Dとし、第1の非晶質シリコン層31を露出する。
続いて同じくPCVD装置を用いて全面に不純物として例えば燐を含む第2の非晶質シリコン層33を例えば0.05μm程度の膜厚で被着した後、SPT等の真空製膜装置を用いて膜厚0.1μm程度の耐熱金属層として例えばTi,Cr,Mo等の薄膜層34と、低抵抗配線層として膜厚0.3μm程度のAL薄膜層35と、さらに膜厚0.1μm程度の中間導電層として例えばTi薄膜層36を順次被着し、図12(c)と図13(c)に示したように微細加工技術により感光性樹脂パターンを用いてソース・ドレイン配線材であるこれら3種の薄膜層34A,35A及び36Aの積層よりなる絶縁ゲート型トランジスタのドレイン電極21とソース電極も兼ねる信号線12を選択的に形成する。この選択的パターン形成はソース・ドレイン配線の形成に用いられる感光性樹脂パターンをマスクとしてTi薄膜層36、AL薄膜層35、Ti薄膜層34を順次食刻した後、ソース・ドレイン電極12,21間の第2の非晶質シリコン層33を除去して保護絶縁層32Dを露出するとともにその他の領域では第1の非晶質シリコン層31をも除去してゲート絶縁層30を露出することによってなされる。このようにチャネルの保護層である第2のSiNx層32D(保護絶縁層、エッチストップ層またはチャネル保護層)が存在して第2の非晶質シリコン層33の食刻が自動的に終了することからこの製法はエッチストップと呼称される。
絶縁ゲート型トランジスタがオフセット構造とならぬようソース・ドレイン電極12,21は保護絶縁層32Dと一部(数μm)平面的に重なって形成される。この重なりは寄生容量として電気的に作用するので小さいほど良いが、露光機の合わせ精度とフォトマスクの精度とガラス基板の膨張係数及び露光時のガラス基板温度で決定され、実用的な数値は精々2μm程度である。
さらに上記感光性樹脂パターンを除去した後、ガラス基板2の全面に透明性の絶縁層としてゲート絶縁層と同様にPCVD装置を用いて0.3μm程度の膜厚のSiNx層を被着してパシベーション絶縁層37とし、図12(d)と図13(d)に示したように微細加工技術により感光性樹脂パターンを用いてパシベーション絶縁層37を選択的に除去してドレイン電極21上に開口部62と、画像表示部外の領域で走査線11の電極端子が形成される領域上に開口部63と、信号線12の電極端子が形成される領域上に開口部64を形成してドレイン電極21と走査線11の一部5と信号線12の一部6を露出する。同様に蓄積容量線16(を平行に束ねた電極パターン)上には開口部65を形成して蓄積容量線16の一部を露出する。
最後にSPT等の真空製膜装置を用いて膜厚0.1〜0.2μm程度の透明導電層として例えばITO(Indium−Tin−Oxide)あるいはIZO(Indium−Zinc−Oxide)を被着し、図12(e)と図13(e)に示したように微細加工技術により感光性樹脂パターンを用いて開口部62を含んでパシベーション絶縁層37上に絵素電極22を選択的に形成してアクティブ基板2として完成する。開口部63内の露出している走査線11の一部を電極端子5とし、開口部64内の露出している信号線12の一部を電極端子6としても良く、図示したように開口部63,64を含んでパシベーション絶縁層37上にITOよりなる電極端子5A,6Aを選択的に形成しても良いが、通常は電極端子5A,6A間を接続する透明導電性の短絡線40も同時に形成される。その理由は、図示はしないが電極端子5A,6Aと短絡線40との間を細長いストライプ状に形成することにより高抵抗化して静電気対策用の高抵抗とすることが出来るからである。同様に番号は付与しないが開口部65を含んで蓄積容量線16への電極端子が形成される。
信号線12の配線抵抗が問題とならない場合にはALよりなる低抵抗配線層35は必ずしも必要ではなく、その場合にはCr,Ta,MoW等の耐熱金属材料を選択すればソース・ドレイン配線12,21を単層化して簡素化することが可能である。このようにソース・ドレイン配線は耐熱金属層を用いて第2の非晶質シリコン層と電気的な接続を確保することが重要であり、絶縁ゲート型トランジスタの耐熱性については先行例である特開平7−74368号公報に詳細が記載されている。なお、図12(c)において蓄積容量線16とドレイン電極21とがゲート絶縁層30を介して平面的に重なっている領域50(右下がり斜線部)が蓄積容量15を形成しているがここではその詳細な説明は省略する。
特開平7−74368号公報
以上述べた5枚マスク・プロセスは詳細な経緯は省略するが、半導体層の島化工程の合理化とコンタクト形成工程が削減された結果得られたもので、当初は7〜8枚程度必要であったフォトマスクもドライエッチ技術の導入により、現時点では5枚に減少してプロセスコストの削減に大きく寄与している。液晶表示装置の生産コストを下げるためにはアクティブ基板の作製工程ではプロセスコストを、またパネル組立工程とモジュール実装工程では部材コストを下げることが有効であることは周知の開発目標である。プロセスコストを下げるためにはプロセスを短くする工程削減と、安価なプロセス開発またはプロセスへの置き換えとがあるが、ここでは4枚のフォトマスクでアクティブ基板が得られる4枚マスク・プロセスを工程削減の一例として説明する。4枚マスク・プロセスはハーフトーン露光技術の導入により写真食刻工程を削減するもので、図14は4枚マスク・プロセスに対応したアクティブ基板の単位絵素の平面図で、図14(e)のA−A’、B−B’およびC−C’線上の断面図を図15に示す。既に述べたように絶縁ゲート型トランジスタには2種類のものが多用されているが、ここではチャネルエッチ型の絶縁ゲート型トランジスタを採用している。
先ず5枚マスク・プロセスと同様にガラス基板2の一主面上にSPT等の真空製膜装置を用いて膜厚0.1〜0.3μm程度の第1の金属層を被着し、図14(a)と図15(a)に示したように微細加工技術により感光性樹脂パターンを用いてゲート電極11Aも兼ねる走査線11と蓄積容量線16を選択的に形成する。
次にガラス基板2の全面にPCVD装置を用いてゲート絶縁層となるSiNx層30、不純物をほとんど含まず絶縁ゲート型トランジスタのチャネルとなる第1の非晶質シリコン層31、及び不純物を含み絶縁ゲート型トランジスタのソース・ドレインとなる第2の非晶質シリコン層33と3種類の薄膜層を、例えば0.3−0.2−0.05μm程度の膜厚で順次被着する。引き続き、SPT等の真空製膜装置を用いて膜厚0.1μm程度の耐熱金属層として例えばTi薄膜層34と、膜厚0.3μm程度の低抵抗配線層としてAL薄膜層35と、さらに膜厚0.1μm程度の中間導電層として例えばTi薄膜層36を、すなわちソース・ドレイン配線材を順次被着し、絶縁ゲート型トランジスタのドレイン電極21とソース電極も兼ねる信号線12を選択的に形成するのであるが、この選択的パターン形成に当たりハーフトーン露光技術により、図14(b)と図15(b)に示したようにソース・ドレイン間のチャネル形成領域80B(斜線部)の膜厚が例えば1.5μmで、ソース・ドレイン配線形成領域80A(12),80A(21)の膜厚3μmよりも薄い感光性樹脂パターン80A,80Bを形成する点が合理化された4枚マスク・プロセスの大きな特徴である。
このような感光性樹脂パターン80A,80Bは、液晶表示装置用基板の作製には通常ポジ型の感光性樹脂を用いるので、ソース・ドレイン配線形成領域80Aが黒、すなわちCr薄膜が形成されており、チャネル領域80Bは灰色、たとえば幅0.5〜1μm程度のラインアンドスペースのCrパターンが形成されており、その他の領域は白、すなわちCr薄膜が除去されているようなフォトマスクを用いれば良い。灰色領域は露光機の解像力が不足しているためにラインアンドスペースが解像されることはなく、ランプ光源からのフオトマスク照射光を半分程度透過させることが可能であるので、ポジ型感光性樹脂の残膜特性に応じて図15(b)に示したような凹型の断面形状を有する感光性樹脂パターン80A,80Bを得ることができる。
上記感光性樹脂パターン80A,80Bをマスクとして図15(b)に示したようにTi薄膜層36、AL薄膜層35、Ti薄膜層34、第2の非晶質シリコン層33及び第1の非晶質シリコン層31を順次食刻してゲート絶縁層30を露出した後、図14(c)と図15(c)に示したように酸素プラズマ等の灰化手段により感光性樹脂パターン80A,80Bを1.5μm以上膜減りさせると感光性樹脂パターン80Bが消失してチャネル領域が露出するとともに、ソース・ドレイン配線形成領域上にのみ80C(12),80C(21)をそのまま残すことができる。そこで膜減りした感光性樹脂パターン80C(12),80C(21)をマスクとして、再びソース・ドレイン配線間(チャネル形成領域)のTi薄膜層,AL薄膜層,Ti薄膜層,第2の非晶質シリコン層33A及び第1の非晶質シリコン層31Aを順次食刻し、第1の非晶質シリコン層31Aは0.05〜0.1μm程度残して食刻する。ソース・ドレイン配線が金属層をエッチングした後に第1の非晶質シリコン層31Aを0.05〜0.1μm程度残して食刻することによりなされるので、このような製法で得られる絶縁ゲート型トランジスタはチャネルエッチと呼称されている。なお上記酸素プラズマ処理においてレジストパターン80Aは80Cに変換されるのでパターン寸法の変化を抑制するため異方性を強めることが望ましく、具体的にはRIE(Reactive Ion Etching)方式、さらに高密度のプラズマ源を有するICP(Inductive Coupled Plasama)方式やTCP(Transfer Coupled Plasama)方式の酸素プラズマ処理がより望ましい。
さらに上記感光性樹脂パターン80C(12),80C(21)を除去した後は、5枚マスク・プロセスと同じくガラス基板2の全面に透明性の絶縁層として0.3μm程度の膜厚の第2のSiNx層を被着してパシベーション絶縁層37とし、図14(d)と図15(d)に示したように微細加工技術により感光性樹脂パターンを用いてドレイン電極21上と、走査線11と信号線12の電極端子が形成される領域にそれぞれ開口部62,63,64を形成し、開口部63内のパシベーション絶縁層37とゲート絶縁層30を除去して開口部63内に走査線の一部5を露出するとともに、開口部62,64内のパシベーション絶縁層37を除去してドレイン電極21の一部と信号線の一部6を露出する。同様に蓄積容量線16上には開口部65を形成して蓄積容量線16の一部を露出する。
最後にSPT等の真空製膜装置を用いて膜厚0.1〜0.2μm程度の透明導電層として例えばITOあるいはIZOを被着し、図14(e)と図15(e)に示したように微細加工技術により感光性樹脂パターンを用いてパシベーション絶縁層37上に開口部62を含んで透明導電性の絵素電極22を選択的に形成してアクティブ基板2として完成する。電極端子に関してはここでは開口部63,64を含んでパシベーション絶縁層37上にITOよりなる透明導電性の電極端子5A,6Aを選択的に形成している。
このように5枚マスク・プロセスと4枚マスク・プロセスにおいてはドレイン電極21と走査線11へのコンタクト形成工程が同時になされるため、それらに対応した開口部62,63内の絶縁層の厚さと種類が異なっている。パシベーション絶縁層37はゲート絶縁層30に比べると製膜温度が低く膜質が劣悪で、弗酸系のエッチング液による食刻では食刻速度が夫々数1000Å/分、数100Å/分と1桁も異なり、ドレイン電極21上の開口部62の断面形状は上部に余りにも過食刻が生じて穴径が制御できない理由から弗素系のガスを用いた乾式食刻(ドライエッチ)を採用している。
ドライエッチを採用してもドレイン電極21上の開口部62はパシベーション絶縁層37のみであるので、走査線11上の開口部63と比較して過食刻になるのは避けられず、材質によっては中間導電層36Aが食刻ガスによって膜減りすることがある。また、食刻終了後の感光性樹脂パターンの除去に当たり、まずは弗素化された表面のポリマー除去のために酸素プラズマ灰化で感光性樹脂パターンの表面を0.1〜0.3μm程度削り、その後に有機剥離液、例えば東京応化製の剥離液106等を用いた薬液処理がなされるのが一般的であるが、中間導電層36Aが膜減りして下地のアルミニウム層35Aが露出した状態になっていると、酸素プラズマ灰化処理でアルミニウム層35Aの表面に絶縁体であるAL2O3が形成されて、絵素電極22との間でオーミック接触が得られなくなる。そこで中間導電層36Aが膜減りしてもいいように、その膜厚を例えば0.2μmと厚く設定することでこの問題から逃れようとしている。あるいは開口部62〜65の形成時、アルミニウム層35Aを除去して下地の耐熱金属層である薄膜層34Aを露出してから絵素電極22を形成する回避策も可能であり、この場合には当初から中間導電層36Aは不要となるメリットもある。
しかしながら前者の対策ではこれら薄膜の膜厚の面内均一性が良好でないとこの取組みも必ずしも有効に作用するわけではなく、また食刻速度の面内均一性が良好でない場合にも全く同様である。後者の対策では中間導電層36Aは不要となるが、アルミニウム層35Aの除去工程が増加し、また開口部62の断面制御が不十分であると絵素電極22が段切れを起こす恐れがあった。
加えてチャネルエッチ型の絶縁ゲート型トランジスタではチャネル領域の不純物を含まない第1の非晶質シリコン層31はどうしても厚めに(チャネルエッチ型では通常0.2μm以上)被着しておかないと、ガラス基板の面内均一性に大きく影響されてトランジスタ特性、とりわけOFF電流が不揃いになりがちである。このことはPCVDの稼働率とパーティクル発生状況に大きく影響し生産コストの観点からも非常に重要な事項である。
また4枚マスク・プロセスにおいて適用されているチャネル形成工程はソース・ドレイン配線12,21間のソース・ドレイン配線材と半導体層を選択的に除去するので、絶縁ゲート型トランジスタのON特性を大きく左右するチャネル長(現在の量産品で4〜6μm)を決定する工程である。このチャネル長の変動は絶縁ゲート型トランジスタのON電流値を大きく変化させるので、通常は厳しい製造管理を要求されるが、チャネル長、すなわちハーフトーン露光領域のパターン寸法は露光量(光源強度とフォマスクのパターン精度、特にライン&スペース寸法)、感光性樹脂の塗布厚、感光性樹脂の現象処理、および当該のエッチング工程における感光性樹脂の膜減り量等多くのパラメータに左右され、加えてこれら諸量の面内均一性もあいまって必ずしも歩留高く安定して生産できるわけではなく、従来の製造管理よりも一段と厳しい製造管理が必要となり、決して高度に完成したレベルにあるとは言えないのが現状である。特にチャネル長が6μm以下ではその傾向が顕著となる。なぜならば感光性樹脂パターン80A,80Bの膜厚を1.5μm膜減りさせるに際して感光性樹脂パターン80A,80Bが等方的に膜減りすると、当然感光性樹脂パターン80A,80B間の寸法は3μmも大きくなるのでチャネル長も設定値よりも3μm長く形成されてしまうからである。
本発明はかかる現状に鑑みなされたもので、従来の5枚マスク・プロセスや4枚マスク・プロセスに共通するコンタクト形成時の不具合を回避するだけでなく、プロセスマージンの狭いハーフトーン露光技術を必要としない4枚マスク・プロセスを提供するものである。
本発明においてはまず先行技術である特開平7−175088号公報に開示されている絵素電極の形成工程を合理化したものを本発明に適合させて絵素電極形成工程を削減して写真食刻工程を削減している。次にチャネル上に保護絶縁層を有する絶縁ゲート型トランジスタを採用し、ソース・ドレイン配線のみを有効にパシベーションするために先行技術である特開平2−275925号公報に開示されている感光性有機絶縁層を用いてソース・ドレイン配線を形成し、感光性有機絶縁層をそのまま残すことでソース・ドレイン配線の表面に絶縁層を形成してパシベーション絶縁層の形成を不要なものとしている。
請求項1に記載の液晶表示装置は、一主面上に少なくとも絶縁ゲート型トランジスタと、前記絶縁ゲート型トランジスタのゲート電極も兼ねる走査線とソース配線も兼ねる信号線と、ドレイン配線に接続された絵素電極を有する単位絵素が二次元のマトリクスに配列された第1の透明性絶縁基板と、前記第1の透明性絶縁基板と対向する第2の透明性絶縁基板またはカラーフィルタとの間に液晶を充填してなる液晶表示装置において、少なくとも、
第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と、透明導電性の絵素電極と、同じく透明導電性の信号線の電極端子が形成され、
プラズマ保護層とゲート絶縁層と不純物を含まない第1の半導体層を介してゲート電極上にゲート電極よりも幅細く保護絶縁層が形成され、
絵素電極上と画像表示部外の領域で走査線の一部上と信号線の電極端子上のプラズマ保護層とゲート絶縁層と第1の半導体層に夫々開口部が形成され、各開口部内に透明導電性の絵素電極と走査線の電極端子と信号線の電極端子が露出し、
前記保護絶縁層の一部と重なり前記第1の半導体層上に不純物を含む第2の半導体層と耐熱金属層を含む1層以上の第2の金属層との積層よりなるソース(信号線)配線と、前記保護絶縁層の一部と重なり前記第1の半導体層上に同じくドレイン配線が形成され、
第2の金属層よりなる前記信号線の一部は信号線の電極端子の一部上と、同じく前記ドレイン配線の一部は前記開口部内の絵素電極の一部上に形成され、
前記ソース・ドレイン配線領域を除いて第1の半導体層が除去されて第1の透明性絶縁基板上にゲート絶縁層が露出し、
前記ソース・ドレイン配線上に感光性有機絶縁層が形成されていることを特徴とする。
この構成により透明導電性の絵素電極は走査線と同時に形成されるのでガラス基板上に形成される。そしてソース・ドレイン間のチャネル上には保護絶縁層が形成されてチャネルを保護するとともにソース配線(信号線)とドレイン配線の表面には感光性有機絶縁層が形成されてエッチストップ型の絶縁ゲート型トランジスタにパシベーション機能が付与されている。このためパシベーション絶縁層をガラス基板の全面に被着する必要はなくなり、絶縁ゲート型トランジスタの耐熱性が問題となることはなくなる。電極端子は透明導電層に限定されたTN型の液晶表示装置が得られる。
請求項2に記載の液晶表示装置は、同じく、
第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と、透明導電性の絵素電極(と同じく透明導電性の信号線の電極端子)が形成され、
プラズマ保護層とゲート絶縁層と不純物を含まない第1の半導体層を介してゲート電極上にゲート電極よりも幅細く保護絶縁層が形成され、
前記絵素電極上と画像表示部外の領域で走査線の一部上(または透明導電性の走査線の電極端子上と信号線の電極端子上)のプラズマ保護層とゲート絶縁層と第1の半導体層に夫々開口部が形成され、各開口部内に透明導電性の絵素電極と透明導電性の走査線の一部(または透明導電性の走査線の電極端子と信号線の電極端子)が露出し、
前記保護絶縁層の一部と重なり前記第1の半導体層上に不純物を含む第2の半導体層と耐熱金属層を含む1層以上の第2の金属層との積層よりなるソース(信号線)配線と、同じく前記保護絶縁層の一部と重なり前記第1の半導体層上にドレイン配線が形成され、
第2の金属層よりなる前記ドレイン配線の一部は前記開口部内の絵素電極の一部上に形成され、
前記走査線の一部を含んで第2の金属層よりなる走査線の電極端子と、前記信号線の一部で第2の金属層よりなる信号線の電極端子が形成され(または第2の金属層よりなる前記信号線の一部は透明導電性の信号線の電極端子の一部上に形成され)、
前記ソース・ドレイン配線領域を除いて第1の半導体層が除去されて第1の透明性絶縁基板上にゲート絶縁層が露出し、
前記信号線の電極端子上を除いて信号線上に感光性有機絶縁層が形成されていることを特徴とする。
この構成により透明導電性の絵素電極は走査線と同時に形成されるのでガラス基板上に形成される。そしてソース・ドレイン間のチャネル上には保護絶縁層が形成されてチャネルを保護するとともにソース配線(信号線)の表面には感光性有機絶縁層が形成されてエッチストップ型の絶縁ゲート型トランジスタに最低限のパシベーション機能が付与されている。このためパシベーション絶縁層をガラス基板の全面に被着する必要はなくなり、絶縁ゲート型トランジスタの耐熱性が問題となることはなくなる。電極端子には透明導電層または金属層の何れでも選択可能なTN型の液晶表示装置が得られる。
請求項3に記載の液晶表示装置は、同じく、
第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と、透明導電性の絵素電極と、同じく透明導電性の信号線の電極端子が形成され、
プラズマ保護層とゲート絶縁層と不純物を含まない第1の半導体層を介してゲート電極上にゲート電極よりも幅細く保護絶縁層が形成され、
絵素電極上と画像表示部外の領域で走査線の一部上と信号線の電極端子上のプラズマ保護層とゲート絶縁層と第1の半導体層に夫々開口部が形成され、各開口部内に透明導電性の絵素電極と走査線の電極端子と信号線の電極端子が露出し、
前記保護絶縁層の一部と重なり信号線の電極端子の一部上と前記第1の半導体層上に不純物を含む第2の半導体層と耐熱金属層を含む1層以上の第2の金属層との積層よりなるソース(信号線)配線と、前記保護絶縁層の一部と重なり前記開口部内の絵素電極の一部上と前記第1の半導体層上に同じくドレイン配線が形成され、
前記ソース・ドレイン配線領域を除いて第1の半導体層が除去されて第1の透明性絶縁基板上にゲート絶縁層が露出し、
前記ソース・ドレイン配線上に感光性有機絶縁層が形成されていることを特徴とする。
この構成により請求項1に記載の液晶表示装置と酷似した液晶表示装置が得られる。請求項1に記載の液晶表示装置との差異はドレイン配線と絵素電極間及び信号線と信号線の電極端子間に第2の非晶質シリコン層が介在することである。
請求項4に記載の液晶表示装置は、同じく、
第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と、透明導電性の絵素電極(と同じく透明導電性の信号線の電極端子)が形成され、
プラズマ保護層とゲート絶縁層と不純物を含まない第1の半導体層を介してゲート電極上にゲート電極よりも幅細く保護絶縁層が形成され、
前記絵素電極上と画像表示部外の領域で走査線の一部上(または走査線の電極端子上と信号線の電極端子上)のプラズマ保護層とゲート絶縁層と第1の半導体層に夫々開口部が形成され、各開口部内に透明導電性の絵素電極と透明導電性の走査線の一部(または透明導電性の走査線の電極端子と信号線の電極端子)が露出し、
前記保護絶縁層の一部と重なり前記第1の半導体層上(と信号線の電極端子の一部上)に不純物を含む第2の半導体層と耐熱金属層を含む1層以上の第2の金属層との積層よりなるソース(信号線)配線と、前記保護絶縁層の一部と重なり前記第1の半導体層上と前記開口部内の絵素電極の一部上に同じくドレイン配線と、前記走査線の一部を含んで同じく走査線の電極端子(または透明導電性の走査線の電極端子)と、信号線の一部よりなる信号線の電極端子(または透明導電性の信号線の電極端子)が形成され、
前記ソース・ドレイン配線領域を除いて第1の半導体層が除去されて第1の透明性絶縁基板上にゲート絶縁層が露出し、
前記信号線の電極端子上を除いて信号線上に感光性有機絶縁層が形成されていることを特徴とする。
この構成により請求項2に記載の液晶表示装置と酷似した液晶表示装置が得られる。請求項2に記載の液晶表示装置との差異はドレイン配線と絵素電極間及び信号線と信号線の電極端子間に第2の非晶質シリコン層が介在することである。
請求項5は請求項1に記載の液晶表示装置の製造方法であって、少なくとも、第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と信号線の擬似電極端子と擬似絵素電極を形成する工程と、プラズマ保護層とゲート絶縁層と不純物を含まない第1の非晶質シリコン層と保護絶縁層を順次被着する工程と、ゲート電極上にゲート電極よりも幅細く保護絶縁層を残して第1の非晶質シリコン層を露出する工程と、不純物を含む第2の非晶質シリコン層を被着する工程と、走査線と信号線の擬似電極端子上と擬似絵素電極上に開口部を形成して前記開口部内の第2の非晶質シリコン層と第1の非晶質シリコン層とゲート絶縁層とプラズマ保護層と第1の金属層を除去して透明導電性の走査線と信号線の電極端子と同じく透明導電性の絵素電極を露出する工程と、耐熱金属層を含む1層以上の第2の金属層を被着後、第2の金属層と第2の非晶質シリコン層との積層よりなり前記保護絶縁層と一部重なるように信号線の電極端子の一部を含んでその表面に感光性有機絶縁層を有するソース配線(信号線)と同じく絵素電極の一部を含んでその表面に感光性有機絶縁層を有するドレイン配線を形成する工程を有することを特徴とする。
この構成により絵素電極と走査線を1枚のフォトマスクを用いて処理することができて写真食刻工程数の削減が実現する。またソース・ドレイン配線の形成時に用いた感光性有機絶縁層をそのまま残すことでパシベーション絶縁層の形成を不要とする製造工程の削減もなされる結果、ハーフトーン露光技術を併用することなく4枚のフォトマスクを用いてTN型の液晶表示装置を作製する事ができる。
請求項6は請求項2に記載の液晶表示装置の製造方法であって、少なくとも、第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と信号線の擬似電極端子と擬似絵素電極を形成する工程と、プラズマ保護層とゲート絶縁層と不純物を含まない第1の非晶質シリコン層と保護絶縁層を順次被着する工程と、ゲート電極上にゲート電極よりも幅細く保護絶縁層を残して第1の非晶質シリコン層を露出する工程と、不純物を含む第2の非晶質シリコン層を被着する工程と、走査線と信号線の擬似電極端子上と擬似絵素電極上に開口部を形成して前記開口部内の第2の非晶質シリコン層と第1の非晶質シリコン層とゲート絶縁層とプラズマ保護層と第1の金属層を除去して透明導電性の走査線と信号線の電極端子と同じく透明導電性の絵素電極を露出する工程と、耐熱金属層を含む1層以上の第2の金属層を被着後、ハーフトーン露光技術により信号線上にのみ感光性有機絶縁層を残してソース・ドレイン配線を形成する工程を有することを特徴とする。
この構成により絵素電極と走査線を1枚のフォトマスクを用いて処理することができて写真食刻工程数の削減が実現する。またソース・ドレイン配線の形成時にハーフトーン露光技術を用いて信号線上にのみ選択的に感光性有機絶縁層を残すことでパシベーション絶縁層の形成を不要とする製造工程の削減もなされる結果、4枚のフォトマスクを用いてTN型の液晶表示装置を作製する事ができる。
請求項7は請求項3に記載の液晶表示装置の製造方法であって、少なくとも、第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と信号線の擬似電極端子と擬似絵素電極を形成する工程と、プラズマ保護層とゲート絶縁層と不純物を含まない第1の非晶質シリコン層と保護絶縁層を順次被着する工程と、走査線と信号線の擬似電極端子上と擬似絵素電極上に開口部を形成して前記開口部内の保護絶縁層と第1の非晶質シリコン層とゲート絶縁層とプラズマ保護層と第1の金属層を除去して透明導電性の走査線と信号線の電極端子と同じく透明導電性の絵素電極を露出する工程と、ゲート電極上にゲート電極よりも幅細く保護絶縁層を残して第1の非晶質シリコン層を露出する工程と、不純物を含む第2の非晶質シリコン層を被着する工程と、耐熱金属層を含む1層以上の第2の金属層を被着後、第2の金属層と第2の非晶質シリコン層との積層よりなり前記保護絶縁層と一部重なるように信号線の電極端子の一部を含んでその表面に感光性有機絶縁層を有するソース配線(信号線)と同じく絵素電極の一部を含んでその表面に感光性有機絶縁層を有するドレイン配線を形成する工程を有することを特徴とする。
この構成により絵素電極と走査線を1枚のフォトマスクを用いて処理することができて写真食刻工程数の削減が実現する。またソース・ドレイン配線の形成時に用いた感光性有機絶縁層をそのまま残すことでパシベーション絶縁層の形成を不要とする製造工程の削減もなされる結果、ハーフトーン露光技術を併用することなく4枚のフォトマスクを用いてTN型の液晶表示装置を作製する事ができる。
請求項8は請求項4に記載の液晶表示装置の製造方法であって、少なくとも、第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と信号線の擬似電極端子と擬似絵素電極を形成する工程と、プラズマ保護層とゲート絶縁層と不純物を含まない第1の非晶質シリコン層と保護絶縁層を順次被着する工程と、走査線と信号線の擬似電極端子上と擬似絵素電極上に開口部を形成して前記開口部内の保護絶縁層と第1の非晶質シリコン層とゲート絶縁層とプラズマ保護層と第1の金属層を除去して透明導電性の走査線と信号線の電極端子と同じく透明導電性の絵素電極を露出する工程と、ゲート電極上にゲート電極よりも幅細く保護絶縁層を残して第1の非晶質シリコン層を露出する工程と、不純物を含む第2の非晶質シリコン層を被着する工程と、耐熱金属層を含む1層以上の第2の金属層を被着後、ハーフトーン露光技術により信号線上にのみ感光性有機絶縁層を残してソース・ドレイン配線を形成する工程を有することを特徴とする。
この構成により絵素電極と走査線を1枚のフォトマスクを用いて処理することができて写真食刻工程数の削減が実現する。またソース・ドレイン配線の形成時にハーフトーン露光技術を用いて信号線上にのみ選択的に感光性有機絶縁層を残すことでパシベーション絶縁層の形成を不要とする製造工程の削減もなされる結果、4枚のフォトマスクを用いてTN型の液晶表示装置を作製する事ができる。
以上述べたように本発明に記載の液晶表示装置では絶縁ゲート型トランジスタはチャネル上に保護絶縁層を有しているので、画像表示部内のソース・ドレイン配線上にのみまたは信号線上にのみ感光性有機絶縁層を選択的に形成することでパシベーション機能が与えられる。このため格別な加熱工程を伴わず、非晶質シリコン層を半導体層とする絶縁ゲート型トランジスタに過度の耐熱性を必要としない。換言すればパシベーション形成で電気的な性能の劣化を生じない効果が付加されている。
加えて透明導電層と第1の金属層との積層よりなる走査線と擬似絵素電極を形成し、擬似絵素電極へのコンタクト形成時に擬似絵素電極上の第1の金属層を除去して透明導電性の絵素電極を得ることにより絵素電極の形成工程を合理化している。この結果、ハーフトーン露光技術を併用した従来の4枚マスク・プロセスとは異なり、ハーフトーン露光技術を併用しない4枚マスク・プロセスが実現し、チャネル長の管理が容易となる。またパターン精度の低いハーフトーン露光技術を採用すれば金属層よりなる走査線と信号線の電極端子を得ることができ、デバイスに多様性を持たせることが可能である。
本発明の要件は上記の説明からも明らかなように、エッチストップ型の絶縁ゲート型トランジスタを採用し、透明導電層と第1の金属層との積層よりなる走査線と擬似絵素電極を形成し、擬似絵素電極へのコンタクト形成時に擬似絵素電極上の第1の金属層を除去し透明導電性の絵素電極を得る工程と、ソース・ドレイン配線の形成時にソース・ドレイン配線上または信号線上にのみ選択的に感光性有機絶縁層を残すことでパシベーション絶縁層の形成を不要とした点にあり、それ以外の構成に関しては走査線や信号線、ゲート絶縁層等の材質や膜厚等が異なった表示装置用半導体装置、あるいはその製造方法の差異も本発明の範疇に属することは自明であり、垂直配向型の液晶表示装置においても本発明の有用性は変らず、また絶縁ゲート型トランジスタの半導体層も非晶質シリコンに限定されるものでないことも明らかである。
本発明の実施例を図1〜図8に基づいて説明する。図1に実施例1に係るアクティブ基板の平面図を示し、図2に図1のA−A’線上とB−B’線上及びC−C’線上の製造工程の断面図を示す。同様に実施例2は図3と図4、実施例3は図5と図6、実施例4は図7と図8とで夫々アクティブ基板の平面図と製造工程の断面図を示す。なお従来例と同一の部位については同一の符号を付して詳細な説明は省略する。
実施例1では先ずガラス基板2の一主面上にSPT等の真空製膜装置を用いて膜厚0.1〜0.2μm程度の透明導電層91として例えばITOと、膜厚0.1〜0.3μm程度の第1の金属層92を被着し、図1(a)と図2(a)に示したように微細加工技術により感光性樹脂パターンを用いて透明導電層91Aと第1の金属層92Aとの積層よりなりゲート電極11Aも兼ねる走査線11及び走査線の擬似電極端子94と、透明導電層91Bと第1の金属層92Bとの積層よりなる擬似絵素電極93と、透明導電層91Cと第1の金属層92Cとの積層よりなる信号線の擬似電極端子95を選択的に形成する。第1の金属層として例えばCr,Ta,Mo等の高融点金属あるいはそれらの合金やシリサイドが選ばれる。走査線の低抵抗化のためにはITOとアルカリ性の現像液やレジスト剥離液で電池反応を起こさないように耐熱金属層でサンドイッチされたアルミニウム層あるいはNdを含むアルミニウム合金層の採用も可能である。ゲート絶縁層を介して信号線との絶縁耐圧を向上させ、歩留を高めるためにはこれらの電極は乾式食刻(ドライエッチ)による断面形状のテーパ制御を行うことが望ましいが、ITOのドライエッチ技術は食刻ガスに沃化水素や臭化水素を用いたものが開発されたもののガス排気系での反応生成物による堆積量が大きく実用化に至らなかったので、当面は例えばAr(ガス)を用いたスパッタ・エッチを採用すると良い。
次にガラス基板2の全面にプラズマ保護層となる透明絶縁層、例えばTaOxやSiO2を0.1μm程度の膜厚で被着して71とする。このプラズマ保護層71は後続のPCVD装置によるゲート絶縁層であるSiNxの形成時に走査線11と擬似絵素電極93のエッジ部に露出している透明導電層91A,91Bが還元されてSiNxの膜質が変動するのを防止するために必要で、詳細は先行例特開昭59−9962号公報を参照されたい。
プラズマ保護層71の被着後は従来例と同様にPCVD装置を用いてゲート絶縁層となる第1のSiNx層30、不純物をほとんど含まず絶縁ゲート型トランジスタのチャネルとなる第1の非晶質シリコン層31、及びチャネルを保護する絶縁層となる第2のSiNx層32と3種類の薄膜層を、例えば0.2−0.05−0.1μm程度の膜厚で順次被着し、図1(b)と図2(b)に示したように微細加工技術により感光性樹脂パターンを用いて第2のSiNx層32を選択的に食刻してゲート電極11Aよりもパターン幅の細い第2のSiNx層32D(保護絶縁層)とするとともに第1の非晶質シリコン層31を露出する。ここではゲート絶縁層がプラズマ保護層71と第1のSiNx層30との積層になるため第1のSiNx層は従来よりも薄く形成して良い副次的なメリットがある。
続いてPCVD装置を用いてガラス基板2の全面に不純物として例えば燐を含む第2の非晶質シリコン層33を例えば0.05μm程度の膜厚で被着した後、図1(c)と図2(c)に示したように微細加工技術により感光性樹脂パターンを用いて擬似絵素電極93上に開口部74と画像表示部外の領域で擬似電極端子94上に開口部63Aと擬似電極端子95上に開口部64Aを形成し、上記開口部内の第2の非晶質シリコン層33、第1の非晶質シリコン層31、ゲート絶縁層30、プラズマ保護層71に加えて第1の金属層92A〜92Cを順次食刻し、走査線11の一部(擬似電極端子94)の透明導電層91Aを露出して走査線の電極端子5Aとし、同様に擬似電極端子95の透明導電層91Cを露出して信号線の電極端子6Aとし、擬似絵素電極93の透明導電層91Bを露出して絵素電極22とする。なお画像表部外の領域で静電気対策線上には開口部63Bを形成して静電気対策用の短絡線40とすることが可能である。
引き続きSPT等の真空製膜装置を用いて膜厚0.1μm程度の耐熱金属層として例えばTi,Ta等の薄膜層34と膜厚0.3μm程度の低抵抗配線層としてAL薄膜層35を順次被着する。そして図1(d)と図2(d)に示したように微細加工技術により感光性樹脂パターン85を用いてこれら2層の薄膜層よりなるソース・ドレイン配線材と第2の非晶質シリコン層33Bと第1の非晶質シリコン層31Bを順次食刻して保護絶縁層32Dとゲート絶縁層30Aを露出し、絵素電極22の一部を含んで34Aと35Aとの積層よりなる絶縁ゲート型トランジスタのドレイン電極21と信号線の電極端子6Aの一部を含んでソース電極も兼ねる信号線12を選択的に形成する。そして感光性樹脂パターン85を除去することなくアクティブ基板2の製造工程を終える。走査線の電極端子5Aと信号線の電極端子6Aはソース・ドレイン配線12,21の食刻が終るとガラス基板2上に露出して形成されることが理解されよう。なおソース・ドレイン配線12,21の構成としては抵抗値の制約が緩いのであれば簡素化してTa,Cr,MoW等の単層とすることも可能である。
このようにして得られたアクティブ基板2とカラーフィルタ9を貼り合わせて液晶パネル化し、本発明の実施例1が完了する。実施例1では感光性樹脂パターン85は液晶に接しているので、感光性樹脂パターン85はノボラック系の樹脂を主成分とする通常の感光性樹脂ではなく、純度が高く主成分にアクリル樹脂やポリイミド樹脂を含む耐熱性の高い感光性有機絶縁層を用いることが大切であり、材質によっては加熱することで流動化してソース・ドレイン配線12,21の側面を覆うように構成することも可能で、この場合には液晶パネルとして信頼性が一段と向上する。蓄積容量15の構成に関しては図1(d)に示したように、ソース・ドレイン配線12,21と同時に絵素電極22の一部を含んで形成された蓄積電極72と前段の走査線11に設けられた突起部とがプラズマ保護層71Aとゲート絶縁層30Aと第1の非晶質シリコン層31Eと第2の非晶質シリコン層33E(共に図示せず)を介して平面的に重なることで構成している例(右下がり斜線部52)を例示しているが、蓄積容量15の構成はこれに限られるものではなく、従来例と同じように走査線11と同時に形成される蓄積容量線16と絵素電極22との間にゲート絶縁層30Aを含む絶縁層を介して構成しても良い。またその他の構成も可能であるが詳細な説明は省略する。
実施例1ではこのように走査線の電極端子と信号線の電極端子がともに透明導電層であるデバイス構成上の制約が生ずるが、その制約を解除するデバイス・プロセスも可能であり、それを実施例2として説明する。
実施例2では図3(c)と図4(c)に示したようにコンタクト形成工程までは実施例1とほぼ同一のプロセスで進行する。ただし後述する理由で信号線の擬似電極端子95は必ずしも必要ではない。ソース・ドレイン配線の形成工程ではSPT等の真空製膜装置を用いて膜厚0.1μm程度の耐熱金属層として例えばTi,Ta等の薄膜層34と膜厚0.3μm程度の低抵抗配線層としてAL薄膜層35を順次被着した後、図3(d)と図4(d)に示したように微細加工技術により感光性樹脂パターン86A,86Bを用いてこれら2層の薄膜層よりなるソース・ドレイン配線材と第2の非晶質シリコン層33Bと第1の非晶質シリコン層31Bを順次食刻して保護絶縁層32Dとゲート絶縁層30Aを露出し、絵素電極22の一部を含んで34Aと35Aとの積層よりなる絶縁ゲート型トランジスタのドレイン電極21とソース配線も兼ねる信号線12を選択的に形成し、ソース・ドレイン配線12,21の形成と同時に露出している走査線の一部5Aを含んで走査線の電極端子5と信号線の一部よりなる電極端子6も同時に形成する。すなわち実施例1のように擬似電極端子95は必ずしも必要ではない。
この時に信号線12上の86Aの膜厚が例えば3μmとドレイン電極21上と電極端子5,6上と蓄積電極72上の86Bの膜厚1.5μmよりも厚い感光性樹脂パターン86A,86Bをハーフトーン露光技術により形成しておくことが実施例2の重要な特徴である。電極端子5,6に対応した86Bの最小寸法は数10μmと大きく、フォトマスク製作もまたその仕上がり寸法管理も極めて容易であるが、信号線12に対応した領域86Aの最小寸法は4〜8μmと比較的寸法精度が高いので黒領域としては細いパターンを必要とする。しかしながら従来例で説明したように1回の露光処理と2回の食刻処理で形成するソース・ドレイン配線12,21と比較すると本発明のソース・ドレイン配線12,21は1回の露光処理と1回の食刻処理で形成されるためにパターン幅の変動する要因が少なく、ソース・ドレイン配線12,21の寸法管理も、ソース・ドレイン配線12,21間すなわちチャネル長の寸法管理も従来のハーフトーン露光技術よりはパターン精度の管理が容易である。またチャネルエッチ型の絶縁ゲートトランジスタと比較するとエッチストップ型の絶縁ゲート型トランジスタのON電流を決定するのは保護絶縁層32Dの寸法であってソース・ドレイン配線12,21間の寸法ではないことからもプロセス管理がさらに容易となることを理解されたい。
ソース・ドレイン配線12,21の形成後、酸素プラズマ等の灰化手段により上記感光性樹脂パターン86A,86Bを1.5μm以上膜減りさせると感光性樹脂パターン86Bが消失し、図3(e)と図4(e)に示したようにドレイン電極21と電極端子5,6と蓄積電極72が露出すると共に信号線12上にのみ感光性樹脂パターン86Cをそのまま残すことができるが、上記酸素プラズマ処理で感光性樹脂パターン86Cのパターン幅が細くなると信号線12の上面が露出して信頼性が低下するので異方性を強めてパターン寸法の変化を抑制することが望ましい。そして感光性樹脂パターン86Cを除去することなくアクティブ基板2の製造工程を終える。なおソース・ドレイン配線12,21の構成としては抵抗値の制約が緩いのであれば簡素化してTa,Cr,MoW等の単層とすることも可能である。
このようにして得られたアクティブ基板2とカラーフィルタ9を貼り合わせて液晶パネル化し、実施例2が完了する。実施例2でも感光性樹脂パターン86Cは液晶に接しているので感光性樹脂パターン86Cはノボラック系の樹脂を主成分とする通常の感光性樹脂ではなく、純度が高く主成分にアクリル樹脂やポリイミド樹脂を含む耐熱性の高い感光性有機絶縁層を用いることが大切であり、材質によっては加熱することで流動化して信号線12の側面を覆うように構成することも可能で、この場合には液晶パネルとして信頼性が確実に向上する。蓄積容量15の構成に関しては実施例1と同一である。走査線の一部5A及び信号線12下に形成された透明導電性のパターン6Aとアクティブ基板2の外周部に配置された短絡線40を接続する透明導電層パターンはその形状を細長い線状とすることで静電気対策における高抵抗配線とすることが可能であるが、その他の導電性部材を用いた静電気対策も勿論可能である。
なお図3(f)と図4(f)に示したように透明導電性の走査線の電極端子5A上に金属性の電極端子5を形成せず、かつ透明導電性の信号線12の電極端子6Aの一部を含んで信号線12を形成するパターン設計の変更により、金属層でソース・ドレイン配線材よりなる電極端子5,6に変えて実施例1と同様に透明導電層よりなる電極端子5A,6Aを得る事も可能であり、電極端子の構成部材を変更しても画像表示部内のデバイス構成は不変である。
以上説明した液晶表示装置では走査線と擬似絵素電極の形成、エッチストップ層の形成、コンタクトの形成そしてソース・ドレイン配線の形成の順でアクティブ基板2が形成されているが、エッチストップ層の形成とコンタクトの形成の順番を入れ替えてもほぼ同等のアクティブ基板2を得ることが可能であり、それを以下の実施例で説明する。
実施例3ではPCVD装置を用いてゲート絶縁層となる第1のSiNx層30、不純物をほとんど含まず絶縁ゲート型トランジスタのチャネルとなる第1の非晶質シリコン層31、及びチャネルを保護する絶縁層となる第2のSiNx層32と3種類の薄膜層を、例えば0.2−0.05−0.1μm程度の膜厚で順次被着するまでは実施例1とほぼ同じ製造工程を進行する。ここでもゲート絶縁層がプラズマ保護層71と第1のSiNx層30との積層になるため第1のSiNx層は従来よりも薄く形成して良い。
続いて図5(b)と図6(b)に示したように微細加工技術により感光性樹脂パターンを用いて擬似絵素電極93上に開口部74と画像表示部外の領域で擬似電極端子94上に開口部63Aと擬似電極端子95上に開口部64Aを形成し、各開口部内の第2のSiNx層32、第1の非晶質シリコン層31、ゲート絶縁層30及びプラズマ保護層71に加えて第1の金属層92A〜92Cを順次食刻し、走査線11の一部(擬似電極端子94)の透明導電層91Aを露出して走査線の電極端子5Aとし、同様に擬似電極端子95の透明導電層91Cを露出して信号線の電極端子6Aとし、擬似絵素電極93の透明導電層91Bを露出して絵素電極22とする。
引き続き図5(c)と図6(c)に示したように微細加工技術により感光性樹脂パターンを用いて第2のSiNx層32Aを選択的に食刻してゲート電極11Aよりもパターン幅の細い第2のSiNx層32D(保護絶縁層)とするとともに第1の非晶質シリコン層31Bを露出する。
そしてPCVD装置を用いてガラス基板2の全面に不純物として例えば燐を含む第2の非晶質シリコン層33を例えば0.05μm程度の膜厚で被着し、さらにSPT等の真空製膜装置を用いて膜厚0.1μm程度の耐熱金属層として例えばTi,Ta等の薄膜層34と膜厚0.3μm程度の低抵抗配線層としてAL薄膜層35を順次被着する。そして図5(d)と図6(d)に示したように微細加工技術により感光性樹脂パターン85を用いてこれら2層の薄膜層よりなるソース・ドレイン配線材と第2の非晶質シリコン層33と第1の非晶質シリコン層31Bを順次食刻して保護絶縁層32Dとゲート絶縁層30Aを露出し、絵素電極22の一部を含んで34Aと35Aとの積層よりなる絶縁ゲート型トランジスタのドレイン電極21と信号線の電極端子6Aの一部を含んでソース電極も兼ねる信号線12を選択的に形成する。そして感光性樹脂パターン85を除去することなくアクティブ基板2の製造工程を終える。なおここでもソース・ドレイン配線12,21の構成としては抵抗値の制約が緩いのであれば簡素化してTa,Cr,MoW等の単層とすることも可能である。
このようにして得られたアクティブ基板2とカラーフィルタ9を貼り合わせて液晶パネル化し、本発明の実施例3が完了する。実施例3でも感光性樹脂パターン85はノボラック系の樹脂を主成分とする通常の感光性樹脂ではなく、純度が高く主成分にアクリル樹脂やポリイミド樹脂を含む耐熱性の高い感光性有機絶縁層を用いることが大切である。蓄積容量15の構成に関しては図5(d)に示したようにソース・ドレイン配線12,21と同時に絵素電極22の一部を含んで形成された蓄積電極72と前段の走査線11に設けられた突起部とがプラズマ保護層71Aとゲート絶縁層30Aと第1の非晶質シリコン層31Eと第2の非晶質シリコン層33E(共に図示せず)を介して平面的に重なることで構成している例(右下がり斜線部52)を例示している。
実施例3ではこのように走査線の電極端子と信号線の電極端子がともに透明導電層であるデバイス構成上の制約が生ずるが、実施例2と同様にその制約を解除するデバイス・プロセスも可能であり、それを実施例4として説明する。
実施例4では図7(c)と図8(c)に示したように保護絶縁層32Dの形成工程までは実施例3とほぼ同一のプロセスで進行する。ただし後述する理由で擬似電極端子95は必ずしも必要ではない。ソース・ドレイン配線の形成工程ではSPT等の真空製膜装置を用いて膜厚0.1μm程度の耐熱金属層として例えばTi,Ta等の薄膜層34と膜厚0.3μm程度の低抵抗配線層としてAL薄膜層35を順次被着した後、図7(d)と図8(d)に示したように微細加工技術により感光性樹脂パターン86A,86Bを用いてこれら2層の薄膜層よりなるソース・ドレイン配線材と第2の非晶質シリコン層33と第1の非晶質シリコン層31Bを順次食刻して保護絶縁層32Dとゲート絶縁層30Aを露出し、絵素電極22の一部を含んで34Aと35Aとの積層よりなる絶縁ゲート型トランジスタのドレイン電極21とソース配線も兼ねる信号線12を選択的に形成し、ソース・ドレイン配線12,21の形成と同時に露出している走査線の一部5Aを含んで走査線の電極端子5と信号線の一部よりなる電極端子6も同時に形成する。
この時に実施例2と同様に信号線12上の86Aの膜厚が例えば3μmとドレイン電極21上と電極端子5,6上と蓄積電極72上の86Bの膜厚1.5μmよりも厚い感光性樹脂パターン86A,86Bをハーフトーン露光技術により形成しておくことが実施例4の重要な特徴である。
ソース・ドレイン配線12,21の形成後、酸素プラズマ等の灰化手段により上記感光性樹脂パターン86A,86Bを1.5μm以上膜減りさせると感光性樹脂パターン86Bが消失し、図7(e)と図8(e)に示したようにドレイン電極21と電極端子5,6と蓄積電極72が露出すると共に信号線12上にのみ感光性樹脂パターン86Cをそのまま残すことができる。そして感光性樹脂パターン86Cを除去することなくアクティブ基板2の製造工程を終える。
このようにして得られたアクティブ基板2とカラーフィルタ9を貼り合わせて液晶パネル化し、実施例4が完了する。実施例4でも感光性樹脂パターン86Cは液晶に接しているので感光性樹脂パターン86Cはノボラック系の樹脂を主成分とする通常の感光性樹脂ではなく、純度が高く主成分にアクリル樹脂やポリイミド樹脂を含む耐熱性の高い感光性有機絶縁層を用いることが大切である。蓄積容量15の構成に関しては実施例3と同一である。
なお図7(f)と図8(f)に示したように透明導電性の走査線の電極端子5A上に金属性の電極端子5を形成せず、かつ透明導電性の信号線12の電極端子6Aの一部を含んで信号線12を形成するパターン設計の変更により、金属層でソース・ドレイン配線材よりなる電極端子5,6に変えて実施例3と同様に透明導電層よりなる電極端子5A,6Aを得る事も可能であり、電極端子の構成部材を変更しても画像表示部内のデバイス構成は不変である。
本発明の実施例1にかかるアクティブ基板の平面図 本発明の実施例1にかかるアクティブ基板の製造工程断面図 本発明の実施例2にかかるアクティブ基板の平面図 本発明の実施例2にかかるアクティブ基板の製造工程断面図 本発明の実施例3にかかるアクティブ基板の平面図 本発明の実施例3にかかるアクティブ基板の製造工程断面図 本発明の実施例4にかかるアクティブ基板の平面図 本発明の実施例4にかかるアクティブ基板の製造工程断面図 液晶パネルの実装状態を示す斜視図 液晶パネルの等価回路図 従来の液晶パネルの断面図 従来例のアクティブ基板の平面図 従来例のアクティブ基板の製造工程断面図 合理化されたアクティブ基板の平面図 合理化されたアクティブ基板の製造工程断面図
符号の説明
1:液晶パネル
2:アクティブ基板(ガラス基板)
3:半導体集積回路チップ、駆動IC
4:TCPフィルム
5:金属性の走査線の電極端子
5A:透明導電性の走査線の一部または電極端子
6:金属性の信号線の電極端子
6A:透明導電性の信号線の一部または電極端子
9:カラーフィルタ(対向するガラス基板)
10:絶縁ゲート型トランジスタ
11:走査線(ゲート配線、ゲート電極)
12:信号線(ソース配線、ソース電極)
16:蓄積容量線
17:液晶
19:偏光板
20:配向膜
21:ドレイン配線、ドレイン電極
22:(透明導電性の)絵素電極
30:ゲート絶縁層
31:不純物を含まない(第1の)非晶質シリコン層
32D:保護絶縁層(エッチストップ層またはチャネル保護層)
33:不純物を含む(第2の)非晶質シリコン層
34:耐熱金属層
35:低抵抗金属層(AL)
36:中間導電層
37:パシベーション絶縁層
50,52:蓄積容量形成領域
62:(ドレイン電極上の)開口部
63,63A:(走査線上の)開口部
64,64A:(信号線上の)開口部
65,65A:(対向電極上の)開口部
71:プラズマ保護層
72:蓄積電極
85A,85B:感光性有機絶縁層パターン
86A,86B:ハーフトーン露光で形成された感光性有機絶縁層パターン
91:透明導電層
92:第1の金属層

Claims (8)

  1. 一主面上に少なくとも絶縁ゲート型トランジスタと、前記絶縁ゲート型トランジスタのゲート電極も兼ねる走査線とソース配線も兼ねる信号線と、ドレイン配線に接続された絵素電極を有する単位絵素が二次元のマトリクスに配列された第1の透明性絶縁基板と、前記第1の透明性絶縁基板と対向する第2の透明性絶縁基板またはカラーフィルタとの間に液晶を充填してなる液晶表示装置において、少なくとも、
    第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と、透明導電性の絵素電極と、同じく透明導電性の信号線の電極端子が形成され、
    プラズマ保護層とゲート絶縁層と不純物を含まない第1の半導体層を介してゲート電極上にゲート電極よりも幅細く保護絶縁層が形成され、
    絵素電極上と画像表示部外の領域で走査線の一部上と信号線の電極端子上のプラズマ保護層とゲート絶縁層と第1の半導体層に夫々開口部が形成され、各開口部内に透明導電性の絵素電極と走査線の電極端子と信号線の電極端子が露出し、
    前記保護絶縁層の一部と重なり前記第1の半導体層上に不純物を含む第2の半導体層と耐熱金属層を含む1層以上の第2の金属層との積層よりなるソース(信号線)配線と、前記保護絶縁層の一部と重なり前記第1の半導体層上に同じくドレイン配線が形成され、
    第2の金属層よりなる前記信号線の一部は信号線の電極端子の一部上と、同じく前記ドレイン配線の一部は前記開口部内の絵素電極の一部上に形成され、
    前記ソース・ドレイン配線領域を除いて第1の半導体層が除去されて第1の透明性絶縁基板上にゲート絶縁層が露出し、
    前記ソース・ドレイン配線上に感光性有機絶縁層が形成されていることを特徴とする液晶表示装置。
  2. 一主面上に少なくとも絶縁ゲート型トランジスタと、前記絶縁ゲート型トランジスタのゲート電極も兼ねる走査線とソース配線も兼ねる信号線と、ドレイン配線に接続された絵素電極を有する単位絵素が二次元のマトリクスに配列された第1の透明性絶縁基板と、前記第1の透明性絶縁基板と対向する第2の透明性絶縁基板またはカラーフィルタとの間に液晶を充填してなる液晶表示装置において、少なくとも、
    第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と、透明導電性の絵素電極(と同じく透明導電性の信号線の電極端子)が形成され、
    プラズマ保護層とゲート絶縁層と不純物を含まない第1の半導体層を介してゲート電極上にゲート電極よりも幅細く保護絶縁層が形成され、
    前記絵素電極上と画像表示部外の領域で走査線の一部上(または走査線の電極端子上と信号線の電極端子上)のプラズマ保護層とゲート絶縁層と第1の半導体層に夫々開口部が形成され、各開口部内に透明導電性の絵素電極と透明導電性の走査線の一部(または透明導電性の走査線の電極端子と信号線の電極端子)が露出し、
    前記保護絶縁層の一部と重なり前記第1の半導体層上に不純物を含む第2の半導体層と耐熱金属層を含む1層以上の第2の金属層との積層よりなるソース(信号線)配線と、同じく前記保護絶縁層の一部と重なり前記第1の半導体層上にドレイン配線が形成され、
    第2の金属層よりなる前記ドレイン配線の一部は前記開口部内の絵素電極の一部上に形成され、
    前記走査線の一部を含んで第2の金属層よりなる走査線の電極端子と、前記信号線の一部で第2の金属層よりなる信号線の電極端子が形成され(または第2の金属層よりなる前記信号線の一部は透明導電性の信号線の電極端子の一部上に形成され)、
    前記ソース・ドレイン配線領域を除いて第1の半導体層が除去されて第1の透明性絶縁基板上にゲート絶縁層が露出し、
    前記信号線の電極端子上を除いて信号線上に感光性有機絶縁層が形成されていることを特徴とする液晶表示装置。
  3. 一主面上に少なくとも絶縁ゲート型トランジスタと、前記絶縁ゲート型トランジスタのゲート電極も兼ねる走査線とソース配線も兼ねる信号線と、ドレイン配線に接続された絵素電極を有する単位絵素が二次元のマトリクスに配列された第1の透明性絶縁基板と、前記第1の透明性絶縁基板と対向する第2の透明性絶縁基板またはカラーフィルタとの間に液晶を充填してなる液晶表示装置において、少なくとも、
    第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と、透明導電性の絵素電極と、同じく透明導電性の信号線の電極端子が形成され、
    プラズマ保護層とゲート絶縁層と不純物を含まない第1の半導体層を介してゲート電極上にゲート電極よりも幅細く保護絶縁層が形成され、
    絵素電極上と画像表示部外の領域で走査線の一部上と信号線の電極端子上のプラズマ保護層とゲート絶縁層と第1の半導体層に夫々開口部が形成され、各開口部内に透明導電性の絵素電極と走査線の電極端子と信号線の電極端子が露出し、
    前記保護絶縁層の一部と重なり信号線の電極端子の一部上と前記第1の半導体層上に不純物を含む第2の半導体層と耐熱金属層を含む1層以上の第2の金属層との積層よりなるソース(信号線)配線と、前記保護絶縁層の一部と重なり前記開口部内の絵素電極の一部上と前記第1の半導体層上に同じくドレイン配線が形成され、
    前記ソース・ドレイン配線領域を除いて第1の半導体層が除去されて第1の透明性絶縁基板上にゲート絶縁層が露出し、
    前記ソース・ドレイン配線上に感光性有機絶縁層が形成されていることを特徴とする液晶表示装置。
  4. 一主面上に少なくとも絶縁ゲート型トランジスタと、前記絶縁ゲート型トランジスタのゲート電極も兼ねる走査線とソース配線も兼ねる信号線と、ドレイン配線に接続された絵素電極を有する単位絵素が二次元のマトリクスに配列された第1の透明性絶縁基板と、前記第1の透明性絶縁基板と対向する第2の透明性絶縁基板またはカラーフィルタとの間に液晶を充填してなる液晶表示装置において、少なくとも、
    第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と、透明導電性の絵素電極(と同じく透明導電性の信号線の電極端子)が形成され、
    プラズマ保護層とゲート絶縁層と不純物を含まない第1の半導体層を介してゲート電極上にゲート電極よりも幅細く保護絶縁層が形成され、
    前記絵素電極上と画像表示部外の領域で走査線の一部上(または走査線の電極端子上と信号線の電極端子上)のプラズマ保護層とゲート絶縁層と第1の半導体層に夫々開口部が形成され、各開口部内に透明導電性の絵素電極と透明導電性の走査線の一部(または透明導電性の走査線の電極端子と信号線の電極端子)が露出し、
    前記保護絶縁層の一部と重なり前記第1の半導体層上(と信号線の電極端子の一部上)に不純物を含む第2の半導体層と耐熱金属層を含む1層以上の第2の金属層との積層よりなるソース(信号線)配線と、前記保護絶縁層の一部と重なり前記第1の半導体層上と前記開口部内の絵素電極の一部上に同じくドレイン配線と、走査線の一部を含んで同じく走査線の電極端子(または透明導電性の走査線の電極端子)と、信号線の一部よりなる信号線の電極端子(または透明導電性の信号線の電極端子)が形成され、
    前記ソース・ドレイン配線領域を除いて第1の半導体層が除去されて第1の透明性絶縁基板上にゲート絶縁層が露出し、
    前記信号線の電極端子上を除いて信号線上に感光性有機絶縁層が形成されていることを特徴とする液晶表示装置。
  5. 一主面上に少なくとも絶縁ゲート型トランジスタと、前記絶縁ゲート型トランジスタのゲート電極も兼ねる走査線とソース配線も兼ねる信号線と、ドレイン配線に接続された絵素電極を有する単位絵素が二次元のマトリクスに配列された第1の透明性絶縁基板と、前記第1の透明性絶縁基板と対向する第2の透明性絶縁基板またはカラーフィルタとの間に液晶を充填してなる液晶表示装置において、少なくとも、
    第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と、走査線の一部である走査線の擬似電極端子と、信号線の擬似電極端子と擬似絵素電極を形成する工程と、
    プラズマ保護層とゲート絶縁層と不純物を含まない第1の非晶質シリコン層と保護絶縁層を順次被着する工程と、
    ゲート電極上にゲート電極よりも幅細く保護絶縁層を残して前記第1の非晶質シリコン層を露出する工程と、
    不純物を含む第2の非晶質シリコン層を被着する工程と、
    走査線と信号線の擬似電極端子上と擬似絵素電極上に開口部を形成して前記開口部内の第2の非晶質シリコン層と第1の非晶質シリコン層とゲート絶縁層とプラズマ保護層と第1の金属層を除去して透明導電性の走査線と信号線の電極端子と、同じく透明導電性の絵素電極を露出する工程と、
    耐熱金属層を含む1層以上の第2の金属層を被着後、第2の金属層と第2の非晶質シリコン層との積層よりなり、前記保護絶縁層と一部重なるように信号線の電極端子の一部を含んでその表面に感光性有機絶縁層を有するソース配線(信号線)と、同じく絵素電極の一部を含んでその表面に感光性有機絶縁層を有するドレイン配線を形成する工程を有する液晶表示装置の製造方法。
  6. 一主面上に少なくとも絶縁ゲート型トランジスタと、前記絶縁ゲート型トランジスタのゲート電極も兼ねる走査線とソース配線も兼ねる信号線と、ドレイン配線に接続された絵素電極を有する単位絵素が二次元のマトリクスに配列された第1の透明性絶縁基板と、前記第1の透明性絶縁基板と対向する第2の透明性絶縁基板またはカラーフィルタとの間に液晶を充填してなる液晶表示装置において、少なくとも、
    第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と、走査線の一部である走査線の擬似電極端子と、(信号線の擬似電極端子と)擬似絵素電極を形成する工程と、
    プラズマ保護層とゲート絶縁層と不純物を含まない第1の非晶質シリコン層と保護絶縁層を順次被着する工程と、
    ゲート電極上にゲート電極よりも幅細く保護絶縁層を残して前記第1の非晶質シリコン層を露出する工程と、
    不純物を含む第2の非晶質シリコン層を被着する工程と、
    走査線の一部上(または走査線と信号線の擬似電極端子上)と擬似絵素電極上に開口部を形成して前記開口部内の第2の非晶質シリコン層と第1の非晶質シリコン層とゲート絶縁層とプラズマ保護層と第1の金属層を除去して透明導電性の走査線の一部(または透明導電性の走査線と信号線の電極端子)と同じく透明導電性の絵素電極を露出する工程と、
    耐熱金属層を含む1層以上の第2の金属層を被着後、前記保護絶縁層と一部重なりソース配線(信号線)と、同じく絵素電極の一部を含んでドレイン配線と、前記走査線の一部を含んで走査線の電極端子と、信号線の一部よりなる信号線の電極端子に対応し、信号線上の膜厚が他の領域よりも厚い感光性有機絶縁層パターンを形成する工程(または前記保護絶縁層と一部重なり透明導電性の信号線の電極端子の一部を含んでソース配線と、同じく絵素電極の一部を含んでドレイン配線に対応し、信号線上の膜厚が他の領域よりも厚い感光性有機絶縁層パターンを形成する工程)と、
    前記感光性有機絶縁層パターンをマスクとして第2の金属層と第2の非晶質シリコン層と第1の非晶質シリコン層を選択的に除去して第2の金属層(または透明導電層)よりなる走査線と信号線の電極端子と、ソース・ドレイン配線を形成する工程と、
    前記感光性有機絶縁層パターンの膜厚を減少して第2の金属層(または透明導電層)よりなる走査線と信号線の電極端子と、ドレイン配線を露出する工程を有する液晶表示装置の製造方法。
  7. 一主面上に少なくとも絶縁ゲート型トランジスタと、前記絶縁ゲート型トランジスタのゲート電極も兼ねる走査線とソース配線も兼ねる信号線と、ドレイン配線に接続された絵素電極を有する単位絵素が二次元のマトリクスに配列された第1の透明性絶縁基板と、前記第1の透明性絶縁基板と対向する第2の透明性絶縁基板またはカラーフィルタとの間に液晶を充填してなる液晶表示装置において、少なくとも、
    第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と、走査線の一部である走査線の擬似電極端子と、信号線の擬似電極端子と擬似絵素電極を形成する工程と、
    プラズマ保護層とゲート絶縁層と不純物を含まない第1の非晶質シリコン層と保護絶縁層を順次被着する工程と、
    走査線と信号線の擬似電極端子上と擬似絵素電極上に開口部を形成して前記開口部内の保護絶縁層と第1の非晶質シリコン層とゲート絶縁層とプラズマ保護層と第1の金属層を除去して透明導電性の走査線と信号線の電極端子と同じく透明導電性の絵素電極を露出する工程と、
    ゲート電極上にゲート電極よりも幅細く保護絶縁層を残して前記第1の非晶質シリコン層を露出する工程と、
    不純物を含む第2の非晶質シリコン層を被着する工程と、
    耐熱金属層を含む1層以上の第2の金属層を被着後、第2の金属層と第2の非晶質シリコン層との積層よりなり、前記保護絶縁層と一部重なるように信号線の電極端子の一部を含んでその表面に感光性有機絶縁層を有するソース配線(信号線)と、同じく絵素電極の一部を含んでその表面に感光性有機絶縁層を有するドレイン配線を形成する工程を有する液晶表示装置の製造方法。
  8. 一主面上に少なくとも絶縁ゲート型トランジスタと、前記絶縁ゲート型トランジスタのゲート電極も兼ねる走査線とソース配線も兼ねる信号線と、ドレイン配線に接続された絵素電極を有する単位絵素が二次元のマトリクスに配列された第1の透明性絶縁基板と、前記第1の透明性絶縁基板と対向する第2の透明性絶縁基板またはカラーフィルタとの間に液晶を充填してなる液晶表示装置において、少なくとも、
    第1の透明性絶縁基板の一主面上に透明導電層と第1の金属層との積層よりなる走査線と、走査線の一部である走査線の擬似電極端子と、(信号線の擬似電極端子と)擬似絵素電極を形成する工程と、
    プラズマ保護層とゲート絶縁層と不純物を含まない第1の非晶質シリコン層と保護絶縁層を順次被着する工程と、
    走査線の一部上(または走査線と信号線の擬似電極端子上)と擬似絵素電極上に開口部を形成して前記開口部内の保護絶縁層と第1の非晶質シリコン層とゲート絶縁層とプラズマ保護層と第1の金属層を除去して透明導電性の走査線の一部(または走査線と信号線の電極端子)と同じく透明導電性の絵素電極を露出する工程と、
    ゲート電極上にゲート電極よりも幅細く保護絶縁層を残して前記第1の非晶質シリコン層を露出する工程と、
    不純物を含む第2の非晶質シリコン層を被着する工程と、
    耐熱金属層を含む1層以上の第2の金属層を被着後、前記保護絶縁層と一部重なりソース配線(信号線)と、同じく絵素電極の一部を含んでドレイン配線と、前記走査線の一部を含んで走査線の電極端子と、信号線の一部よりなる信号線の電極端子に対応し、信号線上の膜厚が他の領域よりも厚い感光性有機絶縁層パターンを形成する工程(または前記保護絶縁層と一部重なり透明導電性の信号線の電極端子の一部を含んでソース配線と、同じく絵素電極の一部を含んでドレイン配線に対応し、信号線上の膜厚が他の領域よりも厚い感光性有機絶縁層パターンを形成する工程)と、
    前記感光性有機絶縁層パターンをマスクとして第2の金属層と第2の非晶質シリコン層と第1の非晶質シリコン層を選択的に除去して第2の金属層(または透明導電層)よりなる走査線と信号線の電極端子と、ソース・ドレイン配線を形成する工程と、
    前記感光性有機絶縁層パターンの膜厚を減少して第2の金属層(または透明導電層)よりなる走査線と信号線の電極端子と、ドレイン配線を露出する工程を有する液晶表示装置の製造方法。
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TW (1) TWI304911B (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8421941B2 (en) 2009-07-23 2013-04-16 Mitsubishi Electric Corporation TFT substrate and method of manufacturing the same
US9178024B2 (en) 2011-12-12 2015-11-03 Samsung Display Co., Ltd. Thin film transistor display panel and manufacturing method thereof

Families Citing this family (17)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4646539B2 (ja) * 2004-03-29 2011-03-09 エーユー オプトロニクス コーポレイション 液晶表示装置とその製造方法
US9384818B2 (en) 2005-04-21 2016-07-05 Violin Memory Memory power management
TWI319911B (en) * 2005-08-11 2010-01-21 Liquid crystal display device and manufacturing method thereof
US7532382B2 (en) * 2006-06-07 2009-05-12 Konica Minolta Opto, Inc. Display element
JP2008010440A (ja) * 2006-06-27 2008-01-17 Mitsubishi Electric Corp アクティブマトリクス型tftアレイ基板およびその製造方法
KR20080060861A (ko) * 2006-12-27 2008-07-02 엘지디스플레이 주식회사 박막 트랜지스터 기판 및 이의 제조 방법
US20080191211A1 (en) * 2007-02-13 2008-08-14 Mitsubishi Electric Corporation Thin film transistor array substrate, method of manufacturing the same, and display device
WO2008131836A1 (en) * 2007-04-25 2008-11-06 Merck Patent Gmbh Process for preparing an electronic device
TWI360885B (en) * 2007-10-26 2012-03-21 Au Optronics Corp Pixel structure and fabrication method thereof
KR101411566B1 (ko) 2009-10-09 2014-06-25 바이올린 메모리 인코포레이티드 Raid 그룹의 여러 스트라이핑을 갖는 메모리 및 그 수행방법
US9107316B2 (en) * 2013-09-11 2015-08-11 Eastman Kodak Company Multi-layer micro-wire substrate structure
US10121951B2 (en) * 2013-11-29 2018-11-06 Sharp Kabushiki Kaisha Light-emitting device substrate, light-emitting device, and method for producing light-emitting device substrate
KR102293123B1 (ko) 2015-04-08 2021-08-24 삼성디스플레이 주식회사 박막 트랜지스터, 유기 발광 표시 장치, 유기 발광 표시 장치의 제조 방법
US11069724B2 (en) * 2018-01-12 2021-07-20 Wuhan China Star Optoelectronics Semiconductor Display Technology Co., Ltd. Array substrate, manufacturing method thereof and display device using the same
CN108919571B (zh) * 2018-07-11 2021-07-27 业成科技(成都)有限公司 显示面板
CN110828485B (zh) * 2019-11-19 2022-08-26 京东方科技集团股份有限公司 一种显示基板及其制备方法、显示装置
CN114005842A (zh) * 2021-10-29 2022-02-01 京东方科技集团股份有限公司 一种阵列基板及其制备方法

Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6385586A (ja) * 1986-09-29 1988-04-16 株式会社東芝 アクテイブマトリクス型表示装置
JPH05313187A (ja) * 1992-05-07 1993-11-26 Fujitsu Ltd 薄膜トランジスタマトリックスの製造方法
JPH07333275A (ja) * 1994-06-09 1995-12-22 Sharp Corp 液晶表示パネルおよびその検査方法
JP2002141512A (ja) * 2000-11-06 2002-05-17 Advanced Display Inc 薄膜のパターニング方法およびそれを用いたtftアレイ基板およびその製造方法
JP2002311454A (ja) * 2001-04-16 2002-10-23 Matsushita Electric Ind Co Ltd 液晶画像表示装置と画像表示装置用半導体装置の製造方法
JP2002368011A (ja) * 2001-06-06 2002-12-20 Matsushita Electric Ind Co Ltd 絶縁ゲート型トランジスタと液晶表示装置
JP2003077933A (ja) * 2001-06-21 2003-03-14 Matsushita Electric Ind Co Ltd 絶縁ゲート型トランジスタと液晶表示装置及び表示装置用半導体装置の製造方法

Family Cites Families (18)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6385589A (ja) 1986-09-29 1988-04-16 株式会社 ニフコ 液晶表示モジユ−ル
JP2600929B2 (ja) * 1989-01-27 1997-04-16 松下電器産業株式会社 液晶画像表示装置およびその製造方法
JPH0816758B2 (ja) * 1989-02-17 1996-02-21 松下電器産業株式会社 液晶画像表示装置およびその製造方法
JPH05249478A (ja) * 1991-12-25 1993-09-28 Toshiba Corp 液晶表示装置
JP3067938B2 (ja) * 1993-10-27 2000-07-24 松下電器産業株式会社 液晶パネル用基板とその製造方法
US5691782A (en) * 1994-07-08 1997-11-25 Sanyo Electric Co., Ltd. Liquid-crystal display with inter-line short-circuit preventive function and process for producing same
TW354380B (en) * 1995-03-17 1999-03-11 Hitachi Ltd A liquid crystal device with a wide visual angle
US6215541B1 (en) * 1997-11-20 2001-04-10 Samsung Electronics Co., Ltd. Liquid crystal displays and manufacturing methods thereof
JPH11311806A (ja) * 1998-04-28 1999-11-09 Matsushita Electric Ind Co Ltd 液晶パネル及びその製造方法
US6493048B1 (en) * 1998-10-21 2002-12-10 Samsung Electronics Co., Ltd. Thin film transistor array panel for a liquid crystal display and a method for manufacturing the same
JP3464944B2 (ja) * 1999-07-02 2003-11-10 シャープ株式会社 薄膜トランジスタ基板、その製造方法および液晶表示装置
JP4403329B2 (ja) * 1999-08-30 2010-01-27 ソニー株式会社 液晶表示装置の製造方法
CN1170196C (zh) * 2001-06-04 2004-10-06 友达光电股份有限公司 薄膜晶体管液晶显示器的制作方法
JP4305811B2 (ja) * 2001-10-15 2009-07-29 株式会社日立製作所 液晶表示装置、画像表示装置およびその製造方法
KR100980020B1 (ko) * 2003-08-28 2010-09-03 삼성전자주식회사 박막 트랜지스터 표시판과 그 제조 방법
JP2005215279A (ja) * 2004-01-29 2005-08-11 Quanta Display Japan Inc 液晶表示装置とその製造方法
JP4646539B2 (ja) * 2004-03-29 2011-03-09 エーユー オプトロニクス コーポレイション 液晶表示装置とその製造方法
TWI239651B (en) * 2004-04-30 2005-09-11 Quanta Display Inc Manufacturing method of a thin film transistor-liquid crystal display

Patent Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6385586A (ja) * 1986-09-29 1988-04-16 株式会社東芝 アクテイブマトリクス型表示装置
JPH05313187A (ja) * 1992-05-07 1993-11-26 Fujitsu Ltd 薄膜トランジスタマトリックスの製造方法
JPH07333275A (ja) * 1994-06-09 1995-12-22 Sharp Corp 液晶表示パネルおよびその検査方法
JP2002141512A (ja) * 2000-11-06 2002-05-17 Advanced Display Inc 薄膜のパターニング方法およびそれを用いたtftアレイ基板およびその製造方法
JP2002311454A (ja) * 2001-04-16 2002-10-23 Matsushita Electric Ind Co Ltd 液晶画像表示装置と画像表示装置用半導体装置の製造方法
JP2002368011A (ja) * 2001-06-06 2002-12-20 Matsushita Electric Ind Co Ltd 絶縁ゲート型トランジスタと液晶表示装置
JP2003077933A (ja) * 2001-06-21 2003-03-14 Matsushita Electric Ind Co Ltd 絶縁ゲート型トランジスタと液晶表示装置及び表示装置用半導体装置の製造方法

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8421941B2 (en) 2009-07-23 2013-04-16 Mitsubishi Electric Corporation TFT substrate and method of manufacturing the same
US9178024B2 (en) 2011-12-12 2015-11-03 Samsung Display Co., Ltd. Thin film transistor display panel and manufacturing method thereof

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US20080018819A1 (en) 2008-01-24
TWI304911B (en) 2009-01-01
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