DE2621791A1 - INTEGRATED TRANSISTOR WITH ANTI-SATURATION SCHOTTKY DIODE - Google Patents
INTEGRATED TRANSISTOR WITH ANTI-SATURATION SCHOTTKY DIODEInfo
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Description
Böblingen, den 14. Mai 1976 gg-feBöblingen, May 14th 1976 gg-fe
Anmelderin: International Business MachinesApplicant: International Business Machines
Corporation, Armonk, N.Y. 10504Corporation, Armonk, N.Y. 10504
Amtliches Aktenzeichen: NeuanmeldungOfficial file number: New registration
Aktenzeichen der Anmelderin: FI 974 092 2621791Applicant's file number: FI 974 092 2621791
Integrierter Transistor mit sättigungsverhindernder Schottky-DiodeIntegrated transistor with anti-saturation Schottky diode
Die Erfindung betrifft einen integrierten Transistor mit sättigungsverhindernder Schottky-Diode, die in gleicher Polung und parallel zur Basis-Kollektorstrecke angeordnet ist, enthaltend eine erste Schicht eines ersten Leitfähigkeitstyps als Kollektor, eine darauf aufgebrachte, schwach dotierte Schicht des zweiten Leitfähigkeitstyps als Basis, eine in die zweite Schicht eingebrachte Zone des ersten Leitfähigkeitstyps als Emitter und eine die Basis durchquerende, hochdotierte zweite Zone des ersten Leitfähigkeits-The invention relates to an integrated transistor with anti-saturation Schottky diode, which is arranged in the same polarity and parallel to the base-collector path, containing a first layer of a first conductivity type as a collector, a lightly doped layer of the second conductivity type applied thereon as the base, a zone of the first conductivity type introduced into the second layer as the emitter and one as the base traversing, highly doped second zone of the first conductivity
typs als Kollektorkontaktierungszone.type as a collector contact zone.
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Transistorstrukturen, bei denen zum Zwecke der Sättigungsverhinderung eine externe Diode zur Basis-Kollektorstrecke parallel geschaltet ist, sind bekannt und finden verbreitete Anwendung. Die externe Diode ist dabei in gleicher Richtung gepolt wie die Basis-Kollektordiode des Transistors. Die externe Diode ist gekennzeichnet durch einen Spannungsabfall in Vorwärtsrichtung, der niedriger ist als die Vorwärtsspannung, bei der die Basis-Kollektordiode des Transistors leitend wird. Auf diese Weise erreicht man, daß im Sättigungsbereich des Transistors, wenn also der Kollektorübergang leitend wird, der darüberhinausgehende Basisstrom abgeleitet wird. Da Minoritätsladungsträger in der externen Diode nicht gespeichert werden, reduziert die Ableitung des überschüssigen Basisstromes die gespeicherten Ladungen im Transistor, so daß die Sättigung-Zeitkonstante des Transistors reduziert wird.Transistor structures in which for the purpose of preventing saturation an external diode is connected in parallel to the base-collector path, are known and are widely used. the The external diode is polarized in the same direction as the base collector diode of the transistor. The external diode is characterized by a voltage drop in the forward direction, which is lower is than the forward voltage at which the base-collector diode of the Transistor becomes conductive. In this way one achieves that in the saturation range of the transistor, so when the collector junction becomes conductive, the excess base current is diverted. Because minority charge carriers are not stored in the external diode the dissipation of the excess base current reduces the stored charges in the transistor, so that the saturation time constant of the transistor is reduced.
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Bei NPN-Transistoren, deren Kollektor aus dem schwach dotierten Substrat gebildet wird, erhält man die sättigungsverhindernde Schottky-Diode auf einfache Weise dadurch, daß sich der Basiskontakt über den übergang zwischen Basis und Kollektor erstreckt. Dieser Basiskontakt bildet dann einen ohmschen Kontakt mit der P-dotierten Basis und einen Schottky-Kontakt mit dem N~-dotierten Kollektor. Bei Transistorstrukturen, deren Basis auf einer auf dem Kollektor aufgebrachten Epitaxieschicht gebildet ist, läßt sich dieses bekannte Verfahren nicht anwenden. Dieser Transistor weist in planarer Anordnung eine hoch N-dotierte Kollektorkontaktierungszone innerhalb der epitaktisch aufgebrachten Basis auf. Ein den übergang zwischen Basis und Kollektorkontaktierungszone überbrückender Kontakt würde lediglich ohmsche Kontakte bilden und somit den Kollektor-Basisübergang kurzschließen.In the case of NPN transistors, whose collector consists of the lightly doped Substrate is formed, the saturation preventing Schottky diode is obtained in a simple manner in that the base contact extends over the transition between base and collector. This base contact then forms an ohmic contact with the P-doped base and a Schottky contact with the N ~ -doped collector. For transistor structures whose base is based on an on the Collector applied epitaxial layer is formed, this known method cannot be used. This transistor has in a planar arrangement, a highly N-doped collector contact zone within the epitaxially applied base. A bridging the transition between base and collector contact zone Contact would only form ohmic contacts and thus short-circuit the collector-base junction.
Es ist die der Erfindung zugrundeliegende Aufgabe, eine einfache, mit den in der Transistorherstellung üblichen Prozeßschritten her stellbare Struktur anzugeben, bei der sich auch die letztgenannte Transistorstruktur mit einer sättigungsverhindernden Schottky- ; Diode integrieren läßt.The object on which the invention is based is to produce a simple process steps using the process steps that are customary in transistor manufacture to specify adjustable structure, in which the last-mentioned transistor structure with a saturation-preventing Schottky ; Can integrate diode.
'■ Die Lösung dieser Aufgabe ist in den Ansprüchen niedergelegt. '■ The solution of this object is set out in the claims.
Die Erfindung ist im folgenden anhand in der Zeichnung dargestell ten Ausführungsbeispiels näher beschrieben. Es zeigen:The invention is described in more detail below with reference to the drawing dargestell th embodiment. Show it:
' Fig. 1 eine vereinfachte Schnittansicht der fertiggestellten Transistorstruktur'Fig. 1 is a simplified sectional view of the completed Transistor structure
Fig. 2 eine Teil-Schnittansicht der Struktur gem. Fig.FIG. 2 is a partial sectional view of the structure according to FIG.
in einem mittleren Prozeßschritt undin a middle process step and
Fig. 3 eine Teil-Schnittansicht der Struktur gem. Fig.3 is a partial sectional view of the structure according to FIG.
in einem späteren Prozeßschnitt.in a later process cut.
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Der in Fig. 1 dargestellte Transistor weist eine durch Epitaxie hergestellte P~-dotierte Basis auf, die sich auf einem P -dotierten Substrat 1 befindet. Das Substrat weist eine Störstellenkonzentration 10 bis 10 Atomen/cm und einen spezifischen Widerstand von etwa 10 bis 25 Ohm . cm auf. Ein N -dotierter Subkollektor 2 ist in das Substrat 1 eindiffundiert. Die Oberflächenstör-The transistor shown in FIG. 1 has a P -doped base produced by epitaxy, which base is on a P -doped Substrate 1 is located. The substrate has an impurity concentration of 10 to 10 atoms / cm and a specific resistance from about 10 to 25 ohms. cm up. An N -doped sub-collector 2 is diffused into the substrate 1. The surface disturbance
20 3 Stellenkonzentration beträgt etwa 4 χ 10 Atome/cm und liefert einen Schichtwiderstand von etwa 5 Ohm/Flächeneinheit. Der Subkollektor wird in der Verwendung einer geeigneten Silliciumdioxidmaske in konventioneller Weise in das Substrat eindiffundiert. Nach der Diffusion wird die Maske entfernt und eine P~-dotierte Epitaxieschicht 3 in einer Dicke von etwa 2 jam über dem Substrat 1J und dem Subkollektor 2 aufgewachsen. Die Epitaxieschicht 3 weist vorzugsweise eine Störstellenkonzentration von etwa 10 Atomen/cm auf.20 3 site concentration is about 4 χ 10 atoms / cm and delivers a sheet resistance of about 5 ohms / unit area. The sub-collector is made in the use of a suitable silicon dioxide mask diffused into the substrate in a conventional manner. After the diffusion, the mask is removed and a P ~ -doped Epitaxial layer 3 about 2 µm thick over substrate 1J and the sub-collector 2 grew up. The epitaxial layer 3 preferably has an impurity concentration of approximately 10 atoms / cm on.
Beim betrachteten Ausführungsbeispiel wird der Transistor durch dielektrische Isolation in Verbindung mit dem vergrabenen Subkollektor 2 isoliert. Man erhält also einen isolierten Bereich der P~"-dotierten Epitaxieschicht, innerhalb dem die Transistorstruktuj: mit der sättigungsverhindernden Schottky-Diode gebildet wird. Es werden also nacheinander Schichten aus thermischem Siliciumdioxid, Siliciumnitrid und pyrolitischem Siliciumdioxid (nicht dargestellt) auf die Oberfläche der Epitaxieschicht 3 aufgebracht. Diese Schich ten erhalten in den Bereichen 4 und 5 Maskenöffnungen, innerhalb der die dielektrischen Isolationszonen 6 und 7 gebildet werden sollen. Die zu bildenden dielektrischen Isolationszonen umgeben selbstverständlich die gesamte erzeugende Transistorstruktur. Nach dem Aufbringen der Maske (nicht dargestellt) wird im Bereich der Masken 4 und 5 eine P -dotierte Diffusionszone hoher Konzentration eingebracht. Anschließend wird der Oxidationsprozeß durchgeführt, bei dem über den P -Zonen 8 und 9 die dielektrischen Isolationszonen 6 und 7 entstehen. Die Aufgabe der P -dotierten Zonen 8 und 9 besteht darin, sicherzustellen, daß unterhalb der dielek-In the exemplary embodiment under consideration, the transistor is provided by dielectric isolation in connection with the buried subcollector 2 isolated. An isolated area of the P ~ "-doped epitaxial layer is thus obtained, within which the transistor structure: is formed with the anti-saturation Schottky diode. It layers of thermal silicon dioxide, silicon nitride and pyrolytic silicon dioxide (not shown) applied to the surface of the epitaxial layer 3. This layer th obtained in the areas 4 and 5 mask openings within which the dielectric isolation zones 6 and 7 are formed should. The dielectric isolation zones to be formed naturally surround the entire generating transistor structure. After the mask (not shown) has been applied, a P -doped diffusion zone of high concentration is created in the area of the masks 4 and 5 brought in. The oxidation process is then carried out, in which the dielectric isolation zones 6 and 7 arise over the P zones 8 and 9. The task of the P -doped zones 8 and 9 is to ensure that underneath the dielectric
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trischen Isolationszonen 6 und 7 die Möglichkeit einer Inversion des P~-Substratmaterials verhindert wird. Eine solche Inversion kann auftreten, wem das die dielektrischen Isolationszonen bildende Siliciumdioxid direkt mit dem Substratmaterial in Kontakt [kommt.tric isolation zones 6 and 7 the possibility of inversion of the P ~ substrate material is prevented. Such an inversion can occur if that constitutes the dielectric isolation zones Silicon dioxide comes into direct contact with the substrate material.
Die bis hierher beschriebenen Verfahrensschritte und die daraus resultierende Struktur gehören zum Stande der Technik. Im nächsten Verfahrensschritt wird vom bekannten Stand der Technik abgewichen und es wird in die Oberfläche des isolierten Bereiches der P~-dotierten Epitaxieschicht 2 ein N~dotiertes Gebiet 10 eingebracht. Dies kann vorzugsweise durch Ionenimplantation geschehen. Das Gebiet 10 wird zur Herstellung einer Schottky-Diode und zur leitenden Verbindung der Kathode dieser Diode mit dem Subkollektor 2 verwendet. Dieser Verfahrensschritt läßt sich am besten anhand der Fig. 2 erläutern, die den entsprechenden Ausschnitt der Struktur gem. Fig. 1 nach Einbringen der N~-dotierten Zone durch Ionenimplantation zeigt. Zunächst werden die pyrolithische Oxidschicht und die Siliciumnitridschicht der bei der Bildung der Isolation verwendeten Maske entfernt, so daß nur noch die thermische Oxidschicht 12 auf der Oberfläche der Anordnung vorhanden ist. Auf diese Oxidschicht 12 wird eine Photolackschicht 11 aufgebracht und in bekannter Weise mit einem Fenster im Bereich des zu implantierenden N~-dotierten Gebietes 10 versehen. Bei der Ionenimplantation dient die Photolackschicht 11 als Maske und die Oxidschicht 12 als Schutzschicht. Bei der Ionenimplantation wird eine Störstellenkonzentration von etwa 5 χ 10 Atomen/cm verwirklicht. Zur Ionenimplantation können bekannte Techniken angewandt werden, eine davon ist beispielsweise im US-Patent 3 388 009 beschrieben.The procedural steps described up to this point and the resulting ones resulting structure are well known in the art. In the next process step, there is a departure from the known state of the art and an N- doped region 10 is introduced into the surface of the isolated region of the P ~ -doped epitaxial layer 2. This can preferably be done by ion implantation. The area 10 is used for the manufacture of a Schottky diode and for conductive connection of the cathode of this diode to the subcollector 2 is used. This process step is best 2, which explain the corresponding section of the structure according to FIG. 1 after the N ~ -doped zone has been introduced by ion implantation shows. First, the pyrolytic oxide layer and the silicon nitride layer are used in the formation of the Isolation used mask removed, so that only the thermal oxide layer 12 is present on the surface of the arrangement is. A photoresist layer 11 is applied to this oxide layer 12 and provided in a known manner with a window in the area of the N ~ -doped region 10 to be implanted. In the For ion implantation, the photoresist layer 11 serves as a mask and the oxide layer 12 as a protective layer. In the case of ion implantation, realizes an impurity concentration of about 5 10 atoms / cm. Known techniques can be used for ion implantation, one of which is for example in the US patent 3 388 009.
Nach der Ionenimplantation wird die Photolackschicht 11 entfernt und in der Oxidschicht 12 im Bereich 13 ein Maskenfenster freigelegt. Durch dieses Maskenfenster erfolgt die Diffusion einer N+- dotierten KoIlektorkontaktierungszone 14. Nach der Diffusion wirdAfter the ion implantation, the photoresist layer 11 is removed and a mask window is exposed in the oxide layer 12 in the region 13. The diffusion of an N + -doped KoIlektorkontaktierungszone 14 takes place through this mask window. After the diffusion
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die Anordnung einem Reoxidationsprozeß unterworfen und gesintert, so daß man die Struktur gemäß Fig. 3 erhält. Die Struktur wird dann in weiteren Verfahrensschritten zu der erfindungsgemäßen · Transistorstruktur gem. Fig. 1 vervollständigt. Zunächst wird in einem Maskierungs- und Diffusionsprozeß der N -dotierte Emitter 15 in die P~-Basis 3 eingebracht. Vorzugsweise wird für den Emitter ein Schichtwiderstand von etwa 15 Ohm/Flächenquadrat vorgesehen. Bei einer Diffusionstiefe des Emitters 15 von etwa 0,5 pm ergibt sich zusammen mit der Ausdiffusion des Subkollektors 2 in die Epitaxieschicht 3 eine Basisweite von etwa 0,5 um zwischen Emitter 15 und Subkollektor 2. Schließlich werden der Emitterkontakt 16, der Basis- und Schottky-Kontakt 17 und der Kollektorkontakt 18 durch Aufdampfen eines geeigneten Metalls, beispielsweise Aluminium, hergestellt.the arrangement is subjected to a reoxidation process and sintered, so that the structure according to FIG. 3 is obtained. The structure is then in further process steps to the invention · Transistor structure according to Fig. 1 completed. First, the N -doped emitter is in a masking and diffusion process 15 introduced into the P ~ base 3. A sheet resistance of approximately 15 ohms / square is preferably provided for the emitter. With a diffusion depth of the emitter 15 of approximately 0.5 μm, this results together with the out-diffusion of the subcollector 2 in the epitaxial layer 3 has a base width of about 0.5 µm between Emitter 15 and sub-collector 2. Finally, the emitter contact 16, the base and Schottky contact 17 and the collector contact 18 by vapor deposition of a suitable metal, for example aluminum.
Der Kontakt 17 bildet mit der P~"-dotierten Epitaxieschicht 3, die die Basis 19 des NPN-Transistors darstellt, einen ohmschen Kontakt. Mit dem N~-dotierten ionenimplantierten Gebiet 10 bildet dieser Kontakt einen Schottky-Kontakt. Da das N--dotierte Gebiet 10 direkt an die N+-dotierte Kollektorkontaktierungszone 14 anschließt, ist die Kathode der erzeugten Schottky-Diode direkt ohmisch mit dem Kollektor bzw. dem Subkollektor 2 des Transistors verbunden. Es ist darauf hinzuweisen, daß die Schottky-Diode und die erforderlichen Verbindungen zur Basis und zum Kollektor in einfacher Weise dadurch herstellbar sind, daß zu den Prozeßschritten für die Herstellung der dielektrischen Isolation die damit verträglichen Prozeßschritte für die Ionenimplantation zugefügt werden.The contact 17 forms an ohmic contact with the P ~ "-doped epitaxial layer 3, which represents the base 19 of the NPN transistor. This contact forms a Schottky contact with the N ~ -doped ion-implanted region 10. doped region 10 directly connects to the N + -doped collector contact zone 14, the cathode of the Schottky diode produced is directly ohmically connected to the collector or the subcollector 2. It should be noted that the Schottky diode and the necessary connections to the base and to the collector can be produced in a simple manner in that the process steps for the ion implantation which are compatible therewith are added to the process steps for the production of the dielectric insulation.
Bjs ist darauf hinzuweisen, daß anstelle der dielektrischen Isolation andere Isolationstechniken verwendbar sind, beispielsweise die bekannte Sperrschichtisolation.Bjs should be noted that instead of dielectric insulation other isolation techniques can be used, such as the well known barrier isolation.
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Claims (7)
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dadurch gekennzeichnet,4. Integrated transistor according to claims 1 to 3,
characterized,
dadurch gekennzeichnet, ι daß die Störstellenkonzentration des Gebietes (10) etwa j 5 χ 1016 Atome/cm3 beträgt. ;7. Integrated transistor according to claims 1 to 6,
characterized in that the impurity concentration of the region (10) is approximately j 5 χ 10 16 atoms / cm 3 . ;
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US4159915A (en) * | 1977-10-25 | 1979-07-03 | International Business Machines Corporation | Method for fabrication vertical NPN and PNP structures utilizing ion-implantation |
US4282538A (en) * | 1977-11-11 | 1981-08-04 | Rca Corporation | Method of integrating semiconductor components |
US4329703A (en) * | 1978-07-21 | 1982-05-11 | Monolithic Memories, Inc. | Lateral PNP transistor |
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US4503521A (en) * | 1982-06-25 | 1985-03-05 | International Business Machines Corporation | Non-volatile memory and switching device |
US4538490A (en) * | 1983-05-02 | 1985-09-03 | Celanese Corporation | Staple fiber cutter |
US4586071A (en) * | 1984-05-11 | 1986-04-29 | International Business Machines Corporation | Heterostructure bipolar transistor |
US7329940B2 (en) * | 2005-11-02 | 2008-02-12 | International Business Machines Corporation | Semiconductor structure and method of manufacture |
US7718481B2 (en) * | 2006-04-17 | 2010-05-18 | International Business Machines Corporation | Semiconductor structure and method of manufacture |
US7538409B2 (en) * | 2006-06-07 | 2009-05-26 | International Business Machines Corporation | Semiconductor devices |
US7242071B1 (en) | 2006-07-06 | 2007-07-10 | International Business Machine Corporation | Semiconductor structure |
US7936041B2 (en) | 2006-09-15 | 2011-05-03 | International Business Machines Corporation | Schottky barrier diodes for millimeter wave SiGe BICMOS applications |
US9853643B2 (en) | 2008-12-23 | 2017-12-26 | Schottky Lsi, Inc. | Schottky-CMOS asynchronous logic cells |
US11342916B2 (en) | 2008-12-23 | 2022-05-24 | Schottky Lsi, Inc. | Schottky-CMOS asynchronous logic cells |
US11955476B2 (en) | 2008-12-23 | 2024-04-09 | Schottky Lsi, Inc. | Super CMOS devices on a microelectronics system |
US8476689B2 (en) | 2008-12-23 | 2013-07-02 | Augustine Wei-Chun Chang | Super CMOS devices on a microelectronics system |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3463975A (en) * | 1964-12-31 | 1969-08-26 | Texas Instruments Inc | Unitary semiconductor high speed switching device utilizing a barrier diode |
US3506893A (en) * | 1968-06-27 | 1970-04-14 | Ibm | Integrated circuits with surface barrier diodes |
US3571674A (en) * | 1969-01-10 | 1971-03-23 | Fairchild Camera Instr Co | Fast switching pnp transistor |
US3699362A (en) * | 1971-05-27 | 1972-10-17 | Ibm | Transistor logic circuit |
US3861968A (en) * | 1972-06-19 | 1975-01-21 | Ibm | Method of fabricating integrated circuit device structure with complementary elements utilizing selective thermal oxidation and selective epitaxial deposition |
US3878552A (en) * | 1972-11-13 | 1975-04-15 | Thurman J Rodgers | Bipolar integrated circuit and method |
-
1975
- 1975-06-20 US US05/588,918 patent/US4005469A/en not_active Expired - Lifetime
-
1976
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