[go: up one dir, main page]
More Web Proxy on the site http://driver.im/

CN113496880A - 碳化硅基板的底部氧化层增厚的制作方法 - Google Patents

碳化硅基板的底部氧化层增厚的制作方法 Download PDF

Info

Publication number
CN113496880A
CN113496880A CN202010251282.8A CN202010251282A CN113496880A CN 113496880 A CN113496880 A CN 113496880A CN 202010251282 A CN202010251282 A CN 202010251282A CN 113496880 A CN113496880 A CN 113496880A
Authority
CN
China
Prior art keywords
oxide layer
silicon carbide
thermal oxidation
carbide substrate
layer
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Withdrawn
Application number
CN202010251282.8A
Other languages
English (en)
Inventor
戴茂州
高巍
廖运健
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Chengdu Rongsi Semiconductor Co ltd
Original Assignee
Chengdu Rongsi Semiconductor Co ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Chengdu Rongsi Semiconductor Co ltd filed Critical Chengdu Rongsi Semiconductor Co ltd
Priority to CN202010251282.8A priority Critical patent/CN113496880A/zh
Publication of CN113496880A publication Critical patent/CN113496880A/zh
Withdrawn legal-status Critical Current

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/0445Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising crystalline silicon carbide
    • H01L21/048Making electrodes
    • H01L21/049Conductor-insulator-semiconductor electrodes, e.g. MIS contacts
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/40Electrodes ; Multistep manufacturing processes therefor
    • H01L29/401Multistep manufacturing processes
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/40Electrodes ; Multistep manufacturing processes therefor
    • H01L29/41Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
    • H01L29/423Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions not carrying the current to be rectified, amplified or switched
    • H01L29/42312Gate electrodes for field effect devices
    • H01L29/42316Gate electrodes for field effect devices for field-effect transistors
    • H01L29/4232Gate electrodes for field effect devices for field-effect transistors with insulated gate
    • H01L29/42356Disposition, e.g. buried gate electrode
    • H01L29/4236Disposition, e.g. buried gate electrode within a trench, e.g. trench gate electrode, groove gate electrode
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/40Electrodes ; Multistep manufacturing processes therefor
    • H01L29/41Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
    • H01L29/423Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions not carrying the current to be rectified, amplified or switched
    • H01L29/42312Gate electrodes for field effect devices
    • H01L29/42316Gate electrodes for field effect devices for field-effect transistors
    • H01L29/4232Gate electrodes for field effect devices for field-effect transistors with insulated gate
    • H01L29/42364Gate electrodes for field effect devices for field-effect transistors with insulated gate characterised by the insulating layer, e.g. thickness or uniformity

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Ceramic Engineering (AREA)
  • Manufacturing & Machinery (AREA)
  • Chemical & Material Sciences (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Drying Of Semiconductors (AREA)

Abstract

本发明公开了一种碳化硅基板的底部氧化层增厚的制作方法,其特征在于,包括:提供碳化硅基板;形成沟槽结构于碳化硅基板之中;进行第一次热氧化,用于该沟槽结构之中形成顶部氧化层、底部氧化层与侧壁氧化层;沉积保护层于该顶部氧化层、该底部氧化层与该侧壁氧化层之上;进行刻蚀,以移除覆盖该底部氧化层上面的该保护层,直到该底部氧化层、侧壁氧化层裸露出来,以形成刻蚀区;进行第二次热氧化,用于刻蚀区中形成氧化层于该底部氧化层之上;其中该热氧化过程的实施温度为大于1100℃。

Description

碳化硅基板的底部氧化层增厚的制作方法
技术领域
本发明涉及一种碳化硅基板,特别涉及一种碳化硅基板的底部氧化层增厚的制作方法。
背景技术
在半导体元件制程之中,氧化硅层的形成通常是以加热方式来执行。通过加热硅或碳化硅表面来生长二氧化硅。碳化硅(Silicon carbide,SiC)的氧化过程会于氧化物/碳化硅界面层产生积聚碳团及高密度的积存电荷。因此,在加热氧化之后,通常会施行另一个长时间氧化后的退火步骤。由于碳化硅具有宽能隙、高临界崩溃电场强度以及高热导率等特性,被认为是功率开关元件的极佳材料。另外,相较于蓝宝石基板而言,碳化硅基板与氮化镓之间的晶格匹配更佳,因此,于碳化硅基板更广泛的用于半导体元件之中。
发明内容
本发明的主要目的在于提供可以增加碳化硅基板的底部氧化层厚度的碳化硅基板结晶结构型态。为达到上述目的,本发明的技术方案是这样实现的:
本发明提供一种碳化硅基板的底部氧化层增厚的制作方法,其特征在于,包括:提供碳化硅基板;形成沟槽结构于碳化硅基板之中;进行第一次热氧化,以于该沟槽结构之中形成顶部氧化层、底部氧化层与侧壁氧化层;沉积保护层于该顶部氧化层、该底部氧化层与该侧壁氧化层之上;进行刻蚀以移除覆盖该底部氧化层上的保护层,直到底部氧化层、侧壁氧化层裸露出来,以形成刻蚀区;执行第二次热氧化,用于刻蚀区中形成氧化层于该底部氧化层之上;其中该热氧化过程的实施温度为大于1100℃。例如1100℃~1600℃的温度。
根据本发明的一观点,碳化硅基板具有上表面的(0001)晶面,侧面的
Figure BDA0002435577830000021
晶面。沟槽结构是通过光刻和刻蚀形成。该保护层之材料为石墨。
根据本发明的另一观点,第一次热氧化是通过湿氧的热氧化法来执行、干氧的热氧化法或气体分子NO及N2O的气体环境下执行。第一次热氧化是通过氮系列元素气体分子NO,NO2,N2O及NH3的至少一个的环境下执行。
此些优点及其他优点从以下较佳实施例之叙述及申请专利范围将使读者得以清楚了解本发明。
附图说明
如下所述的对本发明的详细描述与实施例的示意图,应使本发明更被充分地理解;然而,应可理解此仅限于作为理解本发明应用的参考,而非限制本发明于特定实施例之中。
图1为本发明实施例碳化硅基板示意图;
图2为本发明实施例的于碳化硅基板上形成光阻图案的示意图;
图3为本发明实施例的刻蚀碳化硅基板形成一沟槽的示意图;
图4为本发明实施例的碳化硅基板的沟槽的示意图;
图5为本发明实施例的执行加热氧化过程于碳化硅基板的沟槽的示意图;
图6为本发明实施例的淀积一保护层于沟槽结构之上的示意图;
图7为本发明实施例进行刻蚀以移除底部层的示意图;
图8为本发明实施例进行第二次热氧化过程于碳化硅基板沟槽底部的示意图;
图9为本发明实施例的形成厚底部氧化层沟槽结构的示意图。
主要部件附图标记:
100碳化硅基板 102水平上表面 104垂直面
106光阻图案 108刻蚀区域 110沟槽
112剩余的光阻 114沟槽的底部 116沟槽的侧壁
118上表面 120沟槽底部的氧化层 122沟槽侧壁的氧化层
124碳化硅基板的上表面的氧化层 126覆盖层 128侧壁层
130底部层 132刻蚀区 134底部的氧化层
具体实施方式
此处本发明将针对发明具体实施例及其观点加以详细描述,此类描述为解释本发明的结构或步骤流程,其供以说明之用而非用以限制本发明的权利要求。因此,除说明书中的具体实施例与较佳实施例外,本发明亦可广泛施行于其它不同的实施例中。
本发明的碳化硅基板的底部氧化层增厚的制作方法,如底下所述。首先,提供一碳化硅(SiC)基板100,如图1所示。在本发明之中,碳化硅基板100具有水平上表面102与垂直面104。举一实施例,碳化硅基板100具有上表面晶面为(0001)面与一侧面的晶面为
Figure BDA0002435577830000031
面。
在一实施例之中,碳化硅基板100可以应用于绝缘栅双极晶体管(Insulated GateBipolar Transistor:IGBT)半导体元件之中。IGBT半导体元件采用沟槽(Trench)结构。在此沟槽结构之中,将原来水平方向的栅极改为垂直方向。在沟槽结构的IGBT元件之中,由于相邻元胞的耗尽区(Depletion Region)不会互相靠近,因此寄生的结栅场效应晶体管(Junction Gate Field Effect Transistor:JFET)区得以消除。另外,沟槽结构的IGBT元件可以有效的抑制闩锁(Latch-Up)。
然后,在碳化硅基板100上形成光阻图案106,定义刻蚀区域108,如图2所示。其中光阻图案106可以利用光刻(Photolithography Process)来实现。接下来,以光阻图案106作为掩膜版进行刻蚀,形成沟槽110,如图3所示。沟槽110的长度、宽度、深度可以依照不同的元件而设计。刻蚀过程有例如湿法刻蚀、干法刻蚀、溅射刻蚀、或其他方法。在一些实施例中,形成沟槽110的刻蚀过程包括利用一种或多种刻蚀剂材料。在一些实施例中,刻蚀剂材料包括使用Cl2、SF6、HBr、HCl、CF4、CHF3、C2F6、C4F8、或其他类似的刻蚀剂材料的一种或多种。
之后,将剩余的光阻112移除,以形成底部114、侧壁116的沟槽以及上表面118,如图4所示。接着,进行热氧化(Thermal Oxidation),用于沟槽的底部114、侧壁116与碳化硅基板100的上表面118分别形成沟槽底部的氧化层120、沟槽侧壁的氧化层122与碳化硅基板100的上表面的氧化层124。在本实施例之中,在1450℃以下的温度(例如1100℃~1450℃的温度)实施热氧化过程,在碳化硅基板的沟槽结构的表面进行热氧化,以形成氧化层薄膜。
上述热氧化过程可以通过使用湿氧的热氧化法形成氧化层薄膜,或者通过使用干氧的热氧化法形成氧化层薄膜,或者通过使用干氧及氮的热氧化法形成氧化层薄膜。上述沟槽底部的氧化层120、沟槽侧壁的氧化层122与碳化硅基板100的上表面的氧化层124的厚度可以通过过程温度、热氧化时间、热氧化方法、或者其他参数条件来控制、决定。
在另一实施例之中,上述热氧化过程可以通过含有氮及氧的气体分子(NO)环境下,将碳化硅基板的沟槽结构表面进行热氧化而形成氧化层薄膜。例如,在包含有氮及氧的的气体分子(N2O)的气体环境下,将碳化硅基板的沟槽结构的表面进行热氧化而形成氧化层薄膜。另外,在包含作为含有氮及氧的气体分子NO及N2O的气体环境下,将碳化硅基板的沟槽结构的表面进行热氧化而形成氧化层薄膜。
接下来,沉积保护层于沟槽结构之上,如图6所示。保护层包含覆盖层(cap layer)126覆盖沟槽结构的上表面124、侧壁层(sidewall layer)128与底部层(bottom layer)130。保护层之材料选择耐高温的材料,例如石墨(graphite)。
然后,进行刻蚀,以移除底部层130的材料,直到沟槽底部的氧化层120、沟槽侧壁的氧化层122裸露出来,以形成刻蚀区132,如图7所示。在刻蚀中,由于侧壁层128可以保护沟槽侧壁的氧化层122,因此不会被刻蚀掉。在一些实施例中,刻蚀剂材料为H2或O2
之后,在刻蚀区132进行第二次热氧化,用于形成沟槽底部的氧化层134。在本实施例之中,实施热氧化过程的温度为大于1100℃,例如1100℃~1600℃,在碳化硅基板的沟槽结构的底部进行热氧化,以形成氧化层薄膜。由于原来的沟槽底部的氧化层120的厚度加上于刻蚀区132热氧化所形的氧化层的厚度,结果形成可以于碳化硅基板100之中形成厚底部氧化层(Thick Bottom Oxide:TBO)134的沟槽氧化层结构。第二次加热氧化过程可以参考前述的加热氧化过程。
最后,移除覆盖层126与侧壁层128的材料,以形成具有厚底部氧化层的碳化硅基板100,如图9所示。
以上所述,仅为本发明的具体实施方式,但本发明的保护范围并不局限于此,任何熟悉本技术领域的技术人员在本发明揭露的技术范围内,可轻易想到变化或替换,都应涵盖在本发明的保护范围之内。因此,本发明的保护范围应以所述权利要求的保护范围为准。

Claims (10)

1.一种碳化硅基板的底部氧化层增厚的制作方法,其特征在于,包含:提供碳化硅基板;形成沟槽结构于该碳化硅基板之中;进行第一次热氧化,以于该沟槽结构之中形成顶部氧化层、底部氧化层与侧壁氧化层;沉积保护层于该顶部氧化层、该底部氧化层与该侧壁氧化层之上;进行刻蚀,以移除覆盖该底部氧化层上面的该保护层,直到该底部氧化层、侧壁氧化层裸露出来,以形成一刻蚀区;以及进行第二次热氧化,以于该刻蚀区之中形成氧化层于该底部氧化层的上面;其中该热氧化过程的实施温度为大于1100℃。
2.根据权利要求1所述的碳化硅基板的底部氧化层增厚的制作方法,其特征在于,所述碳化硅基板具有上表面的0001晶面,侧面的
Figure FDA0002435577820000011
晶面。
3.根据权利要求1所述的碳化硅基板的底部氧化层增厚的制作方法,其特征在于,所述沟槽结构是通过刻蚀工艺而形成。
4.根据权利要求3所述的碳化硅基板的底部氧化层增厚的制作方法,其特征在于,所述刻蚀工艺的刻蚀剂材料包括以下至少之一:Cl2、SF6、HBr、HCl、CF4、CHF3、C2F6、C4F8
5.根据权利要求1所述的碳化硅基板的底部氧化层增厚的制作方法,其特征在于,所述保护层材料为石墨。
6.根据权利要求1所述的碳化硅基板的底部氧化层增厚的制作方法,其特征在于,更包含移除该保护层的覆盖层与侧壁层。
7.根据权利要求1所述的碳化硅基板的底部氧化层增厚的制作方法,其特征在于,所述第一次热氧化过程是通过湿氧的热氧化法来执行。
8.根据权利要求1所述的碳化硅基板的底部氧化层增厚的制作方法,其特征在于,所述第一次热氧化过程是通过干氧的热氧化法来执行。
9.根据权利要求1所述的碳化硅基板的底部氧化层增厚的制作方法,其特征在于,所述第一次热氧化过程是通过氮系列元素气体分子的环境下执行。
10.根据权利要求1所述的碳化硅基板的底部氧化层增厚的制作方法,其特征在于,所述第一次热氧化过程是在氮系列元素气体分子NO,NO2,N2O及NH3的至少一个的环境下执行。
CN202010251282.8A 2020-04-01 2020-04-01 碳化硅基板的底部氧化层增厚的制作方法 Withdrawn CN113496880A (zh)

Priority Applications (1)

Application Number Priority Date Filing Date Title
CN202010251282.8A CN113496880A (zh) 2020-04-01 2020-04-01 碳化硅基板的底部氧化层增厚的制作方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN202010251282.8A CN113496880A (zh) 2020-04-01 2020-04-01 碳化硅基板的底部氧化层增厚的制作方法

Publications (1)

Publication Number Publication Date
CN113496880A true CN113496880A (zh) 2021-10-12

Family

ID=77994064

Family Applications (1)

Application Number Title Priority Date Filing Date
CN202010251282.8A Withdrawn CN113496880A (zh) 2020-04-01 2020-04-01 碳化硅基板的底部氧化层增厚的制作方法

Country Status (1)

Country Link
CN (1) CN113496880A (zh)

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20090114969A1 (en) * 2007-11-06 2009-05-07 Denso Corporation Silicon carbide semiconductor device and related manufacturing method
CN103839807A (zh) * 2012-11-20 2014-06-04 北大方正集团有限公司 一种沟槽dmos管的制造方法及一种沟槽dmos管
JP2020035867A (ja) * 2018-08-29 2020-03-05 ラピスセミコンダクタ株式会社 半導体装置の製造方法および半導体装置

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20090114969A1 (en) * 2007-11-06 2009-05-07 Denso Corporation Silicon carbide semiconductor device and related manufacturing method
CN103839807A (zh) * 2012-11-20 2014-06-04 北大方正集团有限公司 一种沟槽dmos管的制造方法及一种沟槽dmos管
JP2020035867A (ja) * 2018-08-29 2020-03-05 ラピスセミコンダクタ株式会社 半導体装置の製造方法および半導体装置

Similar Documents

Publication Publication Date Title
JP6720962B2 (ja) 縦型炭化珪素半導体装置のトレンチのアニール処理装置、縦型炭化珪素半導体装置の製造方法および縦型炭化珪素半導体装置
KR101584023B1 (ko) SiC반도체소자 및 그 제조방법
TW201308443A (zh) 半導體裝置之製造方法
JP2007066944A (ja) 炭化珪素半導体装置及びその製造方法
JPH09260653A (ja) 半導体装置の製造方法
KR20140038559A (ko) 탄화규소 반도체 장치
JP2012160485A (ja) 半導体装置とその製造方法
CN114335144A (zh) 一种SiC MOSFET结构及其制造方法
US11127840B2 (en) Method for manufacturing isolation structure for LDMOS
JP2005056868A (ja) 炭化珪素半導体装置の製造方法
JP2013110331A (ja) 半導体装置の製造方法
CN108257861A (zh) 一种栅氧化层的制备方法及mos功率器件
JP7073767B2 (ja) 炭化珪素半導体装置の製造方法および炭化珪素基板の製造方法
JP6183224B2 (ja) 炭化珪素半導体装置の製造方法
JP2005229105A (ja) 半導体素子およびその製造方法
TW202137570A (zh) 半導體元件及其製造方法
JP2021082689A (ja) 炭化珪素半導体装置および炭化珪素半導体装置の製造方法
CN113496880A (zh) 碳化硅基板的底部氧化层增厚的制作方法
JP2008311260A (ja) 半導体装置の製造方法
CN113496884A (zh) 碳化硅基板的底部氧化层增厚的制作方法
CN113496883A (zh) 碳化硅基板的底部氧化层增厚的制作方法
CN113496882A (zh) 碳化硅栅极氧化层迁移率改善的制作方法
CN111489963B (zh) 一种沟槽转角处具有厚栅氧化层的SiC-MOSFET栅的制备方法
US20110084332A1 (en) Trench termination structure
US8853089B2 (en) Manufacturing method of semiconductor substrate

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination
WW01 Invention patent application withdrawn after publication

Application publication date: 20211012

WW01 Invention patent application withdrawn after publication