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CN113168811B - 一种eoa电路、显示面板及终端 - Google Patents

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CN113168811B CN201880097640.5A CN201880097640A CN113168811B CN 113168811 B CN113168811 B CN 113168811B CN 201880097640 A CN201880097640 A CN 201880097640A CN 113168811 B CN113168811 B CN 113168811B
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Abstract

一种EOA电路、显示面板及终端，该EOA电路包括：输出模块(10)，用于根据第一扫描信号(Gn)和时钟信号(ECKB)生成输出信号(Eout)；输出模块(10)还用于在第一扫描信号(Gn)为有效电平期间且时钟信号(ECKB)为无效电平期间，将输出信号(Eout)由高电平信号重置为低电平信号；控制模块(20)，用于在第一扫描信号(Gn)为无效电平期间，根据第二扫描信号(Gn‑2)，将输出信号(Eout)由低电平信号恢复至高电平信号。该EOA电路结构简单，占用空间小，有利于窄边框设计。

Description

一种EOA电路、显示面板及终端
技术领域
本发明涉及显示技术领域，更具体地说，涉及一种EOA电路、显示面板及终端。
背景技术
OLED(Organic Light-Emitting Diode，有机发光二极管)作为一种电流型发光器件，具有自发光、广视角、几乎无穷高的对比度、较低耗电、极高反应速度等优点，被广泛应用于显示技术领域。
OLED显示面板的显示需要由扫描驱动电路提供扫描驱动信号，扫描驱动电路主要由GOA(Gate D-IC On Array，显示面板扫描驱动)电路和EOA电路两部分组成。其中，EOA(Emission D-IC On Array，显示面板发光驱动)电路，其仅在数据输入阶段为低电平，在其它阶段均为高电平，即在数据输入阶段，EOA电路处于截止状态，不输出信号，驱动IC输出的数据信号经由驱动晶体管进入，完成数据信号的输入。
现有的EOA电路结构一般由8T1C(即8个晶体管和1个电容)组成，同时需要4条第一时钟信号(ECLK)和2条第二时钟信号(ECLKB)信号线，如图1所示为现有的8T1C的EOA电路的电路图，该EOA电路主要包括上拉控制模块、上拉输出模块、下拉控制模块和下拉输出模块，由图1中可以看出，该电路结构在布局(layout)时需要占用的空间较大，不利于窄边框设计。
发明内容
本发明要解决的技术问题在于，针对现有技术的上述电路结构复杂，占用空间大，不利于窄边框设计的缺陷，提供一种EOA电路、显示面板及终端。
本发明解决其技术问题所采用的技术方案是：提供一种EOA电路，包括：
输出模块，用于根据第一扫描信号和时钟信号生成输出信号；所述输出模块还用于在所述第一扫描信号为有效电平期间且所述时钟信号为无效电平期间，将所述输出信号由高电平信号重置为低电平信号；
控制模块，用于在所述第一扫描信号为无效电平期间，根据第二扫描信号，将所述输出信号由低电平信号恢复至高电平信号。
优选地，所述输出模块由N沟道金属氧化物半导体晶体管构成。
优选地，所述控制模块由N沟道金属氧化物半导体晶体管和P沟道金属氧化物半导体晶体管构成。
优选地，所述输出模块包括：
EOA电路的输出端；
第三晶体管，所述第三晶体管的第一电极连接所述时钟信号，所述第三晶体管第二电极连接所述EOA电路的输出端，所述第三晶体管的第三电极连接所述第一扫描信号。
优选地，所述控制模块包括：
第一晶体管，所述第一晶体管的第一电极连接高电平信号，所述第一晶体管的第二电极连接所述第三晶体管的第二电极，所述第一晶体管的第三电极连接所述第二扫描信号。
优选地，所述控制模块还包括：
第二晶体管，所述第二晶体管的第一电极连接所述第一晶体管的第二电极，所述第二晶体管的第二电极连接低电平信号，所述第二晶体管的第三电极与所述第一晶体管的第三电极短接并连接所述第二扫描信号。
优选地，所述第一晶体管为P沟道金属氧化物半导体晶体管，所述第二晶体管为N沟道金属氧化物半导体晶体管。
优选地，所述第一扫描信号为高电平时，所述第三晶体管导通。
优选地，所述第二扫描信号为高电平时，所述第一晶体管关断，所述第三晶体管导通。
优选地，所述第三晶体管的尺寸大于所述第一晶体管的尺寸。
优选地，在第一时段，第一扫描信号为低电平，第二扫描信号为高电平；当低电平的第一扫描信号施加至所述第三晶体管的第三电极时，所述第三晶体管关断，同时，高电平的第二扫描信号施加至所述第一晶体管和第二晶体管的第三电极，所述第一晶体管关断，第二晶体管导通；
低电平信号将第二晶体管的第一电极拉低，同时将所述EOA电路的输出端电压拉低，使所述EOA电路的输出端输出低电平信号。
优选地，在第二时段，当高电平的第一扫描信号施加至所述第三晶体管的第三电极时，所述第三晶体管导通，同时，低电平的第二扫描信号施加至所述第一晶体管和所述第二晶体管的第三电极，所述第一晶体管导通，所述第二晶体管关断；
高电平的时钟信号从所述第三晶体管的第一电极传送至所述第三晶体管的第二电极，并传送至所述EOA电路的输出端，同时，高电平信号从所述第一晶体管的第一电极传送至所述第一晶体管的第二电极，并传送至所述EOA电路的输出端，使所述EOA电路的输出端输出高电平信号。
优选地，在第三时段，当低电平的第二扫描信号施加至所述第一晶体管的第三电极和所述第三晶体管的第三电极时，所述第一晶体管导通，所述第二晶体管关断，同时，高电平的第一扫描信号施加至所述第三晶体管的第三电极，第三晶体管导通；
高电平信号从所述第一晶体管的第一电极传送至所述第一晶体管的第二电极，并传送至所述EOA电路的输出端，同时，低电平的时钟信号通过所述第三晶体管的第一电极传送至所述第三晶体管的第二电极并传送至所述EOA电路的输出端，使所述EOA电路的输出端输出低电平信号。
优选地，所述EOA电路为CMOS EOA电路。
本发明还提供一种显示面板，包括设置在边界区域的EOA电路，所述EOA电路为以上所述的EOA电路。
优选地，所述显示面板为液晶显示面板。
优选地，所述显示面板为OLED显示面板。
优选地，所述显示面板为AMOLED显示面板。
本发明还提供一种终端，包括以上所述的显示面板。
实施本发明的EOA电路，由于所采用的电路结构简单，可以大大缩小EOA电路的layout尺寸，layout占用空间小，大大有利于窄边框设计，可广泛应用于窄边框设计需求的显示面板。
附图说明
为了更清楚地说明本发明实施例，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。附图中：
图1是现有的8T1C的EOA电路的电路图；
图2是本发明提供的EOA电路的电路图；
图3是本发明提供的单级EOA电路的时序图；
图4是本发明提供的单级EOA电路的仿真结果图；
图5是本发明提供的多级EOA电路的时钟信号时序仿真结果图；
图6是本发明提供的EOA电路与现有的8T1C的EOA电路的layout尺寸对比图；
图7为本发明提供的EOA电路的位置示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
图2是本发明提供的一种EOA电路的电路图，该EOA电路可用于显示面板，其中，显示面板包括但不限于液晶显示面板(如TFT-LCD面板)、OLED显示面板、AMOLED显示面板、柔性显示面板等。
其中，该EOA电路可设置在显示面板的非显示区域，一般可设置在显示面板的边界区域，如可以设置显示面板的左右两侧。本发明的EOA电路可以为CMOS EOA电路。
如图2所示，本实施例中，该EOA电路包括输出模块10和控制模块20。其中，输出模块10用于第一扫描信号(Gn)和时钟信号(ECKB)生成输出信号；该输出模块10还用于在第一扫描信号(Gn)为有效电平期间且时钟信号(ECKB)为无效电平期间，将输出信号(Eout)由高电平信号重置为低电平信号。控制模块20，用于在第一扫描信号(Gn)为无效电平期间，根据第二扫描信号(Gn-2)，将输出信号(Eout)由低电平信号恢复至高电平信号。
这里，第一扫描信号(Gn)的有效电平期间为高电平期间，第一扫描信号(Gn)的无效电平期间为低电平期间。时钟信号(ECKB)的有效电平期间为高电平期间，时钟信号(ECKB)的无效电平期间为低电平期间。
可选的，本发明实施例中，输出模块10可以由N沟道金属氧化物半导体晶体管构成。
进一步地，在该实施例中，该输出模块10包括EOA电路的输出端(Eout)和第三晶体管T3。
该第三晶体管T3的第一电极连接时钟信号(ECKB)，第三晶体管T3第二电极连接EOA电路的输出端(Eout)，第三晶体管T3的第三电极连接第一扫描信号(Gn)。可以理解地，该第三晶体管T3可以为N沟道金属氧化物半导体晶体管，如N型MOS管。其中，第三晶体管T3的第一电极为N型MOS管的漏极，第三晶体管T3的第二电极为N型MOS管的源极，第三晶体管T3的第三电极为N型MOS管的栅极。本实施例中，当第一扫描信号(Gn)为高电平时，第三晶体管T3导通；当第一扫描信号(Gn)为低电平时，第三晶体管T3关断。其中，本发明实施例的第三晶体管的尺寸远大于第一晶体管的尺寸。
如图3所示，在第一时段(①)，第一扫描信号为低电平，第二扫描信号为高电平。当低电平的第一扫描信号施加至第三晶体管T3的第三电极时，第三晶体管T3关断，同时，高电平的第二扫描信号施加至第一晶体管T1和第二晶体管T2的第三电极，第一晶体管T1和第二晶体管T2导通；低电平信号将第二晶体管T2的第一电极拉低，同时将EOA电路的输出端(Eout)电压拉低，使EOA电路的输出端(Eout)输出低电平信号。
在第二时段(②)，当高电平的第一扫描信号(Gn)施加至第三晶体管T3的第三电极时，第三晶体管T3导通，同时，低电平的第二扫描信号(Gn-2)施加至第一晶体管T1和第二晶体管T2的第三电极，第一晶体管T1导通，第二晶体管T2关断；高电平的时钟信号(ECKB)从第三晶体管T3的第一电极传送至第三晶体管T3的第二电极，并传送至EOA电路的输出端(Eout)，同时，高电平信号(EGH)从第一晶体管T1的第一电极传送至第一晶体管T1的第二电极，并传送至EOA电路的输出端(Eout)，使EOA电路的输出端(Eout)输出高电平信号。
可选的，本发明实施例中，控制模块20可以由N沟道金属氧化物半导体晶体管和P沟道金属氧化物半导体晶体管构成。
进一步地，在该实施例中，该控制模块20包括第一晶体管T1。
该第一晶体管T1的第一电极连接高电平信号(EGH)，第一晶体管T1的第二电极连接第三晶体管T3的第二电极，第一晶体管T1的第三电极连接第二扫描信号(Gn-2)。可以理解地，该第一晶体管T1可以为P沟道金属氧化物半导体晶体管，如P型MOS管。其中，第一晶体管T1的第一电极为P型MOS管的漏极，第一晶体管T1的第二电极为P型MOS管的源极，第一晶体管T1的第三电极为P型MOS管的栅极。本实施例中，当第二扫描信号(Gn-2)为低电平时，第一晶体管T1导通；当第二扫描信号(Gn-2)为高电平时，第一晶体管T1关断。
进一步地，该控制模块20还包括第二晶体管T2。
该第二晶体管T2的第一电极连接第一晶体管T1的第二电极，第二晶体管T2的第二电极连接低电平信号(EGL)，第二晶体管T2的第三电极与第一晶体管T1的第三电极短接并连接第二扫描信号(Gn-2)。可以理解地，该第二晶体管T2可以为N沟道金属氧化物半导体晶体管，如N型MOS管。其中，第二晶体管T2的第一电极为N型MOS管的源极，第二晶体管T2的第二电极为N型MOS管的漏极，第二晶体管T2的第三电极为N型MOS管的栅极。本实施例中，当第二扫描信号(Gn-2)为低电平时，第二晶体管T2关断；当第二扫描信号(Gn-2)为高电平时，第二晶体管T2导通。
即如图2所示，第一晶体管T1为P型MOS管，第二晶体管T2为N型MOS管，且第一晶体管T1的栅极与第二晶体管T2的栅极短接，所以，当第二扫描信号(Gn-2)为低电平时，第一晶体管T1导通，第二晶体管T2关断；当第二扫描信号(Gn-2)为高电平时，第一晶体管T1关断，第二晶体管T2导通。
如图3所示，在第三时段(③)，当低电平的第二扫描信号(Gn-2)施加至第一晶体管T1的第三电极和第二晶体管T2的第三电极时，第一晶体管T1导通，第二晶体管T2关断，同时，高电平的第一扫描信号(Gn)施加至第三晶体管T3的第三电极，第三晶体管T3导通。
高电平信号(EGH)从第一晶体管T1的第一电极传送至第一晶体管T1的第二电极，并传送至EOA电路的输出端(Eout)，同时，低电平的时钟信号(ECKB)通过第三晶体管T3的第一电极传送至第三晶体管T3的第二电极并传送至EOA电路的输出端(Eout)，由于，第三晶体管T3的尺寸远大于第一晶体管T1的尺寸，所以EOA电路的输出端(Eout)保持在低电平，进而EOA电路的输出端(Eout)输出低电平信号。
进一步地，图3示出了本发明的EOA电路的单个时钟信号(ECKB)的时序仿真结果图。
如图3所示：在①时段：第二扫描信号(Gn-2)为高电平，第一扫描信号(Gn)为低电平，时钟信号(ECKB)为高电平，此时，第三晶体管T3关断，第一晶体管T1关断，第二晶体管T2导通，低电平信号(EGL)通过第二晶体管T2输出到P点，将EOA电路的输出端(Eout)下拉到低电平，，使EOA电路的输出端(Eout)输出低电平。
在②时段：第二扫描信号(Gn-2)为低电平，第一扫描信号(Gn)为高电平，时钟信号(ECKB)为高电平，此时，第三晶体管T3导通，第一晶体管T1导通，第二晶体管T2关断；高电平的时钟信号(ECKB)从第三晶体管T3的第一电极输入并通过第三晶体管T3的第二电极传送至EOA电路的输出端(Eout)，高电平信号(EGH)通过第一晶体管T1输出到P点，使EOA电路的输出端(Eout)输出高电平信号(EGH)至显示面板的显示区域。
在③时段：第二扫描信号(Gn-2)为低电平，第一扫描信号(Gn)为高电平，时钟信号(ECKB)为低电平，此时，第三晶体管T3导通，第一晶体管T1导通，第二晶体管T2关断；低电平的时钟信号(ECKB)施加在第三晶体管T3的第一电极上，通过第三晶体管T3输出到P点，同时高电平信号(EGH)通过第一晶体管T1输出到P点，此时，由于第三晶体管T3的尺寸远大于第一晶体管T1的尺寸，所以，P点的电压维持在低电平，进而将EOA电路的输出端(Eout)拉低至低电平，将EOA电路的输出端(Eout)的高电平信号(EGH)重置为低电平信号(EGL)。
在④时段：第二扫描信号(Gn-2)为低电平，第一扫描信号(Gn)为低电平，时钟信号(ECKB)为高电平，此时，第三晶体管T3关断，第一晶体管T1导通，第二晶体管T2关断；高电平信号(EGH)从第一晶体管T1的第一电极输入传送至第一晶体管T1的第二电极，由第一晶体管T1的第二电极将高电平信号(EGH)传送至EOA电路的输出端(Eout)，将EOA电路的输出端(Eout)由低电平信号恢复至高电平信号。
参考图4，为本发明实施例提供的单级EOA电路的仿真结果图。
对比图3和图4可以看出，仿真结果图与时序图结果相当。
结合图5，图5为本发明采用前述EOA电路及4条时钟信号(ECKB)的仿真结果。由图5中可以看出，本发明只采用前述的EOA电路及4条时钟信号(ECKB)线即可完成对显示面板中驱动TFT管的发光信号的输出。
综上，如图1和图5所示，本发明的EOA电路只需3个晶体管和4条时钟信号(ECKB)线即可完成EOA电路的输出信号的控制，相比现有的8T1C、4条CLK信号线和2条ECLKB信号线，稳定性更好，而且，晶体管的数量大大减小，而且信号线的数量也大大减小，进而大大简化了EOA电路的电路结构，在进行layout时可以有效缩小EOA电路占用的空间。如图6所示，为本发明的EOA电路的layout尺寸和现有8T1C的EOA电路的layout尺寸对比图，由图6中可以看出，本发明的每一级EOA电路的layout尺寸可以缩小到0.75mm，相比现有可以缩小达到50％，整体的EOA电路的layout尺寸可以缩小达到20％，因此，本发明的EOA电路可以有效缩小layout占用的空间，可应用于窄边框需求的设计。
本发明还提供了一种显示面板，该显示面板包括设置在边界区域的EOA电路，设置在该显示面板的边界区域的EOA电路为前述的EOA电路。其中，边界区域为显示面板的非显示区域。
参考图7，图7示出了本发明实施例提供的EOA电路一个具体实施例的位置图。
如图7所示，在该实施例中，该显示面板显示区域AA和两个EOA电路。显示区域AA位于显示面板的中部位置，显示区域AA外围与显示面板的边缘之间的区域形成边界区域。该两个EOA电路分别设置在显示区域AA的相对两侧的边界区域内。
在具体实施时，本发明实施例提供的显示面板可以为液晶显示面板(如TFT-LCD等)、或者，本发明实施例提供的显示面板可以为OLED显示面板；或者，本发明实施例提供的显示面板可以为AMOLED显示面板，当然，可以理解地，在其他一些实施例中，本发明实施例提供的显示面板还可以是其他类型的显示面板，如柔性显示面板等，本发明对此不作具体限定。
本发明还提供一种终端，该终端包括前述的显示面板。其中，终端包括但不限于智能手机、平板电脑、智能手表、智能可穿戴设备、智能家居等。
以上实施例只为说明本发明的技术构思及特点，其目的在于让熟悉此项技术的人士能够了解本发明的内容并据此实施，并不能限制本发明的保护范围。凡跟本发明权利要求范围所做的均等变化与修饰，均应属于本发明权利要求的涵盖范围。
应当理解的是，对本领域普通技术人员来说，可以根据上述说明加以改进或变换，而所有这些改进和变换都应属于本发明所附权利要求的保护范围。

Claims (16)

1.一种EOA电路，其特征在于，包括：
输出模块，用于根据第一扫描信号和时钟信号生成输出信号；所述输出模块还用于在所述第一扫描信号为有效电平期间且所述时钟信号为无效电平期间，将所述输出信号由高电平信号重置为低电平信号；控制模块，用于在所述第一扫描信号为无效电平期间，根据第二扫描信号，将所述输出信号由低电平信号恢复至高电平信号，
所述输出模块由N沟道金属氧化物半导体晶体管构成，
所述输出模块包括：
EOA电路的输出端；
第三晶体管，所述第三晶体管的第一电极连接所述时钟信号，所述第三晶体管第二电极连接所述EOA电路的输出端，所述第三晶体管的第三电极连接所述第一扫描信号，
所述控制模块包括：
第一晶体管，所述第一晶体管的第一电极连接高电平信号，所述第一晶体管的第二电极连接所述第三晶体管的第二电极，所述第一晶体管的第三电极连接所述第二扫描信号。
2.根据权利要求1所述的EOA电路，其特征在于，所述控制模块由N沟道金属氧化物半导体晶体管和P沟道金属氧化物半导体晶体管构成。
3.根据权利要求1所述的EOA电路，其特征在于，所述控制模块还包括：
第二晶体管，所述第二晶体管的第一电极连接所述第一晶体管的第二电极，所述第二晶体管的第二电极连接低电平信号，所述第二晶体管的第三电极与所述第一晶体管的第三电极短接并连接所述第二扫描信号。
4.根据权利要求3所述的EOA电路，其特征在于，所述第一晶体管为P沟道金属氧化物半导体晶体管，所述第二晶体管为N沟道金属氧化物半导体晶体管。
5.根据权利要求3所述的EOA电路，其特征在于，所述第一扫描信号为高电平时，所述第三晶体管导通。
6.根据权利要求3所述的EOA电路，其特征在于，所述第二扫描信号为高电平时，所述第一晶体管关断，所述第二晶体管导通。
7.根据权利要求1所述的EOA电路，其特征在于，所述第三晶体管的尺寸大于所述第一晶体管的尺寸。
8.根据权利要求3所述的EOA电路，其特征在于，在第一时段，第一扫描信号为低电平，第二扫描信号为高电平；当低电平的第一扫描信号施加至所述第三晶体管的第三电极时，所述第三晶体管关断，同时，高电平的第二扫描信号施加至所述第一晶体管和第二晶体管的第三电极，所述第一晶体管和第二晶体管导通；
低电平信号将第二晶体管的第一电极拉低，同时将所述EOA电路的输出端电压拉低，使所述EOA电路的输出端输出低电平信号。
9.根据权利要求3所述的EOA电路，其特征在于，在第二时段，当高电平的第一扫描信号施加至所述第三晶体管的第三电极时，所述第三晶体管导通，同时，低电平的第二扫描信号施加至所述第一晶体管和所述第二晶体管的第三电极，所述第一晶体管导通，所述第二晶体管关断；
高电平的时钟信号从所述第三晶体管的第一电极传送至所述第三晶体管的第二电极，并传送至所述EOA电路的输出端，同时，高电平信号从所述第一晶体管的第一电极传送至所述第一晶体管的第二电极，并传送至所述EOA电路的输出端，使所述EOA电路的输出端输出高电平信号。
10.根据权利要求3所述的EOA电路，其特征在于，在第三时段，当低电平的第二扫描信号施加至所述第一晶体管的第三电极和所述第二晶体管的第三电极时，所述第一晶体管导通，所述第二晶体管关断，同时，高电平的第一扫描信号施加至所述第三晶体管的第三电极，第三晶体管导通；
高电平信号从所述第一晶体管的第一电极传送至所述第一晶体管的第二电极，并传送至所述EOA电路的输出端，同时，低电平的时钟信号通过所述第三晶体管的第一电极传送至所述第三晶体管的第二电极并传送至所述EOA电路的输出端，使所述EOA电路的输出端输出低电平信号。
11.根据权利要求1所述的EOA电路，其特征在于，所述EOA电路为CMOS EOA电路。
12.一种显示面板，包括设置在边界区域的EOA电路，其特征在于，所述EOA电路为权利要求1-11任一项所述的EOA电路。
13.根据权利要求12所述的显示面板，其特征在于，所述显示面板为液晶显示面板。
14.根据权利要求12所述的显示面板，其特征在于，所述显示面板为OLED显示面板。
15.根据权利要求12所述的显示面板，其特征在于，所述显示面板为AMOLED显示面板。
16.一种终端，其特征在于，包括权利要求12-15任一项所述的显示面板。
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