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CN112233622B - Goa电路、显示面板 - Google Patents

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Abstract

本发明公开了一种GOA电路及显示面板，其中，GOA电路包括多个级联的GOA单元，前m级GOA单元包括开启电路。开启电路与对应的GOA单元的上拉控制模块连接，用于控制前m级GOA单元的上拉控制模块依次开启；其中，m为正整数。本发明通过与前m级GOA单元一一对应的开启电路控制前m级GOA单元的上拉控制模块依次开启，能够均衡前m级GOA单元节点Q的充电时间，提高显示面板亮度的均匀性。

Description

GOA电路、显示面板
技术领域
本发明涉及显示领域，具体涉及一种GOA电路、显示面板。
背景技术
GOA(Gate Driver on Array)技术即阵列基板行驱动技术，是利用薄膜晶体管(Thin Film Transistor，TFT)阵列制程将栅极扫描驱动电路制作在LCD及OLED显示装置的TFT阵列基板上，以实现逐行扫描的驱动方式，具有降低生产成本和实现面板窄边框设计的优点。GOA电路具有两项基本功能：第一是输出栅极扫描驱动信号，驱动面板内的栅极线，打开显示区内的TFT，以对像素进行充电；第二是移位寄存功能，当一个栅极扫描驱动信号输出完成后，通过时钟控制进行下一个栅极扫描驱动信号的输出，并依次传递下去。
现有的GOA电路的基本架构通常如图1所示(以8个时钟信号为例)，每行(前4级除外)的薄膜晶体管T1由输出端G(N-4)打开，节点Q(N)点位上升，薄膜晶体管T2打开且时钟信号CK(N)为高电平，输出端G(N)输出高电平，第N行的像素准备充电。由于前4级GOA的薄膜晶体管T1统一由起始信号STV信号打开，节点Q(N)点充电时间不相等，节点Q(1)-Q(4)充电时间依次减小，从而导致薄膜晶体管T2打开程度不同，输出端G(1)-G(4)输出电压不等，进而导致像素电路充电率不等，出现显示面板前4行亮度不均的问题。
因此，如何避免前面几级G0A单元输出端输出电压不等，进而导致显示面板亮度不均匀的问题成为了本领域技术人员亟待解决的技术问题和始终研究的重点。
发明内容
有鉴于此，本发明实施例提供了一种GOA电路、显示面板，以解决前面几级G0A单元输出端输出电压不等，进而导致显示面板亮度不均匀的问题。
为此，本发明实施例提供了如下技术方案：
本发明第一方面提供了一种GOA电路，包括多个级联的GOA单元，前m级GOA单元包括开启电路；
所述开启电路与对应的GOA单元的上拉控制模块连接，用于控制前m级GOA单元的上拉控制模块依次开启；其中，m为正整数。
进一步地，所述开启电路包括第一薄膜晶体管(T01)和第二薄膜晶体管(T02)；
所述第一薄膜晶体管(T01)的栅极连接下拉信号(PD)，源极连接起始信号(STV)，漏极连接所述开启电路的输出端；
所述第二薄膜晶体管(T02)的栅极连接上拉信号(PU)，源极连接恒压低电平信号(VSS)，漏极连接所述开启电路的输出端；
所述开启电路的输出端与对应的GOA单元的上拉控制模块连接。
进一步地，所述开启电路还包括第一电容(C0)；
所述第一电容(C0)的一端连接所述恒压低电平信号(VSS)，另一端连接所述开启电路的输出端。
进一步地，N为大于m的正整数，第N-m级GOA单元的级传信号输出端与第N级GOA单元的上拉控制模块相连，用于提供开启信号。
进一步地，所述上拉信号(PU)和所述下拉信号(PD)分别为独立的信号。
进一步地，所述上拉信号(PU)由第一时钟信号提供；
所述下拉信号(PD)由第二时钟信号提供。
本发明第二方面提供了一种显示面板，包括本发明第一方面任一实施例所述的GOA电路。
本发明实施例技术方案，具有如下优点：
本发明实施例提供了一种GOA电路。现有的GOA电路，以8个时钟信号为例，前4级GOA的薄膜晶体管通常由起始信号统一打开，导致像素电路充电率不等，出现显示面板前4行亮度不均的问题。本发明通过与前m级GOA单元一一对应的开启电路控制前m级GOA单元的上拉控制模块依次开启，能够均衡前m级GOA单元节点Q的充电时间，提高显示面板亮度的均匀性。
附图说明
为了更清楚地说明本发明具体实施方式或现有技术中的技术方案，下面将对具体实施方式或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图是本发明的一些实施方式，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为现有实施例的GOA电路图。
图2为本发明实施例的开启电路电路图。
图3为图1的GOA电路前4级GOA单元中节点Q的波形图。
图4为图2的GOA电路前4级GOA单元中节点Q的波形图。
图5为图1的GOA电路前16级GOA单元的输出波形图。
图6为图2的GOA电路前16级GOA单元的输出波形图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
在本申请的描述中，需要理解的是，术语“中心”、“纵向”、“横向”、“长度”、“宽度”、“厚度”、“上”、“下”、“前”、“后”、“左”、“右”、“竖直”、“水平”、“顶”、“底”、“内”、“外”、“顺时针”、“逆时针”等指示的方位或位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本申请和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本申请的限制。此外，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者更多个所述特征。在本申请的描述中，“多个”的含义是两个或两个以上，除非另有明确具体的限定。
在本申请的描述中，需要说明的是，除非另有明确的规定和限定，术语“安装”、“相连”、“连接”应做广义理解，例如，可以是固定连接，也可以是可拆卸连接，或一体地连接；可以是机械连接，也可以是电连接或可以相互通讯；可以是直接相连，也可以通过中间媒介间接相连，可以是两个元件内部的连通或两个元件的相互作用关系。对于本领域的普通技术人员而言，可以根据具体情况理解上述术语在本申请中的具体含义。
在本申请中，除非另有明确的规定和限定，第一特征在第二特征之“上”或之“下”可以包括第一和第二特征直接接触，也可以包括第一和第二特征不是直接接触而是通过它们之间的另外的特征接触。而且，第一特征在第二特征“之上”、“上方”和“上面”包括第一特征在第二特征正上方和斜上方，或仅仅表示第一特征水平高度高于第二特征。第一特征在第二特征“之下”、“下方”和“下面”包括第一特征在第二特征正下方和斜下方，或仅仅表示第一特征水平高度小于第二特征。
下文的公开提供了许多不同的实施方式或例子用来实现本申请的不同结构。为了简化本申请的公开，下文中对特定例子的部件和设置进行描述。当然，它们仅仅为示例，并且目的不在于限制本申请。此外，本申请可以在不同例子中重复参考数字和/或参考字母，这种重复是为了简化和清楚的目的，其本身不指示所讨论各种实施方式和/或设置之间的关系。此外，本申请提供了的各种特定的工艺和材料的例子，但是本领域普通技术人员可以意识到其他工艺的应用和/或其他材料的使用。
图1为现有实施例的GOA电路图。如图1所示，上拉控制模块包括薄膜晶体管T1。薄膜晶体管T1由第N-4级的GOA单元的级传信号输出端G(N-4)打开。节点Q(N)电位上升，上拉薄膜晶体管T2打开且时钟信号CK(N)为高电平，级传信号输出端G(N)输出高电平，第N行的像素准备充电。由于前4级GOA单元上拉控制模块的薄膜晶体管T1统一由起始信号STV打开，节点Q(N)充电时间不相等，节点Q(1)-Q(4)充电时间依次减小，从而导致前4级GOA单元中薄膜晶体管T2的打开程度不同，级传信号输出端G(1)-G(4)的输出电压不等，进而导致像素电路充电率不等，出现显示面板前4行亮度不均的问题。
本发明提供了一种GOA电路，包括多个级联的GOA单元，前m级GOA单元包括开启电路。开启电路与对应的GOA单元的上拉控制模块连接，用于控制前m级GOA单元的上拉控制模块依次开启；其中，m为正整数。
本实施例中，每一个单级GOA单元均包括节点Q和分别电性连接于节点Q的上拉控制模块、上拉模块和下拉模块。上拉控制模块用于拉升节点Q的电位。上拉模块用于在节点Q的电位控制下输出输出信号。下拉模块用于将节点Q的电位拉低为低电位，并用于将输出级传信号拉低为低电位。N为大于m的正整数，第N级GOA单元的上拉控制模块由第N-m级GOA单元的级传信号输出端开启。前m级GOA单元的开启电路按照从第1级到第m级的顺序依次向对应的上拉控制模块发送开启信号。相邻的两级GOA单元的开启电路间隔设定时长发送开启信号。
与现有技术相比，本发明通过与前m级GOA单元一一对应的开启电路控制前m级GOA单元的上拉控制模块依次开启，能够均衡前m级GOA单元节点Q的充电时间，提高显示面板亮度的均匀性。
图2为本发明实施例的开启电路电路图。如图2所示，在一个具体的实施方式中，开启电路包括第一薄膜晶体管T01和第二薄膜晶体管T02。第一薄膜晶体管T01的栅极连接下拉信号PD，源极连接起始信号STV，漏极连接开启电路的输出端。第二薄膜晶体管T02的栅极连接上拉信号PU，源极连接恒压低电平信号VSS，漏极连接开启电路的输出端。开启电路的输出端与对应的GOA单元的上拉控制模块连接。
本实施例中，上拉控制模块包括薄膜晶体管T1。开启电路的输出端与薄膜晶体管T1的栅极相连。优选地，上拉信号PU和下拉信号PD分别由独立的控制芯片提供。上拉信号PU可选由第一时钟信号提供。下拉信号PD可选由第二时钟信号提供。
在一个具体的实施方式中，开启电路还包括第一电容(C0)。第一电容(C0)的一端连接恒压低电平信号(VSS)，另一端连接开启电路的输出端。
本实施例中，第一电容(C0)能够调节GOA电路的输出波形。
在一个具体的实施方式中，N为大于m的正整数，第N-m级GOA单元的级传信号输出端与第N级GOA单元的上拉控制模块相连，用于提供开启信号。
本实施例中，m可选为4。第N级GOA单元的第三薄膜晶体管T1的栅极连接第N-4级GOA单元的级传信号输出端，源极和漏极分别连接第N-4级GOA单元的级传信号输出端和第N级GOA单元的节点Q。
图3为图1的GOA电路前4级GOA单元中节点Q的波形图。如图3中上面一条为初始信号STV的波形，下面4条为第1至第4级GOA单元的节点Q的波形。图4为图2的GOA电路前4级GOA单元中节点Q的波形图。如图4中上面一条为初始信号STV的波形，下面4条为第1至第4级GOA单元的节点Q的波形。图5为图1的GOA电路前16级GOA单元的输出波形图。图5中，从上到下依次为开启电压、上升时间、下降时间、关闭电压。图6为图2的GOA电路前16级GOA单元的输出波形图。图6中，从上到下依次为开启电压、上升时间、下降时间、关闭电压。如图3、4、5、6所示，本发明实施例提供的GOA电路，前4行的节点Q(N)输出(包括开启/关闭电压VG_on/VG_off及上升时间rise time、下降时间fall time)的均匀性明显好于现有GOA电路。且本发明实施例提供的GOA电路5-16行的输出与现有GOA电路相同。与现有技术相比，本发明开启电路能够均衡前4级GOA单元节点Q的充电时间，同时不影响其他GOA单元的输出，能够提高显示面板亮度的均匀性。
本发明还提供了了一种显示面板，包括本发明任一实施例的GOA电路。
虽然结合附图描述了本发明的实施例，但是本领域技术人员可以在不脱离本发明的精神和范围的情况下作出各种修改和变型，这样的修改和变型均落入由所附权利要求所限定的范围之内。

Claims (4)

1.一种GOA电路，包括多个级联的GOA单元，其特征在于，前m级GOA单元包括开启电路；所述开启电路与对应的GOA单元的上拉控制模块连接，用于控制前m级GOA单元的上拉控制模块依次开启；其中，m为正整数；
其中，所述开启电路包括第一薄膜晶体管(T01)和第二薄膜晶体管(T02)；
所述第一薄膜晶体管(T01)的栅极连接下拉信号(PD)，源极连接恒压低电平信号(VSS)，漏极连接所述开启电路的输出端；
所述第二薄膜晶体管(T02)的栅极连接上拉信号(PU)，源极连接起始信号(STV)，漏极直接连接所述开启电路的输出端；
所述上拉信号(PU)和所述下拉信号(PD)分别为独立的信号；
所述开启电路的输出端与对应的GOA单元的上拉控制模块连接；
所述开启电路还包括第一电容(C0)；所述第一电容(C0)的一端连接所述恒压低电平信号(VSS)，另一端连接所述开启电路的输出端。
2.根据权利要求1所述的GOA电路，其特征在于，N为大于m的正整数，第N-m级GOA单元的级传信号输出端与第N级GOA单元的上拉控制模块相连，用于提供开启信号。
3.根据权利要求1所述的GOA电路，其特征在于，所述上拉信号(PU)由第一时钟信号提供；
所述下拉信号(PD)由第二时钟信号提供。
4.一种显示面板，其特征在于，包括权利要求1-3任一项所述的GOA电路。
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