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CN114023253B - 像素电路及显示装置 - Google Patents

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CN114023253B CN202111356204.5A CN202111356204A CN114023253B CN 114023253 B CN114023253 B CN 114023253B CN 202111356204 A CN202111356204 A CN 202111356204A CN 114023253 B CN114023253 B CN 114023253B
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Abstract

本申请提供一种像素电路及显示装置；该像素电路包括驱动单元、与驱动单元电性连接的发光控制单元、以及与驱动单元电性连接的第一复位单元，且第一复位单元的第一端电性连接驱动单元，第一复位单元的第二端电性连接第一恒压信号输入端，第一复位单元的控制端电性连接第一复位信号输入端。本申请通过设置与驱动单元电性连接的第一复位单元，利用第一复位单元对驱动单元的电压进行调节，缓解驱动单元在低频显示时受到的单向电应力，使流经驱动单元的电流趋于稳定，进而提升显示装置在低频显示时的显示效果。

Description

像素电路及显示装置
技术领域
本申请涉及显示技术领域，尤其涉及一种像素电路及显示装置。
背景技术
低频驱动显示是目前显示技术发展的一个重要方向。传统的7T1C(由7个晶体管和1个存储电容组成)像素电路中使用的晶体管多为低温多晶硅晶体管，这种晶体管的一个明显缺陷是漏电流较大，在低频显示条件下会严重影响显示效果。目前的一个解决方案是将与驱动晶体管连接的晶体管采用金属氧化物晶体管替代，金属氧化物晶体管可以在一定程度上缓解与驱动晶体管之间的漏电流。但是由于低频驱动显示时，画面停留时间较长，驱动晶体管受到长时间电应力的作用而出现阈值电压偏移，使得流经驱动晶体管的电流发生变化，进而导致显示面板的发光亮度变化而出现闪烁问题。
所以，目前的像素电路存在低频显示时流经驱动晶体管电流发生变化的技术问题。
发明内容
本申请提供一种像素电路及显示装置，用于缓解目前像素电路存在的低频显示时流经驱动晶体管电流发生变化的技术问题。
本申请提供一种像素电路，其包括：
驱动单元，电性连接于第一电源输入端与发光单元之间；
发光控制单元，电性连接于所述第一电源输入端与所述发光单元之间，且与所述驱动单元电性连接；
第一复位单元，所述第一复位单元的第一端电性连接所述驱动单元，所述第一复位单元的第二端电性连接第一恒压信号输入端，所述第一复位单元的控制端电性连接第一复位信号输入端。
在本申请的像素电路中，所述像素电路还包括第二复位单元，所述第二复位单元的第一端电性连接所述发光单元，所述第二复位单元的第二端电性连接第二恒压信号输入端，所述第二复位单元的控制端电性连接第二复位信号输入端。
在本申请的像素电路，所述像素电路还包括第三复位单元，所述第三复位单元的第一端电性连接所述发光单元，所述第三复位单元的第二端电性连接所述第二恒压信号输入端，所述第三复位单元的控制端电性连接第一扫描信号输入端。
在本申请的像素电路，所述发光控制单元包括第一发光控制单元和第二发光控制单元，所述第一发光控制单元电性连接于所述第一电源输入端与所述驱动单元之间，所述第二发光控制单元电性连接于所述驱动单元与所述发光单元之间。
在本申请的像素电路，所述第一复位单元的第一端电性连接于所述第一发光控制单元与所述驱动单元之间。
在本申请的像素电路，所述第一复位单元的第一端电性连接于所述驱动单元与所述第二发光控制单元之间。
在本申请的像素电路，所述第二复位单元的第一端和所述第三复位单元的第一端均电性连接于所述第二发光控制单元与所述发光单元之间。
在本申请的像素电路，所述像素电路还包括：
输入单元，所述输入单元的第一端电性连接于所述第一发光控制单元与所述驱动单元之间，所述输入单元的第二端电性连接数据信号输入端，所述输入单元的控制端电性连接所述第一扫描信号输入端；
补偿单元，所述补偿单元的第一端电性连接所述驱动单元的控制端，所述补偿单元的第二端电性连接于所述驱动单元与所述第二发光控制单元之间，所述补偿单元的控制端电性连接第二扫描信号输入端；
初始化单元，所述初始化单元的第一端电性连接所述驱动单元的控制端，所述初始化单元的第二端电性连接第三恒压信号输入端，所述初始化单元的控制端电性连接所述第二扫描信号输入端。
在本申请的像素电路，所述驱动单元包括第一晶体管，所述第一发光控制单元包括第二晶体管，所述第二发光控制单元包括第三晶体管，所述第一复位单元包括第四晶体管，所述第二复位单元包括第五晶体管，所述第三复位单元包括第六晶体管，所述补偿单元包括第七晶体管，所述输入单元包括第八晶体管，所述初始化单元包括第九晶体管；
所述第二晶体管的栅极、源极和漏极分别电性连接第一控制信号输入端、所述第一电源输入端和所述第一晶体管的源极，所述第三晶体管的栅极、源极和漏极分别电性连接第二控制信号输入端、所述第一晶体管的漏极和所述发光单元，所述第四晶体管的栅极、源极和漏极分别电性连接所述第一复位信号输入端、所述第一恒压信号输入端和所述第一晶体管的源极或漏极，所述第五晶体管的栅极、源极和漏极分别电性连接所述第二复位信号输入端、所述第二恒压信号输入端和所述发光单元，所述第六晶体管的栅极、源极和漏极分别电性连接所述第一扫描信号输入端、所述第二恒压信号输入端和所述发光单元，所述第七晶体管的栅极、源极和漏极分别电性连接所述第二扫描信号输入端、所述第一晶体管的栅极和所述第一晶体管的漏极，所述第八晶体管的栅极、源极和漏极分别电性连接所述第一扫描信号输入端、所述数据信号输入端和所述第一晶体管的源极，所述第九晶体管的栅极、源极和漏极分别电性连接所述第二扫描信号输入端、所述第三恒压信号输入端和所述第一晶体管的栅极。
本申请还提供一种显示装置，其包括如上所述的像素电路。
本申请的有益效果是：本申请提供一种像素电路及显示装置，该像素电路包括驱动单元、与驱动单元电性连接的发光控制单元、以及与驱动单元电性连接的第一复位单元，且第一复位单元的第一端电性连接驱动单元，第一复位单元的第二端电性连接第一恒压信号输入端，第一复位单元的控制端电性连接第一复位信号输入端。本申请通过设置与驱动单元电性连接的第一复位单元，利用第一复位单元对驱动单元的电压进行调节，缓解驱动单元在低频显示时受到的单向电应力，使流经驱动单元的电流趋于稳定，进而提升显示装置在低频显示时的显示效果。
附图说明
下面结合附图，通过对本申请的具体实施方式详细描述，将使本申请的技术方案及其它有益效果显而易见。
图1是本申请实施例提供的第一种像素电路的结构原理图。
图2是本申请实施例提供的第二种像素电路的结构原理图。
图3是本申请实施例提供的第三种像素电路的结构原理图。
图4是本申请实施例提供的第四种像素电路的结构原理图。
图5是采用本申请实施例提供的像素电路驱动显示装置在不同频率下显示的驱动方式示意图。
图6是本申请实施例提供的像素电路的驱动时序图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
本申请实施例提供一种像素电路及显示装置，所述像素电路包括驱动单元、与所述驱动单元电性连接的发光控制单元、以及与所述驱动单元电性连接的第一复位单元，且所述第一复位单元的第一端电性连接所述驱动单元，所述第一复位单元的第二端电性连接第一恒压信号输入端，所述第一复位单元的控制端电性连接第一复位信号输入端。本申请实施例通过设置与驱动单元电性连接的第一复位单元，利用第一复位单元对驱动单元的电压进行调节，缓解驱动单元在低频显示时受到的单向电应力，使流经驱动单元的电流趋于稳定，进而提升显示装置在低频显示时的显示效果。
下面结合附图对本申请实施例提供的像素电路的结构和功能进行阐述。
在一种实施例中，请参阅图1，图1是本申请实施例提供的第一种像素电路的结构原理图。该像素电路包括驱动单元10、发光控制单元、第一复位单元30，其中，所述发光控制单元可以包括第一发光控制单元21和第二发光控制单元22。所述驱动单元10电性连接于第一电源输入端VDD与发光单元L之间；所述发光控制单元电性连接于所述第一电源输入端VDD与所述发光单元L之间，且与所述驱动单元10电性连接；所述第一复位单元30与所述驱动单元10电性连接，用于调整流经所述驱动单元10的电流。
具体地，所述第一发光控制单元21电性连接于所述第一电源输入端VDD与所述驱动单元10之间，且所述第一发光控制单元21的控制端电性连接第一控制信号输入端EM1；所述第二发光控制单元22电性连接于所述驱动单元10与所述发光单元L之间，且所述第二发光控制单元22的控制端电性连接第二控制信号输入端EM2；所述发光单元L的另一端电性连接第二电源输入端VSS。所述第一复位单元30的第一端电性连接于所述第一发光控制单元21与所述驱动单元10之间，所述第一复位单元30的第二端电性连接第一恒压信号输入端V1，所述第一复位单元30的控制端电性连接第一复位信号输入端F1。
可以理解，所述第一电源输入端VDD和所述第二电源输入端VSS分别提供电压信号，且所述第一电源输入端VDD提供的电压大于所述第二电源输入端VSS提供的电压；所述第一恒压信号输入端V1用于提供特定的恒定电压，该恒定电压可以根据所述驱动单元10的需求进行设定；所述第一复位信号输入端F1用于提供特定方波信号，以控制所述第一复位单元30将所述第一恒压信号输入端V1输入的恒定电压周期性的输入所述驱动单元10，以缓解所述驱动单元10在单向电应力的作用下而产生的电流变化。并且，对于低频显示驱动，本申请实施例可以在保证扫描信号维持低频扫描的前提下，通过第一复位信号输入端F1输入的信号控制对驱动单元10的工作状态的复位，防止流经驱动单元10的电流变化，从而无需在低频驱动下提升部分扫描信号的频率，因此，本申请实施例还有利于降低像素电路的整体能耗。
可选地，所述第一控制信号输入端EM1和所述第二控制信号输入端EM2可以输入相同的控制信号，也可以根据需要输入不同的控制信号。
进一步地，所述像素电路还包括第三复位单元50、补偿单元60、输入单元70和初始化单元80。所述第三复位单元50用于对所述发光单元L的输入端电压进行复位；所述补偿单元60用于补偿所述驱动单元10的控制端电压；所述输入单元70用于输入数据信号并通过所述驱动单元10驱动所述发光单元L进行发光；所述初始化单元80用于对所述驱动单元10的控制端电压进行初始化操作。
所述第三复位单元50的第一端电性连接所述发光单元，所述第三复位单元50的第二端电性连接第二恒压信号输入端V2，所述第三复位单元50的控制端电性连接第一扫描信号输入端S1。其中，所述第三复位单元50的第一端和第二端分别指第三复位单元50的输出和输入端；所述第二恒压信号输入端V2用于提供特定电压，该特定电压可以根据发光单元L的需求进行设定；所述第一扫描信号输入端S1用于提供周期性的扫描信号，以控制所述第三复位单元50将所述第二恒压信号输入端V2输入的特定电压周期性的输入所述发光单元L，从而完成对发光单元L的复位操作。
所述补偿单元60的第一端电性连接所述驱动单元10的控制端，所述补偿单元60的第二端电性连接于所述驱动单元10与所述第二发光控制单元22之间，所述补偿单元60的控制端电性连接第二扫描信号输入端S2。其中，所述补偿单元60的第一端和第二端分别指补偿单元60的输出和输入端；所述第二扫描信号输入端S2用于提供周期性的扫描信号，以控制所述补偿单元60选择是否将所述驱动单元10的控制端电性连接至所述驱动单元10与所述第二发光控制单元22之间。
所述输入单元70的第一端电性连接于所述第一发光控制单元21与所述驱动单元10之间，所述输入单元70的第二端电性连接数据信号输入端Da，所述输入单元70的控制端电性连接所述第一扫描信号输入端S1。其中，所述输入单元70的第一端和第二端分别指输入单元70的输出和输入端；所述数据信号输入端Da用于输入数据信号；所述第一扫描信号输入端S1输入的扫描信号控制所述输入单元70将所述数据信号传输至所述驱动单元10，并通过所述驱动单元10驱动所述发光单元L进行发光。
所述初始化单元80的第一端电性连接所述驱动单元10的控制端，所述初始化单元80的第二端电性连接第三恒压信号输入端V3，所述初始化单元80的控制端电性连接所述第二扫描信号输入端S2。其中，所述初始化单元80的第一端和第二端分别指初始化单元80的输出和输入端；所述第三恒压信号输入端V3用于提供初始电压；所述第二扫描信号输入端S2输入的扫描信号控制所述初始化单元80将第三恒压信号输入端V3提供的初始电压传输至所述驱动单元10的控制端，以实现对所述驱动单元10的控制端进行初始化操作。
进一步地，所述驱动单元10包括第一晶体管T1，所述第一发光控制单元21包括第二晶体管T2，所述第二发光控制单元22包括第三晶体管T3，所述第一复位单元30包括第四晶体管T4，所述第三复位单元50包括第六晶体管T6，所述补偿单元60包括第七晶体管T7，所述输入单元70包括第八晶体管T8，所述初始化单元80包括第九晶体管T9。
其中，所述第二晶体管T2的栅极、源极和漏极分别电性连接所述第一控制信号输入端EM1、所述第一电源输入端VDD和所述第一晶体管T1的源极，所述第三晶体管T3的栅极、源极和漏极分别电性连接第二控制信号输入端EM2、所述第一晶体管T1的漏极和所述发光单元L，所述第四晶体管T4的栅极、源极和漏极分别电性连接所述第一复位信号输入端F1、所述第一恒压信号输入端V1和所述第一晶体管T1的源极或漏极，所述第六晶体管T6的栅极、源极和漏极分别电性连接所述第一扫描信号输入端S1、所述第二恒压信号输入端V2和所述发光单元L，所述第七晶体管T7的栅极、源极和漏极分别电性连接所述第二扫描信号输入端S2、所述第一晶体管T1的栅极和所述第一晶体管T1的漏极，所述第八晶体管T8的栅极、源极和漏极分别电性连接所述第一扫描信号输入端S1、所述数据信号输入端Da和所述第一晶体管T1的源极，所述第九晶体管T9的栅极、源极和漏极分别电性连接所述第二扫描信号输入端S2、所述第三恒压信号输入端V3和所述第一晶体管T1的栅极。
所述像素电路还包括第一电容C1和第二电容C2，所述第一电容C1的相对两端分别电性连接所述第一电源输入端VDD和所述第一晶体管T1的栅极，所述第二电容C2的相对两端分别电性连接所述第一扫描信号输入端S1和所述第一晶体管T1的栅极。
在另一种实施例中，请参阅图2，图2是本申请实施例提供的第二种像素电路的结构原理图。可以理解，本实施例提供的像素电路与上述实施例记载的像素电路具有相同或相似的结构特征，下面对本实施例中的像素电路进行说明，其中未详述之处请参阅上述实施例的记载。
该像素电路包括驱动单元10、发光控制单元、第一复位单元30、第三复位单元50、补偿单元60、输入单元70和初始化单元80。所述发光控制单元可以包括第一发光控制单元21和第二发光控制单元22。所述第一复位单元30电性连接于所述驱动单元10与所述第二发光控制单元22之间，用于调整流经所述驱动单元10的电流。
所述第一发光控制单元21电性连接于所述第一电源输入端VDD与所述驱动单元10之间，且所述第一发光控制单元21的控制端电性连接第一控制信号输入端EM1；所述第二发光控制单元22电性连接于所述驱动单元10与所述发光单元L之间，且所述第二发光控制单元22的控制端电性连接第二控制信号输入端EM2；所述发光单元L的另一端电性连接第二电源输入端VSS。所述第一复位单元30的第一端电性连接于所述驱动单元10与所述第二发光控制单元22之间，所述第一复位单元30的第二端电性连接第一恒压信号输入端V1，所述第一复位单元30的控制端电性连接第一复位信号输入端F1。
所述第三复位单元50的第一端电性连接所述发光单元，所述第三复位单元50的第二端电性连接第二恒压信号输入端V2，所述第三复位单元50的控制端电性连接第一扫描信号输入端S1。所述补偿单元60的第一端电性连接所述驱动单元10的控制端，所述补偿单元60的第二端电性连接于所述驱动单元10与所述第二发光控制单元22之间，所述补偿单元60的控制端电性连接第二扫描信号输入端S2。所述输入单元70的第一端电性连接于所述第一发光控制单元21与所述驱动单元10之间，所述输入单元70的第二端电性连接数据信号输入端Da，所述输入单元70的控制端电性连接所述第一扫描信号输入端S1。所述初始化单元80的第一端电性连接所述驱动单元10的控制端，所述初始化单元80的第二端电性连接第三恒压信号输入端V3，所述初始化单元80的控制端电性连接所述第二扫描信号输入端S2。
进一步地，所述驱动单元10包括第一晶体管T1，所述第一发光控制单元21包括第二晶体管T2，所述第二发光控制单元22包括第三晶体管T3，所述第一复位单元30包括第四晶体管T4，所述第三复位单元50包括第六晶体管T6，所述补偿单元60包括第七晶体管T7，所述输入单元70包括第八晶体管T8，所述初始化单元80包括第九晶体管T9。
其中，所述第二晶体管T2的栅极、源极和漏极分别电性连接所述第一控制信号输入端EM1、所述第一电源输入端VDD和所述第一晶体管T1的源极，所述第三晶体管T3的栅极、源极和漏极分别电性连接第二控制信号输入端EM2、所述第一晶体管T1的漏极和所述发光单元L，所述第四晶体管T4的栅极、源极和漏极分别电性连接所述第一复位信号输入端F1、所述第一恒压信号输入端V1和所述第一晶体管T1的源极或漏极，所述第六晶体管T6的栅极、源极和漏极分别电性连接所述第一扫描信号输入端S1、所述第二恒压信号输入端V2和所述发光单元L，所述第七晶体管T7的栅极、源极和漏极分别电性连接所述第二扫描信号输入端S2、所述第一晶体管T1的栅极和所述第一晶体管T1的漏极，所述第八晶体管T8的栅极、源极和漏极分别电性连接所述第一扫描信号输入端S1、所述数据信号输入端Da和所述第一晶体管T1的源极，所述第九晶体管T9的栅极、源极和漏极分别电性连接所述第二扫描信号输入端S2、所述第三恒压信号输入端V3和所述第一晶体管T1的栅极。
所述像素电路还包括第一电容C1和第二电容C2，所述第一电容C1的相对两端分别电性连接所述第一电源输入端VDD和所述第一晶体管T1的栅极，所述第二电容C2的相对两端分别电性连接所述第一扫描信号输入端S1和所述第一晶体管T1的栅极。
在另一种实施例中，请参阅图3，图3是本申请实施例提供的第三种像素电路的结构原理图。可以理解，本实施例提供的像素电路与上述实施例记载的像素电路具有相同或相似的结构特征，下面对本实施例中的像素电路进行说明，其中未详述之处请参阅上述实施例的记载。
该像素电路包括驱动单元10、发光控制单元、第一复位单元30、第二复位单元40、第三复位单元50、补偿单元60、输入单元70和初始化单元80。所述发光控制单元可以包括第一发光控制单元21和第二发光控制单元22。所述第一复位单元30电性连接于所述第一发光控制单元21与所述驱动单元10之间，用于调整流经所述驱动单元10的电流；所述第二复位单元40电性连接于所述第二发光控制单元22与所述发光单元L之间，用于对所述发光单元L进行复位。
所述第一发光控制单元21电性连接于所述第一电源输入端VDD与所述驱动单元10之间，且所述第一发光控制单元21的控制端电性连接第一控制信号输入端EM1；所述第二发光控制单元22电性连接于所述驱动单元10与所述发光单元L之间，且所述第二发光控制单元22的控制端电性连接第二控制信号输入端EM2；所述发光单元L的另一端电性连接第二电源输入端VSS。所述第一复位单元30的第一端电性连接于所述第一发光控制单元21与所述驱动单元10之间，所述第一复位单元30的第二端电性连接第一恒压信号输入端V1，所述第一复位单元30的控制端电性连接第一复位信号输入端F1。
所述第二复位单元40的第一端电性连接所述发光单元L，所述第二复位单元40的第二端电性连接第二恒压信号输入端V2，所述第二复位单元40的控制端电性连接第二复位信号输入端F2。所述第二复位信号输入端F2用于提供特定方波信号，以控制所述第二复位单元40将所述第二恒压信号输入端V2输入的恒定电压周期性的传输至所述发光单元L，实现对所述发光单元L进行复位操作。
可选地，所述第二复位信号输入端F2输入的信号与所述第一复位信号输入端F1输入的信号可以是相同的信号，以实现所述第一复位单元30与所述第二复位单元40的同时工作。可以理解，对于低频显示驱动的同一帧画面，在所述第一复位单元30的作用下，使流经所述驱动单元10的电流趋于稳定，并在所述第二复位单元40的作用下，使流向所述发光单元L的电流趋于稳定，从而保证所述发光单元L稳定发光，防止出现闪烁问题。
所述第三复位单元50的第一端电性连接所述发光单元，所述第三复位单元50的第二端电性连接所述第二恒压信号输入端V2，所述第三复位单元50的控制端电性连接第一扫描信号输入端S1。所述补偿单元60的第一端电性连接所述驱动单元10的控制端，所述补偿单元60的第二端电性连接于所述驱动单元10与所述第二发光控制单元22之间，所述补偿单元60的控制端电性连接第二扫描信号输入端S2。所述输入单元70的第一端电性连接于所述第一发光控制单元21与所述驱动单元10之间，所述输入单元70的第二端电性连接数据信号输入端Da，所述输入单元70的控制端电性连接所述第一扫描信号输入端S1。所述初始化单元80的第一端电性连接所述驱动单元10的控制端，所述初始化单元80的第二端电性连接第三恒压信号输入端V3，所述初始化单元80的控制端电性连接所述第二扫描信号输入端S2。
进一步地，所述驱动单元10包括第一晶体管T1，所述第一发光控制单元21包括第二晶体管T2，所述第二发光控制单元22包括第三晶体管T3，所述第一复位单元30包括第四晶体管T4，所述第三复位单元50包括第六晶体管T6，所述补偿单元60包括第七晶体管T7，所述输入单元70包括第八晶体管T8，所述初始化单元80包括第九晶体管T9。
其中，所述第二晶体管T2的栅极、源极和漏极分别电性连接所述第一控制信号输入端EM1、所述第一电源输入端VDD和所述第一晶体管T1的源极，所述第三晶体管T3的栅极、源极和漏极分别电性连接第二控制信号输入端EM2、所述第一晶体管T1的漏极和所述发光单元L，所述第四晶体管T4的栅极、源极和漏极分别电性连接所述第一复位信号输入端F1、所述第一恒压信号输入端V1和所述第一晶体管T1的源极或漏极，所述第六晶体管T6的栅极、源极和漏极分别电性连接所述第一扫描信号输入端S1、所述第二恒压信号输入端V2和所述发光单元L，所述第七晶体管T7的栅极、源极和漏极分别电性连接所述第二扫描信号输入端S2、所述第一晶体管T1的栅极和所述第一晶体管T1的漏极，所述第八晶体管T8的栅极、源极和漏极分别电性连接所述第一扫描信号输入端S1、所述数据信号输入端Da和所述第一晶体管T1的源极，所述第九晶体管T9的栅极、源极和漏极分别电性连接所述第二扫描信号输入端S2、所述第三恒压信号输入端V3和所述第一晶体管T1的栅极。
所述像素电路还包括第一电容C1和第二电容C2，所述第一电容C1的相对两端分别电性连接所述第一电源输入端VDD和所述第一晶体管T1的栅极，所述第二电容C2的相对两端分别电性连接所述第一扫描信号输入端S1和所述第一晶体管T1的栅极。
在另一种实施例中，请参阅图4，图4是本申请实施例提供的第四种像素电路的结构原理图。可以理解，本实施例提供的像素电路与上述实施例记载的像素电路具有相同或相似的结构特征，下面对本实施例中的像素电路进行说明，其中未详述之处请参阅上述实施例的记载。
该像素电路包括驱动单元10、发光控制单元、第一复位单元30、第二复位单元40、第三复位单元50、补偿单元60、输入单元70和初始化单元80。所述发光控制单元可以包括第一发光控制单元21和第二发光控制单元22。所述第一复位单元30电性连接于所述驱动单元10与所述第二发光控制单元22之间，用于调整流经所述驱动单元10的电流；所述第二复位单元40电性连接于所述第二发光控制单元22与所述发光单元L之间，用于对所述发光单元L进行复位。
所述第一发光控制单元21电性连接于所述第一电源输入端VDD与所述驱动单元10之间，且所述第一发光控制单元21的控制端电性连接第一控制信号输入端EM1；所述第二发光控制单元22电性连接于所述驱动单元10与所述发光单元L之间，且所述第二发光控制单元22的控制端电性连接第二控制信号输入端EM2；所述发光单元L的另一端电性连接第二电源输入端VSS。
所述第一复位单元30的第一端电性连接于所述驱动单元10与所述第二发光控制单元22之间，所述第一复位单元30的第二端电性连接第一恒压信号输入端V1，所述第一复位单元30的控制端电性连接第一复位信号输入端F1。所述第二复位单元40的第一端电性连接所述发光单元L，所述第二复位单元40的第二端电性连接第二恒压信号输入端V2，所述第二复位单元40的控制端电性连接第二复位信号输入端F2。
所述第三复位单元50的第一端电性连接所述发光单元，所述第三复位单元50的第二端电性连接所述第二恒压信号输入端V2，所述第三复位单元50的控制端电性连接第一扫描信号输入端S1。所述补偿单元60的第一端电性连接所述驱动单元10的控制端，所述补偿单元60的第二端电性连接于所述驱动单元10与所述第二发光控制单元22之间，所述补偿单元60的控制端电性连接第二扫描信号输入端S2。所述输入单元70的第一端电性连接于所述第一发光控制单元21与所述驱动单元10之间，所述输入单元70的第二端电性连接数据信号输入端Da，所述输入单元70的控制端电性连接所述第一扫描信号输入端S1。所述初始化单元80的第一端电性连接所述驱动单元10的控制端，所述初始化单元80的第二端电性连接第三恒压信号输入端V3，所述初始化单元80的控制端电性连接所述第二扫描信号输入端S2。
进一步地，所述驱动单元10包括第一晶体管T1，所述第一发光控制单元21包括第二晶体管T2，所述第二发光控制单元22包括第三晶体管T3，所述第一复位单元30包括第四晶体管T4，所述第三复位单元50包括第六晶体管T6，所述补偿单元60包括第七晶体管T7，所述输入单元70包括第八晶体管T8，所述初始化单元80包括第九晶体管T9。
其中，所述第二晶体管T2的栅极、源极和漏极分别电性连接所述第一控制信号输入端EM1、所述第一电源输入端VDD和所述第一晶体管T1的源极，所述第三晶体管T3的栅极、源极和漏极分别电性连接第二控制信号输入端EM2、所述第一晶体管T1的漏极和所述发光单元L，所述第四晶体管T4的栅极、源极和漏极分别电性连接所述第一复位信号输入端F1、所述第一恒压信号输入端V1和所述第一晶体管T1的源极或漏极，所述第六晶体管T6的栅极、源极和漏极分别电性连接所述第一扫描信号输入端S1、所述第二恒压信号输入端V2和所述发光单元L，所述第七晶体管T7的栅极、源极和漏极分别电性连接所述第二扫描信号输入端S2、所述第一晶体管T1的栅极和所述第一晶体管T1的漏极，所述第八晶体管T8的栅极、源极和漏极分别电性连接所述第一扫描信号输入端S1、所述数据信号输入端Da和所述第一晶体管T1的源极，所述第九晶体管T9的栅极、源极和漏极分别电性连接所述第二扫描信号输入端S2、所述第三恒压信号输入端V3和所述第一晶体管T1的栅极。
所述像素电路还包括第一电容C1和第二电容C2，所述第一电容C1的相对两端分别电性连接所述第一电源输入端VDD和所述第一晶体管T1的栅极，所述第二电容C2的相对两端分别电性连接所述第一扫描信号输入端S1和所述第一晶体管T1的栅极。
下面结合图5和图6对图1所示的像素电路的工作原理进行阐述。图5是采用本申请实施例提供的像素电路驱动显示装置在不同频率下显示的驱动方式示意图，图6是本申请实施例提供的像素电路的驱动时序图。
对于图5，在较高驱动频率下，例如120Hz时，像素电路驱动显示装置的阶段仅包括显示阶段DS和重置阶段RST，其中，重置阶段RST是所述第三复位单元50和所述初始化单元80进行工作而使显示画面重置的阶段。在这种较高驱动频率下，相邻两个显示阶段DS之间的时间间隔较短，在此期间不会出现流经驱动单元10的电流较大幅度变化的现象，可以维持稳定的显示效果。因此，在较高驱动频率下，所述第一复位单元30可以不工作。
随着驱动频率的降低，例如60Hz、30Hz、24Hz、15Hz和小于120Hz的随机频率，像素电路驱动显示装置的阶段还出现了重置维持阶段RF，此时，相邻两个显示阶段DS之间的时间间隔增大，在此期间流经驱动单元10的电流存在变化的驱使，因此在此期间增设重置维持阶段RF；在重置维持阶段RF，第一复位单元30工作，调整作用在驱动单元10上的电应力状况，使流经驱动单元10的电流趋于稳定，进而使防止出现闪烁。
对于图6，NS(n-1)和NS(n)分别代表第n-1级第二扫描信号和第n级第二扫描信号，PS(n-1)和PS(n)分别代表第n-1级第一扫描信号和第n级第一扫描信号，与补偿单元60连接的第二扫描信号输入端S2接入NS(n)，与初始化单元80连接的第二扫描信号输入端S2接入NS(n-1)，与第三复位单元50连接的第一扫描信号输入端S1和与输入单元70连接的第一扫描信号输入端S1接入PS(n)。第一复位信号输入端F1接入复位信号RT。第一控制信号输入端EM1和第二控制信号输入端EM2均接入控制信号EM。
在显示阶段DS，在NS(n-1)、NS(n)、PS(n-1)、PS(n)以及EM信号的作用下，像素电路驱动显示装置进行显示，并在重置维持阶段RF到来之前的短暂时间内，复位信号RT开启第一复位单元30对驱动单元10进行一次复位操作。在重置维持阶段RF，NS(n-1)、NS(n)、PS(n-1)和PS(n)几个扫描信号均维持恒定电压，而在此期间，复位信号RT可以根据需要再次或多次开启第一复位单元30对驱动单元10再次或多次进行复位操作，以维持流经驱动单元10的电流的稳定。
本申请实施例还提供一种显示装置，所述显示装置包括上述任一实施例所述像素电路。所述显示装置可以有机发光二极管显示装置、微型发光二极管显示装置，或包含该显示装置的显示器、笔记本电脑、平板电脑、电视机、手机等。
需要说明的是，虽然本申请以具体实施例揭露如上，但上述实施例并非用以限制本申请，本领域的普通技术人员，在不脱离本申请的精神和范围内，均可作各种更动与润饰，因此本申请的保护范围以权利要求界定的范围为准。

Claims (9)

1.一种像素电路，其特征在于，包括：
驱动单元，电性连接于第一电源输入端与发光单元之间；
发光控制单元，电性连接于所述第一电源输入端与所述发光单元之间，且与所述驱动单元电性连接；
第一复位单元，所述第一复位单元的第一端电性连接所述驱动单元，所述第一复位单元的第二端电性连接第一恒压信号输入端，所述第一复位单元的控制端电性连接第一复位信号输入端；
其中，所述像素电路还包括第二复位单元，所述第二复位单元的第一端电性连接所述发光单元，所述第二复位单元的第二端电性连接第二恒压信号输入端，所述第二复位单元的控制端电性连接第二复位信号输入端。
2.根据权利要求1所述的像素电路，其特征在于，所述像素电路还包括第三复位单元，所述第三复位单元的第一端电性连接所述发光单元，所述第三复位单元的第二端电性连接所述第二恒压信号输入端，所述第三复位单元的控制端电性连接第一扫描信号输入端。
3.根据权利要求2所述的像素电路，其特征在于，所述发光控制单元包括第一发光控制单元和第二发光控制单元，所述第一发光控制单元电性连接于所述第一电源输入端与所述驱动单元之间，所述第二发光控制单元电性连接于所述驱动单元与所述发光单元之间。
4.根据权利要求3所述的像素电路，其特征在于，所述第一复位单元的第一端电性连接于所述第一发光控制单元与所述驱动单元之间。
5.根据权利要求3所述的像素电路，其特征在于，所述第一复位单元的第一端电性连接于所述驱动单元与所述第二发光控制单元之间。
6.根据权利要求3所述的像素电路，其特征在于，所述第二复位单元的第一端和所述第三复位单元的第一端均电性连接于所述第二发光控制单元与所述发光单元之间。
7.根据权利要求3所述的像素电路，其特征在于，所述像素电路还包括：
输入单元，所述输入单元的第一端电性连接于所述第一发光控制单元与所述驱动单元之间，所述输入单元的第二端电性连接数据信号输入端，所述输入单元的控制端电性连接所述第一扫描信号输入端；
补偿单元，所述补偿单元的第一端电性连接所述驱动单元的控制端，所述补偿单元的第二端电性连接于所述驱动单元与所述第二发光控制单元之间，所述补偿单元的控制端电性连接第二扫描信号输入端；
初始化单元，所述初始化单元的第一端电性连接所述驱动单元的控制端，所述初始化单元的第二端电性连接第三恒压信号输入端，所述初始化单元的控制端电性连接所述第二扫描信号输入端。
8.根据权利要求7所述的像素电路，其特征在于，所述驱动单元包括第一晶体管，所述第一发光控制单元包括第二晶体管，所述第二发光控制单元包括第三晶体管，所述第一复位单元包括第四晶体管，所述第二复位单元包括第五晶体管，所述第三复位单元包括第六晶体管，所述补偿单元包括第七晶体管，所述输入单元包括第八晶体管，所述初始化单元包括第九晶体管；
所述第二晶体管的栅极、源极和漏极分别电性连接第一控制信号输入端、所述第一电源输入端和所述第一晶体管的源极，所述第三晶体管的栅极、源极和漏极分别电性连接第二控制信号输入端、所述第一晶体管的漏极和所述发光单元，所述第四晶体管的栅极、源极和漏极分别电性连接所述第一复位信号输入端、所述第一恒压信号输入端和所述第一晶体管的源极或漏极，所述第五晶体管的栅极、源极和漏极分别电性连接所述第二复位信号输入端、所述第二恒压信号输入端和所述发光单元，所述第六晶体管的栅极、源极和漏极分别电性连接所述第一扫描信号输入端、所述第二恒压信号输入端和所述发光单元，所述第七晶体管的栅极、源极和漏极分别电性连接所述第二扫描信号输入端、所述第一晶体管的栅极和所述第一晶体管的漏极，所述第八晶体管的栅极、源极和漏极分别电性连接所述第一扫描信号输入端、所述数据信号输入端和所述第一晶体管的源极，所述第九晶体管的栅极、源极和漏极分别电性连接所述第二扫描信号输入端、所述第三恒压信号输入端和所述第一晶体管的栅极。
9.一种显示装置，其特征在于，包括权利要求1至8中任一所述的像素电路。
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