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CN106067291A - 一种像素驱动电路及其驱动方法、显示装置 - Google Patents

一种像素驱动电路及其驱动方法、显示装置 Download PDF

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CN106067291A
CN106067291A CN201610685895.6A CN201610685895A CN106067291A CN 106067291 A CN106067291 A CN 106067291A CN 201610685895 A CN201610685895 A CN 201610685895A CN 106067291 A CN106067291 A CN 106067291A
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transistor
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light emitting
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冯佑雄
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Chengdu BOE Optoelectronics Technology Co Ltd
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BOE Technology Group Co Ltd
Chengdu BOE Optoelectronics Technology Co Ltd
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Abstract

本发明实施例提供一种像素驱动电路及其驱动方法、显示装置，涉及显示技术领域，能够改善由于阈值电压引起的显示器显示亮度不均匀的不良现象。该像素驱动电路包括发光模块、驱动模块、补偿模块以及初始化模块。初始化模块在第一信号端和/或第三信号端的控制下，将第一电压端的电压输出至驱动模块和发光模块。补偿模块在第二信号端和第二电压端的控制下，将数据电压端的数据电压写入驱动模块，并对驱动模块进行阈值电压补偿。驱动模块在发光控制信号端和第二电压端的控制下，根据写入的数据电压驱动发光模块进行发光。

Description

一种像素驱动电路及其驱动方法、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种像素驱动电路及其驱动方法、显示装置。
背景技术
随着显示技术的急速进步，作为显示装置核心的半导体元件技术也随之得到了飞跃性的进步。对于现有的显示装置而言，有机发光二极管(Organic Light EmittingDiode，OLED)作为一种电流型发光器件，因其所具有的自发光、快速响应、宽视角和可制作在柔性衬底上等特点而越来越多地被应用于高性能显示领域当中。
采用上述OLED器件可以构成OLED显示器，该显示器的阵列基板上设置有多个TFT(Thin Film Transistor，薄膜晶体管)。为了提高TFT的载流子迁移率，并降低电阻率，使得通过相同电流时，功耗较小。一般采用多晶硅构成上述TFT。然而由于生产工艺和多晶硅的特性，导致在大面积玻璃基板上制作的TFT开关电路时，常常在诸如阈值电压Vth、迁移率等电学参数上出现波动，从而使得流经OLED器件的电流不仅会随着TFT长时间导通所产生的导通电压应力的变化而改变，而且其还会随着TFT的阈值电压Vth漂移而有所不同。如此一来，将会影响到显示器的亮度均匀性与亮度恒定性。从而降低显示器的画面品质和质量。
发明内容
本发明的实施例提供一种像素驱动电路及其驱动方法、显示装置，能够改善由于阈值电压引起的显示器显示亮度不均匀的不良现象。
为达到上述目的，本发明的实施例采用如下技术方案：
本发明实施例的一方面，提供一种像素驱动电路，包括发光模块、驱动模块、补偿模块以及初始化模块；所述初始化模块连接第一信号端和/或第三信号端，所述初始化模块还连接第一电压端、所述驱动模块和所述发光模块，用于在第一信号端和/或第三信号端的控制下，将第一电压端的电压输出至所述驱动模块和所述发光模块，对所述驱动模块和所述发光模块进行初始化；所述补偿模块连接第二信号端、数据电压端、第二电压端以及驱动模块，用于在所述第二信号端和所述第二电压端的控制下，将所述数据电压端的数据电压写入所述驱动模块，并对所述驱动模块进行阈值电压补偿；所述驱动模块还连接所述第二电压端和发光控制信号端，用于在所述发光控制信号端和所述第二电压端的控制下，根据写入的所述数据电压驱动所述发光模块进行发光；所述发光模块还连接所述第一电压端。
优选的，所述初始化模块包括第一晶体管和第二晶体管；所述第一晶体管的栅极连接所述第一信号端，所述第二晶体管的栅极连接所述第一信号端；或者，所述第一晶体管的栅极连接所述第三信号端，所述第二晶体管的栅极连接所述第三信号端；所述第一晶体管的第一极与所述第一电压端相连接，第二极与所述发光模块相连接；所述第二晶体管的第一极连接所述第一电压端相连接，第二极与所述驱动模块相连接。
优选的，所述初始化模块包括第一晶体管和第二晶体管；所述第一晶体管的栅极连接所述第一信号端，第一极连接所述第一电压端，第二极与所述发光模块相连接；所述第二晶体管的栅极连接所述第三信号端，第一极连接所述第一电压端，第二极与所述驱动模块相连接。
优选的，所述补偿模块包括第三晶体管、第四晶体管以及电容；所述第三晶体管的栅极连接所述第二信号端，第一极和第二极与所述驱动模块相连接；所述第四晶体管的栅极连接所述第二信号端，第一极连接所述数据电压端，第二极与所述驱动模块相连接；所述电容的一端连接所述第二电压端，另一端与所述驱动模块相连接。
优选的，所述驱动模块包括第五晶体管、第六晶体管以及第七晶体管；所述第五晶体管的栅极连接所述补偿模块和所述初始化模块，第一极连接所述第六晶体管的第二极，第二极与所述第七晶体管的第一极相连接；所述第六晶体管的栅极连接所述发光控制信号端，第一极连接所述第二电压端；所述第七晶体管的栅极连接所述发光控制信号端，第二极与所述发光模块相连接。
优选的，所述发光模块包括发光二极管，所述发光二极管的阳极连接所述驱动模块，阴极与所述第一电压端相连接。
本发明实施例的另一方面，提供一种显示装置，包括如上所述的任意一种像素驱动电路。
本发明实施例的又一方面，提供一种像素驱动电路的驱动方法，在一图像帧内，所述方法包括：在第一阶段，初始化模块在第一信号端和/或第三信号端的控制下，将第一电压端的电压输出至驱动模块和发光模块，对所述驱动模块和所述发光模块进行初始化；在第二阶段，所述补偿模块在第二信号端和第二电压端的控制下，将数据电压端的数据电压写入所述驱动模块，并对所述驱动模块进行阈值电压补偿；在第三阶段，所述驱动模块在发光控制信号端和第二电压端的控制下，根据写入的所述数据电压驱动所述发光模块进行发光；其中，所述第一信号端、所述第二信号端以及所述第三信号端输出的信号不同。
优选的，在所述初始化模块包括第一晶体管和第二晶体管，所述补偿模块包括第三晶体管、第四晶体管以及电容，所述驱动模块包括第五晶体管、第六晶体管和第七晶体管，所述发光模块包括发光二极管，且各晶体管为N型晶体管的情况下；当所述第一晶体管和所述第二晶体管的栅极连接第一信号端时，所述驱动方法包括：在所述第一阶段，第一信号端或第三信号端输出低电平，所述第一晶体管导通，将所述第一电压端的信号输出至第五晶体管的栅极；所述第二晶体管导通，将所述第一电压端的信号输出至发光二极管的阳极；在所述第二阶段，第二信号端输入低电平，所述第三晶体管导通，将所述第五晶体管的栅极和第二极导通，将所述第五晶体管的阈值电压写入所述第五晶体管的栅极；所述第四晶体管导通，将所述数据电压端的数据电压写入所述第五晶体管的栅极；在所述第三阶段，所述发光控制信号端输入低电平，所述第六晶体管、所述第七晶体管导通，所述第五晶体管驱动所述发光二极管发光。
优选的，在所述初始化模块包括第一晶体管和第二晶体管，所述补偿模块包括第三晶体管、第四晶体管以及电容，所述驱动模块包括第五晶体管、第六晶体管和第七晶体管，所述发光模块包括发光二极管，且各晶体管为N型晶体管的情况下；当所述第一晶体管的栅极连接第一信号端，第二晶体管的栅极连接第三信号端时，所述驱动方法包括：所述第一阶段包括第一子阶段和第二子阶段；在所述第一子阶段，第一信号端输出低电平，所述第一晶体管导通，将所述第一电压端的信号输出至第五晶体管的栅极；在所述第二子阶段，第三信号端输出低电平，所述第二晶体管导通，将所述第一电压端的信号输出至发光二极管的阳极；在所述第二阶段，第二信号端输入低电平，所述第三晶体管导通，将所述第五晶体管的栅极和第二极导通，将所述第五晶体管的阈值电压写入所述第五晶体管的栅极；所述第四晶体管导通，将所述数据电压端的数据电压写入所述第五晶体管的栅极；在所述第三阶段，所述发光控制信号端输入低电平，所述第六晶体管、所述第七晶体管导通，所述第五晶体管驱动所述发光二极管发光。
本发明实施例提供一种像素驱动电路及其驱动方法、显示装置。该像素驱动电路包括发光模块、驱动模块、补偿模块以及初始化模块。该初始化模块连接第一信号端和/或第三信号端，初始化模块还连接第一电压端、驱动模块和发光模块，用于在第一信号端和/或第三信号端的控制下，将第一电压端的电压输出至驱动模块和发光模块，对驱动模块和发光模块进行初始化。补偿模块连接第二信号端、数据电压端、第二电压端以及驱动模块，用于在第二信号端和第二电压端的控制下，将数据电压端的数据电压写入驱动模块，并对所述驱动模块进行阈值电压补偿。驱动模块还连接第二电压端和发光控制信号端，用于在发光控制信号端和第二电压端的控制下，根据写入的数据电压驱动所述发光模块进行发光。发光模块还连接第一电压端。
这样一来，通过上述补偿模块能够对驱动模块进行阈值电压的补偿，使得驱动模块在驱动发光单元进行发光时，流过发光单元的电流与晶体管的阈值电压无关，从而消除了阈值电压对发光亮度的影响，提高了显示器的亮度均匀性与亮度恒定性。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本发明实施例提供的一种像素驱动电路的结构示意图；
图2为本发明实施例提供的另一种像素驱动电路的结构示意图；
图3为图1中各个模块的具体结构示意图；
图4为图2中各个模块的具体结构示意图；
图5为用于控制图4所示的像素驱动电路的各个控制信号波形图；
图6为用于控制图3所示的像素驱动电路的各个控制信号波形图；
图7为现有技术提供的一种像素驱动电路的结构示意图。
附图标记：
10-初始化模块；20-补偿模块；30-驱动模块；40-发光模块；S1-第一信号端；S2-第二信号端；S3-第三信号端；EM-发光控制信号端；VSS-第一电压端；VDD-第二电压端；Vdata-数据电压端。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
本发明实施例提供一种像素驱动电路，如图1或图2所示，包括初始化模块10、补偿模块20、驱动模块30以及发光模块40。
具体的，上述初始化模块10如图1所示连接第一信号端S1或第三信号端S3，或者，初始化模块10还可以如图2所示，连接第一信号端S1和第三信号端S3。此外，该初始化模块10还连接第一电压端VSS、驱动模块30和发光模块40，用于在第一信号端S1或第三信号端S3的控制下，将第一电压端VSS的电压输出至驱动模块30和发光模块40，对驱动模块30和发光模块40进行初始化。
在此基础上，补偿模块20连接第二信号端S2、数据电压端Vdata、第二电压端VDD以及驱动模块30，用于在第二信号端S2和第二电压端VDD的控制下，将数据电压端Vdata的数据电压写入驱动模块30，并对驱动模块30进行阈值电压Vth补偿。
驱动模块30还连接第二电压端VDD和发光控制信号端EM，用于在发光控制信号端EM和第二电压端VDD的控制下，根据写入的上述数据电压驱动发光模块40进行发光。
此外，发光模块40还连接第一电压端VSS。
这样一来，通过上述补偿模块能够对驱动模块进行阈值电压的补偿，使得驱动模块在驱动发光单元进行发光时，流过发光单元的电流与晶体管的阈值电压无关，从而消除了阈值电压对发光亮度的影响，提高了显示器的亮度均匀性与亮度恒定性。
以下对上述各个模块的结构进行详细的说明。
具体的，上述初始化模块10可以如图3或图4所示，包括第一晶体管T1和第二晶体管T2。
具体的，第一晶体管T1和第二晶体管T2的连接方式，可以如图3所示，第一晶体管T1的栅极连接第一信号端S1，第二晶体管T2的栅极连接第一信号端S1。或者第一晶体管T1的栅极连接第三信号端S3，第二晶体管T2的栅极连接第三信号端S3。
此外，第一晶体管T1的第一极与第一电压端VSS相连接，第二极与发光模块40相连接。
第二晶体管T2的第一极连接第一电压端VSS，第二极与驱动模块30相连接。
或者，当上述第一晶体管T1和第二晶体管T2的连接方式，还可以如图4所示为：第一晶体管T1的栅极连接第一信号端S1，第二晶体管T2的栅极连接第三信号端S3。第一晶体管T1和第二晶体管T2其他端的连接方式同上所述，此处不再赘述。
在此基础上，补偿模块20可以包括第三晶体管T3、第四晶体管T4以及电容C。
其中，第三晶体管T3的栅极连接第二信号端S2，第一极和第二极与驱动模块30相连接。
第四晶体管T4的栅极连接第二信号端S2，第一极连接数据电压端Vdata，第二极与驱动模块30相连接。
电容C的一端连接第二电压端VDD，另一端与驱动模块30相连接。
而上述驱动模块30可以包括第五晶体管T5、第六晶体管T6以及第七晶体管T7。
其中，第五晶体管T5的栅极连接补偿模块20和初始化模块10，第一极连接第六晶体管T6的第二极，第二极与第七晶体管T7的第一极相连接。当补偿模块20和初始化模块10的结构如上所述时，第五晶体管T5的栅极连接补偿模块20中第三晶体管T3的第一极，且连接初始化模块10中第二晶体管的第二极。
此外，第六晶体管T6的栅极连接发光控制信号端EM，第一极连接第二电压端VDD。
第七晶体管T7的栅极连接发光控制信号端EM，第二极与发光模块40相连接。
需要说明的是，当驱动模块30的结构如上所述时，补偿模块20中的第三晶体管T3的第二极与第五晶体管T5的第二极相连接。此外，补偿模块20中第四晶体管T4的第二极与第五晶体管T5的第一极相连接。
在此基础上，发光模块40包括发光二极管L，该发光二极管L的阳极连接驱动模块30，阴极与第一电压端VSS相连接。当驱动模块30的结构如上所述时，该发光二极管L的阳极连接第七晶体管T7的第二极。且当发光模块40的结构如上所述时，初始化模块10中的第一晶体管T1的第二极发光二极管L的阳极相连接。
本发明对上述晶体管的类型不做限定，可以为N型晶体管或P型晶体管，且上述晶体管可以为增强型，也可以为耗尽型。在此基础上，上述各个晶体管的第一极可以为源极，第二极漏极；或者第一极为漏极，第二极为源极。
以下结合图5对图4所示的像素驱动电路的具体工作过程进行详细的说明。其中，以下描述均是以上述各个晶体管为P型晶体管为例进行的说明。此外，本发明实施例均是以第一电压端VSS输出恒定低电平，第二电压端VDD输出恒定高电平为例进行的说明。
具体的，如图5所示，该像素电路的每一图像帧显示过程可以分为第一阶段P1、第二阶段P2和第三阶段P3，其中，第一阶段P1可以包括第一子阶段P11和第二子阶段P12。具体为：
在第一子阶段P11，S1＝1，S2＝1，S3＝0，EM＝1；其中，本发明实施例中“0”表示低电平，“1”表示高电平。
在此情况下，第一信号端S1输出低电平，第一晶体管T1导通，将第一电压端VSS的低电平通过第一晶体管T1输出至发光二极管L的阳极，从而对发光二极管L的阳极进行初始化，以清除上一图像帧残留至发光二极管L阳极的电压，从而再本画面帧确保发光二极管L发光亮度与数据电压端Vdata输出的数据电压相匹配。
在第二子阶段P12，S3＝1，S2＝1，S3＝0，EM＝1。
在此情况下，第三信号端S3输出低电平，第二晶体管T2导通，使得第一电压端VSS的低电平通过第二晶体管T2输出至第五晶体管T5的栅极(即节点a)，以对第五晶体管T5的栅极电压进行初始化，以清除上一图像帧残留至该第五晶体管T5栅极的电压，从而可以保证数据电压端Vdata输出的数据电压能够正常写入至该第五晶体管T5的栅极。
在此基础上，在上述第一阶段P1，由于第二信号端S2以及发光控制信号端EM均输出高电平，因此除了第一晶体管T1和第二晶体管T2以外的其余晶体管均处于截止的状态。
综上所述，该上述第一阶段P1为初始化阶段，该阶段发光二极管L不发光。此外，本申请通过设置第一电压端VSS便可以实现上述初始化阶段。而现有提供的像素驱动电路，如图7所示，需要通过参考电压Vref和初始电压Vint进行初始化。因此本发明的像素驱动电路中晶体管需要连接的电压端的数量较少，从而可以减小用于将电压端与晶体管相连接的过孔数量。
在第二阶段P2，S1＝1，S2＝0，S3＝1，EM＝1。
第四晶体管T4导通，将数据电压端Vdata的数据电压输出至第五晶体管T5的第一极，以在第五晶体管T5导通时，将上述数据电压端Vdata的数据电压写入第五晶体管T5的栅极。此外，第二信号端S2输出低电平，第三晶体管T3导通，以将第五晶体管T5的第二极和栅极导通，以将第五晶体管T5的阈值电压Vth写入第五晶体管T5的栅极。这样一来，可以将第五晶体管T5的阈值电压Vth补偿值第五晶体管T5的栅极，以实现阈值电压Vth的补偿。
在此情况下，第五晶体管T5的栅极电压Va＝Vdata+Vth。
此外，相对于现有的像素驱动电路结构而言，如图7所示，由于数据电压(Vdata)需要先存储至电容C内，然后再通过电容C将数据电压(Vdata)充入驱动晶体管M1的栅极。由于电容C自身具有杂散电容，因此为了避免杂散电容导致数据电压(Vdata)无法准确写入至驱动晶体管M1的栅极。需要增大上述电容C的尺寸，这样一来，将导致像素驱动电路的体积增大，不利于制作高PPI(英文全称：Pixels Per Inch，中文全称：像素密度)面板。相比较而言，本发明提供的像素驱动电路的补偿模块20中，可以通过导通的第五晶体管T5将数据电压(Vdata)直接写入至第五晶体管T5的栅极，无需通过电容的充放电，因此避免了需要增大电容尺寸的问题。
在此基础上，在上述第二阶段P2，由于第三信号端S3、第一信号端S1以及发光控制信号端EM均输出高电平，因此除了第三晶体管T3和第四晶体管T4以外的其余晶体管均处于截止的状态。
综上所述，该上述第二阶段P2为与阈值电压Vth的补偿以及数据电压(Vdata)的写入阶段，该阶段发光二极管L不发光。
在第三阶段P3，S1＝1，S2＝1，S3＝1，EM＝0。
发光控制信号端EM输出低电平，第六晶体管T6和第七晶体管T7导通。此情况下，作为驱动晶体管第五晶体管T5的栅-源电压Vgs为Vgs＝Va-Vd＝Vdata+Vth-VDD。
此外，当第五晶体管T5的栅-源电压Vgs减去第五晶体管T5的阈值电压Vth得到的值小于等于第五晶体管T5的漏-源电压Vds时，即Vgs-Vth≤Vds时，第五晶体管T5能够处于饱和开启状态。此时流过所述第五晶体管T5的驱动电流I为：
I＝K(Vgs-Vth)2
＝K(Vdata+Vth-VDD-Vth)2
＝K(Vdata-VDD)2。 (1)
其中，K为关联于第五晶体管T5的电流常数，与第五晶体管T5的工艺参数和几何尺寸有关。
现有技术中，不同像素单元之间的Vth不尽相同，且同一像素中的Vth还有可能随时间发生漂移，这将造成显示亮度差异。由以上公式(1)可知，用于驱动发光二极管L进行发光的驱动电流I与第五晶体管T5的阈值电压Vth无关，从而消除了驱动晶体管(即第五晶体管T5)的阈值电压Vth对发光二极管L发光亮度的影响，提高了发光二极管亮度的均一性。
综上所述，该阶段为发光阶段，其的目的在于驱动发光二极管L进行发光，且用于驱动发光二极管L进行发光的驱动电流I与第五晶体管T5的阈值电压Vth无关。
此外，现有技术提供的如图7所示的像素驱动电路，其驱动电流I为I＝K(Vdata-Vref)2，该驱动电路I与第一电压端VDD的电压无关。具体的，可以通过第一电压端VDD的电压其自身进行补偿以实现。然而，通过第一电压端VDD的电压其自身进行补偿的过程中，第一电压端VDD在写入的过程中会受到自身讯号的影响，而无法正常写入，导致显示行串扰现象的发生。而本申请中，由公式(1)可以看出本发明仅对阈值电压Vth进行了补偿，驱动电路I仍然与第一电压端VDD的电压有关。因此能够避免通过第一电压端VDD的电压其自身进行补偿，而导致行串扰现象的产生。
需要说明的是，上述像素驱动电路的工作过程，是以图4所示的连接方式为例进行的说明，当以图3所示的连接方式时，各个控制信号如图6所示，由于第一晶体管T1和第二晶体管T2的栅极均与第一电压端S1相连接，因此第一阶段P1无需再划分为第一子阶段P11和第二子阶段P12。
此外，上述像素驱动电路的工作过程，是以各个晶体管均为P型晶体管为例进行的说明。当各个晶体管为N型时，需要将图5或图6所示的控制信号进行翻转，各个晶体管的通断过程同上所述，此处不再赘述。
本发明实施例提供一种显示装置，包括如上所述的任意一种像素驱动电路。具有与前述实施例提供的像素驱动电路相同的结构和有益效果，由于前述实施例已经对该像素驱动电路的结构和有益效果进行了详细的描述，此处不再赘述。
本发明实施例提供一种像素驱动电路的驱动方法，在一图像帧内(包括第一阶段P1、第二阶段P2以及第三阶段P3)，上述方法包括：
首先，在第一阶段P1，如图1所示的初始化模块10在第一信号端S1或第三信号端S3的控制下，将第一电压端VSS的电压输出至驱动模块30和发光模块40，对驱动模块30和发光模块40进行初始化。
或者，在第一阶段P1，如图2所示的初始化模块10在第一信号端S1和第三信号端S3的控制下，将第一电压端VSS的电压输出至驱动模块30和发光模块40，对驱动模块30和发光模块40进行初始化。
接下来，在第二阶段P2，补偿模块20在第二信号端S2和第二电压端VDD的控制下，将数据电压端Vdata的数据电压写入驱动模块30，并对驱动模块30进行阈值电压Vth补偿。
最后，在第三阶段P3，驱动模块30在发光控制信号端EM和第二电压端VDD的控制下，根据写入的数据电压驱动发光模块40进行发光。
其中，如图5所示，上述第一信号端S1、第二信号端S2以及第三信号端S3输出的信号不同。
这样一来，通过上述补偿模块能够对驱动模块进行阈值电压的补偿，使得驱动模块在驱动发光单元进行发光时，流过发光单元的电流与晶体管的阈值电压无关，从而消除了阈值电压对发光亮度的影响，提高了显示器的亮度均匀性与亮度恒定性。
以下当初始化模块10如图3或图4所示包括第一晶体管T1和第二晶体管T2。补偿模块20包括第三晶体管T3、第四晶体管T4以及电容C。驱动模块30包括第五晶体管T5、第六晶体管T6和第七晶体管T7。发光模块40包括发光二极管L，且各晶体管为N型晶体管的情况下，对上述像素驱动电路的驱动方法进行举例说明。
例如，当第一晶体管T1和第二晶体管T2的栅极连接第一信号端S1(或第三信号端S3)时，上述驱动方法包括：
如图6所示，在第一阶段P1，第一信号端S1输出低电平，第一晶体管T1导通，将第一电压端VSS的信号输出至第五晶体管T5的栅极，以对第五晶体管T5的栅极电压进行初始化，以清除上一图像帧残留至该第五晶体管T5栅极的电压，从而可以保证数据电压端Vdata输出的数据电压能够正常写入至该第五晶体管T5的栅极。
此外，第二晶体管T2导通，将第一电压端VSS的信号输出至发光二极管L的阳极。从而对发光二极管L的阳极进行初始化，以清除上一图像帧残留至发光二极管L阳极的电压，从而再本画面帧确保发光二极管L发光亮度与数据电压端Vdata输出的数据电压相匹配。
在第二阶段P2，第二信号端S2输入低电平，第三晶体管T3导通，以将第五晶体管T5的第二极和栅极导通，将第五晶体管T5的阈值电压Vth写入第五晶体管T5的栅极。此外，第四晶体管T4导通，将数据电压端Vdata的数据电压写入第五晶体管T5的栅极。这样一来，可以将第五晶体管T5的阈值电压Vth补偿值第五晶体管T5的栅极，以实现阈值电压Vth的补偿。
此时，第五晶体管T5的栅极电压Va＝Vdata+Vth。
在第三阶段P3，发光控制信号端EM输入低电平，第六晶体管T6和第七晶体管T7导通，第五晶体管T5驱动发光二极管L发光。具体驱动发光的过程在之前已进行了详细的说明，此处不再赘述。
又例如，当第一晶体管T1的栅极连接第一信号端S1，第二晶体管T2的栅极连接第三信号端S3时，上述驱动方法包括：
其中，第一阶段P1如图5所示包括第一子阶段P11和第二子阶段P12。
在上述第一子阶段P11，第一信号端S1输出低电平，第一晶体管T1导通，将第一电压端VSS的信号输出至第五晶体管T5的栅极，以对第五晶体管T5的栅极电压进行初始化。
在第二子阶段P12，第三信号端S3输出低电平，第二晶体管T2导通，将第一电压端VSS的信号输出至发光二极管L的阳极。从而对发光二极管L的阳极进行初始化。
此外，在第二阶段P2和第三阶段P3中，各个晶体管的通断状态同上所述，此处不再赘述。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。

Claims (10)

1.一种像素驱动电路，其特征在于，包括发光模块、驱动模块、补偿模块以及初始化模块；
所述初始化模块连接第一信号端和/或第三信号端，所述初始化模块还连接第一电压端、所述驱动模块和所述发光模块，用于在第一信号端和/或第三信号端的控制下，将第一电压端的电压输出至所述驱动模块和所述发光模块，对所述驱动模块和所述发光模块进行初始化；
所述补偿模块连接第二信号端、数据电压端、第二电压端以及驱动模块，用于在所述第二信号端和所述第二电压端的控制下，将所述数据电压端的数据电压写入所述驱动模块，并对所述驱动模块进行阈值电压补偿；
所述驱动模块还连接所述第二电压端和发光控制信号端，用于在所述发光控制信号端和所述第二电压端的控制下，根据写入的所述数据电压驱动所述发光模块进行发光；
所述发光模块还连接所述第一电压端。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述初始化模块包括第一晶体管和第二晶体管；
所述第一晶体管的栅极连接所述第一信号端，所述第二晶体管的栅极连接所述第一信号端；或者，所述第一晶体管的栅极连接所述第三信号端，所述第二晶体管的栅极连接所述第三信号端；
所述第一晶体管的第一极与所述第一电压端相连接，第二极与所述发光模块相连接；
所述第二晶体管的第一极连接所述第一电压端相连接，第二极与所述驱动模块相连接。
3.根据权利要求1所述的像素驱动电路，其特征在于，所述初始化模块包括第一晶体管和第二晶体管；
所述第一晶体管的栅极连接所述第一信号端，第一极连接所述第一电压端，第二极与所述发光模块相连接；
所述第二晶体管的栅极连接所述第三信号端，第一极连接所述第一电压端，第二极与所述驱动模块相连接。
4.根据权利要求1所述的像素驱动电路，其特征在于，所述补偿模块包括第三晶体管、第四晶体管以及电容；
所述第三晶体管的栅极连接所述第二信号端，第一极和第二极与所述驱动模块相连接；
所述第四晶体管的栅极连接所述第二信号端，第一极连接所述数据电压端，第二极与所述驱动模块相连接；
所述电容的一端连接所述第二电压端，另一端与所述驱动模块相连接。
5.根据权利要求1所述的像素驱动电路，其特征在于，所述驱动模块包括第五晶体管、第六晶体管以及第七晶体管；
所述第五晶体管的栅极连接所述补偿模块和所述初始化模块，第一极连接所述第六晶体管的第二极，第二极与所述第七晶体管的第一极相连接；
所述第六晶体管的栅极连接所述发光控制信号端，第一极连接所述第二电压端；
所述第七晶体管的栅极连接所述发光控制信号端，第二极与所述发光模块相连接。
6.根据权利要求1所述的像素驱动电路，其特征在于，所述发光模块包括发光二极管，所述发光二极管的阳极连接所述驱动模块，阴极与所述第一电压端相连接。
7.一种显示装置，其特征在于，包括如权利要求1-6任一项所述的像素驱动电路。
8.一种像素驱动电路的驱动方法，其特征在于，在一图像帧内，所述方法包括：
在第一阶段，初始化模块在第一信号端和/或第三信号端的控制下，将第一电压端的电压输出至驱动模块和发光模块，对所述驱动模块和所述发光模块进行初始化；
在第二阶段，所述补偿模块在第二信号端和第二电压端的控制下，将数据电压端的数据电压写入所述驱动模块，并对所述驱动模块进行阈值电压补偿；
在第三阶段，所述驱动模块在发光控制信号端和所述第二电压端的控制下，根据写入的所述数据电压驱动所述发光模块进行发光；
其中，所述第一信号端、所述第二信号端以及所述第三信号端输出的信号不同。
9.根据权利要求8所述的像素驱动电路的驱动方法，其特征在于，在所述初始化模块包括第一晶体管和第二晶体管，所述补偿模块包括第三晶体管、第四晶体管以及电容，所述驱动模块包括第五晶体管、第六晶体管和第七晶体管，所述发光模块包括发光二极管，且各晶体管为N型晶体管的情况下；当所述第一晶体管和所述第二晶体管的栅极连接第一信号端时，所述驱动方法包括：
在所述第一阶段，第一信号端或第三信号端输出低电平，所述第一晶体管导通，将所述第一电压端的信号输出至第五晶体管的栅极；所述第二晶体管导通，将所述第一电压端的信号输出至发光二极管的阳极；
在所述第二阶段，第二信号端输入低电平，所述第三晶体管导通，将所述第五晶体管的栅极和第二极导通，将所述第五晶体管的阈值电压写入所述第五晶体管的栅极；所述第四晶体管导通，将所述数据电压端的数据电压写入所述第五晶体管的栅极；
在所述第三阶段，所述发光控制信号端输入低电平，所述第六晶体管、所述第七晶体管导通，所述第五晶体管驱动所述发光二极管发光。
10.根据权利要求8所述的像素驱动电路的驱动方法，其特征在于，在所述初始化模块包括第一晶体管和第二晶体管，所述补偿模块包括第三晶体管、第四晶体管以及电容，所述驱动模块包括第五晶体管、第六晶体管和第七晶体管，所述发光模块包括发光二极管，且各晶体管为N型晶体管的情况下；当所述第一晶体管的栅极连接第一信号端，第二晶体管的栅极连接第三信号端时，所述驱动方法包括：
所述第一阶段包括第一子阶段和第二子阶段；
在所述第一子阶段，第一信号端输出低电平，所述第一晶体管导通，将所述第一电压端的信号输出至第五晶体管的栅极；
在所述第二子阶段，第三信号端输出低电平，所述第二晶体管导通，将所述第一电压端的信号输出至发光二极管的阳极；
在所述第二阶段，第二信号端输入低电平，所述第三晶体管导通，将所述第五晶体管的栅极和第二极导通，将所述第五晶体管的阈值电压写入所述第五晶体管的栅极；所述第四晶体管导通，将所述数据电压端的数据电压写入所述第五晶体管的栅极；
在所述第三阶段，所述发光控制信号端输入低电平，所述第六晶体管、所述第七晶体管导通，所述第五晶体管驱动所述发光二极管发光。
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