[go: up one dir, main page]
More Web Proxy on the site http://driver.im/

CN105608028A - 基于emif接口和双口ram实现dsp与fpga高速通信方法 - Google Patents

基于emif接口和双口ram实现dsp与fpga高速通信方法 Download PDF

Info

Publication number
CN105608028A
CN105608028A CN201510679527.6A CN201510679527A CN105608028A CN 105608028 A CN105608028 A CN 105608028A CN 201510679527 A CN201510679527 A CN 201510679527A CN 105608028 A CN105608028 A CN 105608028A
Authority
CN
China
Prior art keywords
fpga
dsp
memory block
port
data
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
CN201510679527.6A
Other languages
English (en)
Inventor
刘玉霞
李拉成
关维周
王新
杨军
范竹荣
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Shaanxi Baocheng Aviation Instrument Co Ltd
Original Assignee
Shaanxi Baocheng Aviation Instrument Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Shaanxi Baocheng Aviation Instrument Co Ltd filed Critical Shaanxi Baocheng Aviation Instrument Co Ltd
Priority to CN201510679527.6A priority Critical patent/CN105608028A/zh
Publication of CN105608028A publication Critical patent/CN105608028A/zh
Pending legal-status Critical Current

Links

Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38Information transfer, e.g. on bus
    • G06F13/382Information transfer, e.g. on bus using universal interface adapter
    • G06F13/387Information transfer, e.g. on bus using universal interface adapter for adaptation of different data processing systems to different peripheral devices, e.g. protocol converters for incompatible systems, open system

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Communication Control (AREA)

Abstract

本发明提供一种基于EMIF接口和双口RAM实现DSP与FPGA高速通信方法,包括提供FPGA,为所述FPGA内部配置RAM,所述RAM包括第一存储区、第二存储区、第一端口和第二端口;提供DSP和EMIF接口,将所述DSP通过所述EMIF接口与所述第一端口连接,所述第一端口与所述第一存储区连接;将所述FPGA与所述第二端口连接,所述第二端口与所述第二存储区连接;所述FPGA与所述DSP实现高速通信。本发明提供的用DSP与FPGA高速通信方法通过EMIF接口实现了DSP与FPGA之间的数据双向快速传输,有效解决了大量的数据需要实时传输与处理的问题该方法可以广泛应用于信号处理系统方面,尤其可应用于各种实时信号处理。

Description

基于EMIF接口和双口RAM实现DSP与FPGA高速通信方法
技术领域
本发明属DSP和FPGA之间通信技术领域,具体涉及一种基于EMIF接口和双口RAM实现DSP与FPGA高速通信方法。
背景技术
随着导航技术,卫星技术和现代电子技术的快速发展,机载设备日益向着数字化、模块化、集成化方向发展,机载设备不仅需要采集、接收、处理、发送大量外部数据,同时设备内部各CPU之间也需要进行大量数据和信息的及时处理和高速传输。现在通用的计算机平台为FPGA+DSP结构,能充分发挥DSP的运算速度的优势及FPGA数据采集处理和接口通讯优势,能很好满足数据采集、处理及外部通讯需要。内部DSP与FPGA数据传输是否及时、有效传输直接决定着机载设备的性能精度和实时性。现有技术采用异步FIFO和同步FIFO来实现DSP与FPGA数据的连续传输,但不能解决数据传输的实时性,因此有必要提出改进。
发明内容
本发明解决的技术问题:提供一种基于EMIF接口和双口RAM实现DSP与FPGA高速通信方法,在FPGA内部建立双口RAM,双口RAM一端以存储器模式通过EMIF接口与DSP通信,另一端与FPGA内部CPU通信,实现FPGA和DSP对该双口RAM的独立读写,解决大量数据需要及时处理与传输的问题。
本发明采用的技术方案:基于EMIF接口和双口RAM实现DSP与FPGA高速通信方法,包括下述步骤:1)提供FPGA,为所述FPGA内部配置RAM,所述RAM包括第一存储区、第二存储区、第一端口和第二端口;2)提供DSP和EMIF接口,将所述DSP通过所述EMIF接口与所述第一端口连接,所述第一端口与所述第一存储区连接;3)将所述FPGA与所述第二端口连接,所述第二端口与所述第二存储区连接;4)所述FPGA与所述DSP实现高速通信。
优选的,1)所述FPGA通过所述第二端口在所述第二存储区内写入数据;2)所述FPGA的内部逻辑电路产生中断信号,向所述DSP的中断控制器模块申请中断;3)所述DSP响应中断请求,查询数据集状态信息,根据状态信息,确定读取更新的数据集,通过所述EMIF接口从所述第二存储区中读出数据。
优选的,1)所述DSP通过所述第一端口在所述第一存储区内写入数据;2)完成后所述DSP通过GPIO模块以软中断方式产生中断信号,向所述FPGA的中断控制器模块申请中断;3)所述FPGA响应中断请求,查询数据集状态信息,根据状态信息,确定读取更新的数据集,读出所述第一存储区的数据。
优选的,所述第一存储区包括第一数据集状态存储区和第一数据集存储区,所述第一数据集状态存储区用于存储数据集更新状态信息,所述第一数据集存储区用于存储数据。
优选的,所述第二存储区包括第二数据集状态存储区和第二数据集存储区,所述第二数据集状态存储区用于存储数据集更新状态信息,所述第二数据集存储区用于存储数据。
相较于现有技术,本发明通过EMIF接口实现了DSP与FPGA之间的数据双向快速传输,有效解决了大量的数据需要实时传输与处理的问题该方法可以广泛应用于信号处理系统方面,尤其可应用于各种实时信号处理。
附图说明:
图1为本发明中数据流向框图。
具体实施方式
下面结合附图1描述本发明的实施例:基于EMIF接口和双口RAM实现DSP与FPGA高速通信方法,包括下述步骤:
1)提供FPGA,为FPGA内部配置RAM,RAM包括第一存储区、第二存储区、第一端口和第二端口;FPGA器件的数据位宽可以根据不同的应用场合配置为8位、16位、32位、64位、128位;第一端口和第二端口有各自的数据线、地址线、读写控制线,可以允许不同的系统同时对其共享的存储空间进行访问,实现用DSP和FPGA同时对FPGA内部的RAM共享的存储空间进行访问;
2)提供DSP和EMIF接口,将DSP通过EMIF接口与第一端口连接,第一端口与第一存储区连接;EMIF是外部存储器和TMS320C6713片内单元之间通信的接口,DSP访问外存储器时必须通过EMIF接口,将EMIF接口与FPGA内部RAM对应的管脚连接实现DSP访问FPGA内部RAM;
3)将FPGA与第二端口连接,第二端口与第二存储区连接;
4)FPGA与DSP实现高速通信。
FPGA向DSP传输数据的方法,包括下述步骤:
1)FPGA通过第二端口在第二存储区内写入数据;
2)FPGA的内部逻辑电路产生中断信号,向DSP的中断控制器模块申请中断;
3)DSP响应中断请求,查询数据集状态信息,根据状态信息,确定读取更新的数据集,通过EMIF接口从第二存储区中读出写入数据。
DSP向FPGA传输数据的方法,包括下述步骤:
1)DSP通过第一端口在第一存储区内写入数据;
2)完成后DSP通过GPIO模块以软中断方式产生中断信号,向FPGA的中断控制器模块申请中断;
3)FPGA响应中断请求,查询数据集状态信息,根据状态信息,确定读取更新的数据集,读出第一存储区的数据。
在本实施例中,所述内部逻辑电路、中断控制器模块及GPIO模块均通过CPU模块控制信号传输。
通过以上两个传输方法,不仅能实现数据在DSP和FPGA中的快速传输,也能实现数据在DSP中的快速处理。这种方式能有效的发挥DSP和FPGA的优势,以达到最优的信号传输与处理的效果,在单位时间内能处理的数据量更大以及数据的快速传输。
具体的,为了实现FPGA与DSP的正确通信,首先要实现两者之间的物理连接,将RAM的第一端口用于DSP通过EMIF接口访问FPGA内部RAM,第二端口用于FPGA访问RAM。DSP通过第一端口来访问共享的存储空间,FPGA通过第二端口访问共享的存储空间。其中EMIF的数据线分别连接到RAM的数据输入端口和数据输出端口,由AOE信号对数据的传输方向进行控制,EMIF接口的地址线和RAM第一端口的地址线连接,EMIF接口时钟输出信号ECLKOUT1与RAM的时钟信号引脚连接,AOE、ARE、AWE、CE信号经FPGA组合逻辑与RAM相应信号相连,以实现DSP对FPGA内部RAM的读写功能。FPGA内部通过地址线、数据线和控制线连接RAM第二端口,实现FPGA对RAM的读写功能。
进一步的,第一存储区包括第一数据集状态存储区和第一数据集存储区,第一数据集状态存储区用于存储数据集更新状态信息,第一数据集存储区用于存储数据;第二存储区包括第二数据集状态存储区和第二数据集存储区,第二数据集状态存储区用于存储数据集更新状态信息,第二数据集存储区用于存储数据。
可以理解为,数据集存储区中的每个数据集对应指定的数据集状态存储区。数据更新后将数据集状态存储区中数据集状态信息更新,可根据状态更新信息读取变化的数据集,提高数据读取效率。根据这两种传输方式所要传的数据集固定这两块存储区的大小和地址范围,DSP和FPGA每次访问固定地址和长度的存储区。
综上,本发明提供的用DSP与FPGA高速通信方法通过EMIF接口实现了DSP与FPGA之间的数据双向快速传输,有效解决了大量的数据需要实时传输与处理的问题该方法可以广泛应用于信号处理系统方面,尤其可应用于各种实时信号处理。
上述实施例,只是本发明的较佳实施例,并非用来限制本发明实施范围,故凡以本发明权利要求所述内容所做的等效变化,均应包括在本发明权利要求范围之内。

Claims (5)

1.基于EMIF接口和双口RAM实现DSP与FPGA高速通信方法,其特征在于包括下述步骤:
1)提供FPGA,为所述FPGA内部配置RAM,所述RAM包括第一存储区、第二存储区、第一端口和第二端口;
2)提供DSP和EMIF接口,将所述DSP通过所述EMIF接口与所述第一端口连接,所述第一端口与所述第一存储区连接;
3)将所述FPGA与所述第二端口连接,所述第二端口与所述第二存储区连接;
4)所述FPGA与所述DSP实现高速通信。
2.根据权利要求1所述的基于EMIF接口和双口RAM实现DSP与FPGA高速通信方法,其特征在于:
1)所述FPGA通过所述第二端口在所述第二存储区内写入数据;
2)所述FPGA的内部逻辑电路产生中断信号,向所述DSP的中断控制器模块申请中断;
3)所述DSP响应中断请求,查询数据集状态信息,根据状态信息,确定读取更新的数据集,通过所述EMIF接口从所述第二存储区中读出写入数据。
3.根据权利要求1所述的基于EMIF接口和双口RAM实现DSP与FPGA高速通信方法,其特征在于:
1)所述DSP通过所述第一端口在所述第一存储区内写入数据;
2)完成后所述DSP通过GPIO模块以软中断方式产生中断信号,向所述FPGA的中断控制器模块申请中断;
3)所述FPGA响应中断请求,查询数据集状态信息,根据状态信息,确定读取更新的数据集,读出所述第一存储区的数据。
4.根据权利要求1所述的基于EMIF接口和双口RAM实现DSP与FPGA高速通信方法,其特征在于,所述第一存储区包括第一数据集状态存储区和第一数据集存储区,所述第一数据集状态存储区用于存储数据集更新状态信息,所述第一数据集存储区用于存储数据。
5.根据权利要求1所述的基于EMIF接口和双口RAM实现DSP与FPGA高速通信方法,其特征在于,所述第二存储区包括第二数据集状态存储区和第二数据集存储区,所述第二数据集状态存储区用于存储数据集更新状态信息,所述第二数据集存储区用于存储数据。
CN201510679527.6A 2015-10-19 2015-10-19 基于emif接口和双口ram实现dsp与fpga高速通信方法 Pending CN105608028A (zh)

Priority Applications (1)

Application Number Priority Date Filing Date Title
CN201510679527.6A CN105608028A (zh) 2015-10-19 2015-10-19 基于emif接口和双口ram实现dsp与fpga高速通信方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201510679527.6A CN105608028A (zh) 2015-10-19 2015-10-19 基于emif接口和双口ram实现dsp与fpga高速通信方法

Publications (1)

Publication Number Publication Date
CN105608028A true CN105608028A (zh) 2016-05-25

Family

ID=55987979

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201510679527.6A Pending CN105608028A (zh) 2015-10-19 2015-10-19 基于emif接口和双口ram实现dsp与fpga高速通信方法

Country Status (1)

Country Link
CN (1) CN105608028A (zh)

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN106248132A (zh) * 2016-07-21 2016-12-21 中车青岛四方车辆研究所有限公司 带增强型数据缓存的高速多通道模拟量实时检测系统
CN109039911A (zh) * 2018-07-27 2018-12-18 烽火通信科技股份有限公司 一种基于hash查找方式共享ram的方法及系统
CN109446126A (zh) * 2018-10-17 2019-03-08 天津津航计算技术研究所 基于emif总线的dsp与fpga高速通信系统及方法
CN111679599A (zh) * 2020-05-22 2020-09-18 中国航空工业集团公司西安航空计算技术研究所 一种cpu与dsp数据高可靠交换方法

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN102122149A (zh) * 2010-12-20 2011-07-13 广东工业大学 用于纸箱打样机的嵌入式控制系统及其控制方法
CN102710316A (zh) * 2012-01-15 2012-10-03 中国电子科技集团公司第十研究所 全数字卫星信号模拟源
CN102760106A (zh) * 2011-04-28 2012-10-31 北京京师励耘教育科技有限公司 Pci学业数据挖掘芯片及其运行方法
CN103905793A (zh) * 2014-03-28 2014-07-02 中国科学院上海技术物理研究所 一种高速红外信号处理系统

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN102122149A (zh) * 2010-12-20 2011-07-13 广东工业大学 用于纸箱打样机的嵌入式控制系统及其控制方法
CN102760106A (zh) * 2011-04-28 2012-10-31 北京京师励耘教育科技有限公司 Pci学业数据挖掘芯片及其运行方法
CN102710316A (zh) * 2012-01-15 2012-10-03 中国电子科技集团公司第十研究所 全数字卫星信号模拟源
CN103905793A (zh) * 2014-03-28 2014-07-02 中国科学院上海技术物理研究所 一种高速红外信号处理系统

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
杨龙等: "DSP EMIF与FPGA双口RAM高速通信实现", 《现代电子技术》 *

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN106248132A (zh) * 2016-07-21 2016-12-21 中车青岛四方车辆研究所有限公司 带增强型数据缓存的高速多通道模拟量实时检测系统
CN109039911A (zh) * 2018-07-27 2018-12-18 烽火通信科技股份有限公司 一种基于hash查找方式共享ram的方法及系统
CN109446126A (zh) * 2018-10-17 2019-03-08 天津津航计算技术研究所 基于emif总线的dsp与fpga高速通信系统及方法
CN109446126B (zh) * 2018-10-17 2022-02-15 天津津航计算技术研究所 基于emif总线的dsp与fpga高速通信系统及方法
CN111679599A (zh) * 2020-05-22 2020-09-18 中国航空工业集团公司西安航空计算技术研究所 一种cpu与dsp数据高可靠交换方法

Similar Documents

Publication Publication Date Title
US10684949B2 (en) Method and apparatus for accessing data stored in a storage system that includes both a final level of cache and a main memory
CN109271335B (zh) 一种多通道数据源ddr缓存的fpga实现方法
CN102760111B (zh) 一种基于fpga的扩展多串口装置及其数据收发方法
CN206557767U (zh) 一种基于乒乓操作结构控制数据缓存的缓存系统
CN102314400B (zh) 一种分散聚合式dma方法及装置
CN109902042B (zh) 一种实现dsp与zynq之间高速数据传输的方法及系统
CN103336745A (zh) 一种基于ssd缓存的fc hba及其设计方法
CN105814560A (zh) 用于实现高吞吐量键-值存储的存储器设置
CN108536642A (zh) 大数据运算加速系统和芯片
CN105608028A (zh) 基于emif接口和双口ram实现dsp与fpga高速通信方法
CN102841871A (zh) 基于高速串行总线的DMA结构的pipeline读写方法
CN102033818A (zh) 媒体缓冲和流水线式处理组件
CN103092781A (zh) 闪存接口的有效利用
CN110825435B (zh) 用于处理数据的方法和装置
KR101736460B1 (ko) 크로스-다이 인터페이스 스누프 또는 글로벌 관측 메시지 오더링
CN116737083B (zh) 存储器访问电路及存储器访问方法、集成电路和电子设备
CN105701060B (zh) 基于fpga的高速实时数据记录系统
CN115129657A (zh) 一种可编程逻辑资源扩展装置和服务器
CN115374035A (zh) 基于单片机的串口扩展方法、串口扩展设备和清洁机器人
CN103870625B (zh) 光纤反射内存网数据实时交互方法
CN208298179U (zh) 大数据运算加速系统和芯片
CN116594570B (zh) 存储器访问电路及存储器访问方法、集成电路和电子设备
US10832132B2 (en) Data transmission method and calculation apparatus for neural network, electronic apparatus, computer-readable storage medium and computer program product
US20240070093A1 (en) Asymmetric Read-Write Sequence for Interconnected Dies
CN104102604A (zh) 一种业务处理装置

Legal Events

Date Code Title Description
C06 Publication
PB01 Publication
C10 Entry into substantive examination
SE01 Entry into force of request for substantive examination
WD01 Invention patent application deemed withdrawn after publication

Application publication date: 20160525

WD01 Invention patent application deemed withdrawn after publication