CH557091A - Verfahren zur herstellung von halbleitervorrichtungen. - Google Patents
Verfahren zur herstellung von halbleitervorrichtungen.Info
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Description
Diese Erfindung betrifft ein Verfahren zur Herstellung von Halbleitervorrichtungen, in dem ein Grundkörper mit mindestens einem Bereich des p-Typs und mindestens einem Bereich des n-Typs gebildet wird, dass der Grundkörper auf einer Stütze angeordnet und in eine Vielzahl von Teilstükken unterteilt wird, wobei jedes Teilstück eine Halbleitervorrichtung darstellt, und zwischen den Vorrichtungen Kanäle ausgeführt werden und die p-n-Übergänge in den Kanälen entblösst werden. Das erfindungsgemässe Verfahren ist dadurch gekennzeichnet, dass zwecks Erleichterung der Handhabung der Halbleitervorrichtungen ein härtbarer Werkstoff in den Kanä len eingegossen wird und dass der Werkstoff so ausgehärtet wird, dass eine die Halbleitervorrichtungen verbindende Membran entsteht. Im folgenden wird der Erfindungsgegenstand anhand der Zeichnung rein beispielsweise näher erläutert. Es zeigen: Fig. 1 bis 6 in schematischer Darstellung 6 verschiedene Verfahrensschritte bei der Herstellung von Dioden und, Fig. 7 ausschnittsweise eine Draufsicht auf ein Halbfabrikat gemäss Fig. 3. Der in den Figuren dargestellte Silizium-Grundkörper 10, der vom p-Typ oder vom n-Typ sein kann, wird mit Hilfe bekannter Diffusionsverfahren so behandelt, dass ein p-n-Übergang entsteht (Fig. 2). Nachdem der letztere entstanden ist, werden geeignete, nichtdargestellte Metallschichten auf den Oberflächen des Grundkörpers angebracht, die die Herstellung elektrischer Anschlüsse an die zu erzeugenden Dioden erleichtern. Der die p-n-Übergänge enthaltende Grundkörper wird dann mittels einer dünnen Wachsschicht 12 auf einer Glasoder Keramikplatte 11 befestigt. Auf die Oberfläche des Grundkörpers wird eine nichtdargestellte Stahlmaske gelegt, die eine Vielzahl von rechteckförmigen Löchern enthält: auf diese Maske wird eine Wachslösung aufgesprüht. Das Wachs tritt durch die Öffnungen der Maske hindurch und bleibt am Grundkörper haften; wenn die Maske entfernt wird, weist die Oberfläche des Grundkörpers eine Vielzahl von rechteckigen Bereichen 13 auf, welche mit Wachs bedeckt sind (Fig. 3). Die den Grundkörper 10 tragende Platte 11 wird dann in ein Ätzbad getaucht, das die Bereiche des Grundkörpers zwischen den maskierten Bereichen 13 entfernt (Fig. 4). Es ist festzustellen, dass das zur Befestigung des Grundkörpers 10 an der Platte 11 benutzte Wachs sowie die Wachsmaske für die Bereiche 13 des Grundkörpers 10 so ausgewählt werden, dass sie durch das Ätzmittel nicht angegriffen werden. Wenn die freigelegten Bereiche des Grundkörpers 10 wegge ätzt worden sind, wird die Platte 11 aus dem Ätzmittel entfernt, gespült und getrocknet. In diesem Stadium des Verfahrens trägt die Platte 11 eine Vielzahl von kleinen rechteckförmigen p-n-Dioden 15; diese sind voneinander getrennt und auf beiden Seiten mit Wachs überzogen; nur die geätzten Kanten 16 der Dioden 15 sind freigelegt. Selbstverständlich können auch anstatt des Wachses andere Maskierungsmittel benutzt werden, die von dem Ätzmittel nicht angegriffen wer den. Auf die Platte 11 wird dann ein synthetischer, vernetzbarer Kautschuk auf Silikonbasis in flüssiger Form gegossen; dieser fliesst in die Zwischenräume 14 zwischen den Dioden (Fig. 5). Wenn die Zwischenräume 14 mit dem flüssigen Werk stoff ausgefüllt sind, wird die Oberfläche des geätzten Grund- körpers abgewischt, um überschüssigen Kautschuk zu entfernen; es bleibt ein Gitterwerk 17 aus flüssigem Kautschuk in den Zwischenräumen 14 zurück. Der flüssige Kautschuk wird dann ausgehärtet, worauf die Platte 11 in ein Flüssigkeitsbad eingelegt wird, in dem sich das Wachs auflöst. Dabei löst sich das die Dioden 15 überdeckende Wachs und auch das die Dioden 15 mit der Platte 12 verbindende Wachs auf; die Dioden sind dann nur noch miteinander durch eine Kautschukmembran 17 verbunden (Fig. 6), die die Handhabung der Halbleitervorrichtung während der weiteren Bearbeitung sehr erleichtert. In einigen Fällen liefert die Membran 17 auch einen Schutz für die p-n-Übergänge der Halbleitervorrichtungen. Wenn es erwünscht ist, eine der Dioden 15 zu benutzen, wird der Abschnitt der Membran, der die Platte mit den übrigen Dioden verbindet, durchgetrennt; es bleibt dabei eine einzelne Diode zurück, deren Kanten durch die abgetrennten Abschnitte der Membran umgeben sind. Wenn die Diode Anschlussleiter aufweist, die durch Löten bei erhöhter Temperatur hergestellt worden sind, dann kann die Löttemperatur so gewählt werden, dass der die Kanten der Dioden umgebende Kautschuk zersetzt wird; dabei bleiben die Kanten der Dioden sauber und sind auf diese Weise bereit zum Eingiessen. Der Kautschuk kann jedoch auch während der ganzen Betriebsdauer der Diode an seinem Ort verbleiben. In diesem Falle ist es notwendig, dass die Löttemperatur so niedrig ist, dass die Membran aus dem betreffenden Werkstoff nicht zerstört wird. Es ist nicht unbedingt erforderlich, dass der Membranwerkstoff flexibel ist. Es können nämlich auch Werkstoffe benutzt werden, die eine spröde Membran erzeugen; in diesem Falle werden die Dioden durch Brechen voneinander getrennt und nicht durch Durchtrennen der Membran. Obwohl sich die obige Beschreibung auf die Herstellung von Dioden beschränkt, ist leicht einzusehen, dass das beschriebene Verfahren auch bei der Herstellung von Transistoren, Thyristoren und anderen Halbleitervorrichtungen verwendbar ist.
Claims (1)
- PATENTANSPRUCHVerfahren zur Herstellung von Halbleitervorrichtungen, in dem ein Grundkörper (10) mit mindestens einem Bereich des p-Typs und mindestens einem Bereich des n-Typs gebildet wird, dass der Grundkörper (10) auf einer Stütze (11) angeordnet und in eine Vielzahl von Teilstücken (15) unterteilt wird, wobei jedes Teilstück eine Halbleitervorrichtung darstellt und zwischen den Vorrichtungen (15) Kanäle (14) ausgeführt werden und die p-n-Übergänge in den Kanälen (14) entblösst werden, dadurch gekennzeichnet, dass zwecks Erleichterung der Handhabung der Halbleitervorrichtungen (15) ein härtbarer Werkstoff in die Kanäle (14) eingegossen wird und dass der Werkstoff so ausgehärtet wird, dass eine die Halbleitervorrichtungen (15) verbindende Membran (17) entsteht.UNTERANSPRÜCHE 1. Verfahren nach Patentanspruch, dadurch gekennzeichnet, dass der härtbare Werkstoff ein vernetzbarer synthetischer Kautschuk auf Silikonbasis ist.2. Verfahren nach Patentanspruch, dadurch gekennzeich net, dass die die Halbleitervorrichtungen verbindende Mem bran (17) auch die p-n-Übergänge schützt.3. Verfahren nach Patentanspruch, dadurch gekennzeich net, dass die Halbleitervorrichtungen durch Löten mit An schlussleitern versehen werden, wobei das Löten die Mem bran (17) zerstört.4. Verfahren nach Patentanspruch, dadurch gekennzeich net, dass die Halbleitervorrichtungen durch Löten mit An schlussleitern versehen werden, wobei das Löten die Mem bran (17) nicht zerstört.
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Cited By (4)
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EP0209767A1 (de) * | 1985-07-06 | 1987-01-28 | SEMIKRON Elektronik GmbH | Verfahren zum Herstellen von Halbleiterelementen |
WO1991011820A1 (en) * | 1990-01-30 | 1991-08-08 | Massachusetts Institute Of Technology | Optical surface polishing method |
US5174072A (en) * | 1990-01-30 | 1992-12-29 | Massachusetts Institute Of Technology | Optical surface polishing method |
WO2005018874A1 (de) * | 2003-08-18 | 2005-03-03 | Schott Ag | Verfahren zur herstellung von bauteilen |
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1969
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Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0209767A1 (de) * | 1985-07-06 | 1987-01-28 | SEMIKRON Elektronik GmbH | Verfahren zum Herstellen von Halbleiterelementen |
WO1991011820A1 (en) * | 1990-01-30 | 1991-08-08 | Massachusetts Institute Of Technology | Optical surface polishing method |
US5095664A (en) * | 1990-01-30 | 1992-03-17 | Massachusetts Institute Of Technology | Optical surface polishing method |
US5174072A (en) * | 1990-01-30 | 1992-12-29 | Massachusetts Institute Of Technology | Optical surface polishing method |
WO2005018874A1 (de) * | 2003-08-18 | 2005-03-03 | Schott Ag | Verfahren zur herstellung von bauteilen |
US7736995B2 (en) | 2003-08-18 | 2010-06-15 | Schott Ag | Process for producing components |
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