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TWI413972B - 移位暫存電路 - Google Patents

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TWI413972B
TWI413972B TW099129561A TW99129561A TWI413972B TW I413972 B TWI413972 B TW I413972B TW 099129561 A TW099129561 A TW 099129561A TW 99129561 A TW99129561 A TW 99129561A TW I413972 B TWI413972 B TW I413972B
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transistor
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TW099129561A
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Yu Chung Yang
Yung Chih Chen
Chih Ying Lin
Kun Yueh Lin
Original Assignee
Au Optronics Corp
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Description

移位暫存電路
本發明是有關於顯示技術領域，且特別是有關於一種移位暫存電路。
先前之應用於平面顯示器，例如液晶顯示器的移位暫存電路一般包括多個級串聯耦接的移位暫存器，用以依序產生多個驅動脈衝訊號，例如用以依次驅動液晶顯示器之閘極線的閘級驅動脈衝訊號；並且各個移位暫存器所產生的對應之啟動脈衝訊號會傳輸至下一級移位暫存器以使下一級移位暫存器開始工作。
先前之移位暫存電路係利用非晶矽(a-Si)或者多晶矽(p-Si)製程而製作在玻璃基板上，藉此節省閘極驅動晶片的成本、簡化模組段製造流程以及增加玻璃基板利用效率等。惟，由於其材質的載子遷移率比較低，因此需要設計較大面積的薄膜電晶體才能有效驅動液晶顯示器的閘極線。而越大面積的薄膜電晶體其所產生的寄生電容效應就越大，造成動態功率消耗大幅上升，從而限制了其應用範圍。
本發明的目的就是在提供一種移位暫存電路，其可大幅度地降低相關的動態功率消耗。
本發明提出一種移位暫存電路，包括多級移位暫存器，每級移位暫存器用以輸出一個對應之啟動脈衝訊號以及驅動脈衝訊號。再者，每級移位暫存器分別包括上拉電路、第一驅動電路、第二驅動電路以及放電電路。上拉電路接收前一級移位暫存器所輸出之前一個啟動脈衝訊號以及一個參考訊號以對第一節點進行充電。第一驅動電路於第一節點處電性耦接上拉電路，且接收對應之時脈訊號以根據第一節點的電位而產生對應之啟動脈衝訊號。第二驅動電路亦於第一節點處電性耦接上拉電路，且接收高參考電位以於輸出端輸出對應之驅動脈衝訊號。放電電路包括第一電晶體以及第二電晶體。其中第一電晶體包括第一控制端、第一通路端以及第二通路端，第一通路端電性耦接第一節點，且第二通路端電性耦接低參考電位，第一控制端接收第一控制訊號以在第一時間段內對第一節點進行放電。第二電晶體包括第二控制端、第三通路端以及第四通路端，第三通路端電性耦接第二驅動電路的輸出端，且第四通路端電性耦接低參考電位，第二控制端接收第二控制訊號以在第二時間段內對第二驅動電路的輸出端進行放電。其中，第一時間段的啟動時刻早於第二時間段的啟動時刻。
在本發明的較佳實施例中，上述之第一電晶體的第一控制端所接收的第一控制訊號為後一級移位暫存器所輸出的後一級啟動脈衝訊號，以在第一時間段內對第一節點上的電位進行放電；且第二電晶體的第二控制端所接收的第二控制訊號為後兩級移位暫存器所輸出的後二級啟動脈衝訊號以在第二時間段內對第二驅動電路的輸出端進行放電。
在本發明的較佳實施例中，上述之放電電路進一步包括第三電晶體，其包括第三控制端、第五通路端以及第六通路端。第五通路端電性耦接第二電晶體的第二控制端，而第六通路端電性耦接低參考電位。其中，第三控制端接收第一節點上的電位以修正第二電晶體的第二控制端所接收的後二級啟動脈衝訊號。
在本發明的較佳實施例中，上述之第一電晶體的第一控制端所接收的第一控制訊號為後兩級移位暫存器所輸出之後二級驅動脈衝訊號，以在第一時間段內對第一節點進行放電；且第二電晶體的第二控制端所接收的第二控制訊號為後三級移位暫存器所輸出之後三個驅動脈衝訊號，以在第二時間段內對第二驅動電路的輸出端進行放電。
在本發明的較佳實施例中，上述之第一電晶體的第一控制端所接收的第一控制訊號為後兩級移位暫存器所輸出之後二級驅動脈衝訊號，以在第一時間段內對第一節點進行放電；且第二電晶體的第二控制端所接收的第二控制訊號為後兩級移位暫存器所輸出之後二級啟動脈衝訊號以在第二時間段內對第二驅動電路的輸出端進行放電。
在本發明的較佳實施例中，上述之上拉電路包括第四電晶體，且第四電晶體包括第四控制端、第七通路端以及第八通路端。第四控制端接收前一級移位暫存器所輸出的前一個啟動脈衝訊號，第七通路端接收參考訊號，而第八通路端電性耦接第一節點。
在本發明的較佳實施例中，上述之參考訊號為高參考電位。或者，參考訊號為前一級移位暫存器所輸出之前一個驅動脈衝訊號。或者，參考訊號為前一級移位暫存器所輸出之前一個啟動脈衝訊號。
在本發明的較佳實施例中，上述之第一驅動電路包括第五電晶體以及電容。第五電晶體包括第五控制端、第九通路端以及第十通路端。第五控制端電性耦接第一節點，第九通路端用以接收對應之時脈訊號，而第十通路端用以輸出對應之啟動脈衝訊號。電容電性耦接於第一節點與第十通路端之間。
在本發明的較佳實施例中，上述之第二驅動電路包括第六電晶體，其包括第六控制端、第十一通路端以及第十二通路端。第六控制端電性耦接第一節點，第十一通路端用以接收高參考電位，而第十二通路端用以輸出對應之驅動脈衝訊號。
在本發明的較佳實施例中，上述之每級移位暫存器進一步包括第一穩壓電路以及第一穩壓控制電路。第一穩壓電路分別電性耦接第一節點及第二驅動電路的輸出端，而第一穩壓控制電路電性耦接第一穩壓電路且接收至少一控制訊號的控制以決定第一穩壓電路是否對第一節點及第二驅動電路的輸出端進行放電。
在本發明的較佳實施例中，上述之第一穩壓電路包括第七電晶體以及第八電晶體。第七電晶體包括第七控制端、第十三通路端以及第十四通路端。第七控制端電性耦接第一穩壓控制電路的輸出端，第十三通路端用於接收對應之驅動脈衝訊號，而第十四通路端電性耦接第一節點。第八電晶體包括第八控制端、第十五通路端以及第十六通路端。第八控制端電性耦接第一穩壓控制電路的輸出端，第十五通路端電性耦接低參考電位，而第十六通路端電性耦接第二驅動電路的輸出端。
在本發明的較佳實施例中，上述之第一穩壓控制電路包括第九電晶體、第十電晶體、第十一電晶體以及第十二電晶體。第九電晶體包括第九控制端、第十七通路端以及第十八通路端。第九控制端電性耦接參考電位，第十七通路端亦電性耦接參考電位。第十電晶體包括第十控制端、第十九通路端以及第二十通路端。第十控制端用於接收第三控制訊號，第十九通路端電性耦接第十八通路端且其連接處作為第二節點，而第二十通路端電性耦接低參考電位。第十一電晶體包括第十一控制端、第二十一通路端以及第二十二通路端。第十一控制端電性耦接第二節點，第二十一通路端電性耦接參考電位。第十二電晶體包括第十二控制端、第二十三通路端以及第二十四通路端。第十二控制端亦用於接收第三控制訊號，第二十三通路端電性耦接低參考電位，而第二十四通路端，電性耦接第二十二通路端且其耦接處作為第一穩壓控制電路的輸出端。
在本發明的較佳實施例中，上述之第三控制訊號為對應之驅動脈衝訊號。
在本發明的較佳實施例中，上述之第一穩壓控制電路進一步包括第十三電晶體以及第十四電晶體。第十三電晶體包括第十三控制端、第二十五通路端以及第二十六通路端。第十三控制端用於接收第四控制訊號，第二十五通路端電性耦接第二節點，而第二十六通路端電性耦接低參考電位。第十四電晶體包括第十四控制端、第二十七通路端以及第二十八通路端。第十四控制端亦用於接收第四控制訊號，第二十七通路端電性耦接低參考電位，而第二十八通路端電性耦接第一穩壓控制電路的輸出端。
在本發明的較佳實施例中，上述之第四控制訊號為前一級移位暫存器所輸出之前一個驅動脈衝訊號。或者第四控制訊號為對應之啟動脈衝訊號。
在本發明的較佳實施例中，上述之第三控制訊號為第一節點上的電位。
本發明之移位暫存器的第二驅動電路是藉由固定的高參考電位對其輸出端進行充電，且放電電路在對第二驅動電路的輸出端進行放電前，先對第一節點進行放電拉低第一節點上的電位。如此即可防止固定的高參考電位對接地電位的輸出，因 此可大幅度地降低移位暫存器的功率消耗。
為讓本發明之上述和其他目的、特徵和優點能更明顯易懂，下文特舉較佳實施例，並配合所附圖式，作詳細說明如下。
請參閱圖1，其繪示為本發明一實施例所揭示的移位暫存電路的局部結構示意圖。如圖1所示，本發明所揭示的移位暫存電路100適用於液晶顯示器的閘極驅動電路，以依次驅動液晶顯示器的閘極線，但本發明並不限於此，例如其也可應用於液晶顯示器的源級驅動電路。移位暫存電路100包括多個級串聯耦接的移位暫存器例如SR(n-1)、SR(n)及SR(n+1)等，其中每個移位暫存器用以依序地產生對應之閘極驅動脈衝訊號如G(n-1)、G(n)或G(n+1)，並產生對應之啟動脈衝訊號如ST(n-1)、ST(n)及ST(n+1)。且每個移位暫存器所產生的對應之啟動脈衝訊號傳輸至下一級移位暫存器以使下一級移位暫存器開始工作。
請參閱圖2及圖3，其中圖2繪示為本發明一實施例所揭示的移位暫存器的方塊示意圖，而圖3繪示為圖2所示的移位暫存器的具體電路示意圖。如圖2-3所示，本實施例以圖1所示的移位暫存器SR(n)為例來介紹本發明。具體地，移位暫存器SR(n)包括上拉電路110、第一驅動電路120、第二驅動電路130以及放電電路140。其中，第一驅動電路120與第二驅動電路130相互並聯，且上拉電路110分別電性耦接第一驅動電路120以及第二驅動電路130，而其電性耦接處作為第一節點Q(n)。
上拉電路110接收前一級移位暫存器所輸出之前一個啟動脈衝訊號ST(n-1)以及參考訊號如VGH，以對第一節點Q(n)進行充電。具體地，上拉電路110包括電晶體T1，其閘極接收前一個啟動脈衝訊號ST(n-1)，其源極接收參考訊號VGH，而其汲極電性耦接第一節點Q(n)。
第一驅動電路120電性耦接第一節點Q(n)，且接收對應之時脈訊號HC(m)以根據第一節點Q(n)的電位而產生對應之啟動脈衝訊號ST(n)。具體地，第一驅動電路120包括電晶體T2以及電容C2，電晶體T2的閘極電性耦接第一節點Q(n)，其源極接收對應之時脈訊號HC(n)，而其汲極作為第一驅動電路120的輸出端以輸出對應之啟動脈衝訊號ST(n)。電容C2電性耦接於電晶體T2的閘極與汲極之間。
第二驅動電路130亦電性耦接第一節點Q(n)，且接收高參考電位VGH以產生對應之閘極驅動脈衝訊號G(n)，從而驅動液晶顯示器上對應的閘極線。具體地，第二驅動電路130包括電晶體T3，其閘極電性耦接第一節點Q(n)，其源極接收高參考電位VGH，而其汲極作為第二驅動電路130的輸出端以輸出對應之閘極驅動脈衝訊號G(n)。
放電電路140電性耦接第一節點Q(n)以及第二驅動電路130的輸出端，且接收第一控制訊號、第二控制訊號以及低參考電位VSS以在第一時間段內對第一節點Q(n)進行放電，且在第二時間段內對第二驅動電路130的輸出端進行放電。在本實施例中，第一控制訊號為後一級移位暫存器SR(n+1)(圖未示)所輸出的後一級啟動脈衝訊號ST(n+1)，而第二控制訊號為後兩級移位暫存器SR(n+2)(圖未示)所輸出的後二級啟動脈衝訊號ST(n+2)。具體地，放電電路140包括電晶體T41及電晶體T42。電晶體T42的閘極接收第一控制訊號ST(n+1)，其源極電性耦接低參考電位VSS，而其汲極電性耦接第一節點Q(n)。電晶體T41的閘極接收第二控制訊號ST(n+2)，其源極電性耦接低參考電位VSS，而其汲極電性耦接第二驅動電路130的輸出端。
請參閱圖4，其繪示為上述各種訊號的時序圖。請一併參閱圖2至圖4，以下將具體地介紹本發明之移位暫存器的工作原理。以下將以四時脈訊號HC(1)~HC(4)為例來介紹本發明，本領域技術人員可以理解的是，時脈訊號的數量由液晶顯示器的畫素個數所決定，本發明並不限定於此。當液晶顯示器接收到啟動訊號ST後，時脈訊號HC(1)~HC(4)依次開啟。
此處以第二級移位暫存器SR(2)為例來介紹本實施例的相關內容。當前一級移位暫存器SR(1)輸出的啟動脈衝訊號ST(1)處於高電位時，上拉電路110中的電晶體T1導通，參考訊號對第一節點Q(2)進行充電，在本實施例中，參考訊號可為高參考電位VGH。因此，第一驅動電路120中的電晶體T2受第一節點Q(2)上的電位的控制從而導通，但是，電晶體T2源極所接收的時脈訊號HC(2)還是處於低電位，因此第一驅動電路120所產生的對應啟動脈衝訊號ST(2)處於低電位，但在此時其會產生一個小小的波動。此外，第二驅動電路130中的電晶體T3受節點Q(2)上的電位的控制從而導通，且由於其源極電性耦接固定的高參考電位VGH，因此高參考電位VGH對其汲極充電，從而拉升其汲極所產生的閘極驅動脈衝訊號G(n)，使閘極驅動脈衝訊號G(n)處於高電位。
當前一級移位暫存器SR(1)輸出的啟動脈衝訊號ST(1)處於低電位時，上拉電路110中的電晶體T1截止，此時第一節點Q(2)處於浮接狀態(floating)，第一驅動電路120中的電晶體T2繼續導通，且電晶體T2源極所接收的時脈訊號HC(2)處於高電位，其汲極所產生的對應啟動脈衝訊號ST(2)拉升而處於高電位，直至對應的時脈訊號HC(2)結束。且，由於電容C2的存在，因此第一節點Q(2)上的電位將對應啟動脈衝訊號ST(2)而被進一步地推高。此外，第二驅動電路130中的電晶體T3受第一節點Q(2)上的電位控制從而繼續導通，高參考電位VSS繼續對其汲極充電，其汲極所產生的閘極驅動脈衝訊號G(n)繼續處於高電位。
進一步地，由於放電電路140中的電晶體T42的閘極受第一控制訊號ST(3)控制，因此當第二控制訊號即後一級移位暫存器SR(3)所輸出的後一級啟動脈衝訊號ST(3)處於高電位時，電晶體T42導通，此時由於電晶體T42源極電性耦接低參考電位VSS，因此放電電路140在第一時間段內藉由電晶體T42對第一節點Q(n)進行放電，即拉低第一節點Q(n)上的電位。此外，由於放電電路140中的電晶體T43的閘極受第二控制訊號ST(4)控制，因此當第二控制訊號即後兩級移位暫存器SR(4)所輸出的後二級啟動脈衝訊號ST(4)處於高電位時，電晶體T41導通，在第二時間段內藉由電晶體T41對第二驅動電路130的輸出端進行放電，即拉低對應之閘極驅動脈衝訊號G(2)。
且，如圖4所示，第一控制訊號ST(3)的啟動時刻早於第二控制訊號ST(4)的啟動時刻，因此，對第一節點Q(n)的放電動作早於對第二驅動電路130的輸出端的放電動作。也就是說，第一節點Q(n)上的電位在對第二驅動電路130的輸出端進行放電動作之前，就已經拉低到低電位，第二驅動電路130中的電晶體T3截止，高參考電位VGH停止對第二驅動電路130的輸出端進行充電。因此，本發明不會出現放電電路140一邊對第二驅動電路130的輸出端進行放電，高參考電位VGH一邊對第二驅動電路130的輸出端進行充電的情形。因此，本發明的移位暫存器可大幅度地降低其動態功率消耗。
此外，本發明實施例的放電電路還進一步包括電晶體T45。電晶體T45的閘極電性耦接第一接點Q(n)以接收第一節點Q(n)上的電位，其源極電性耦接低參考電位VSS，而其汲極電性耦接電晶體T41的閘極以對電晶體T41的閘極所接收的第二控制訊號ST(n+2)進行調整。因此，對於第二級移位暫存器SR(2)而言，其第一節點Q(2)上的電位處於高電位時，電晶體T45導通，低參考訊號VSS會對其汲極放電，因此第二控制訊號ST(4)在此時會被拉低，以消除第二控制訊號ST(4)在此處的波動。
請繼續參閱圖2-3，移位暫存器SR(n)進一步包括第一穩壓控制電路150、第一穩壓電路160、第二穩壓控制電路170以及第二穩壓電路180。第一穩壓控制電路150電性耦接第一穩壓電路160以控制第一穩壓電路160的動作，而第一穩壓電路160電性耦接第一節點Q(n)以及第二驅動電路130的輸出端以穩定第一節點Q(n)上的電位以及第二驅動電路130所輸出的閘極驅動脈衝訊號G(n)。第二穩壓控制電路170與第二穩壓電路180與第一穩壓控制電路150與第一穩壓電路160的電路結構相同，其亦是用來進一步地穩定第一節點Q(n)上的電位以及第二驅動電路130所輸出的閘極驅動脈衝訊號G(n)。
具體地，第一穩壓控制電路150包括電晶體T51、電晶體T52、電晶體T53、電晶體T54、電晶體T55以及電晶體T56。電晶體T51的閘極電性耦接第一參考電位LC1，其源極亦電性耦接第一參考電位LC1，其汲極電性耦接電晶體T52的汲極，且其連接處定義為第二節點A(n)。電晶體T52的閘極接收第三控制訊號，如對應之閘極脈衝訊號G(n)，其源極電性耦接低參考電位VSS。電晶體T53的閘極電性耦接第二節點A(n)，其源極電性耦接第一參考電位LC1，其汲極電性耦接電晶體T54的汲極，且其連接處定義為第三節點P(n)，第三節點P(n)作為第一穩壓控制點路150的輸出端。電晶體T54的閘極亦接收第三控制訊號G(n)，其源極電性耦接低參考電位VSS。電晶體T55的閘極接收第四控制訊號，如前一級移位暫存器SR(n-1)所輸出的前一個閘極驅動脈衝訊號G(n-1)，其源極電性耦接低參考電位VSS，而其汲極亦電性耦接第二節點A(n)。電晶體T56的閘極亦接收第四控制訊號G(n-1)，其源極電性耦接低參考電位VSS，而其汲極亦電性耦接第三節點P(n)。
也就是說，電晶體T55與電晶體T56的相關電路與電晶體T52與電晶體T54的相關電路相互並聯，且電晶體T52與電晶體T54是受第三控制訊號G(n)的控制，而電晶體T55與電晶體T56是受第四控制訊號G(n-1)的控制。
第一穩壓電路160包括電晶體T61與電晶體T62。電晶體T61與電晶體T62的閘極均電性耦接第一穩壓控制電路150的輸出端P(n)，且電晶體T61的源極電性耦接對應之閘極驅動脈衝訊號G(n)，而其汲極電性耦接第一節點Q(n)。電晶體T62的源極電性耦接低參考訊號VSS，而其汲極電性耦接第二驅動電路130的輸出端。
在本實施例中，第一穩壓控制電路150接收第三控制訊號G(n)，其可保證第一穩壓控制電路150的輸出端P(n)所輸出的控制訊號使第一穩壓電路160在本級移位暫存器SR(n)進行工 作時，停止對第一節點Q(n)以及第二驅動電路130的輸出端進行放電。此外，第一穩壓控制電路150接收第四控制訊號G(n-1)，其可保證第一穩壓控制電路150的輸出端P(n)所輸出的控制訊號使第一穩壓電路160在其前一級移位暫存器SR(n-1)進行工作時，就開始停止對第一節點Q(n)以及第二驅動電路130的輸出端進行放電，從而進一步地保證穩定第一節點Q(n)上的電位以及第二驅動電路130的輸出端所輸出的對應之閘極驅動脈衝訊號G(n)。
此外，由於第二穩壓控制電路170與第二穩壓電路180與第一穩壓控制電路150與第一穩壓電路160的電路結構相同，其不同僅在於第二穩壓控制電路170電性耦接第二參考電位LC2，而其餘的結構在此不再贅述。
請參閱圖5，其繪示為本發明另一實施例所揭示的上拉電路的示意圖。如圖5所示，本實施例所揭示的上拉電路與圖2-3所揭示的上拉電路相似，其不同僅在於上拉電路所接收的參考訊號並非是固定的高參考電位VGH，而是前一級移位暫存器SR(n-1)所輸出的前一個閘極驅動脈衝訊號G(n-1)，其可在前一級移位暫存器SR(n-1)所輸出的前一個啟動脈衝訊號ST(n-1)導通本級移位暫存器SR(n)上拉電路110的電晶體T1的時候，前一個閘極驅動脈衝訊號G(n-1)可對第一節點Q(n)進行充電以拉升第一節點Q(n)上的電位。
請參閱圖6，其繪示為本發明又一實施例所揭示的上拉電路的示意圖。如圖6所示，本實施例所揭示的上拉電路與圖2-3所揭示的上拉電路相似，其不同僅在於上拉電路所接收的參考訊號並非是固定的高參考電位VGH，而是前一級移位暫存器SR(n-1)所輸出的前一個啟動脈衝訊號ST(n-1)，其可在前一級移位暫存器SR(n-1)所輸出的前一個啟動脈衝訊號ST(n-1)在導通本級移位暫存器SR(n)上拉電路110的電晶體T1的時候，前一個啟動脈衝訊號ST(n-1)也可對第一節點Q(n)進行充電以拉升第一節點Q(n)上的電位。當然，本領域技術人員可以理解的是，上拉電路所接收的參考訊號亦可以為其他的訊號，只要前一級移位暫存器SR(n-1)所輸出的前一個啟動脈衝訊號ST(n-1)在導通本級移位暫存器SR(n)上拉電路110的電晶體T1的時候，上述參考訊號可以對第一節點Q(n)進行充電即可。
請參閱圖7，其繪示為本發明另一實施例所揭示的放電電路的示意圖。如圖7所示，本實施例的放電電路與圖2與圖3所揭示的放電電路相似，其不同僅在於第一控制訊號為後兩級移位暫存器SR(n+2)所輸出的後二級閘極驅動脈衝訊號G(n+2)以在第一時間段內對第一節點Q(n)進行放電，而第二控制訊號為後三級移位暫存器SR(n+3)所輸出的後三個閘極驅動脈衝訊號G(n+3)以在第二時間段內對第二驅動電路130的輸出端進行放電。由於後二級閘極驅動脈衝訊號G(n+2)的啟動時刻早於後三個閘極驅動脈衝訊號G(n+3)的啟動時刻，因此其可保證放電電路140首先對第一節點Q(n)進行放電，以防止對第二驅動電路130的輸出端進行放電時，高參考電位VGH還對第二驅動電路130的輸出端進行充電。
請參閱圖8，其繪示為本發明又一實施例所揭示的放電電路的示意圖。如圖8所示，本實施例的放電電路與圖2與圖3所揭示的放電電路相似，其不同僅在於第一控制訊號為後兩級移位暫存器SR(n+2)所輸出的後二級閘極驅動脈衝訊號G(n+2)以在第一時間段內對第一節點Q(n)進行放電，而第二控制訊號為後兩級移位暫存器SR(n+3)所輸出的後二級啟動脈衝訊號ST(n+2)以在第二時間段內對第二驅動電路130的輸出端進行放電。由於後二級閘極驅動脈衝訊號G(n+2)的啟動時刻早於後二級啟動脈衝訊號ST(n+2)的啟動時刻，因此其亦可保證放電電路140首先對第一節點Q(n)進行放電。當然，本領域技術人員可以理解的是，第一控制訊號與第二控制訊號亦可以為其他訊號的組合，只要其可控制放電電路140在對第二驅動電路130的輸出端進行放電前，先對第一節點Q(n)進行放電拉低第一節點Q(n)上的電位即可。
請參閱圖9，其繪示為本發明另一實施例所揭示的第一穩壓控制電路的示意圖。如圖9所示，本實施例的第一穩壓控制電路與圖2-3所揭示的第一穩壓控制電路相似，其不同僅在於第一穩壓控制電路只接收第三控制訊號G(n)，而並沒有接收第四控制訊號G(n-1)。即本實施例中的第一穩壓控制電路並沒有電晶體T55以及電晶體T56，其只保證第一穩壓電路160在本級移位暫存器SR(n)進行工作時，停止對第一節點Q(n)以及第二驅動電路130的輸出端進行放電。
請參閱圖10，其繪示為本發明又一實施例所揭示的第一穩壓控制電路的示意圖。如圖10所示，本實施例的第一穩壓控制電路與圖9所揭示的第一穩壓控制電路相似，其不同僅在於第三控制訊號並非是本級移位暫存器SR(n)所輸出的對應之閘極驅動脈衝訊號G(n)，而是第一節點Q(n)上的電位，其亦可保證第一穩壓電路160在本級移位暫存器SR(n)進行工作時，停止對第一節點Q(n)以及第二驅動電路130的輸出端進行放電。
請參閱圖11，其繪示為本發明再一實施例所揭示的第一穩壓控制電路的示意圖。如圖11所示，本實施例的第一穩壓控制電路與圖2與圖3所揭示的第一穩壓控制電路相似，其不同僅在於第一穩壓控制電路所接收第四控制訊號並非前一級移位暫存器SR(n-1)所輸出的前一個閘極驅動脈衝訊號G(n-1)，而是本級移位暫存器SR(n)所輸出的對應之啟動脈衝訊號ST(n)，其亦可保證第一穩壓電路160在本級移位暫存器SR(n)進行工作時，停止對第一節點Q(n)以及第二驅動電路130的輸出端進行放電。當然，第一穩壓控制電路所接收的第三控制訊號及第四控制訊號也可作其他的改變方式。
綜上所述，本發明之移位暫存器的第二驅動電路是藉由固定的高參考電位對其輸出端進行充電，且放電電路在對第二驅動電路的輸出端進行放電前，先對第一節點進行放電拉低第一節點上的電位即可，防止固定的高參考電位繼續對第二驅動電路的輸出端進行充電，因此其可大幅度地降低移位暫存器的動態功率消耗。
雖然本發明已以較佳實施例揭露如上，然其並非用以限定本發明，任何熟習此技藝者，在不脫離本發明之精神和範圍內，當可作些許之更動與潤飾，因此本發明之保護範圍當視後附之申請專利範圍所界定者為準。
100．．．移位暫存電路
SR(n-1)、SR(n)、SR(n+1)．．．移位暫存器
ST(n-2)、ST(n-1)、ST(n)、ST(n+1)、ST(n+2)、ST(1)、ST(2)、ST(3)、ST(4)．．．啟動脈衝訊號
G(n-1)、G(n)、G(n+1)、G(n+2)、G(n+3)、G(1)、G(2)、G(3)、G(4)．．．閘極驅動脈衝訊號
110．．．上拉電路
120．．．第一驅動電路
130．．．第二驅動電路
140．．．放電電路
150．．．第一穩壓控制電路
160．．．第一穩壓電路
170．．．第二穩壓控制電路
180．．．第二穩壓電路
VGH．．．高參考電位
VSS．．．低參考電位
Q(n)．．．第一節點
HC(m)、HC(1)、HC(2)、HC(3)、HC(4)．．．時脈訊號
A(n)．．．第二節點
P(n)．．．第三節點
LC1．．．第一參考電位
LC2．．．第二參考電位
T1、T2、T3、T41、T42、T45、T51、T52、T53、T54、T55、T56、T61、T62．．．電晶體
C2．．．電容
圖1繪示為本發明一實施例所揭示的移位暫存電路的局部結構示意圖。
圖2繪示為本發明一實施例所揭示的移位暫存器的方塊示意圖。
圖3繪示為圖2所示的移位暫存器的具體電路示意圖。
圖4繪示為圖3所示的各種訊號的時序圖。
圖5繪示為本發明另一實施例所揭示的上拉電路的示意圖。
圖6繪示為本發明又一實施例所揭示的上拉電路的示意圖。
圖7繪示為本發明另一實施例所揭示的放電電路的示意圖。
圖8繪示為本發明又一實施例所揭示的放電電路的示意圖。
圖9繪示為本發明另一實施例所揭示的第一穩壓控制電路的示意圖。
圖10繪示為本發明又一實施例所揭示的第一穩壓控制電路的示意圖。
圖11繪示為本發明再一實施例所揭示的第一穩壓控制電路的示意圖。
ST(n-1)、ST(n)、ST(n+1)、ST(n+2)‧‧‧啟動脈衝訊號
G(n-1)、G(n)‧‧‧閘極驅動脈衝訊號
110‧‧‧上拉電路
120‧‧‧第一驅動電路
130‧‧‧第二驅動電路
140‧‧‧放電電路
150‧‧‧第一穩壓控制電路
160‧‧‧第一穩壓電路
170‧‧‧第二穩壓控制電路
180‧‧‧第二穩壓電路
VGH‧‧‧高參考電位
VSS‧‧‧低參考電位
Q(n)‧‧‧第一節點
HC(m)‧‧‧時脈訊號
P(n)‧‧‧第三節點
LC1‧‧‧第一參考電位
LC2‧‧‧第二參考電位

Claims (19)

  1. 一種移位暫存電路，包括：多級移位暫存器，每一級該些移位暫存器用以輸出一對應之啟動脈衝訊號以及一對應之驅動脈衝訊號，且每一該些移位暫存器分別包括：一上拉電路，接收前一級移位暫存器所輸出之前一個啟動脈衝訊號以及一個參考訊號，以對一第一節點進行充電；一第一驅動電路，於該第一節點處電性耦接該上拉電路，且接收一對應之時脈訊號以根據該第一節點的電位而產生該對應之啟動脈衝訊號；一第二驅動電路，亦於該第一節點處電性耦接該上拉電路，且接收一高參考電位以於一輸出端輸出該對應之驅動脈衝訊號；以及一放電電路，其包括：一第一電晶體，其包括一第一控制端、一第一通路端以及一第二通路端，該第一通路端電性耦接該第一節點，且該第二通路端電性耦接一低參考電位，該第一控制端接收一第一控制訊號以在一第一時間段內對該第一節點進行放電；以及一第二電晶體，其包括一第二控制端、一第三通路端以及一第四通路端，該第三通路端電性耦接該第二驅動電路的該輸出端，且該第四通路端電性耦接該低參考電位，該第二控制端接收一第二控制訊號以在一第二時間段內對該第二驅動電路的輸出端進行放電；其中，該第一時間段的啟動時刻早於該第二時間段的啟動時刻。
  2. 如申請專利範圍第1項所述之移位暫存電路，其中該第一電晶體的該第一控制端所接收的該第一控制訊號為後一級移位暫存器所輸出的後一級啟動脈衝訊號，以在該第一時間段內對該第一節點上的電位進行放電；且該第二電晶體的該第二控制端所接收的該第二控制訊號為後兩級移位暫存器所輸出的後二級啟動脈衝訊號以在該第二時間段內對該第二驅動電路的輸出端進行放電。
  3. 如申請專利範圍第2項所述之移位暫存電路，其中該放電電路進一步包括一第三電晶體，其包括：一第三控制端，一第五通路端，電性耦接該第二電晶體的該第二控制端；以及一第六通路端，電性耦接該低參考電位；其中，該第三控制端接收該第一節點上的電位以修正該第二電晶體的該第二控制端所接收的該後二級啟動脈衝訊號。
  4. 如申請專利範圍第1項所述之移位暫存電路，其中該第一電晶體的該第一控制端所接收的該第一控制訊號為後兩級移位暫存器所輸出之後二級驅動脈衝訊號，以在該第一時間段內對該第一節點進行放電；且該第二電晶體的該第二控制端所接收的該第二控制訊號為後三級移位暫存器所輸出之後三個驅動脈衝訊號，以在該第二時間段內對該第二驅動電路的輸出端進行放電。
  5. 如申請專利範圍第1項所述之移位暫存電路，其中該第一電晶體的該第一控制端所接收的該第一控制訊號為後兩級移位暫存器所輸出之後二級驅動脈衝訊號，以在該第一時間段內對該第一節點進行放電；且該第二電晶體的該第二控制端所接收的該第二控制訊號為該後兩級移位暫存器所輸出之後二級啟動脈衝訊號以在該第二時間段內對該第二驅動電路的輸出端進行放電。
  6. 如申請專利範圍第1項所述之移位暫存電路，其中該上拉電路包括一第四電晶體，該第四電晶體包括：一第四控制端，接收該前一級移位暫存器所輸出的該前一個啟動脈衝訊號；一第七通路端，接收該參考訊號；以及一第八通路端，電性耦接該第一節點。
  7. 如申請專利範圍第6項所述之移位暫存電路，其中該參考訊號為該高參考電位。
  8. 如申請專利範圍第6項所述之移位暫存電路，其中該參考訊號為該前一級移位暫存器所輸出之前一個驅動脈衝訊號。
  9. 如申請專利範圍第6項所述之移位暫存電路，其中該參考訊號為該前一級移位暫存器所輸出之該前一個啟動脈衝訊號。
  10. 如申請專利範圍第1項所述之移位暫存電路，其中該第一驅動電路包括：一第五電晶體，其包括：一第五控制端，電性耦接該第一節點；一第九通路端，用以接收該對應之時脈訊號；以及一第十通路端，用以輸出該對應之啟動脈衝訊號；以及一電容，電性耦接於該第一節點與該第十通路端之間。
  11. 如申請專利範圍第1項所述之移位暫存電路，其中該第二驅動電路包括一第六電晶體，其包括：一第六控制端，電性耦接該第一節點；一第十一通路端，用以接收該高參考電位；以及一第十二通路端，用以輸出該對應之驅動脈衝訊號。
  12. 如申請專利範圍第1項所述之移位暫存電路，其中每一級該些移位暫存器進一步包括：一第一穩壓電路，分別電性耦接該第一節點及該第二驅動電路的該輸出端；一第一穩壓控制電路，電性耦接該第一穩壓電路且接收至少一控制訊號的控制以決定該第一穩壓電路是否對該第一節點及該第二驅動電路的輸出端進行放電。
  13. 如申請專利範圍第12項所述之移位暫存電路，其中該第一穩壓電路包括：一第七電晶體，其包括：一第七控制端，電性耦接該第一穩壓控制電路的一輸出端；一第十三通路端，用於接收該對應之驅動脈衝訊號；以及一第十四通路端，電性耦接該第一節點；以及一第八電晶體，其包括：一第八控制端，電性耦接該第一穩壓控制電路的該輸出端；一第十五通路端，電性耦接該低參考電位；以及一第十六通路端，電性耦接該第二驅動電路的該輸出端。
  14. 如申請專利範圍第13項所述之移位暫存電路，其中該第一穩壓控制電路包括：一第九電晶體，其包括：一第九控制端，電性耦接一參考電位；一第十七通路端，亦電性耦接該參考電位；以及一第十八通路端；一第十電晶體，其包括：一第十控制端，用於接收一第三控制訊號；一第十九通路端，電性耦接該第十八通路端且其連接處作為一第二節點；以及一第二十通路端，電性耦接該低參考電位；一第十一電晶體，其包括：一第十一控制端，電性耦接該第二節點；一第二十一通路端，電性耦接該參考電位；以及一第二十二通路端；以及一第十二電晶體，其包括：一第十二控制端，亦用於接收該第三控制訊號；一第二十三通路端，電性耦接該低參考電位；以及一第二十四通路端，電性耦接該第二十二通路端且其耦接處作為該第一穩壓控制電路的該輸出端。
  15. 如申請專利範圍第14項所述之移位暫存電路，其中該第三控制訊號為該對應之驅動脈衝訊號。
  16. 如申請專利範圍第15項所述之移位暫存電路，其中該第一穩壓控制電路進一步包括：一第十三電晶體，其包括：一第十三控制端，用於接收一第四控制訊號；一第二十五通路端，電性耦接該第二節點；以及一第二十六通路端，電性耦接該低參考電位；以及一第十四電晶體，其包括：一第十四控制端，亦用於接收該第四控制訊號；一第二十七通路端，電性耦接該低參考電位；以及一第二十八通路端，電性耦接該第一穩壓控制電路的該輸出端。
  17. 如申請專利範圍第16項所述之移位暫存電路，其中該第四控制訊號為前一級移位暫存器所輸出之前一個驅動脈衝訊號。
  18. 如申請專利範圍第16項所述之移位暫存電路，其中該第四控制訊號為該對應之啟動脈衝訊號。
  19. 如申請專利範圍第14項所述之移位暫存電路，其中該第三控制訊號為該第一節點上的電位。
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