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CN104851402B - 一种多相位时钟产生电路及液晶显示面板 - Google Patents

一种多相位时钟产生电路及液晶显示面板 Download PDF

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CN104851402B CN201510280398.3A CN201510280398A CN104851402B CN 104851402 B CN104851402 B CN 104851402B CN 201510280398 A CN201510280398 A CN 201510280398A CN 104851402 B CN104851402 B CN 104851402B
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Abstract

本发明提供一种多相位时钟产生电路及液晶显示面板，所述电路包括：移位寄存器，包括N个相互级联的移位寄存单元；第一输入端输入起始控制信号；第二输入端输入延迟控制信号，第n级移位寄存单元的第一输出端与第n+1级移位寄存单元的第一输入端连接，其中N≥2，1≤n<N；薄膜晶体管组，包括N个薄膜晶体管；所述薄膜晶体管与所述移位寄存单元一一对应；该薄膜晶体管具有第三输入端、控制端、第二输出端；第三输入端输入主时钟信号；第二输出端输出子时钟信号，其中第n级薄膜晶体管的控制端分别与(N‑n+1)个移位寄存单元的第一输出端连接。本发明的多相位时钟产生电路及液晶显示面板，能够减少电路的管脚数，从而降低了生产成本。

Description

一种多相位时钟产生电路及液晶显示面板
技术领域
本发明涉及显示器领域，特别是涉及一种多相位时钟产生电路及液晶显示面板。
背景技术
液晶电视因具有体积小，重量小，功耗小，解析度高的特点而被广泛应用。
液晶面板驱动电路一般包括时序控制器芯片，行扫描驱动芯片等。液晶面板将行扫描驱动芯片做在液晶面板侧来达到节省资源的目的，但是为了达到更好的视觉效果，常需要行扫描驱动芯片提供多路时钟信号，这些时钟信号相互之间有一定的相位差。如图1所示，现有的时序控制器芯片与多相位时钟产生电路的连接示意图，由于时序控制器芯片10向多相位时钟产生电路11输入多路时钟信号CLK1-CLKn，多相位时钟产生电路11再将多路时钟信号CLK1-CLKn输出给行扫描驱动芯片12，由于需要输出多路时钟信号，从而增加了时序控制芯片10和行扫描驱动芯片12的引脚，同时增加了驱动电路的成本。
因此，有必要提供一种多相位时钟产生电路及液晶显示面板，以解决现有技术所存在的问题。
发明内容
本发明的目的在于提供一种多相位时钟产生电路及液晶显示面板，以解决现有技术中时序控制芯片需要具有多路时钟信号对应的输出管脚的技术问题，增加了生产成本。
为解决上述技术问题，本发明构造了一种多相位时钟产生电路，其包括：
移位寄存器，包括N个移位寄存单元，所述N个移位寄存单元相互级联；每个所述移位寄存单元具有第一输入端、第二输入端以及第一输出端，所述第一输入端输入起始控制信号，所述起始控制信号用于控制所述移位寄存器开启；所述第二输入端输入延迟控制信号，所述延迟控制信号用于控制所述移位寄存单元输出，第n级所述移位寄存单元的第一输出端与第n+1级所述移位寄存单元的第一输入端连接，其中N≥2，1≤n<N；以及
薄膜晶体管组，包括N个薄膜晶体管，所述薄膜晶体管与所述移位寄存单元一一对应；每个所述薄膜晶体管具有第三输入端、控制端、第二输出端；每个所述薄膜晶体管的第三输入端输入主时钟信号，所述主时钟信号用于提供参考时钟；每个所述薄膜晶体管的第二输出端输出子时钟信号，所述子时钟信号用于输入到显示面板的行扫描驱动芯片中；其中第n级所述薄膜晶体管的控制端分别与(N-n+1)个所述移位寄存单元的第一输出端连接。
在本发明的所述多相位时钟产生电路中，所述多相位时钟产生电路还包括第一二极管组，所述第一二极管组包括N个第一二极管，所述第一二极管与所述移位寄存单元一一对应；
所述第一二极管的阳极连接所述移位寄存单元的第一输出端，所述第一二极管的阴极连接所述薄膜晶体管的控制端。
在本发明的所述多相位时钟产生电路中，所述多相位时钟产生电路还包括第二二极管组，所述第二二极管组包括N-1个第二二极管，每相邻两级的所述移位寄存单元通过一所述第二二极管连接；
第n个所述第二二极管的阴极连接第n级所述移位寄存单元的第一二极管的阴极，第n个所述第二二极管的阳极连接第n+1级所述移位寄存单元的第一二极管的阴极。
在本发明的所述多相位时钟产生电路中，根据所述延迟控制信号的周期确定第n路子时钟信号和第n+1路子时钟信号之间的相位差。
在本发明的所述多相位时钟产生电路中，根据所述起始控制信号的高电平的输出时间确定多路所述子时钟信号的输出时间。
在本发明的所述多相位时钟产生电路中，第N级所述移位寄存单元的第一输出端通过第三二极管与第1级所述移位寄存单元的第一输入端连接，所述第三二极管的阳极连接所述第N级所述移位寄存单元的第一输出端；所述第三二极管的阴极连接所述第1级所述移位寄存单元的第一输入端。
本发明还提供一种液晶显示面板，其包括：
多条数据线和多条扫描线以及由所述数据线和所述扫描线限定的多个像素单元；以及
行扫描驱动芯片，所述行扫描驱动芯片用于向所述扫描线提供扫描信号；所述扫描信号根据多相位时钟产生电路的多路子时钟信号产生；
其中所述多相位时钟产生电路，包括：
移位寄存器，包括N个移位寄存单元，所述N个移位寄存单元相互级联；每个所述移位寄存单元具有第一输入端、第二输入端以及第一输出端，所述第一输入端输入起始控制信号，所述起始控制信号用于控制所述移位寄存器开启；所述第二输入端输入延迟控制信号，所述延迟控制信号用于控制所述移位寄存单元输出，第n级所述移位寄存单元的第一输出端与第n+1级所述移位寄存单元的第一输入端连接，其中N≥2，1≤n<N；以及
薄膜晶体管组，包括N个薄膜晶体管，所述薄膜晶体管与所述移位寄存单元一一对应；每个所述薄膜晶体管具有第三输入端、控制端、第二输出端；每个所述薄膜晶体管的第三输入端输入主时钟信号，所述主时钟信号用于提供参考时钟；每个所述薄膜晶体管的第二输出端输出子时钟信号，所述子时钟信号用于输入到显示面板的行扫描驱动芯片中；其中第n级所述薄膜晶体管的控制端分别与(N-n+1)个所述移位寄存单元的第一输出端连接。
在本发明的所述液晶显示面板中，所述多相位时钟产生电路还包括第一二极管组，所述第一二极管组包括N个第一二极管，所述第一二极管与所述移位寄存单元一一对应；
所述第一二极管的阳极连接所述移位寄存单元的第一输出端，所述第一二极管的阴极连接所述薄膜晶体管的控制端。
在本发明的所述液晶显示面板中，所述多相位时钟产生电路还包括第二二极管组，所述第二二极管组包括N-1个第二二极管，每相邻两级的所述移位寄存单元通过一所述第二二极管连接；
第n个所述第二二极管的阴极连接第n级所述移位寄存单元的第一二极管的阴极，第n个所述第二二极管的阳极连接第n+1级所述移位寄存单元的第一二极管的阴极。
在本发明的所述液晶显示面板中，根据所述延迟控制信号的周期确定第n路子时钟信号和第n+1路子时钟信号之间的相位差。
在本发明的所述液晶显示面板中，根据所述起始控制信号的高电平的输出时间确定多路所述子时钟信号的输出时间。
本发明的多相位时钟产生电路及液晶显示面板，通过对现有技术的时钟产生电路进行改进，使得只需要输入一路时钟信号就可以产生具有相位偏移的多路时钟，减少了时序控制芯片的管脚数，从而降低了生产成本。
为让本发明的上述内容能更明显易懂，下文特举优选实施例，并配合所附图式，作详细说明如下：
附图说明
图1为现有的时序控制器芯片与多相位时钟产生电路的连接示意图；
图2为本发明多相位时钟产生电路的结构示意图；
图3为本发明多相位时钟产生电路的控制信号的时序图；
图4本发明的时序控制器芯片与多相位时钟产生电路的连接示意图。
具体实施方式
以下各实施例的说明是参考附加的图式，用以例示本发明可用以实施的特定实施例。本发明所提到的方向用语，例如「上」、「下」、「前」、「后」、「左」、「右」、「内」、「外」、「侧面」等，仅是参考附加图式的方向。因此，使用的方向用语是用以说明及理解本发明，而非用以限制本发明。
在图中，结构相似的单元是以相同标号表示。
请参照图2，图2为本发明多相位时钟产生电路的结构示意图。
本发明的多相位时钟产生电路，如图1所示，其输入信号包括：延迟控制信号CP、起始控制信号ST、一主时钟信号CLK；所述多相位时钟产生电路包括：移位寄存器13和薄膜晶体管组T0-Tn；
所述移位寄存器13包括N个移位寄存单元14，所述N个移位寄存单元相互级联(不限定级联的顺序)，其中N≥2，所述移位寄存单元14譬如为触发器FF0-FFn；每个所述移位寄存单元具有第一输入端、第二输入端以及第一输出端，每个所述移位寄存单元的所述第一输入端输入起始控制信号，所述起始控制信号用于控制所述移位寄存器开启；每个所述移位寄存单元的所述第二输入端输入延迟控制信号，所述延迟控制信号用于控制所述移位寄存单元输出，第n级所述移位寄存单元的第一输出端与第n+1级所述移位寄存单元的第一输入端连接；所述移位寄存单元譬如为触发器，其中N≥2，1≤n<N。
薄膜晶体管组包括N个薄膜晶体管T0-Tn，所述薄膜晶体管与所述移位寄存单元一一对应，即每个移位寄存单元连接一个薄膜晶体管；每个所述薄膜晶体管具有第三输入端、控制端、第二输出端；每个所述薄膜晶体管的第三输入端输入主时钟信号CLK，所述主时钟信号CLK用于提供参考时钟；每个所述薄膜晶体管的第二输出端输出子时钟信号，所述子时钟信号用于输入到显示面板的行扫描驱动芯片中；其中第n级所述薄膜晶体管的控制端分别与(N-n+1)个所述移位寄存单元的第一输出端连接。
譬如第1级所述移位寄存单元FF0具有第一输入端22、第二输入端21以及第一输出端23，所述第一输入端22输入所述起始控制信号ST，所述第二输入端21输入延迟控制信号CP，第1级所述移位寄存单元FF0的第一输出端23连接第2级触发器FF1的第一输入端25；且所述第一输出端23还连接有薄膜晶体管T0；所述薄膜晶体管T0的第三输入端连接所述主时钟信号CLK，所述薄膜晶体管T0的第二输出端输出第1路子时钟信号CLK1；所述薄膜晶体管T0的控制端分别与所述移位寄存单元FF0-FFn的第一输出端连接。
所述第二级移位寄存单元FF1具有第一输入端25、第二输入端24、第一输出端26，所述第一输入端25连接所述第一级移位寄存单元FF0的第一输出端23；所述第二输入端24连接所述延迟控制信号CP；所述第一输出端26连接有薄膜晶体管T1，所述第一输出端26还连接第三级移位寄存单元FF2的第一输入端；所述薄膜晶体管T1的第三输入端连接所述主时钟信号CLK，所述薄膜晶体管T1的第二输出端输出第2路子时钟信号CLK2；所述薄膜晶体管T1的控制端分别与所述移位寄存单元FF1-FFn的第一输出端连接。
所述第三级移位寄存单元FF2的所述第一输出端连接有薄膜晶体管T2，所述薄膜晶体管T2的第二输出端输出第3路子时钟信号CLK3；所述第四级移位寄存单元FF3的所述第一输出端连接有薄膜晶体管T3，所述薄膜晶体管T3的第二输出端输出第4路子时钟信号CLK4；所述第n级移位寄存单元FFn-1的所述第一输出端连接有薄膜晶体管Tn-1，所述薄膜晶体管Tn-1的第二输出端输出第n路子时钟信号CLK(n)；所述第n+1级移位寄存单元FFn的所述第一输出端连接有薄膜晶体管Tn，所述薄膜晶体管Tn的第二输出端输出第n+1路子时钟信号CLK(n+1)；其余触发器与此类似。
当起始控制信号为高电平，且当延迟控制信号每到来一个上升沿时，对应一级移位寄存单元输出，因此通过延迟控制信号的控制作用，使得多级移位寄存单元产生具有相位差的多路子时钟信号，本发明的多相位时钟产生电路只需要输入一路时钟信号，就能得到多路时钟信号，从而减少了时序控制芯片的输出管脚数以及多相位时钟产生电路的输入管脚数，降低了生产成本。
优选地，所述多相位时钟产生电路还包括第一二极管组，所述第一二极管组包括N个第一二极管，如图2中的31-36所示，所述第一二极管与所述移位寄存单元一一对应；所述第一二极管的阳极连接相应的所述移位寄存单元的第一输出端，所述第一二极管的阴极连接相应的所述薄膜晶体管的控制端。
譬如所述薄膜晶体管T0的控制端与第1级所述移位寄存单元FF0的第一输出端23之间设置有一二极管31，所述第一二级管31的阳极连接所述第1级所述移位寄存单元的第一输出端23，所述第一二极管31的阴极连接所述薄膜晶体管T0的控制端。
所述多相位时钟产生电路还包括第二二极管组，所述第二二极管组包括N-1个第二二极管，每相邻两级的所述移位寄存单元通过一所述第二二极管连接；第n个所述第二二极管的阴极连接第n级所述移位寄存单元的第一二极管的阴极，第n个所述第二二极管的阳极连接第n+1级所述移位寄存单元的第一二极管的阴极。
第1级所述移位寄存单元FF0的第一二极管31的阴极和第2级所述移位寄存单元FF1的第一二极管32的阴极之间设置有一第二二极管41，所述第二二极管41的阴极连接第1级所述移位寄存单元FF0的第一二极管31的阴极，所述第二二极管41的阳极连接第2级所述移位寄存单元FF1的第一二极管32的阴极。第2级所述移位寄存单元FF1的第一二极管32的阴极和第3级所述移位寄存单元FF2的第一二极管33的阴极之间设置有一第二二极管42；第n-1级所述移位寄存单元FF(n-2)的第一二极管34的阴极和第n级所述移位寄存单元FF(n-1)的第一二极管35的阴极之间设置有一第二二极管44；第n级所述移位寄存单元FF(n-1)的第一二极管35的阴极和第n+1级所述移位寄存单元FF(n)的第一二极管36的阴极之间设置有一第二二极管45。其余的二极管与此类似。
通过设置第二二极管，能够在后面一级移位寄存单元触发时，将其输出的信号通过第二二极管传递给上一级移位寄存单元或者上面多级移位寄存单元对应的薄膜晶体管的控制端，从而减少ST的高电平输出时间，降低能耗；其第二二极管的连接方式，使得在上一级移位寄存单元触发时，防止上一级移位寄存单元输出的信号直接流向其后的移位寄存单元对应的薄膜晶体管的控制端中，避免T0-Tn同时输出子时钟信号，导致不能使得子时钟信号产生延迟。同时第一二级管能够防止，后面一级移位寄存单元将其输出信号传递给上面一级或者多级移位寄存单元对应的薄膜晶体管的控制端时，该信号流向前面的多级移位寄存单元的第一输出端。
譬如以第3级移位寄存单元为例，第二个第二二极管42能够防止，移位寄存单元FF2输出端的信号流向移位寄存单元FF3—FFn对应薄膜晶体管的控制端，避免CLK3-CLKn同时输出，第3级移位寄存单元的第一二极管33，能够防止移位寄存单元FF2输出端的信号流向移位寄存单元FF1—FF2的第一输出端。
优选地，第N级所述移位寄存单元的第一输出端通过第三二极管与第1级所述移位寄存单元的第一输入端连接，所述第三二极管的阳极连接所述第N级所述移位寄存单元的第一输出端；所述第三二极管的阴极连接所述第1级所述移位寄存单元的第一输入端。
譬如最后一级移位寄存器FFn的第一输出端46还连接至所述第1级所述移位寄存单元FF0的第一输入端22，所述第三二极管47的阳极连接最后一级移位寄存器FFn的第一输出端46，所述第三二极管47的阴极连接至所述第1级所述移位寄存单元FF0的第一输入端22。
通过将最后一级移位寄存单元的输出信号传递给第一级移位寄存单元的第一输入端，能够使得多相位时钟产生的多路子时钟信号的输出时间延长。
如图4所示，时序控制器芯片50仅需要输出3个信号给多相位时钟产生电路51、多相位时钟产生电路51就能产生多路子时钟信号CLK1-CLKn给行扫描驱动芯片52，减少了时序控制器芯片50和多相位时钟产生电路51的管脚数目，而现有的多相位时钟产生电路需要输入多路时钟信号，生产成本较高，对比看出，本发明的多相位时钟产生电路只需要输入一个时钟信号，通过延迟控制信号的控制，就可以形成多个相位时钟，减少了相应芯片的管脚，因为可以降低生产成本。
本发明的多相位时钟产生电路的工作原理为：如图3所示，
当ST为高电平时，且CP信号为上升沿时，使得FF0触发，FF0输出一个高脉冲，薄膜晶体管T0闭合，使得CLK信号通过T0的输出端输出CLK1；当CP信号的第二个上升沿到来时，使得FF1触发，FF0将ST的信号传递给FF1。
譬如ST为高电平，且在时间为t1时，CP信号第一个上升沿到来，使得FF0触发，FF0输出一个高脉冲，薄膜晶体管T0闭合，使得CLK信号通过T0的输出端输出CLK1；
在时间为t2时，CP信号第二个上升沿到来，使得FF1触发，FF1输出一个高脉冲，薄膜晶体管T1闭合，由于薄膜晶体管T0的控制端连接FF1的输出端，因此也会使得薄膜晶体管T0闭合，使得CLK信号通过T0的输出端输出CLK1以及通过T1的输出端输出CLK2；
在时间为t3时，CP信号第三个上升沿到来，使得FF2触发，FF2输出一个高脉冲，薄膜晶体管T2闭合；由于薄膜晶体管T1、T0的控制端连接FF2的输出端，因此也会使得薄膜晶体管T1、T0闭合；使得CLK信号通过T0的输出端输出CLK1、通过T1的输出端输出CLK2、以及通过T2的输出端输出CLK3；
在时间为t4时，CP信号第四个上升沿到来，使得FF3触发，FF3输出一个高脉冲，薄膜晶体管T3闭合，由于薄膜晶体管T2、T0、T1的控制端连接FF3的输出端，因此也会使得薄膜晶体管T2、T0、T1闭合；使得CLK信号通过T0的输出端输出CLK1、通过T1的输出端输出CLK2、通过T2的输出端输出CLK3、通过T3的输出端输出CLK4；
在时间为tn+1时，CP信号第n个上升沿到来，使得FFn触发，FFn输出一个高脉冲，薄膜晶体管Tn闭合，由于薄膜晶体管Tn-1、以及Tn-2至T0的控制端连接FFn的输出端，因此也会使得薄膜晶体管Tn-1至T0闭合；使得CLK信号通过T0—Tn的输出端输出CLK1—CLKn+1。
优选地，根据所述延迟控制信号的周期确定第n路子时钟信号和第n+1路子时钟信号之间的时相位差。即CLK1，CLK2…CLKn依次输出CLK信号，相互之间的相位差可以通过CP信号的周期控制，且当CP的周期越大，时钟信号之间对应的相位差也越大。譬如图2，CLK1和CLK2之间的相位差等于所述CP的周期t2-t1。
优选地，根据所述起始控制信号的高电平的输出时间确定多路所述子时钟信号的输出时间。可以通过ST信号的高电平的输出时间来控制CLK信号被各通道输出的时间(即何时输出CLK1—CLKn)，ST信号的占空比越大，CLK被各通道输出的时间也越长。
根据D触发器的原理，当ST信号的上升沿到来之后，CP信号的上升沿时，D触发器的输出端输出高电平，直至ST为低，且CP的下一个上升沿，D触发器的输出端输出低电平，使得薄膜晶体管断开不再输出相应的子时钟信号。所以ST信号的高电平输出的时间越长，D触发器的输出端输出的高电平亦越久。因此ST信号的占空比越大，D触发器的输出端输出的高电平亦越久，CLK被各通道输出的时间也越长。
本发明的多相位时钟产生电路，通过对现有技术的时钟产生电路进行改进，使得只需要输入一路时钟信号就可以产生具有相位偏移的多路时钟，减少了时序控制芯片和电源管理芯片的管脚数，从而降低了生产成本。
本发明还提供一种液晶显示面板，其包括多条数据线和多条扫描线以及由所述数据线和所述扫描线限定的多个像素单元；以及
行扫描驱动芯片，所述行扫描驱动芯片用于向所述扫描线提供扫描信号；所述扫描信号根据多相位时钟产生电路的多路子时钟信号产生；
其中所述多相位时钟产生电路，包括：
移位寄存器，包括N个移位寄存单元，所述N个移位寄存单元相互级联；每个所述移位寄存单元具有第一输入端、第二输入端以及第一输出端，所述第一输入端输入起始控制信号，所述起始控制信号用于控制所述移位寄存器开启；所述第二输入端输入延迟控制信号，所述延迟控制信号用于控制所述移位寄存单元输出，第n级所述移位寄存单元的第一输出端与第n+1级所述移位寄存单元的第一输入端连接，其中N≥2，1≤n<N；以及
薄膜晶体管组，包括N个薄膜晶体管，所述薄膜晶体管与所述移位寄存单元一一对应；每个所述薄膜晶体管具有第三输入端、控制端、第二输出端；每个所述薄膜晶体管的第三输入端输入主时钟信号，所述主时钟信号用于提供参考时钟；每个所述薄膜晶体管的第二输出端输出子时钟信号，所述子时钟信号用于输入到显示面板的行扫描驱动芯片中；其中第n级所述薄膜晶体管的控制端分别与(N-n+1)个所述移位寄存单元的第一输出端连接。
优选地，所述多相位时钟产生电路还包括第一二极管组，所述第一二极管组包括N个第一二极管，所述第一二极管与所述移位寄存单元一一对应；
所述第一二极管的阳极连接所述移位寄存单元的第一输出端，所述第一二极管的阴极连接所述薄膜晶体管的控制端。
优选地，所述多相位时钟产生电路还包括第二二极管组，所述第二二极管组包括N-1个第二二极管，每相邻两级的所述移位寄存单元通过一所述第二二极管连接；
第n个所述第二二极管的阴极连接第n级所述移位寄存单元的第一二极管的阴极，第n个所述第二二极管的阳极连接第n+1级所述移位寄存单元的第一二极管的阴极。
优选地，根据所述延迟控制信号的周期确定所述第n路子时钟信号和第n+1路子时钟信号之间的相位差。
优选地，根据所述起始控制信号的高电平的输出时间确定多路所述子时钟信号的输出时间。
优选地，第N级所述移位寄存单元的第一输出端通过第三二极管与第1级所述移位寄存单元的第一输入端连接，所述第三二极管的阳极连接所述第N级所述移位寄存单元的第一输出端；所述第三二极管的阴极连接所述第1级所述移位寄存单元的第一输入端。
本发明的液晶显示面板可包括上述任何一种多相位时钟产生电路，鉴于多相位时钟产生电路在上文已有详细的描述，此处不再赘述。
本发明的多相位时钟产生电路及液晶显示面板，通过对现有技术的时钟产生电路进行改进，使得只需要输入一路时钟信号就可以产生具有相位偏移的多路时钟，减少了时序控制芯片和电源管理芯片的管脚数，从而降低了生产成本。
综上所述，虽然本发明已以优选实施例揭露如上，但上述优选实施例并非用以限制本发明，本领域的普通技术人员，在不脱离本发明的精神和范围内，均可作各种更动与润饰，因此本发明的保护范围以权利要求界定的范围为准。

Claims (10)

1.一种多相位时钟产生电路，其特征在于，包括：
移位寄存器，包括N个移位寄存单元，所述N个移位寄存单元相互级联；每个所述移位寄存单元具有第一输入端、第二输入端以及第一输出端，所述第一输入端输入起始控制信号，所述起始控制信号用于控制所述移位寄存器开启；所述第二输入端输入延迟控制信号，所述延迟控制信号用于控制所述移位寄存单元输出，第n级所述移位寄存单元的第一输出端与第n+1级所述移位寄存单元的第一输入端连接，其中N≥2，1≤n<N；以及
薄膜晶体管组，包括N个薄膜晶体管，所述薄膜晶体管与所述移位寄存单元一一对应；每个所述薄膜晶体管具有第三输入端、控制端、第二输出端；每个所述薄膜晶体管的第三输入端输入主时钟信号，所述主时钟信号用于提供参考时钟；每个所述薄膜晶体管的第二输出端输出子时钟信号，所述子时钟信号用于输入到显示面板的行扫描驱动芯片中；其中第n级所述薄膜晶体管的控制端分别与(N-n+1)个所述移位寄存单元的第一输出端连接。
2.根据权利要求1所述的多相位时钟产生电路，其特征在于，所述多相位时钟产生电路还包括第一二极管组，所述第一二极管组包括N个第一二极管，所述第一二极管与所述移位寄存单元一一对应；
所述第一二极管的阳极连接所述移位寄存单元的第一输出端，所述第一二极管的阴极连接所述薄膜晶体管的控制端。
3.根据权利要求2所述的多相位时钟产生电路，其特征在于，所述多相位时钟产生电路还包括第二二极管组，所述第二二极管组包括N-1个第二二极管，每相邻两级的所述移位寄存单元通过一所述第二二极管连接；
第n个所述第二二极管的阴极连接第n级所述移位寄存单元的第一二极管的阴极，第n个所述第二二极管的阳极连接第n+1级所述移位寄存单元的第一二极管的阴极。
4.根据权利要求1所述的多相位时钟产生电路，其特征在于，根据所述延迟控制信号的周期确定第n路子时钟信号和第n+1路子时钟信号之间的相位差。
5.根据权利要求1所述的多相位时钟产生电路，其特征在于，根据所述起始控制信号的高电平的输出时间确定多路所述子时钟信号的输出时间。
6.根据权利要求1所述的多相位时钟产生电路，其特征在于，
第N级所述移位寄存单元的第一输出端通过第三二极管与第1级所述移位寄存单元的第一输入端连接，所述第三二极管的阳极连接所述第N级所述移位寄存单元的第一输出端；所述第三二极管的阴极连接所述第1级所述移位寄存单元的第一输入端。
7.一种液晶显示面板，其特征在于，包括：
多条数据线和多条扫描线以及由所述数据线和所述扫描线限定的多个像素单元；以及
行扫描驱动芯片，用于向所述扫描线提供扫描信号；所述扫描信号根据多相位时钟产生电路的多路子时钟信号产生；
其中所述多相位时钟产生电路，包括：
移位寄存器，包括N个移位寄存单元，所述N个移位寄存单元相互级联；每个所述移位寄存单元具有第一输入端、第二输入端以及第一输出端，所述第一输入端输入起始控制信号，所述起始控制信号用于控制所述移位寄存器开启；所述第二输入端输入延迟控制信号，所述延迟控制信号用于控制所述移位寄存单元输出，第n级所述移位寄存单元的第一输出端与第n+1级所述移位寄存单元的第一输入端连接，其中N≥2，1≤n<N；以及
薄膜晶体管组，包括N个薄膜晶体管，所述薄膜晶体管与所述移位寄存单元一一对应；每个所述薄膜晶体管具有第三输入端、控制端、第二输出端；每个所述薄膜晶体管的第三输入端输入主时钟信号，所述主时钟信号用于提供参考时钟；每个所述薄膜晶体管的第二输出端输出子时钟信号，所述子时钟信号用于输入到显示面板的行扫描驱动芯片中；其中第n级所述薄膜晶体管的控制端分别与(N-n+1)个所述移位寄存单元的第一输出端连接。
8.根据权利要求7所述的液晶显示面板，其特征在于，所述多相位时钟产生电路还包括第一二极管组，所述第一二极管组包括N个第一二极管，所述第一二极管与所述移位寄存单元一一对应；
所述第一二极管的阳极连接所述移位寄存单元的第一输出端，所述第一二极管的阴极连接所述薄膜晶体管的控制端。
9.根据权利要求8所述的液晶显示面板，其特征在于，所述多相位时钟产生电路还包括第二二极管组，所述第二二极管组包括N-1个第二二极管，每相邻两级的所述移位寄存单元通过一所述第二二极管连接；
第n个所述第二二极管的阴极连接第n级所述移位寄存单元的第一二极管的阴极，第n个所述第二二极管的阳极连接第n+1级所述移位寄存单元的第一二极管的阴极。
10.根据权利要求7所述的液晶显示面板，其特征在于，根据所述延迟控制信号的周期确定第n路子时钟信号和第n+1路子时钟信号之间的相位差。
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